[go: up one dir, main page]

JP2010206161A - 成膜方法および半導体装置の製造方法 - Google Patents

成膜方法および半導体装置の製造方法 Download PDF

Info

Publication number
JP2010206161A
JP2010206161A JP2009216362A JP2009216362A JP2010206161A JP 2010206161 A JP2010206161 A JP 2010206161A JP 2009216362 A JP2009216362 A JP 2009216362A JP 2009216362 A JP2009216362 A JP 2009216362A JP 2010206161 A JP2010206161 A JP 2010206161A
Authority
JP
Japan
Prior art keywords
film
heat treatment
silicon
silicon oxide
forming
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2009216362A
Other languages
English (en)
Inventor
Hirotaka Akao
裕隆 赤尾
Yuriko Kaino
由利子 貝野
Kenichi Kurihara
研一 栗原
Masateru Hara
昌輝 原
Takahiro Kamei
隆広 亀井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP2009216362A priority Critical patent/JP2010206161A/ja
Priority to US12/694,342 priority patent/US8394728B2/en
Priority to CN2010101055982A priority patent/CN101800176B/zh
Publication of JP2010206161A publication Critical patent/JP2010206161A/ja
Pending legal-status Critical Current

Links

Images

Classifications

    • H10D64/0135
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C18/00Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating
    • C23C18/02Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition
    • C23C18/12Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material
    • C23C18/1204Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material inorganic material, e.g. non-oxide and non-metallic such as sulfides, nitrides based compounds
    • C23C18/1208Oxides, e.g. ceramics
    • C23C18/1212Zeolites, glasses
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C18/00Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating
    • C23C18/02Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition
    • C23C18/12Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material
    • C23C18/1204Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material inorganic material, e.g. non-oxide and non-metallic such as sulfides, nitrides based compounds
    • C23C18/122Inorganic polymers, e.g. silanes, polysilazanes, polysiloxanes
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C18/00Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating
    • C23C18/02Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition
    • C23C18/12Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material
    • C23C18/1225Deposition of multilayers of inorganic material
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C18/00Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating
    • C23C18/02Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition
    • C23C18/12Chemical coating by decomposition of either liquid compounds or solutions of the coating forming compounds, without leaving reaction products of surface material in the coating; Contact plating by thermal decomposition characterised by the deposition of inorganic material other than metallic material
    • C23C18/125Process of deposition of the inorganic material
    • C23C18/1295Process of deposition of the inorganic material with after-treatment of the deposited inorganic material
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D30/00Field-effect transistors [FET]
    • H10D30/01Manufacture or treatment
    • H10D30/021Manufacture or treatment of FETs having insulated gates [IGFET]
    • H10D30/031Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT]
    • H10D30/0321Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT] comprising silicon, e.g. amorphous silicon or polysilicon
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D86/00Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates
    • H10D86/01Manufacture or treatment
    • H10D86/021Manufacture or treatment of multiple TFTs
    • H10D86/0221Manufacture or treatment of multiple TFTs comprising manufacture, treatment or patterning of TFT semiconductor bodies
    • H10D86/0223Manufacture or treatment of multiple TFTs comprising manufacture, treatment or patterning of TFT semiconductor bodies comprising crystallisation of amorphous, microcrystalline or polycrystalline semiconductor materials
    • H10D86/0229Manufacture or treatment of multiple TFTs comprising manufacture, treatment or patterning of TFT semiconductor bodies comprising crystallisation of amorphous, microcrystalline or polycrystalline semiconductor materials characterised by control of the annealing or irradiation parameters
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D86/00Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates
    • H10D86/01Manufacture or treatment
    • H10D86/021Manufacture or treatment of multiple TFTs
    • H10D86/0241Manufacture or treatment of multiple TFTs using liquid deposition, e.g. printing
    • H10P14/265
    • H10P14/3411
    • H10P14/38
    • H10P14/6322
    • H10P14/69215
    • H10D64/01346

Landscapes

  • Chemical & Material Sciences (AREA)
  • Engineering & Computer Science (AREA)
  • Thermal Sciences (AREA)
  • Physics & Mathematics (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Inorganic Chemistry (AREA)
  • Materials Engineering (AREA)
  • Mechanical Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Ceramic Engineering (AREA)
  • Formation Of Insulating Films (AREA)
  • Liquid Deposition Of Substances Of Which Semiconductor Devices Are Composed (AREA)
  • Thin Film Transistor (AREA)

Abstract

【課題】本発明は、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない酸化シリコン膜の成膜を実現することを可能にする。
【解決手段】基板11上にポリシラン化合物を含有する溶液を塗布して塗布膜12を形成した後に、不活性雰囲気中で第1熱処理を行って、前記塗布膜12をシリコン膜13に形成する工程と、前記シリコン膜13上にポリシラン化合物を含有する塗布膜14を形成した後に、不活性雰囲気中で第2熱処理を行って、前記塗布膜14を酸化シリコン前駆体膜15に形成する工程と、酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜15を酸化シリコン膜16に形成するとともに、前記シリコン膜13を緻密化する工程とを有する。
【選択図】図1

Description

本発明は、成膜方法および半導体装置の製造方法に関するものである。
酸化シリコン膜は、電界効果トランジスタ等の半導体デバイスを作製する際に絶縁膜や誘電体膜、表面保護膜として使用されている。
このような酸化シリコン膜を形成する方法として、熱酸化法、化学気相成長法(CVD法)やスパッタリング法に等による気相プロセスによる形成が行われてきた。
一方、液相プロセスではアルコキシシラン類の加水分解などによる成膜や、ポリシラザンの酸化などによる形成方法がある。
例えば、ポリシラン化合物を含有する塗膜を形成し、その塗布膜を酸化処理して酸化シリコン膜を形成する方法が開示されている(例えば、特許文献1参照。)。
しかしながら上記方法は、気相プロセスでは高価な真空装置や危険性のあるガス原料を用いる必要がある方法であり、かつ高温やプラズマなどの使用によりエネルギー消費が大きい方法でもある。
また、膜を形成する基板の大きさの制約や均一性などの問題もある。
さらに、液層プロセスでは膜の緻密化などの問題も残っている。
また、熱酸化法では、数nmの絶縁膜厚を制御よく形成でき、かつ欠陥密度も1010cm-2eV-1と低い。しかし、1000℃程度のプロセスを有するため基板材料としてガラス、または有機材料(樹脂、例えばポリカーボネート、ポリエチレン、ポリイミドなど)を用いることができない。
また、CVD法やスパッタリング法ではプロセス温度は、熱酸化膜を形成する方法よりも低い。しかし、欠陥密度が1012cm-2eV-1と高く、数nmの絶縁膜厚を制御よく形成することは困難である。
さらに、層間絶縁膜で用いられているポリシラザンなどを用いた絶縁膜では200℃〜500℃程度の低温プロセスが可能であるが、欠陥密度が非常に大きい。
特開2002−246384号公報
解決しようとする問題点は、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない酸化シリコン膜の成膜を実現するのが困難な点である。
本発明は、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない酸化シリコン膜の成膜を実現することを可能にする。
本発明の成膜方法は、基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成する工程と、前記シリコン膜上にポリシラン化合物を含有する塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜を酸化シリコン膜に形成するとともに、前記シリコン膜を緻密化する工程とを有する。
本発明の成膜方法では、不活性雰囲気および還元性雰囲気で成膜が実現されるので、真空雰囲気での成膜は必要ない。また酸化シリコン前駆体膜を形成した後、酸化雰囲気で熱処理を行うので緻密な酸化シリコン膜が形成される。
本発明の半導体装置の製造方法(第1製造方法)は、基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成する工程と、前記シリコン膜上にポリシラン化合物を含有する塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜を酸化シリコン膜に形成するとともに、前記シリコン膜を緻密化する工程と、前記酸化シリコン膜上にゲート電極を形成する工程と、前記ゲート電極の両側の前記シリコン膜にソース・ドレイン領域を形成する工程を有する。
本発明の半導体装置の第1製造方法では、不活性雰囲気および還元性雰囲気で成膜が実現されるので、真空雰囲気での成膜は必要ない。また酸化シリコン前駆体膜を形成した後、酸化雰囲気で熱処理を行うので緻密な酸化シリコン膜からなるゲート絶縁膜が形成される。また、第3熱処理では、シリコン膜の緻密化が行われるので、結晶性のよい活性領域を形成することができる。
本発明の半導体装置の製造方法(第2製造方法)は、基板上にシリコン膜を形成し、そのシリコン膜を活性層に用いた薄膜トランジスタを形成する工程と、前記基板上に水素を含む酸化シリコン膜を形成して前記薄膜トランジスタを被覆する工程を有し、前記シリコン膜を形成する工程は、前記基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成し、前記水素を含む酸化シリコン膜を形成する工程は、前記基板上に前記薄膜トランジスタを被覆するようにポリシラン化合物を含有する塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜から水素を含む酸化シリコン膜を形成する工程を有する。
本発明の半導体装置の第2製造方法では、不活性雰囲気および還元性雰囲気で成膜が実現されるので、真空雰囲気での成膜は必要ない。また還元性雰囲気の第2熱処理でポリシラン化合物を含有する塗布膜から酸化シリコン前駆体膜が形成されるので、その膜中には水素が含まれる。そして水素を含む状態の酸化シリコン前駆体膜を酸化性雰囲気で第3熱処理を行うので、水素を含む緻密な酸化シリコン膜が得られる。また、第3熱処理では、薄膜トランジスタのシリコン膜の緻密化が行われるので、結晶性のよい活性領域を形成することができる。
本発明の成膜方法、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない酸化シリコン膜の成膜を実現できる。
本発明の半導体装置の第1製造方法は、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない酸化シリコン膜の成膜を実現することができる。また緻密な酸化シリコン膜からなるゲート絶縁膜を実現できるので、ゲートリークのない半導体装置(FET)を実現できる。さらに、シリコン膜の結晶性がよくなるので、特性に優れた半導体装置(FET)を実現できる。
本発明の半導体装置の第2製造方法では、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない水素を含む状態の酸化シリコン膜を得ることができる。
本発明の第1実施の形態に係る成膜方法の第1例を示した製造工程断面図である。 第1熱処理温度によるシリコン膜のバンドギャップ依存性を示した図である。 シリコン膜と酸化シリコン膜の積層膜にアルミニウム電極を形成して測定したC−V特性図である。 第3熱処理の温度によるFT−IRスペクトル図である。 第3熱処理の温度による抵抗値を示した図である。 本発明の第1実施の形態に係る成膜方法の第2例を示した製造工程断面図である。 ラザフォード後方散乱法(RBS)による水素を含む酸化シリコン膜の膜厚方向のシリコン(Si)と酸素(O)の存在比率を示した図である。 フーリエ変換赤外分光法(FT−IR)による水素を含む酸化シリコン膜のスペクトル(透過)図である。 絶縁破壊電圧(BDV)、エッチングレートと、アニール温度との関係図である。 本発明の第2実施の形態に係る半導体装置の製造方法の第1例を示した製造工程断面図である。 本発明の第2実施の形態に係る半導体装置の製造方法の第2例を示した製造工程断面図である。 昇温脱離ガス分析(TDS)による測定値であり、水素を含む酸化シリコン膜からの脱ガス量を表したイオン電流と保持時間との関係図である。 サンプルのドレイン電流−ゲート電圧の関係図である。 サンプルのドレイン電流−ゲート電圧の関係図である。 サンプルのドレイン電流−ゲート電圧の関係図である。
以下、発明を実施するための最良の形態(以下、実施の形態とする)について説明する。
<1.第1実施の形態>
[成膜方法の第1例]
本発明の第1実施の形態に係る成膜方法の第1例を、図1の製造工程断面図によって説明する。
図1(1)に示すように、基板11上にポリシラン化合物を含有する溶液を塗布して塗布膜12を形成した後に、不活性雰囲気中で第1熱処理を行って、上記塗布膜12をシリコン膜13に形成する。
上記塗布膜12を形成する工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。または還元性雰囲気中で水素を含有していても良い。
上記第1熱処理は、図2に示すように、アルゴンや窒素などの不活性雰囲気中で300℃以上の温度とすることで、シリコン膜13のバンドギャップが2eVを以下となる。そして、安定領域になるのが、約340℃以上である。
その上限は、アルゴンや窒素などの不活性雰囲気中で600℃以下の温度で行う。600度を超える温度では、シリコン膜13が破壊される可能性がある。
上記ポリシラン化合物は、Sinm(ただし、n≧3以上の自然数、mは2n−2以上2n+2以下、Rは有機鎖状体、有機環状体、水素原子、ハロゲンもしくは金属原子)で表されたものである。
上記Rを水素原子とした具体例としては、鎖状のポリシラン化合物として、ノーマルテトラシラン(Si410)、イソテトラシラン(Si410)、ノーマルペンタシラン(Si512)、イソペンタシラン(Si512)、ネオペンタシラン(Si512)、ノーマルヘキサシラン(Si614)、ノーマルヘプタシラン(Si716)、ノーマルオクタシラン(Si818)、ノーマルノナシラン(Si920)またはこれらの異性体が挙げられる。
また環状のポリシラン化合物として、シクロテトラシラン(Si48)、シクロペンタシラン(Si510)、シクロヘキサシラン(Si612)、シクロヘプタシラン(Si714)等が挙げられる。他にはかご状のポリシラン化合物なども挙げられる。
また、上記nが3未満のモノシラン(SiH4)、ジシラン(Si26)、トリシラン(Si38)が混在していてもよい。
ここでは一例として、シクロペンタシラン(Si510)を単独で用いる。
上記シクロペンタシランは、合成したものをそのまま用いてもよい。もしくは、予め単離されたものを用いてもよい。
シクロペンタシランを合成する場合には、例えばフェニルジクロロシランをテトラヒドロフラン中、金属リチウムで環化させてデカフェニルシクロペンタシランを生成する。
次いで、塩化アルミニウムの存在下、塩化水素で処理し、さらにリチウム水素化アルミニウム、シリカゲルで処理することにより製造することができる。
次いで、上記シクロペンタシランを適当な溶媒に溶解させることで、ポリシラン化合物を含有する溶液を得る。
すなわち、上記ポリシラン化合物を含有する溶液は、上記ポリシラン化合物を溶媒に溶解させたものである。
上記溶媒としては、シクロペンタシランを溶解し、シクロペンタシランと反応しないものであれば、特に限定されるものではない。
このような溶媒として、例えば、n−ヘプタン、n−オクタン、デカン、トルエン、キシレン、シメン、デュレン、インデン、ジペンテン、テトラヒドロナフタレン、デカヒドロナフタレン、シクロヘキシルベンゼン等の炭化水素系溶媒、エチレングリコールジメチルエーテル、エチレングリコールジエチルエーテル、エチレングリコールメチルエチルエーテル、ジエチレングリコールジメチルエーテル、ジエチレングリコールメチルエチルエーテル、1,2−ジメトキシエタン、ビス(2−メトキシエチル)エーテル、p−ジオキサン等のエーテル系溶媒、さらに、プロピレンカーボネート、γ−ブチルラクトン、n−メチル−2−ピロリドン、ジメチルホルムアルデヒド、ジメチルスルホキシド、シクロヘキサノンなどの非プロトン性極性溶媒を好ましいものとして挙げることができる。
これらの溶媒は、単独でもまたは2種以上の混合物としても使用できる。
ここでは、例えばトルエンを用いて、シクロペンタシランを溶解したシクロペンタシラン溶液を生成した。
なお、上記溶媒として、扱い易さから、シクロヘキサン、トルエン、キシレン等の溶媒を用いることがより好ましい。
なお、上記溶液中に界面活性剤を含んでいてもよい。
次に、図1(2)に示すように、上記シリコン膜13上にポリシラン化合物を含有する塗布膜14を形成した後に、不活性雰囲気中で第2熱処理を行って、上記塗布膜14を酸化シリコン前駆体膜15にする。
上記塗布膜14を形成する工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。または還元性雰囲気中で水素を含有していても良い。
上記第2熱処理は、アルゴンや窒素などの不活性雰囲気中で200℃以上280℃以下の温度で行う。
上記ポリシラン化合物は、前記同様に、Sinm(ただし、n≧3以上の自然数、mは2n−2以上2n+2以下、Rは有機鎖状体、有機環状体、水素原子、ハロゲンもしくは金属原子)で表されたものである。
上記Rを水素原子とした具体例としては、鎖状のポリシラン化合物として、ノーマルテトラシラン(Si410)、イソテトラシラン(Si410)、ノーマルペンタシラン(Si512)、イソペンタシラン(Si512)、ネオペンタシラン(Si512)、ノーマルヘキサシラン(Si614)、ノーマルヘプタシラン(Si716)、ノーマルオクタシラン(Si818)、ノーマルノナシラン(Si920)またはこれらの異性体が挙げられる。
また環状のポリシラン化合物として、シクロテトラシラン(Si48)、シクロペンタシラン(Si510)、シクロヘキサシラン(Si612)、シクロヘプタシラン(Si714)等が挙げられる。他にはかご状のポリシラン化合物なども挙げられる。
また、上記nが3未満のモノシラン(SiH4)、ジシラン(Si26)、トリシラン(Si38)が混在していてもよい。
ここでは一例として、シクロペンタシラン(Si510)を単独で用いる。
上記シクロペンタシランは、合成したものをそのまま用いてよい。もしくは、予め単離されたものを用いてもよい。
シクロペンタシランを合成する場合には、例えばフェニルジクロロシランをテトラヒドロフラン中、金属リチウムで環化させてデカフェニルシクロペンタシランを生成する。
次いで、塩化アルミニウムの存在下、塩化水素で処理し、さらにリチウム水素化アルミニウム、シリカゲルで処理することにより製造することができる。
次いで、上記シクロペンタシランを適当な溶媒に溶解させることで、ポリシラン化合物を含有する溶液を得る。
すなわち、上記ポリシラン化合物を含有する溶液は、上記ポリシラン化合物を溶媒に溶解させたものである。
上記溶媒としては、シクロペンタシランを溶解し、シクロペンタシランと反応しないものであれば、特に限定されるものではない。
このような溶媒として、例えば、n−ヘプタン、n−オクタン、デカン、トルエン、キシレン、シメン、デュレン、インデン、ジペンテン、テトラヒドロナフタレン、デカヒドロナフタレン、シクロヘキシルベンゼン等の炭化水素系溶媒、エチレングリコールジメチルエーテル、エチレングリコールジエチルエーテル、エチレングリコールメチルエチルエーテル、ジエチレングリコールジメチルエーテル、ジエチレングリコールメチルエチルエーテル、1,2−ジメトキシエタン、ビス(2−メトキシエチル)エーテル、p−ジオキサン等のエーテル系溶媒、さらに、プロピレンカーボネート、γ−ブチルラクトン、n−メチル−2−ピロリドン、ジメチルホルムアルデヒド、ジメチルスルホキシド、シクロヘキサノンなどの非プロトン性極性溶媒を好ましいものとして挙げることができる。
これらの溶媒は、単独でもまたは2種以上の混合物としても使用できる。
ここでは、例えばトルエンを用いて、シクロペンタシランを溶解したシクロペンタシラン溶液を生成した。
なお、上記溶媒として、扱い易さから、シクロヘキサン、トルエン、キシレン等の溶媒を用いることがより好ましい。
なお、上記溶液中に界面活性剤を含んでいてもよい。
次に、図1(3)に示すように、酸化雰囲気中で第3熱処理を行って、上記酸化シリコン前駆体膜15を酸化シリコン膜16に形成する。同時に、上記シリコン膜13の結晶性を緻密化する。
上記第3熱処理の最高温度は、上記第2熱処理の最高温度よりも高い状態とする。
ここで、上記第3熱処理の温度について説明する。
上記酸化シリコン膜16上にアルミニウム電極(図示せず)を形成して、容量−電圧(C−V)特性測定装置(例えば、アジレント社製4284A)を用い、1MHzでのC−V特性を測定した。
その結果を図3に示す。図3(1)は、第2熱処理を不活性雰囲気中で、260℃で実施し、第3熱処理を酸化雰囲気中で、260℃で実施した場合のC−V特性である。図3(2)は、第2熱処理を不活性雰囲気中で、260℃で実施し、第3熱処理を酸化雰囲気中で、425℃で実施した場合のC−V特性である。
図3に示すように、良い特性のシリコン酸化膜を形成するためには、第3熱処理の温度を第2熱処理の温度である260℃よりも高い温度にすると良いことがわかる。
これは一例であって、その他の温度でも、同様な結果が得られた。
第3熱処理の最高温度を上記第2熱処理の最高温度よりも高くすることにより、シリコン膜13と酸化シリコン膜16との界面は、良好な界面特性を得ることができる。
また、酸化シリコン膜16の欠陥密度を低減することができることもわかった。
また、上記第3熱処理の温度を変化させて、フーリエ変換赤外分光法(FT−IR)により分光スペクトル(透過)を測定した結果を、図4に示す。
良い特性のシリコン酸化膜を形成するために、第3熱処理の温度を、425℃、260℃、95℃、第3熱処理なしの4サンプルを作製した。その結果を図4に示す。
図4に示すように、第3熱処理において酸化処理が効率的に行われるのは95℃よりも高い温度であることがわかった。
ただし、上記第3熱処理では、上記シリコン膜13が酸化されないような温度条件で行うことが求められる。その温度は、酸化シリコン膜16の膜厚、基板11の材質等によって、適宜、決定される。
また、上記第3熱処理では、上記酸化雰囲気中での熱処理のほかに、熱処理に加えてオゾンによる酸化処理、熱処理に加えて光照射による酸化処理を行ってもよい。
また、上記成膜方法でシリコン単結晶基板の上に酸化シリコン膜16を形成した。
上記第2熱処理を200℃、220℃、240℃、260℃、280℃、300℃にして、上記第3熱処理を全て425℃にした6サンプルを形成した。
その上にアルミニウム電極(図示せず)を形成して、I−V特性測定装置(例えば、アジレントテクノロジー社製デバイスアナライザー4156C)を用い、I−V特性を測定した。その結果を図5に示す。
図5に示すように、200℃以上280℃以下の熱処理により高抵抗となり、300℃程度の熱処理により低抵抗となることが分かった。
すなわち、200℃以上280℃以下で良好な酸化シリコン前駆体膜15が形成でき、300℃以上で酸化は促進されず、シリコンのネットワーク化が進んでいることが分かった。
具体的には、第2熱処理は、200℃以上で熱処理することでシリコン膜に、シリコンが酸化するために必要なネットワークを生成させる。シリコンのネットワークが進み過ぎて、−Si−Si−Si−結合が多くなり過ぎ、酸素(O)が入る余地がなくなることがないように熱処理を行う。すなわち、シリコン膜中に酸素(O)が結合できる結合手をシリコン(Si)に残すように、シリコンのネットワークを生成する。その温度が280℃以下である。
よって、第2熱処理は200℃以上280℃以下で行うことが望ましい。
上記成膜方法においては、上記ポリシラン化合物を含有する溶液中に、上記シクロペンタシラン等のポリシラン化合物の他にラジカル発生剤を含有していてもよい。
このようなラジカル発生剤としては、ビイミダゾール系化合物、ベンゾイン系化合物、トリアジン系化合物、アセトフェノン系化合物、ベンゾフェノン系化合物、α−ジケトン系化合物、多核キノン系化合物、キサントン系化合物、アゾ系化合物等が挙げられる。
この溶液に含まれるポリシラン化合物の濃度は所望の塗膜条件と膜厚によって調整することができる。
また、調整した溶液に塗膜前もしくは塗膜後にエネルギービームを照射することが好ましい。
上記エネルギービームは紫外線領域を含むものである。例えば、低圧の水銀ランプ、高圧の水銀ランプ、重水素ランプ等のランプ光が挙げられる。また、アルゴン、クリプトン、キセノン等の希ガスの放電光が挙げられる。さらには、YAGレーザー光、アルゴンレーザー光、炭酸ガスレーザー光、XeF、XeCl、XeBr、KrF、KrCl、ArF、ArClなどのエキシマレーザー光などを使用することができる。
上記エネルギービームを用い、出力と照射時間を調整することで、照射エネルギーを調整する。
例えば、塗膜前の上記ポリシラン化合物を含有する溶液に上記エネルギービームを照射する場合、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を石英などの紫外線領域を透過する容器(セル)に封入し、エネルギービームを容器の外部から照射する。
また、上記ポリシラン化合物を含有する溶液を塗膜した後に上記エネルギービームを照射する場合、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を塗膜したい基板上に上部から滴下し、その液滴にエネルギービームを上部から照射する。この際、基板がエネルギービームを透過する物であれば下部から照射しても構わない。その後、基板全面に液滴を広げて塗布膜を形成する。
または、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を塗膜したい基板に、スピンコート法、ロールコート法、スクリーン印刷法、オフセット印刷法、スプレー法、インクジェット法などの任意の方法で広げて、塗布膜を形成した後、エネルギービームを照射する。上記同様に基板がエネルギービームを透過する物であれば、基板の上部および下部からの照射が可能である。
なお、上記エネルギービーム照射と熱処理をする場合の順番は問わない。
しかし熱処理を行う場合は、好ましくは基板にポリシラン化合物を含有する溶液を広げた後、もしくはエネルギービーム照射後に行う。
本発明の成膜方法の第1例では、シリコン膜13、酸化シリコン膜16の積層膜を、低温プロセスで、欠陥密度を従来よりも低くすることができる。
また、上記第1例の成膜方法は、酸化シリコン膜を形成する手法である熱酸化法、CVD法、スパッタリング法と異なり、真空レスのプロセスを使用することが可能である。
よって真空プロセスを使用する製造方法より設備投資を低くすることができ、連続的、かつ低コストであるシリコン膜13と酸化シリコン膜16の積層膜を形成することができる。
さらに、塗布法と熱処理という簡便な方法で、大面積に、低耐熱性の基板上にも、欠陥密度が低い酸化シリコン膜を作製することができる。
[成膜方法の第2例]
本発明の第1実施の形態に係る成膜方法の第2例を、図6の製造工程断面図によって説明する。この第2例では、水素を含む酸化シリコン膜の成膜方法を説明する。
図6(1)に示すように、基板31上にポリシラン化合物を含有する溶液を塗布して塗布膜12を形成した後に、不活性雰囲気中で第1熱処理を行って、上記塗布膜12をシリコン膜13に形成する。
上記塗布膜12を形成する工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。または還元性雰囲気中で水素を含有していても良い。
また上記基板31には、例えばシリコン基板、ガラス基板、石英基板等を用いることができる。
次に、図6(2)に示すように、上記シリコン膜13上にポリシラン化合物を含有する塗布膜32を形成する。
上記ポリシラン化合物は、Sinm(ただし、n≧3以上の自然数、mは2n−2以上2n+2以下、Rは有機鎖状体、有機環状体、水素原子、ハロゲンもしくは金属原子)で表されるものを用いる。
上記Rを水素原子とした具体例としては、鎖状のポリシラン化合物として、ノーマルテトラシラン(Si410)、イソテトラシラン(Si410)、ノーマルペンタシラン(Si512)、イソペンタシラン(Si512)、ネオペンタシラン(Si512)、ノーマルヘキサシラン(Si614)、ノーマルヘプタシラン(Si716)、ノーマルオクタシラン(Si818)、ノーマルノナシラン(Si920)またはこれらの異性体が挙げられる。
また環状のポリシラン化合物として、シクロテトラシラン(Si48)、シクロペンタシラン(Si510)、シクロヘキサシラン(Si612)、シクロヘプタシラン(Si714)等が挙げられる。他にはかご状のポリシラン化合物なども挙げられる。
また、上記nが3未満のモノシラン(SiH4)、ジシラン(Si26)、トリシラン(Si38)が混在していてもよい。
ここでは一例として、シクロペンタシラン(Si510)を単独で用いる。
上記シクロペンタシランは、合成したものをそのまま用いてよい。もしくは、予め単離されたものを用いてもよい。
シクロペンタシランを合成する場合には、例えばフェニルジクロロシランをテトラヒドロフラン中、金属リチウムで環化させてデカフェニルシクロペンタシランを生成する。
次いで、塩化アルミニウムの存在下、塩化水素で処理し、さらにリチウム水素化アルミニウム、シリカゲルで処理することにより製造することができる。
次いで、上記シクロペンタシランを適当な溶媒に溶解させることで、ポリシラン化合物を含有する溶液を得る。
すなわち、上記ポリシラン化合物を含有する溶液は、上記ポリシラン化合物を溶媒に溶解させたものである。
上記溶媒としては、シクロペンタシランを溶解し、シクロペンタシランと反応しないものであれば、特に限定されるものではない。
このような溶媒として、例えば、n−ヘプタン、n−オクタン、デカン、トルエン、キシレン、シメン、デュレン、インデン、ジペンテン、テトラヒドロナフタレン、デカヒドロナフタレン、シクロヘキシルベンゼン等の炭化水素系溶媒、エチレングリコールジメチルエーテル、エチレングリコールジエチルエーテル、エチレングリコールメチルエチルエーテル、ジエチレングリコールジメチルエーテル、ジエチレングリコールメチルエチルエーテル、1,2−ジメトキシエタン、ビス(2−メトキシエチル)エーテル、p−ジオキサン等のエーテル系溶媒、さらに、プロピレンカーボネート、γ−ブチルラクトン、n−メチル−2−ピロリドン、ジメチルホルムアルデヒド、ジメチルスルホキシド、シクロヘキサノンなどの非プロトン性極性溶媒を好ましいものとして挙げることができる。
これらの溶媒は、単独でもまたは2種以上の混合物としても使用できる。
ここでは、例えばトルエンを用いて、シクロペンタシランを溶解したシクロペンタシラン溶液を生成した。
この溶液中には上記シクロペンタシランの他にラジカル発生剤を含有していてもよい。このようなラジカル発生剤としては、ビイミダゾール系化合物、ベンゾイン系化合物、トリアジン系化合物、アセトフェノン系化合物、ベンゾフェノン系化合物、α−ジケトン系化合物、多核キノン系化合物、キサントン系化合物、アゾ系化合物等が挙げられる。
この溶液に含まれるポリシラン化合物の濃度は所望の塗膜条件と膜厚によって調整することができる。
また、調整した溶液に塗膜前もしくは塗膜後にエネルギービームを照射することが好ましい。
上記エネルギービームは紫外線領域を含むものである。例えば、低圧の水銀ランプ、高圧の水銀ランプ、重水素ランプ等のランプ光が挙げられる。また、アルゴン、クリプトン、キセノン等の希ガスの放電光が挙げられる。さらには、YAGレーザー光、アルゴンレーザー光、炭酸ガスレーザー光、キセノンフッ素(XeF)、キセノン塩素(XeCl)、キセノン臭素(XeBr)、クリプトンフッ素(KrF)、クリプトン塩素(KrCl)、アルゴンフッ素(ArF)、アルゴン塩素(ArCl)などのエキシマレーザー光などを使用することができる。
上記エネルギービームを用い、出力と照射時間を調整することで、照射エネルギーを調整する。
例えば、塗膜前の上記ポリシラン化合物を含有する溶液に上記エネルギービームを照射する場合、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を石英などの紫外線領域を透過する容器(セル)に封入し、エネルギービームを容器の外部から照射する。
また、上記ポリシラン化合物を含有する溶液を塗膜した後に上記エネルギービームを照射する場合、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を塗膜したい基板上に上部から滴下し、その液滴にエネルギービームを上部から照射する。この際、基板がエネルギービームを透過する物であれば下部から照射しても構わない。その後、基板全面に液滴を広げて塗布膜を形成する。
または、ポリシラン化合物(例えばシクロペンタシラン)単体、もしくは溶媒を含む溶液を塗膜したい基板に、スピンコート法、ロールコート法、スクリーン印刷法、オフセット印刷法、スプレー法、インクジェット法などの任意の方法で広げて、塗布膜を形成した後、エネルギービームを照射する。上記同様に基板がエネルギービームを透過する物であれば、基板の上部および下部からの照射が可能である。
上記塗布膜32を形成する塗膜工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。また、還元性雰囲気のように水素が含まれていても良い。
上記塗布膜32を塗膜した後、熱処理をする場合は、その熱処理は、塗膜工程と同様にアルゴンや窒素などの不活性雰囲気中で行われることが好ましい。また、この熱処理は、好ましくは600℃以下で行う。
なお、上記エネルギービーム照射と熱処理をする場合の順番は問わない。
しかし熱処理を行う場合は、好ましくは基板にポリシラン化合物を含有する溶液を広げた後、もしくはエネルギービーム照射後に行う。
次に、上記塗布膜32を酸化処理する。この酸化処理は、酸化雰囲気中での熱処理、オゾンによる処理(熱処理を加えても良い)、光照射による処理(熱処理を加えても良い)が挙げられる。ここでは酸化雰囲気中での熱処理を例にして説明する。
上記酸化処理は、最低2段階の処理ステップを要する。
まず、図6(3)に示すように、第1段階の処理ステップは、不活性雰囲気または還元性雰囲気での熱処理(第2熱処理)であり、熱処理温度を240℃以上280℃以下とし、好適には260℃以上280℃以下として、不活性雰囲気または還元性雰囲気で熱処理を行う。この第2熱処理によって、上記塗布膜32が酸化シリコン前駆体膜33になる。この酸化シリコン前駆体膜33は、鎖状のポリシラン化合物が重合された状態で、上記塗布膜32中の溶媒等が蒸発されていて膜中に水素を含む。
次に、図6(4)に示すように、第2段階の処理ステップは、酸化性雰囲気での酸化処理(第3熱処理)であり、好ましくは酸化性雰囲気での熱酸化処理である。この第3熱処理は、例えば、好適には180℃以上の酸化性雰囲気中で熱処理を行う。さらに好適には240℃以上の酸化性雰囲気中で熱処理を行う。このように、第3熱処理の最高温度が不活性雰囲気または還元性雰囲気での第2熱処理の最高温度以上に設定されていることがより好ましい。この第3熱処理によって、上記酸化シリコン前駆体膜33が水素を含む酸化シリコン膜34になる。なお、熱処理をともなわない酸化性雰囲気での酸化処理を用いることも可能である。
次に、上記水素を含む酸化シリコン膜34について検証する。
石英基板の上に成膜方法の第2例によって水素を含む酸化シリコン膜34を形成した。
不活性雰囲気の第2熱処理は、各々、180℃/30min、220℃/30min、220℃/60min、250℃/30minとした。酸化性雰囲気の第3熱処理は、4サンプルとも、410℃/30minとした。
上記各条件で得た水素を含む酸化シリコン膜34を、例えばラザフォード後方散乱法(RBS)によって分析した。その結果、シリコン(Si)と酸素(O)の存在比率は、図7に示すようになった。
図7(1)、(2)に示すように、水素を含む酸化シリコン膜34は、膜厚方向にほぼ一定に、シリコン(Si)と酸素(O)の組成比がSi:O≒1:2となっていることからして、上記成膜条件では酸化シリコン膜となっていることが確認できた。
次に、シリコン単結晶基板の上に成膜方法の第2例によって水素を含む酸化シリコン膜34を形成した。
酸化雰囲気での第3熱処理の熱処理温度を500℃、425℃、350℃、260℃に設定して水素を含む酸化シリコン膜34を形成した。その後、フーリエ変換赤外分光法(FT−IR)により、上記各条件で形成した水素を含む酸化シリコン膜34のスペクトル(透過)を測定した。その結果を、表1および図8に示す。表1では、水素を含む酸化シリコン膜34の膜厚、第2熱処理、第3熱処理の各処理温度を示した。
Figure 2010206161
図8に示すように、上記第3熱処理の温度が高くなるにしたがい、水素を含む酸化シリコン膜34の膜中のシリコンと水素の結合が減少していることが確認できた。
次に、シリコン単結晶基板の上に成膜方法の第2例によって水素を含む酸化シリコン膜34を形成した。
不活性雰囲気での処理温度を、200℃、220℃、240℃、260℃、280℃、300℃に設定し、酸化性雰囲気の処理温度を全て425℃に設定した6サンプルを形成した。その上にアルミ電極を形成して、電流−電圧特性測定装置(例えば、アジレントテクノロジー社製デバイスアナライザー4156C)で、電流−電圧(I−V)特性を測定した。その結果を図9に示す。図9では、左縦軸に絶縁破壊電圧(BDV)(図中の黒塗りのひし形印)を示し、右縦軸にエッチングレート(図中黒塗りの三角印)を示し、横軸にアニール温度を示した。
その結果、図9に示すように240℃以上の熱処理により高抵抗となり、300℃程度の熱処理により低抵抗となることが分かった。第1段階の処理ステップの還元雰囲気の第2熱処理では240℃以上で良好な酸化シリコン膜が形成でき、300℃以上で酸化は促進されず、シリコンのネットワーク化が進んでいることが分かった。
したがって、第2熱処理は、240℃以上280℃以下で行うことが望ましいことが分かった。より好ましくは、260℃以上280℃以下で熱処理を行うことである。
上記成膜方法の第2例では、不活性雰囲気および酸化性雰囲気で成膜が実現されるので、真空雰囲気での成膜は必要ない。また不活性雰囲気の第2熱処理でポリシラン化合物を含有する塗布膜32から酸化シリコン前駆体膜33が形成されるので、その膜中には水素が含まれる。そして水素を含む状態の酸化シリコン前駆体膜33を酸化雰囲気で第3熱処理を行うので、欠陥密度が従来よりも低い水素を含む酸化シリコン膜34が得られる。また、第3熱処理では、シリコン膜13の緻密化が行われるので、結晶性のよい活性領域を形成することができる。
また、上記第2例の成膜方法は、酸化シリコン膜を形成する手法である熱酸化法、CVD法、スパッタリング法と異なり、真空レスのプロセスを使用することが可能である。
よって真空プロセスを使用する製造方法より設備投資を低くすることができ、連続的、かつ低コストであるシリコン膜13と水素を含む酸化シリコン膜34を形成することができる。
さらに、塗布法と熱処理という簡便な方法で、大面積に、低耐熱性の基板上にも、欠陥密度が低い酸化シリコン膜を作製することができる。
上記水素を含む酸化シリコン膜は、シリコン基板やシリコン層中のダングリングボンドを制御する膜として、従来の水素含有窒化シリコン膜と同様に用いることができる。
現在、薄型ディスプレイに使用される薄膜トランジスタ(TFT)や太陽電池で検討されている薄膜シリコン太陽電池ではアモルファスシリコン(a−Si)が広く用いられている。アモルファスとは結晶構造を持たない固体状態であり、アモルファスシリコンの原子配列は結晶シリコンの原子配列が乱れたものになっている。この乱れた原子配列では共有結合に関与しないダングリングボンドが存在する。このダングリングボンドを制御することで薄膜トランジスタや薄膜シリコン太陽電池として使える目処が立つようになる。
従来のダングリングボンドの制御法としては、具体的にはダングリングボンドと水素原子を結合させることでトラップを減少させる手段がとられている。例えばグロー放電でモノシラン(SiH4)を分解するグロー放電法や、真空中に水素を導入して電子ビームでシリコン(Si)を蒸発させるイオンプレーティング法、クラスタイオンビーム法などがある。反応性スパッタやCVD法では水素が不十分な場合があり、水素プラズマによる処理を行ったりする。
ちなみに水素は2000℃に加熱しても0.1%程度しか解離せず、5000℃程度で解離することが知られているが、350℃〜400℃程度の水素含有ガス(フォーミングガス)処理でもシリコンと水素の結合は確認されている。
またアモルファスシリコン(a−Si)よりも高移動度な多結晶シリコン(poly−Si)の場合は、一例としてプラズマエンハンスメントCVD(PECVD)のアモルファスシリコン膜をエキシマレーザーアニール(ELA)により多結晶化して形成する。
しかし、比較的低温で成膜した膜中には10%以下程度水素が含まれているため、爆発性の結晶(Explosive Crystallization)が生じる。このため、事前に400℃〜450℃の加熱処理により脱水素処理を行い、水素濃度を数%程度にする。この後、ダングリングボンドに水素原子を結合させてトラップを減少させている。
また良好な半導体と絶縁膜との界面を得るためには、真空中で連続成膜することが好ましい。もしくは半導体表面を酸化することで膜中に界面を形成させることも好ましい。
しかし将来的にフレキシブルな基材を用い、かつ設備投資の削減などを視野に入れると、塗布や印刷でデバイスを作製することが求められてきている。その際は真空中での連続成膜や、高温を要するような半導体表面の酸化は難しくなる。
酸化シリコン膜は、電界効果トランジスタ等の半導体デバイスを作製する際に絶縁膜や誘電体膜、表面保護膜として使用されている。
このような酸化シリコン膜を形成する方法として、熱酸化法、化学気相成長法(CVD)やスパッタリング法に等による気相プロセスによる形成が行われてきている。
液相プロセスではアルコキシシラン類の加水分解などによる成膜や、ポリシラザンの酸化などによる形成方法がある。
しかしながら上記方法のうち、気相プロセスでは高価な真空装置や危険性のあるガス原料を用いる必要があり、かつ高温やプラズマなどの使用によるエネルギー消費も大きい。また膜を形成する基板の大きさの制約や均一性などの問題もある。また、液層プロセスでは膜の緻密化などの問題が残っている。
これらの問題点を解決する方法として、前記成膜方法の第2例による水素を含む酸化シリコン膜が有効となる。
したがって、TFTや太陽電池などの半導体デバイス作製に際し、半導体膜(例えばシリコン膜)に生じるダングリングボンドを減少させる水素化工程に代わり、水素を含有するポリシラン化合物を塗布、熱処理することにより、水素を含む酸化シリコン膜34を形成することで、水素を任意箇所(もしくは、接している近隣の膜)に供給するができる。
また、水素を含む酸化シリコン膜34が塗布により形成することができるので、半導体デバイス製造方法において、一部または全部を真空雰囲気での処理を用いない真空レスのプロセスとすることができる。さらに、塗布と比較的低温(例えば450℃以下)の熱処理で水素を含む酸化シリコン膜34を形成できるので、有機材料基板を用いることにより、いわゆるロール・トゥ・ロールのプロセスを構成することが可能となる。
<2.第2実施の形態>
[半導体装置の製造方法の第1例]
本発明の第2実施の形態に係る半導体装置の製造方法の第1例を、図10の概略構成断面図によって説明する。
まず、上記図1によって説明した成膜方法によって、図10(1)に示すように、基板11上にポリシラン化合物を含有する溶液を塗布して塗布膜12を形成した後に、不活性雰囲気中で第1熱処理を行って、上記塗布膜12をシリコン膜13に形成する。
上記ポリシラン化合物は、前記説明したものを用いる。
すなわち、Sinm(ただし、n≧3以上の自然数、mは2n−2以上2n+2以下、Rは有機鎖状体、有機環状体、水素原子、ハロゲンもしくは金属原子)で表されたものである。
上記Rを水素原子とした具体例としては、鎖状のポリシラン化合物として、ノーマルテトラシラン(Si410)、イソテトラシラン(Si410)、ノーマルペンタシラン(Si512)、イソペンタシラン(Si512)、ネオペンタシラン(Si512)、ノーマルヘキサシラン(Si614)、ノーマルヘプタシラン(Si716)、ノーマルオクタシラン(Si818)、ノーマルノナシラン(Si920)またはこれらの異性体が挙げられる。
また環状のポリシラン化合物として、シクロテトラシラン(Si48)、シクロペンタシラン(Si510)、シクロヘキサシラン(Si612)、シクロヘプタシラン(Si714)等が挙げられる。他にはかご状のポリシラン化合物なども挙げられる。
また、上記nが3未満のモノシラン(SiH4)、ジシラン(Si26)、トリシラン(Si38)が混在していてもよい。
また上記ポリシラン化合物を含有する溶液は、上記ポリシラン化合物を溶媒に溶解させたものであり、その溶媒としては、前記説明したものを用いる。
すなわち、n−ヘプタン、n−オクタン、デカン、トルエン、キシレン、シメン、デュレン、インデン、ジペンテン、テトラヒドロナフタレン、デカヒドロナフタレン、シクロヘキシルベンゼン等の炭化水素系溶媒、エチレングリコールジメチルエーテル、エチレングリコールジエチルエーテル、エチレングリコールメチルエチルエーテル、ジエチレングリコールジメチルエーテル、ジエチレングリコールメチルエチルエーテル、1,2−ジメトキシエタン、ビス(2−メトキシエチル)エーテル、p−ジオキサン等のエーテル系溶媒、さらに、プロピレンカーボネート、γ−ブチルラクトン、n−メチル−2−ピロリドン、ジメチルホルムアルデヒド、ジメチルスルホキシド、シクロヘキサノンなどの非プロトン性極性溶媒を好ましいものとして挙げることができる。
これらの溶媒は、単独でもまたは2種以上の混合物としても使用できる。
上記塗布膜14を形成する工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。または水素を含有していても良い。
上記第1熱処理は、アルゴンや窒素などの不活性雰囲気中で600℃以下の温度で行う。
次に、図10(2)に示すように、上記シリコン膜13上にポリシラン化合物を含有する塗布膜14を形成した後に、不活性雰囲気中で第2熱処理を行って、上記塗布膜14を酸化シリコン前駆体膜15に形成する。
上記ポリシラン化合物は、前記説明したものを用いる。
また上記ポリシラン化合物を含有する溶液は、上記ポリシラン化合物を溶媒に溶解させたものであり、その溶媒としては、前記説明したものを用いる。
上記塗布膜14を形成する工程は、アルゴンや窒素などの不活性雰囲気中で行われることが好ましい。または水素を含有していても良い。
上記第2熱処理は、アルゴンや窒素などの不活性雰囲気中で200℃以上280℃以下の温度で行う。
次に、図10(3)に示すように、酸化雰囲気中で第3熱処理を行って、上記酸化シリコン前駆体膜15を酸化シリコン膜16に形成する。同時に、上記シリコン膜13の結晶性を緻密化する。この酸化シリコン膜16がゲート絶縁膜21となる。
上記第3熱処理の最高温度は、上記第2熱処理の最高温度よりも高い状態とする。
次に、図10(4)に示すように、上記ゲート絶縁膜21上にゲート電極形成膜22を形成する。このゲート電極形成膜22の成膜方法としては、CVD法、スパッタリング法、蒸着法等の真空成膜技術、もしくは、金属微粒子を塗布して焼結する方法、めっき法、印刷法等がある。
上記ゲート電極形成膜22の材料としては、例えば、アルミニウム膜、アルミニウム合金等の金属または合金膜、不純物がドープされた多結晶シリコン膜、ポリサイド膜等を用いることができる。
次に、図10(5)に示すように、通常のリソグラフィー技術用いて、上記ゲート電極形成膜22をパターニングして、ゲート電極23を形成する。また、このパターニングにより、ゲート絶縁膜21もパターニングされる。
なお、例えば印刷法等の塗布法を用いた場合には、リソグラフィー工程を行わずに、上記ゲート絶縁膜21上に直接ゲート電極23をパターン形成することができる。
次に、図10(6)に示すように、例えばイオン注入法により、上記ゲート電極23をマスクにして、n型またはp型の不純物イオンをゲート電極23の両側のシリコン層13にイオン注入する。その後活性化処理を行って、注入した不純物イオンを活性化し、n型またはp型のソース・ドレイン領域24、25を形成する。
上記ソース・ドレイン領域24、25を形成する方法は、上記イオン注入法に限定されるものではない。例えば、ゲート電極23の両側のシリコン膜13上に、塗布、散布、または印刷等の手法により、不純物イオンを付着させることで、化合物層(図示せず)を形成する。続いて、この状態の基板11の表面にエネルギービームを照射して化合物層とその直下のシリコン膜13を加熱することにより、この化合物層から不純物イオンをシリコン膜13中に拡散させる。この際、ゲート電極23がマスクとなることにより、シリコン膜13のうちのゲート電極23の直下部を除く領域の表面部に不純物イオンが拡散し、n型またはp型のソース・ドレイン領域24、25がゲート電極23に対して自己整合的に形成される。
その後の工程は、通常の薄膜トランジスタの製造方法と同様に行う。
図示はしないが、例えば、ゲート電極23およびソース・ドレイン領域24、25を覆う層間絶縁膜(図示省略)を形成する。この層間絶縁膜には、酸化シリコン膜、無機系SOG膜、有機系SOG膜等の層間絶縁膜として通常使用される絶縁膜あるいは誘電体膜を用いることができる。その成膜法は、CVD法、スパッタリング法、蒸着法等の真空成膜技術、もしくは、SOG法、ゾルゲル法等を用いる。
次に、上記層間絶縁膜の所定部分をエッチング除去して上記ソース・ドレイン領域24、25に達するコンタクトホールを形成し、さらに、コンタクトホールを通じてソース・ドレイン領域24、25に接続されるソース・ドレイン電極を形成する。
本発明の半導体装置1の製造方法は、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ないゲート絶縁膜21に用いる酸化シリコン膜16の成膜を実現することができる。また緻密な酸化シリコン膜16からなるゲート絶縁膜21を実現できるので、ゲートリークのない半導体装置(FET)1を実現できる。さらに、シリコン膜13の結晶性がよくなるので、移動度に優れた半導体装置(FET)1を実現できるという利点がある。
また、上記説明したように、本発明の成膜方法で形成される酸化シリコン膜16を半導体デバイスに応用した場合、生産性よく、低いプロセスコストで、しかも設備投資を抑えて、上記のような絶縁ゲート型電界効果トランジスタのゲート絶縁膜21の作製することができる。
さらに、表示素子のような大面積の基板に半導体デバイスとしてTFT等を作製することができるようになるため、用途が広がり付加価値が飛躍的に高まる。
特に、低温プロセスでの成膜が可能なことから、低耐熱性の基板を使用できる。例えば、有機材料、特にプラスチック材料を使用でき、酸化シリコン膜の作製手段として、例えばロール・トゥ・ロールが可能であり、デバイスとしては巻き取りが可能となり、もしくは柔軟性を有した表示素子が実現できる。
[半導体装置の製造方法の第2例]
本発明の第2実施の形態に係る半導体装置の製造方法の第2例を、図11の概略構成断面図によって説明する。
まず、上記図1によって説明したシリコン膜13の成膜方法によって、図11(1)に示すように、基板11上にシリコン膜41を形成し、それを活性層とする薄膜トランジスタ3を形成する。この薄膜トランジスタ3は以下のように形成される。
上記シリコン膜41上にゲート絶縁膜42を介してゲート電極43を形成し、このゲート電極43の両側の上記シリコン膜41にソース・ドレイン領域44、45を形成する。
次に、図11(2)、(3)の工程を経て(4)に示すように、上記基板31上に水素を含む酸化シリコン膜34を形成して上記薄膜トランジスタ3を被覆する。
上記水素を含む酸化シリコン膜34を形成する工程は、以下のようにして行う。
まず、図11(2)に示すように、上記基板31上に上記薄膜トランジスタ3を被覆するようにポリシラン化合物を含有する塗布膜32を形成する。この塗布膜32は、前記成膜方法の第2例で説明したのと同様である。
その後、図11(3)に示すように、前記成膜方法の第2例で説明したのと同様に、不活性雰囲気中で第2熱処理を行って、上記塗布膜32を酸化シリコン前駆体膜33に形成する。
次に、図11(4)に示すように、前記成膜方法の第2例で説明したのと同様に、酸化雰囲気中で第3熱処理を行って、上記酸化シリコン前駆体膜33から水素を含む酸化シリコン膜34を形成する。このようにして、上記基板31上に水素を含む酸化シリコン膜34を形成して上記薄膜トランジスタ3を被覆する。
なお、上記薄膜トランジスタ3の形成方法は、前記図10によって説明した半導体装置の製造方法を用いることもできる。
次に、上記水素を含む酸化シリコン膜34について検証をした。シリコン単結晶基板の上に上記方法で水素を含む酸化シリコン膜34を形成した。その際、不活性雰囲気で260℃の熱処理を行い、次に酸化性雰囲気で260℃の熱処理を施した。
その水素を含む酸化シリコン膜34を昇温脱離ガス分析(TDS)により分析した。100℃で120min保持した結果を図12に示す。
図12に示すように、100℃程度であるが、水素が一番多く検知されており、一酸化炭素もしくは窒素と同様に出続けていることが確認できる。測定初期には水も多く検出されているが、基板や他部材からも出ることから、非常に多くの水素が100℃程度で出ていることが分かる。すなわち、水素を含む酸化シリコン膜34中に水素が含まれていることがわかる。
次に、トップゲート型poly−SiゲートのTFTを作製した。
その作製過程のTFTの活性層となるシリコン膜の結晶化プロセスにおいて、エキシマレーザアニール(ELA)による結晶化を行う前に、水素抜きのアニールを500℃の真空中で行った。
その後のプロセスで上記シリコン膜に水素を供給するプロセスを省いたサンプルを「as−depoサンプル」として図中に示した(水素を含む酸化シリコン膜は未成膜)。
また、上記製造方法の第2例と同様に、水素を含む酸化シリコン膜を260℃(不活性雰囲気中)+260℃(酸素雰囲気中)で成膜した第1サンプルと、260℃(不活性雰囲気中)+425℃(酸素雰囲気中)で成膜した第2サンプルを作製した。
各サンプルともに、酸化シリコン膜を成膜した後、例えばフッ酸系のエッチング液にてコンタクトホールを作製した。
そして、上記TFTのI−V特性を測定した。その結果を図13のTFTのドレイン電流−ゲート電圧の関係図に示す。
図13に示すように、as−depoサンプルよりも、成膜方法の第2例で成膜した水素を含む酸化シリコン膜を用いた第1サンプル、第2サンプルともに、シリコン膜の水素化の効果が確認できた。
次に、前記同様に、トップゲート型poly−SiゲートのTFTを作製した。
前記同様にTFTのシリコン膜に水素を供給するプロセスを省いたサンプルを「as−depoサンプル」として図中に示した。
また350℃の水素ガス含有雰囲気中で、20minのアニールによりTFTのシリコン膜に水素を供給したサンプルを「as−depo水素化後サンプル」とした。
さらに、その「as−depo水素化後サンプル」に水素を含む酸化シリコン膜を、260℃(不活性雰囲気中)+260℃(酸素雰囲気中)で成膜した第3サンプルと比較した。
この結果を図14のTFTのドレイン電流−ゲート電圧の関係図に示す。
図14に示すように、as−depo水素化後サンプルと第3サンプルとは、ほとんど差異がないことから、260℃の熱処理条件ではTFT特性を劣化させないことが確認できた。
次に、前記同様に、トップゲート型poly−SiゲートのTFTを作製した。
水素化後、酸化シリコン膜を260℃(260℃(大気中)+260℃(酸素(O2)雰囲気中))で成膜したサンプルを作製した。そしてこのサンプルのドレイン電流−ゲート電圧(Id−Vg)特性を測定した。その結果は、図15のTFTのドレイン電流−ゲート電圧の関係図に示すように、「pas」の曲線となった。
そして、上記サンプルをそのまま14日間、大気下で保管した後、Id−Vg特性を測定した。その結果は、図15に示すように、「14日(大気中)」の曲線となった。
その後、上記サンプルを425℃の酸素雰囲気での熱処理を行い、425℃の酸素(O2)雰囲気中でId−Vg特性を測定した。その結果は、図15に示すように、「425℃(酸素雰囲気)」の曲線となった。
その後、上記熱処理を行ったサンプルを温度が60℃で湿度が90%の環境下に保管した。
そして、上記環境下で所定日数が経過したものを取り出して測定した。その結果は、図15に示すように、「7日」、「10日」、「21日」、「45日」、「143日」の曲線となった。
上記熱処理後、Id−Vg特性が多少変化しているが、143日後まで温度が60℃で湿度が90%の環境下では安定した特性を得ていることがわかった。
この結果から、水素を含む酸化シリコン膜を通して水素が抜ける脱水素反応が生じていないことが確認できた。
上記半導体装置の第2製造方法では、不活性雰囲気および還元性雰囲気で成膜が実現されるので、真空雰囲気での成膜は必要ない。また還元性雰囲気の第2熱処理でポリシラン化合物を含有する塗布膜32から酸化シリコン前駆体膜33が形成されるので、その膜中には水素が含まれる。そして水素を含む状態の酸化シリコン前駆体膜33を酸化雰囲気で第3熱処理を行うので、水素を含む緻密な酸化シリコン膜34が得られる。また、第3熱処理では、薄膜トランジスタ3のシリコン膜41の緻密化が行われるので、結晶性のよい活性領域を形成することができる。
よって、真空雰囲気での成膜を用いずに低温プロセスで欠陥密度の少ない水素を含む状態の酸化シリコン膜34を得ることができる。
1…半導体装置、3…薄膜トランジスタ、11…基板、12…塗布膜、13…シリコン膜、14…塗布膜、15…酸化シリコン前駆体膜、16…酸化シリコン膜、21…ゲート絶縁膜、23…ゲート電極、24,25…ソース・ドレイン領域、31…シリコン膜、32…塗布膜、33…酸化シリコン前駆体膜、34…水素を含む酸化シリコン膜

Claims (7)

  1. 基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成する工程と、
    前記シリコン膜上にポリシラン化合物を含有する塗布膜を形成した後に、不活性雰囲気または還元性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、
    酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜を酸化シリコン膜に形成するとともに、前記シリコン膜を緻密化する工程とを有する
    成膜方法。
  2. 前記ポリシラン化合物はSinm(ただし、n≧3以上の自然数、mは2n−2以上2n+2以下、Rは有機鎖状体、有機環状体、水素原子、ハロゲンもしくは金属原子)で表されたものであり、
    前記ポリシラン化合物を含有する溶液は、前記ポリシラン化合物を溶媒に溶解させたものである
    請求項1記載の成膜方法。
  3. 前記第2熱処理は、不活性雰囲気中で200℃以上280℃以下の温度で行う
    請求項1または請求項2記載の成膜方法。
  4. 前記第2熱処理は、還元性雰囲気中で240℃以上280℃以下の温度で行う
    請求項1または請求項2記載の成膜方法。
  5. 前記第2熱処理は不活性雰囲気で行われ、
    前記第3熱処理の最高温度は、前記第2熱処理の最高温度よりも高い
    請求項1ないし請求項3のうちの1項に記載の成膜方法。
  6. 基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成する工程と、
    前記シリコン膜上にポリシラン化合物を含有する塗布膜を形成した後に、不活性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、
    酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜を酸化シリコン膜に形成するとともに、前記シリコン膜を緻密化する工程と、
    前記酸化シリコン膜上にゲート電極を形成する工程と、
    前記ゲート電極の両側の前記シリコン膜にソース・ドレイン領域を形成する工程を有する
    半導体装置の製造方法。
  7. 基板上にシリコン膜を形成し、そのシリコン膜を活性層に用いた薄膜トランジスタを形成する工程と、
    前記基板上に水素を含む酸化シリコン膜を形成して前記薄膜トランジスタを被覆する工程を有し、
    前記シリコン膜を形成する工程は、
    前記基板上にポリシラン化合物を含有する溶液を塗布して塗布膜を形成した後に、不活性雰囲気中で第1熱処理を行って、前記塗布膜をシリコン膜に形成し、
    前記水素を含む酸化シリコン膜を形成する工程は、
    前記基板上に前記薄膜トランジスタを被覆するようにポリシラン化合物を含有する塗布膜を形成した後に、還元性雰囲気中で第2熱処理を行って、前記塗布膜を酸化シリコン前駆体膜に形成する工程と、
    酸化雰囲気中で第3熱処理を行って、前記酸化シリコン前駆体膜から水素を含む酸化シリコン膜を形成する工程を有する
    半導体装置の製造方法。
JP2009216362A 2009-02-04 2009-09-18 成膜方法および半導体装置の製造方法 Pending JP2010206161A (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2009216362A JP2010206161A (ja) 2009-02-04 2009-09-18 成膜方法および半導体装置の製造方法
US12/694,342 US8394728B2 (en) 2009-02-04 2010-01-27 Film deposition method and manufacturing method of semiconductor device
CN2010101055982A CN101800176B (zh) 2009-02-04 2010-01-28 膜沉积方法和半导体器件的制造方法

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2009023219 2009-02-04
JP2009216362A JP2010206161A (ja) 2009-02-04 2009-09-18 成膜方法および半導体装置の製造方法

Publications (1)

Publication Number Publication Date
JP2010206161A true JP2010206161A (ja) 2010-09-16

Family

ID=42398047

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2009216362A Pending JP2010206161A (ja) 2009-02-04 2009-09-18 成膜方法および半導体装置の製造方法

Country Status (3)

Country Link
US (1) US8394728B2 (ja)
JP (1) JP2010206161A (ja)
CN (1) CN101800176B (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2012043363A1 (ja) * 2010-09-28 2012-04-05 エスアイアイ・ナノテクノロジー株式会社 荷電粒子ビーム装置、薄膜作製方法、欠陥修正方法及びデバイス作製方法
JP2017063178A (ja) * 2015-09-25 2017-03-30 三星エスディアイ株式会社Samsung SDI Co., Ltd. シリカ膜の製造方法、シリカ膜および電子素子

Families Citing this family (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2541616B1 (en) * 2010-02-25 2016-05-04 Sanki Dengyo Co., Ltd. Method for manufacturing solar cell using silicon powder
DE102010041842A1 (de) * 2010-10-01 2012-04-05 Evonik Degussa Gmbh Verfahren zur Herstellung höherer Hydridosilanverbindungen
DE102013010102A1 (de) 2013-06-18 2014-12-18 Evonik Industries Ag Formulierungen umfassend Hydridosilane und Hydridosilan-Oligomere, Verfahren zu ihrer Herstellung und ihrer Verwendung
DE102013010101A1 (de) 2013-06-18 2014-12-18 Evonik Industries Ag Formulierungen umfassend Hydridosilane und Hydridosilan-Oligomere, Verfahren zu ihrer Herstellung und ihrer Verwendung
DE102013010099B4 (de) * 2013-06-18 2015-07-09 Evonik Industries Ag Verfahren zur Herstellung strukturierter Beschichtungen, mit dem Verfahren hergestellte strukturierte Beschichtungen und ihre Verwendung
US11091649B2 (en) 2013-09-05 2021-08-17 Jiangsu Nata Opto-Electronic Materials Co. Ltd. 2,2,4,4-tetrasilylpentasilane and its compositions, methods and uses
TWI634073B (zh) 2013-09-05 2018-09-01 道康寧公司 2,2,4,4-四矽基五矽烷及其組成物、方法及用途
CN107507799B (zh) * 2013-11-06 2021-01-26 应用材料公司 溶胶凝胶涂布的支撑环
US9818607B2 (en) * 2014-07-18 2017-11-14 The Hong Kong University Of Science And Technology Metal-induced crystallization of amorphous silicon in an oxidizing atmosphere
NL2013288B1 (en) * 2014-07-31 2016-09-21 Univ Delft Tech Low-temperature formation of silicon and silicon oxide structures.
US10752507B2 (en) 2018-10-11 2020-08-25 L'Air Liquide, Société Anonyme pour l'Etude et l'Exploitation des Procédés Georges Claude Process for producing liquid polysilanes and isomer enriched higher silanes
US11401166B2 (en) 2018-10-11 2022-08-02 L'Air Liaquide, Société Anonyme pour l'Etude et l'Exploitation des Procédés Georges Claude Process for producing isomer enriched higher silanes
US11097953B2 (en) 2018-10-11 2021-08-24 L'Air Liquide, Société Anonyme pour l'Etude et l'Exploitation des Procédés Georges Claude Process for producing liquid polysilanes and isomer enriched higher silanes
CN109467880B (zh) * 2018-10-31 2024-01-12 江苏科化新材料科技有限公司 一种提高环氧树脂组合物封装的半导体器件可靠性的方法
CN111118944B (zh) * 2019-12-13 2021-09-07 广西大学 一种纤维素复合氧化硅超疏水材料及其制备方法
JP2024544635A (ja) * 2021-11-30 2024-12-03 メルク パテント ゲゼルシャフト ミット ベシュレンクテル ハフツング ケイ素含有膜形成組成物、およびそれを用いたケイ素含有膜の製造方法

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001308020A (ja) * 2000-04-19 2001-11-02 Jsr Corp シリコン膜およびそのパターン形成方法
JP2003055556A (ja) * 2001-08-14 2003-02-26 Jsr Corp シリコン膜またはシリコン酸化膜の形成方法およびそのための組成物
JP2007103611A (ja) * 2005-10-03 2007-04-19 Seiko Epson Corp 半導体装置、半導体装置の製造方法、電気光学装置、および電子機器
JP2007142021A (ja) * 2005-11-16 2007-06-07 Seiko Epson Corp 順スタガ構造薄膜トランジスタの製造方法
JP2007250954A (ja) * 2006-03-17 2007-09-27 Seiko Epson Corp 半導体装置の製造方法、電気光学装置の製造方法、及び電子機器の製造方法

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002246384A (ja) 2001-02-21 2002-08-30 Jsr Corp シリコン酸化膜の形成方法および形成用組成物
KR100627203B1 (ko) * 2001-08-14 2006-09-22 제이에스알 가부시끼가이샤 실란 조성물, 실리콘막의 형성법 및 태양 전지의 제조법
JP2005260040A (ja) * 2004-02-12 2005-09-22 Sony Corp ドーピング方法、半導体装置の製造方法および電子応用装置の製造方法

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001308020A (ja) * 2000-04-19 2001-11-02 Jsr Corp シリコン膜およびそのパターン形成方法
JP2003055556A (ja) * 2001-08-14 2003-02-26 Jsr Corp シリコン膜またはシリコン酸化膜の形成方法およびそのための組成物
JP2007103611A (ja) * 2005-10-03 2007-04-19 Seiko Epson Corp 半導体装置、半導体装置の製造方法、電気光学装置、および電子機器
JP2007142021A (ja) * 2005-11-16 2007-06-07 Seiko Epson Corp 順スタガ構造薄膜トランジスタの製造方法
JP2007250954A (ja) * 2006-03-17 2007-09-27 Seiko Epson Corp 半導体装置の製造方法、電気光学装置の製造方法、及び電子機器の製造方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2012043363A1 (ja) * 2010-09-28 2012-04-05 エスアイアイ・ナノテクノロジー株式会社 荷電粒子ビーム装置、薄膜作製方法、欠陥修正方法及びデバイス作製方法
JP2012074194A (ja) * 2010-09-28 2012-04-12 Sii Nanotechnology Inc 荷電粒子ビーム装置、薄膜作製方法、欠陥修正方法及びデバイス作製方法
US9257273B2 (en) 2010-09-28 2016-02-09 Hitachi High-Tech Science Corporation Charged particle beam apparatus, thin film forming method, defect correction method and device forming method
JP2017063178A (ja) * 2015-09-25 2017-03-30 三星エスディアイ株式会社Samsung SDI Co., Ltd. シリカ膜の製造方法、シリカ膜および電子素子

Also Published As

Publication number Publication date
CN101800176B (zh) 2012-05-02
US20100197102A1 (en) 2010-08-05
CN101800176A (zh) 2010-08-11
US8394728B2 (en) 2013-03-12

Similar Documents

Publication Publication Date Title
CN101800176B (zh) 膜沉积方法和半导体器件的制造方法
CN100385683C (zh) 薄膜晶体管的制造方法
JP3072000B2 (ja) 半導体装置の作製方法
CN100385682C (zh) 薄膜晶体管的制造方法
CN1560691B (zh) 半导体器件及其制造方法和有源矩阵显示器
US7052980B2 (en) Transistor manufacturing method, electrooptical apparatus and electronic apparatus
JPWO2000059041A1 (ja) 薄膜トランジスタの製造方法
US9328414B2 (en) Method of manufacturing thin film semiconductor device
US6905920B2 (en) Method for fabrication of field-effect transistor to reduce defects at MOS interfaces formed at low temperature
JPWO2000059040A1 (ja) 薄膜トランジスタの製造方法
CN103972050A (zh) 多晶硅薄膜、多晶硅薄膜晶体管及阵列基板的制备方法
TW201330112A (zh) 低溫多晶矽薄膜晶體管制造方法
JP4729881B2 (ja) 薄膜半導体装置の製造方法および薄膜半導体装置
TWI773844B (zh) 薄膜電晶體及其製造方法
JPH08125197A (ja) 半導体装置の作製方法および半導体装置の作製装置
JP4337554B2 (ja) 半導体装置の製造方法
JP4461731B2 (ja) 薄膜トランジスタの製造方法
JP4337555B2 (ja) 半導体装置の製造方法
JP5199954B2 (ja) 半導体装置の製造方法
US10748759B2 (en) Methods for improved silicon nitride passivation films
JP2002208707A (ja) 薄膜トランジスタの製造方法
JPH0855995A (ja) 半導体装置およびその作製方法
CN100386690C (zh) 在液晶显示器中形成薄膜晶体管的方法
JP2002237598A (ja) 薄膜トランジスタの製造方法
Tanaka et al. Solution-processed silicon films and transistors using novel liquid silicon materials

Legal Events

Date Code Title Description
RD02 Notification of acceptance of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7422

Effective date: 20110714

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20120820

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20130111

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20130205

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130401

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20130702