JP2007151341A - Standby circuit - Google Patents
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Abstract
【課題】電気回路の待機電力を少なくし、かつ、メインの電源への影響を少なくする。
【解決手段】待機中に電圧の監視や負荷の駆動処理を行うマイクロプロセッサＵ１と、そのマイクロプロセッサＵ１へ電力を供給するＤＣ−ＤＣスイッチングレギュレータＰＵ１間にサブキャパシタＣ１を設ける。また、インターバルタイマＴを設けて、待機中にシャットダウン状態のマイクロプロセッサＵ１を起動して、所定の間隔で電圧の監視や負荷の駆動処理を行わせる。このように電圧の監視や負荷の駆動処理時以外はマイクロプロセッサＵ１を省エネ状態にして待機電力の低減を図る。また、この待機中に消費する電力は、サブキャパシタＣ１に蓄えた電荷（電力）を使用し、この電荷の充電は、通常の作動中（太陽電池Ｓによる充電中）に、前記スイッチングレギュレータＰＵ１の出力の一部を用いて行うことにより、電気回路の待機電力を少なくし、かつ、メインの電源への影響を少なくする。
【選択図】図１The standby power of an electric circuit is reduced and the influence on a main power supply is reduced.
A sub-capacitor C1 is provided between a microprocessor U1 that monitors voltage and drives a load during standby and a DC-DC switching regulator PU1 that supplies power to the microprocessor U1. In addition, an interval timer T is provided to start the microprocessor U1 in the shutdown state during standby so that voltage monitoring and load driving processing are performed at predetermined intervals. As described above, the standby power is reduced by putting the microprocessor U1 in an energy saving state except during the voltage monitoring and the load driving process. Further, the electric power consumed during the standby uses the electric charge (electric power) stored in the sub-capacitor C1, and this electric charge is charged by the switching regulator PU1 during normal operation (charging by the solar cell S). By using a part of the output, the standby power of the electric circuit is reduced and the influence on the main power supply is reduced.
[Selection] Figure 1
Description
この発明は、待機電力の最小化を図った待機回路に関するものである。 The present invention relates to a standby circuit that minimizes standby power.
電気回路の待機電力を少なくすることは有用である。待機電力を少なくすれば省エネに寄与することができる。また、蓄電池や蓄電キャパシタを電源とするものでは、稼働時間を延ばすこともできる。 It is useful to reduce the standby power of the electric circuit. Reducing standby power can contribute to energy saving. Moreover, in the case of using a storage battery or a storage capacitor as a power source, the operation time can be extended.
例えば、図５（ａ）に示すような電源、太陽電池Ｓで電気二重層キャパシタ（コンデンサ）Ｃを充電するようにしたものでは、従来、電気二重層キャパシタＣから負荷Ｌへ安定化した電圧を供給するために設けたレギュレータ（ここではＤＣ−ＤＣコンバータ）Ｒの出力側に負荷コントローラＬＣを設け、負荷コントローラＬＣで負荷Ｌへの電力の供給と遮断を行う構成であった。 For example, in the case where the electric double layer capacitor (capacitor) C is charged with the power source and the solar cell S as shown in FIG. 5A, a stabilized voltage from the electric double layer capacitor C to the load L is conventionally used. A load controller LC is provided on the output side of a regulator (here, a DC-DC converter) R provided for supply, and power is supplied to and cut off from the load L by the load controller LC.
そのため、レギュレータＲは、負荷（この場合、照明灯）Ｌがオフ（消灯）の場合でも作動させて負荷コントローラＬＣへ電力を供給し、負荷コントローラＬＣが負荷Ｌへの電力の供給を再開できるようにしておかねばならず、待機電力が大きくなる問題があった。 Therefore, the regulator R is operated even when the load (in this case, the illuminating lamp) L is off (extinguished) to supply power to the load controller LC so that the load controller LC can resume supplying power to the load L. There is a problem that standby power is increased.
この問題を解決する一つの方法として、例えば特許文献１では、図５（ｂ）に示すように、レギュレータＲの入力側に負荷コントローラＬＣを設け、負荷コントローラＬＣにより、負荷Ｌへの電力の供給が必要なときにのみ、レギュレータＲへ電力を供給して作動させるようにしていた。このとき、負荷コントローラＬＣへの電力の供給は、内蔵電源（定電圧回路）を設けて、電気二重層キャパシタＣから直接給電するようにしていた。
上記の図５（ｂ）のように、ＤＣ−ＤＣコンバータの入力側に負荷コントローラＬＣを設けたものでは、待機中にレギュレータＲを作動しなくても良いので、待機電力の大幅な削減が期待できる。 As shown in FIG. 5B, in the case where the load controller LC is provided on the input side of the DC-DC converter, it is not necessary to operate the regulator R during standby, so a significant reduction in standby power is expected. it can.
しかしながら、上記のように電気二重層キャパシタＣを待機中の負荷コントローラＬＣの電源として使用した場合、電気二重層キャパシタＣの電圧を低下させてしまうことになり、例えば、電気二重層キャパシタＣの充電量が想定された充電量を下回ると（図５の例では、天候の状態によって想定された発電量が得られない場合がある）、電気二重層キャパシタＣを電源とする全ての回路の使用に支障を来たす問題がある。 However, when the electric double layer capacitor C is used as a power source for the standby load controller LC as described above, the voltage of the electric double layer capacitor C is reduced. For example, the electric double layer capacitor C is charged. When the amount falls below the assumed charge amount (in the example of FIG. 5, the assumed power generation amount may not be obtained depending on the weather condition), all the circuits using the electric double layer capacitor C as a power source are used. There is a problem that causes trouble.
そこで、この発明が解決しようとする課題は、電気回路の待機電力を少なくし、かつ、メインの電源の供給電力を少なくすることである。 Therefore, the problem to be solved by the present invention is to reduce the standby power of the electric circuit and to reduce the supply power of the main power source.
上記の課題を解決するため、この発明では、待機中に所定の間隔で電圧の監視や負荷の駆動処理を行う制御部と、前記制御部へ電力を供給するレギュレータ部との間に設けられ、かつ、待機が解除された通常作動中に前記レギュレータ部から充電される蓄電池あるいは蓄電キャパシタとタイマ手段とを備え、前記タイマ手段を待機中に前記レギュレータ部に代えて前記蓄電池あるいは蓄電キャパシタの電力により作動させ、作動した前記タイマ手段からの出力信号により待機中の前記制御部が所定の間隔で電圧の監視や負荷の駆動処理を前記蓄電池あるいは蓄電キャパシタの電力により行うようにした構成を採用したものである。 In order to solve the above-described problems, in the present invention, provided between a control unit that performs voltage monitoring and load driving processing at predetermined intervals during standby, and a regulator unit that supplies power to the control unit, And a storage battery or a storage capacitor that is charged from the regulator unit during normal operation in which standby is released, and timer means, and the timer means is replaced with the regulator unit during standby by the power of the storage battery or storage capacitor. A configuration is adopted in which the control unit that is in operation and that is on standby by the output signal from the operated timer means performs voltage monitoring and load drive processing at predetermined intervals by the power of the storage battery or storage capacitor It is.
このような構成を採用することにより、待機中は、タイマ手段がタイムアップして制御部を起動し、所定の間隔で電圧の監視や負荷の駆動処理を行わせることにより待機電力の低減を図る。また、この待機中に、タイマ手段と制御部（定期的に電圧の監視や負荷の駆動処理を実施）を作動するための電力は、これ専用に設けた蓄電池あるいは蓄電キャパシタに、レギュレータ部から充電した電力によって賄う。さらに、この充電は、電圧が低下したときのみレギュレータ部を介して蓄電池あるいは蓄電キャパシタに対して行われるため、レギュレータ部自身で消費する動作電力を低減し、メインの電源からレギュレータ部に供給する電力を少なくできる。 By adopting such a configuration, during standby, the timer means times up to start the control unit, and voltage monitoring and load driving processing are performed at predetermined intervals to reduce standby power. . Also, during this standby period, the power for operating the timer means and the control unit (which periodically performs voltage monitoring and load drive processing) is charged from the regulator unit to a dedicated storage battery or storage capacitor. Will be covered by electricity. Furthermore, since this charging is performed to the storage battery or the storage capacitor via the regulator unit only when the voltage drops, the operating power consumed by the regulator unit itself is reduced, and the power supplied from the main power source to the regulator unit Can be reduced.
また、このとき、上記制御部が待機中に所定の間隔で前記蓄電池あるいは蓄電キャパシタの電圧を監視し、前記電圧が所定の電圧以下に低下すると、前記レギュレータ部を作動させて前記蓄電池あるいは蓄電キャパシタの充電を行う構成を採用することができる。 At this time, the control unit monitors the voltage of the storage battery or the storage capacitor at a predetermined interval during standby, and when the voltage drops below a predetermined voltage, the regulator unit is operated to operate the storage battery or the storage capacitor. It is possible to adopt a configuration that performs charging.
このような構成を採用することにより、待機中に蓄電池あるいは蓄電キャパシタの電圧が低下すると、充電を行って電圧の監視や負荷の駆動処理を継続できる。また、この充電により、蓄電池あるいは蓄電キャパシタの電圧が所定の電圧に復帰すれば、レギュレータ部からの充電は停止するので、メインの電源の供給電力を最小限に抑えることができる。 By adopting such a configuration, when the voltage of the storage battery or the storage capacitor decreases during standby, charging can be performed to continue voltage monitoring and load driving processing. In addition, when the voltage of the storage battery or the storage capacitor returns to a predetermined voltage due to this charging, the charging from the regulator unit is stopped, so that the power supplied from the main power source can be minimized.
なお、上記所定の間隔あるいは所定の電圧とは、回路構成や回路によって作動される負荷の特性などに応じて実験や経験から決められるものである。 The predetermined interval or the predetermined voltage is determined from experiments and experiences according to the circuit configuration and the characteristics of the load operated by the circuit.
この発明は、以上のように構成したことにより、待機電力を少なくし、かつ、メインの電源への影響を少なくできる。そのため、省エネに寄与することができるとともに、蓄電池や蓄電キャパシタを電源とするものでは、稼働時間を延ばすこともできる。 Since the present invention is configured as described above, standby power can be reduced and the influence on the main power supply can be reduced. Therefore, it can contribute to energy saving, and the operation time can be extended with a battery or a storage capacitor as a power source.
以下、この発明を実施するための最良の形態を図面に基づいて説明する。 The best mode for carrying out the present invention will be described below with reference to the drawings.
図１に示すものは、実施形態の１つとして、電源に太陽電池Ｓと電気二重層キャパシタＣを採用した自動散水システムの回路に、本願の待機回路を採用したものである。 As shown in FIG. 1, as one embodiment, the standby circuit of the present application is adopted as a circuit of an automatic watering system that employs a solar cell S and an electric double layer capacitor C as a power source.
この自動散水システムの回路は、蓄電部１、レギュレータ部２、制御部３および負荷回路４で構成されており、その回路に待機回路用の電気二重層キャパシタ（以下、サブキャパシタ）Ｃ１及びインターバルタイマＴを備えた構成となっている。
The circuit of this automatic watering system is composed of a
蓄電部１は、太陽電池Ｓと大容量の電気二重層キャパシタ（以下、メインキャパシタ）Ｃとで構成される散水システム全体を駆動するための電源で、太陽電池Ｓは逆流防止用ダイオードを介してメインキャパシタＣに接続してある。また、その太陽電池Ｓと接続されたメインキャパシタの出力は、レギュレータ部２と負荷回路４とに接続されている。
The
レギュレータ部２は、オン・オフを制御すると共に、シャットダウン信号入力機能を有するＤＣ−ＤＣスイッチングレギュレータＰＵ１からなり、蓄電部１の出力電圧を制御部３の各回路の駆動電圧Ｖｃｃに昇圧あるいは降圧する。この昇圧あるいは降圧した前記スイッチングレギュレータＰＵ１の出力は、逆流防止用のダイオードを介して待機回路用のサブキャパシタＣ１及びインターバルタイマＴと制御部３へ供給するようになっている。
The regulator unit 2 includes a DC-DC switching regulator PU1 that controls on / off and also has a shutdown signal input function, and boosts or lowers the output voltage of the
制御部３は、入出力ポート、メモリ（ＲＡＭ、ＲＯＭ）回路、クロック回路及びＡ／Ｄコンバータ入力などの周辺機能を備えた１チップのマイクロプロセッサＵ１からなり、例えば、シャットダウンなどの省電力モードを備えたものを採用している。 The control unit 3 includes a one-chip microprocessor U1 having peripheral functions such as an input / output port, a memory (RAM, ROM) circuit, a clock circuit, and an A / D converter input. We use what we have.
このシャットダウンモードは、ＳＬＥＥＰ命令の実行により、クロック回路も含めた機能の動作を停止して消費電力の低減を図るものである。このシャットダウンモードからの復帰は、割り込みあるいはハードウェアリセットにより行う。そして、この割り込みによる復帰を行った際には、内部レジスタ及びメモリの内容は保存される。 This shutdown mode is intended to reduce the power consumption by stopping the operation of the functions including the clock circuit by executing the SLEEP instruction. The return from the shutdown mode is performed by interruption or hardware reset. Then, when the return by this interruption is performed, the contents of the internal register and the memory are saved.
一方、このマイクロプロセッサＵ１のＡ／Ｄコンバータ入力は、蓄電部１のメインキャパシタＣとレギュレータ部２のサブキャパシタＣ１とを接続することにより、両キャパシタＣ、Ｃ１の電圧を検出できるようにしてある。
On the other hand, the A / D converter input of the microprocessor U1 can detect the voltages of both capacitors C and C1 by connecting the main capacitor C of the
また、マイクロプロセッサＵ１の出力ポートを前記スイッチングレギュレータＰＵ１のシャットダウン信号入力と接続して、前記スイッチングレギュレータＰＵ１のオンとオフの制御を行うようにしてある。さらに、出力ポートと負荷回路４とを接続することにより、負荷回路４の制御も行うようにしてある。 Further, the output port of the microprocessor U1 is connected to the shutdown signal input of the switching regulator PU1, and the switching regulator PU1 is controlled to be turned on and off. Further, the load circuit 4 is controlled by connecting the output port and the load circuit 4.
サブキャパシタＣ１は、図１のように、制御部３と前記レギュレータ部２との間に充放電用の回路を介して接続し、サブキャパシタＣ１に充電した電力を制御部３へ供給できるようにしてある。 As shown in FIG. 1, the sub-capacitor C1 is connected between the control unit 3 and the regulator unit 2 through a charge / discharge circuit so that the power charged in the sub-capacitor C1 can be supplied to the control unit 3. It is.
この充放電用の回路は、サブキャパシタＣ１への充電電流制限用の抵抗Ｒと、ダイオードＤを並列に接続した並列回路からなるもので、前記ダイオードＤは、サブキャパシタＣ１の放電時にオンとなって、電流制限抵抗Ｒによる損失の低減を図るものである。このサブキャパシタＣ１の出力は、先に述べたとおりマイクロコンピュータＵ１のＡ／Ｄコンバータ入力と接続されている。 This charging / discharging circuit is composed of a parallel circuit in which a charging current limiting resistor R to the sub-capacitor C1 and a diode D are connected in parallel. The diode D is turned on when the sub-capacitor C1 is discharged. Thus, the loss due to the current limiting resistor R is reduced. The output of the sub capacitor C1 is connected to the A / D converter input of the microcomputer U1 as described above.
インターバルタイマＴは、例えば、マイクロプロセッサＵ１の割込み入力ポートと接続され、一定間隔で割込み信号を発生して割込み処理をさせるものである。また、このインターバルタイマＴは、マイクロプロセッサＵ１とも接続され、タイマ間隔などを設定できるようにしてある。 The interval timer T is connected to, for example, an interrupt input port of the microprocessor U1, and generates an interrupt signal at a constant interval to perform interrupt processing. The interval timer T is also connected to the microprocessor U1 so that the timer interval can be set.
負荷回路４は、散水用のモータＭとその駆動回路Ｄｒｖ及びエラー出力用のリレー回路ＲＬとで構成されている。前記散水用のモータＭの駆動回路Ｄｒｖは、図１のようにマイクロプロセッサＵ１の２つの出力ポート（モータ正転信号および逆転信号）と接続され、モータＭを正回転あるいは逆回転させる。 The load circuit 4 includes a watering motor M, a driving circuit Drv thereof, and an error output relay circuit RL. As shown in FIG. 1, the drive circuit Drv of the watering motor M is connected to two output ports (motor forward rotation signal and reverse rotation signal) of the microprocessor U1, and rotates the motor M forward or backward.
リレー回路ＲＬは、図１のように、マイクロプロセッサＵ１の出力ポート（例えば、シンク出力）と接続されており、エラーの際に、その旨の接点出力が得られるようにしてある。 As shown in FIG. 1, the relay circuit RL is connected to an output port (for example, a sink output) of the microprocessor U1, and a contact output to that effect is obtained in the event of an error.
なお、図１のリセット回路Ｕ３は、前記スイッチングレギュレータＰＵ１の出力に接続されており、マイクロプロセッサＵ１をパワーオンリセットできるようにしてある。 The reset circuit U3 in FIG. 1 is connected to the output of the switching regulator PU1 so that the microprocessor U1 can be power-on reset.
この実施形態は、上記のように構成されており、以下に、前記回路の待機時の動作を述べ、この発明の待機回路について詳しく説明する。 This embodiment is configured as described above. Hereinafter, the operation of the circuit during standby will be described, and the standby circuit of the present invention will be described in detail.
図１の回路では、待機状態に移行する前に、例えば蓄電部１の太陽電池ＳがメインキャパシタＣに充電している間に、レギュレータ部２の前記スイッチングレギュレータＰＵ１を作動して、サブキャパシタＣ１を充電する。その際、サブキャパシタＣ１の電圧をマイクロプロセッサＵ１が監視して、サブキャパシタＣ１が満充電に達すると、前記スイッチングレギュレータＰＵ１をオフにする。そして、マイクロプロセッサＵ１自身もシャットダウンモードに移行する。この後は、サブキャパシタＣ１に充電した電荷でマイクロプロセッサＵ１を動作させることになる。
In the circuit of FIG. 1, before shifting to the standby state, the switching regulator PU1 of the regulator unit 2 is operated, for example, while the solar cell S of the
すなわち、図２に示す通り、マイクロプロセッサＵ１がシャットダウンモードに移行した状態で、インターバルタイマＴによる割込み信号を受信すると、マイクロプロセッサＵ１は通常モードに復帰し、サブキャパシタＣ１の電圧をチェックする。この時、サブキャパシタＣ１が監視最低電圧ＶＤ以下であれば満充電電圧ＶＵに達するまでサブキャパシタＣ１を充電した後、マイクロプロセッサＵ１はシャットダウンモードに移行する。また、サブキャパシタＣ１の電圧が監視最低電圧ＶＤより高ければマイクロプロセッサＵ１はすぐにシャットダウンモードに移行する。以後、この動作を繰り返す。 That is, as shown in FIG. 2, when the interrupt signal from the interval timer T is received while the microprocessor U1 is in the shutdown mode, the microprocessor U1 returns to the normal mode and checks the voltage of the sub capacitor C1. In this case, after charging the sub-capacitor C1 to the sub capacitor C1 reaches the full charge voltage V U If less monitoring minimum voltage V D, the microprocessor U1 is moving into a shutdown mode. Further, the microprocessor U1 is higher than the voltage monitoring minimum voltage V D of the sub capacitor C1 immediately enter shutdown mode. Thereafter, this operation is repeated.
このようにして、電圧の監視処理時以外はマイクロプロセッサＵ１を省エネ状態にして、待機電力の低減を図る。また、この待機中に、消費する電力は、サブキャパシタＣ１に蓄えた電荷を使用する。なお、この電荷の充電は、通常の作動中（太陽電池Ｓによる充電中）に前記スイッチングレギュレータＰＵ１の出力の一部を用いて行うため、メインキャパシタＣの蓄電電力低下を防止することができる。 In this way, the standby power is reduced by putting the microprocessor U1 in an energy saving state except during the voltage monitoring process. Further, during this standby, the electric power consumed uses the electric charge stored in the sub capacitor C1. Note that this charge charge is performed using a part of the output of the switching regulator PU1 during normal operation (during charging by the solar battery S), and therefore, a reduction in the stored power of the main capacitor C can be prevented.
一方、マイクロプロセッサＵ１の監視するサブキャパシタＣ１の電圧が、例えば、インターバルタイマＴやマイクロプロセッサＵ１などの電力消費で降下して、前記インターバルタイマＴやマイクロプロセッサＵ１を作動することのできる最低電圧（監視最低電圧）に達すると、マイクロプロセッサＵ１は、前記スイッチングレギュレータＰＵ１を作動してサブキャパシタＣ１を充電する。その際、サブキャパシタＣ１の電圧をマイクロプロセッサＵ１が監視し、サブキャパシタＣ１が満充電に達すると前記スイッチングレギュレータＰＵ１をオフにしたのち、マイクロプロセッサＵ１自身もシャットダウンモードへ移行する。そして、前述したように、インターバルタイマＴにより、一定時間ごとに割込み信号を発生してマイクロプロセッサＵ１をシャットダウンモードから復帰させてサブキャパシタＣ１の電圧をチェックし、電圧のチェックが終了するとマイクロプロセッサＵ１は再びシャットダウン状態に移行して、以後この動作を繰り返す。 On the other hand, the voltage of the sub-capacitor C1 monitored by the microprocessor U1 drops due to power consumption of the interval timer T, the microprocessor U1, etc., for example, and the minimum voltage (that can operate the interval timer T and the microprocessor U1) ( When the minimum monitoring voltage is reached, the microprocessor U1 operates the switching regulator PU1 to charge the subcapacitor C1. At that time, the microprocessor U1 monitors the voltage of the subcapacitor C1, and when the subcapacitor C1 reaches full charge, the microprocessor U1 itself shifts to the shutdown mode after turning off the switching regulator PU1. As described above, the interval timer T generates an interrupt signal at regular intervals to return the microprocessor U1 from the shutdown mode and check the voltage of the subcapacitor C1. When the voltage check is completed, the microprocessor U1. Returns to the shutdown state and repeats this operation thereafter.
このように、待機中にサブキャパシタＣ１の電圧が低下すると、充電を行って監視処理を継続できる。また、この充電により、サブキャパシタＣ１の電圧が所定の電圧に復帰すれば、前記スイッチングレギュレータＰＵ１からの充電は停止されるので、メインキャパシタＣへの影響を最小限に抑えることができる。 As described above, when the voltage of the sub-capacitor C1 decreases during standby, charging can be performed and monitoring processing can be continued. If the voltage of the sub-capacitor C1 returns to a predetermined voltage due to this charging, the charging from the switching regulator PU1 is stopped, so that the influence on the main capacitor C can be minimized.
なお、実施形態では、サブキャパシタＣ１に電気二重層キャパシタを用いたものを示したが、これに限定されるものではなく、充電できるものであればよいので、例えば蓄電池（二次電池）を使用するようにしても良い。 In the embodiment, an electric double layer capacitor is used as the sub-capacitor C1, but the present invention is not limited to this, and any battery that can be charged is used. For example, a storage battery (secondary battery) is used. You may make it do.
同様に、メインキャパシタＣも充電できるものであればよいので、例えば蓄電池（二次電池）を使用するようにしても良い。 Similarly, as long as the main capacitor C can be charged, for example, a storage battery (secondary battery) may be used.
また、この実施形態では、蓄電部１に太陽電池Ｓと電気二重層キャパシタＣを用いたものを示したが、これに限定されるものではない。例えば、蓄電部１に太陽電池Ｓと電気二重層キャパシタＣを用いないで、通常の乾電池やＡＣアダプターで充電される二次電池を用いるようにしても構わない。
Moreover, in this embodiment, although what used the solar cell S and the electric double layer capacitor C for the
この実施例１では、サブキャパシタＣ１の電圧を監視する制御部３のマイクロプロセッサＵ１に代えて検出回路を用いたものを示す。 In the first embodiment, a detection circuit is used instead of the microprocessor U1 of the control unit 3 that monitors the voltage of the sub capacitor C1.
この検出回路は、図３に示すように、２個のコンパレータＡ１、Ａ２、２個のモノステーブルマルチバイブレータＭ・Ｍ１、Ｍ・Ｍ２、ＲＳフリップフロップ回路Ｆで構成されている。
As shown in FIG. 3, the detection circuit includes two
すなわち、２個のコンパレータＡ１、Ａ２の反転入力にサブキャパシタＣ１の出力電圧を入力し、非反転入力に、それぞれ、基準電圧として満充電電圧ＶＵと監視最低電圧ＶＤ
を入力する。また、そのコンパレータＡ１、Ａ２の出力に、それぞれ、モノステーブルマルチバイブレータＭ・Ｍ１、Ｍ・Ｍ２を接続し、そのモノステーブルマルチバイブレータＭ・Ｍ２の出力をＲＳフリップフロップ回路ＦのＲ入力と接続し、モノステーブルマルチバイブレータＭ・Ｍ１の出力を、リセット信号が一方の入力に入力されたＡＮＤ回路を介してＲＳフリップフロップ回路ＦのＳ入力に接続している。
That is, inputs the output voltage of the sub capacitor C1 to the inverting input of two comparators A1, A2, the non-inverting input, respectively, the full charge voltage V U as a reference voltage monitoring minimum voltage V D
Enter. The outputs of the comparators A1 and A2 are connected to the monostable multivibrators M · M1 and M · M2, respectively, and the outputs of the monostable multivibrator M · M2 are connected to the R input of the RS flip-flop circuit F. The outputs of the monostable multivibrators M and M1 are connected to the S input of the RS flip-flop circuit F through an AND circuit in which a reset signal is input to one input.
このようにモノステーブルマルチバイブレータＭ・Ｍ１、Ｍ・Ｍ２の出力が接続されたＲＳフリップフロップ回路Ｆの
このように構成された図３の回路では、サブキャパシタＣ１の電圧が、監視最低電圧ＶＤ以下へと変化すると、コンパレータＡ１の出力は“Ｌ”から“Ｈ”へ反転し、モノステーブルマルチバイブレータＭ・Ｍ１は、ＲＳフリップフロップ回路Ｆのセット入力Ｓが有効となる幅のパルスを出力する。 In the circuit of Figure 3 such configured as described above, the voltage of the sub-capacitor C1, when changes to the following monitoring minimum voltage V D, the output of the comparator A1 is inverted to "L" to "H", monostable multivibrator M · M1 outputs a pulse having a width in which the set input S of the RS flip-flop circuit F is valid.
そのため、図４の表に示すように、ＲＳフリップフロップ回路Ｆの
そして、充電中に、サブキャパシタＣ１の電圧が満充電電圧ＶＵ以上になると、コンパレータＡ２の出力は“Ｈ”から“Ｌ”に反転するので、モノステーブルマルチバイブレータＭ・Ｍ２からＲＳフリップフロップ回路Ｆのリセット入力Ｒが有効となる幅のパルスが出力される。 Then, during charging, the voltage of the sub-capacitor C1 becomes equal to or higher than the full charge voltage V U, the output of comparator A2 is inverted from "L" to "H", RS flip-flop circuit from the monostable multivibrator M · M2 A pulse having a width that enables the F reset input R is output.
そのため、図４の表に示すように、ＲＳフリップフロップ回路Ｆの
この発明は、サブの充電電源を設けて、待機中に消費する電力を蓄えるとともに、一定の間隔で制御部を起動するタイマ手段を備えることで、制御部で消費する電力を低減し、待機中のメインの電源の供給電力を少なくすることができる。そのため、待機時間の長い携帯電話、ＡＶ機器、監視システムなどにも利用可能である。 The present invention provides a sub charging power source to store power consumed during standby, and includes timer means for starting the control unit at regular intervals, thereby reducing power consumed by the control unit and waiting. The main power supply can be reduced. Therefore, it can also be used for mobile phones, AV devices, monitoring systems and the like having a long standby time.
１ 蓄電部
２ レギュレータ部
３ 制御部
４ 負荷回路
Ｃ１ サブキャパシタ
Ｔ インターバルタイマ
ＰＵ１ ＤＣ−ＤＣスイッチングレギュレータ
Ｕ１ マイクロプロセッサ
ＶＤ 監視最低電圧
ＶＵ 満充電電圧
1 storage unit 2 regulator portion 3 control unit 4 loads the circuit C1 sub capacitor T interval timer PU1 DC-DC switching regulator U1 Microprocessor V D monitor minimum voltage V U full charge voltage
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