JP2007019333A - Semiconductor device and manufacturing method thereof - Google Patents
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Abstract
【課題】 インダクタを備えた半導体装置において、該インダクタのインダクタンスを増大させ、特性の優れたインダクタを有する半導体装置を提供すること。
【解決手段】 本発明の半導体装置は、少なくとも一面に電極が設けられた基板と、該基板の一面を被覆する絶縁樹脂層と、該絶縁樹脂層上に配された第一の磁性層と、該第一の磁性層上に配され、前記電極と電気的に接続されたインダクタと、該インダクタを覆うように配された第二の磁性層とを備え、前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されていることを特徴とする。
【選択図】 図1
PROBLEM TO BE SOLVED: To provide a semiconductor device having an inductor having an excellent characteristic by increasing the inductance of the inductor in a semiconductor device provided with an inductor.
A semiconductor device according to the present invention includes a substrate provided with an electrode on at least one surface, an insulating resin layer covering one surface of the substrate, a first magnetic layer disposed on the insulating resin layer, An inductor disposed on the first magnetic layer and electrically connected to the electrode, and a second magnetic layer disposed to cover the inductor, the first magnetic layer and the second magnetic layer The closed magnetic circuit is formed in a plane perpendicular to the direction of the current flowing in the inductor.
[Selection] Figure 1
Description
本発明は、シリコンウェハ等の半導体基材やポリイミド等の樹脂基材の上にインダクタを備えた半導体装置及びその製造方法に関する。 The present invention relates to a semiconductor device including an inductor on a semiconductor substrate such as a silicon wafer or a resin substrate such as polyimide and a method for manufacturing the same.
近年、コスト低減やチップ部品の削減を目的に、インダクタ等の誘導素子を半導体基板に集積化する傾向がある。
シリコン基板表面にスパイラルインダクタを形成する場合、このインダクタによって作り出される電磁エネルギーの一部は、配線と下側の基板との間の寄生キャパシタンスによってシリコン基板やインダクタを形成する配線において失われる(例えば、特許文献1、特許文献2参照)
上記文献において、電磁エネルギーが失われる原因のひとつは、基板とスパイラルインダクタとの距離が近いことである。そこで、ウエハレベルCSP(chip scale package)の銅めっき再配線プロセスと、厚膜樹脂を絶縁層として利用することで、インダクタと基板間の距離を大きくとり、かつ配線抵抗を小さくすることにより、高いQ値を実現したインダクタが開発されている(例えば、非特許文献1参照)。
In recent years, inductive elements such as inductors tend to be integrated on a semiconductor substrate in order to reduce costs and chip components.
When forming a spiral inductor on the surface of a silicon substrate, some of the electromagnetic energy created by the inductor is lost in the wiring that forms the silicon substrate and inductor due to the parasitic capacitance between the wiring and the underlying substrate (e.g., (See
In the above document, one of the causes for the loss of electromagnetic energy is the short distance between the substrate and the spiral inductor. Therefore, by using a wafer level CSP (chip scale package) copper plating rewiring process and using a thick film resin as an insulating layer, the distance between the inductor and the substrate is increased, and the wiring resistance is reduced. An inductor that realizes a Q value has been developed (see, for example, Non-Patent Document 1).
図9はスパイラルインダクタを有する従来の半導体装置の一例を示す図面であり、図9(a)は部分切り欠き斜視図、図9(b)は断面図である。
この半導体装置40においては、集積回路4が形成された半導体基板1の一面に集積回路(IC)の電極2およびパッシベーション膜3(絶縁層)が形成されている。さらに、半導体基板1のパッシベーション膜3の上には、第一の絶縁樹脂層41が設けられ、この第一の絶縁樹脂層41の上には、電極2と電気的に接続された下部配線層42が形成されている。さらに半導体基板1および下部配線層42の上を覆うように第二の絶縁樹脂層43が形成されており、この第二の絶縁樹脂層43の上に、誘導素子としてスパイラルインダクタ45を有する上部配線層44が設けられている。スパイラルインダクタ45は、下部配線層42を介して集積回路4の電極2と電気的に接続されている。
FIG. 9 is a drawing showing an example of a conventional semiconductor device having a spiral inductor. FIG. 9A is a partially cutaway perspective view, and FIG. 9B is a cross-sectional view.
In this
しかしながら、このような半導体装置においては、絶縁樹脂層によってインダクタが半導体基板から離れているとはいえ、まだ半導体基板内を通過する磁束が存在し、インダクタ真下には、デバイスを設置することができないことがある。
上記の問題を解決するために、メアンダタイプのインダクタも使用されているが、インダクタンス値が小さく、所望の値を満たせないことがある。また、大きなインダクタンス値を得ようとすると、インダクタのサイズが大きくなってしまう。
例えば、特開2002−45320号公報に記載のように、スパイラルインダクタに強磁性体を適用する提案もなされているが、強磁性体の体積が少なく、かつ閉磁路を形成できないため、効果が弱い。また、強磁性体を使用するため、ICプロセスが汚染されるおそれがある。
However, in such a semiconductor device, although the inductor is separated from the semiconductor substrate by the insulating resin layer, there is still a magnetic flux passing through the semiconductor substrate, and the device cannot be installed directly under the inductor. Sometimes.
In order to solve the above problem, meander type inductors are also used. However, the inductance value is small and a desired value may not be satisfied. Further, when trying to obtain a large inductance value, the size of the inductor becomes large.
For example, as described in JP-A-2002-45320, a proposal has been made to apply a ferromagnetic material to a spiral inductor, but the effect is weak because the volume of the ferromagnetic material is small and a closed magnetic circuit cannot be formed. . Further, since the ferromagnetic material is used, the IC process may be contaminated.
さらに、上記のような従来のオンチップインダクタでは、その特徴である小型ゆえに、インダクタンス値は低い値しか得ることができない。
ここでインダクタのインダクタンス値を計算する際に用いられる代表的なソレノイドモデルの計算式を式(1)に示す。
Further, the conventional on-chip inductor as described above can obtain only a low inductance value because of its small size.
Formula (1) shows a calculation formula of a typical solenoid model used when calculating the inductance value of the inductor.
ここで、k:長岡係数、μ0:真空の透磁率、μr:軸材の透磁率、A:コイルの断面積、n:コイルの単位長さ当たりの巻き数、l:コイル軸方向の長さ、である。
インダクタンス値を上昇させるには、(a)コイルの断面積を大きくする、(b)コイルの巻き数を増やす、(c)コイル軸方向の長さを長くする、以上の手段が考えられるが、チップサイズの小型化であること、WL−CSP技術で作製可能な素子形状がほぼ2次元であり断面積と長さを同時に稼ぐことが難しいこと、巻き数を増やすと直列抵抗の増加が支配的となることより、オンチップ・インダクタでインダクタンス値を稼ぐには限界があり、その値は約数nHから数十nHであった。したがって、DC−DCコンバータ等、大きなインダクタンス値が必要となる用途においては、オンチップ・インダクタが使用できないという問題がある。
Where k: Nagaoka coefficient, μ 0 : vacuum permeability, μ r : shaft permeability, A: coil cross-sectional area, n: number of turns per unit length of coil, l: coil axial direction Length.
In order to increase the inductance value, (a) the cross-sectional area of the coil is increased, (b) the number of turns of the coil is increased, (c) the length in the coil axial direction is increased. The chip size is small, the element shape that can be fabricated with WL-CSP technology is almost two-dimensional, and it is difficult to increase the cross-sectional area and the length at the same time. Therefore, there is a limit to increasing the inductance value with the on-chip inductor, and the value is about several nH to several tens nH. Therefore, there is a problem that an on-chip inductor cannot be used in applications that require a large inductance value, such as a DC-DC converter.
近年、インダクタのサイズを大きくすることなくインダクタンス値を上昇させるために、μrの大きな磁気材料を利用した磁気素子が開発されてきている(例えば、特許文献3)。これらの磁気素子は、平面インダクタを磁性層でサンドイッチした構造となっており、磁性層とコイルを形成する配線導体の間に絶縁層を形成し電流の漏洩による損失を減らす構造としている。
しかしこの構造では、図10に示すように隣り合う配線間に生じる磁場がお互いに打ち消しあう方向に生じるので、その結果インダクタンス値の低下に繋がる。また、従来のオンチップ・インダクタと比較して、上下にそれぞれ磁性層と絶縁層を成膜する必要があるために、工程の増加、コスト増加や歩留まり低下等の問題が生じる。それに加えて、この構造では上下の磁性体膜間にある隙間から磁気が漏洩し、以上の結果としてインダクタンスの大幅な上昇は期待できない。
However, in this structure, as shown in FIG. 10, magnetic fields generated between adjacent wirings are generated in directions that cancel each other, resulting in a decrease in inductance value. In addition, compared with a conventional on-chip inductor, it is necessary to form a magnetic layer and an insulating layer on the upper and lower sides, respectively, which causes problems such as an increase in process, an increase in cost, and a decrease in yield. In addition, in this structure, magnetism leaks from the gap between the upper and lower magnetic films, and as a result, a significant increase in inductance cannot be expected.
本発明は、上記事情に鑑みてなされたものであり、インダクタを備えた半導体装置において、該インダクタのインダクタンスを増大させ、特性の優れたインダクタを有する半導体装置を提供することを目的とする。また、本発明は、インダクタンスが高く、特性の優れたインダクタを有する半導体装置の製造方法を提供することを目的とする。 The present invention has been made in view of the above circumstances, and an object of the present invention is to provide a semiconductor device including an inductor having an excellent characteristic by increasing the inductance of the inductor in a semiconductor device including the inductor. Another object of the present invention is to provide a method for manufacturing a semiconductor device having an inductor with high inductance and excellent characteristics.
本発明の請求項1に係る半導体装置は、少なくとも一面に電極が設けられた基板と、該基板の一面を被覆する絶縁樹脂層と、該絶縁樹脂層上に配された第一の磁性層と、該第一の磁性層上に配され、前記電極と電気的に接続されたインダクタと、該インダクタを覆うように配された第二の磁性層とを備えた半導体装置であって、前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されていることを特徴とする。
本発明の請求項2に係る半導体装置は、請求項1において、前記インダクタは、メアンダ形状またはスパイラル形状であることを特徴とする。
本発明の請求項3に係る半導体装置は、請求項1または2において、前記インダクタを構成する配線間の空隙が、絶縁樹脂で満たされていることを特徴とする。
本発明の請求項4に係る半導体装置の製造方法は、少なくとも一面に電極が設けられた基板と、該基板の一面を被覆する絶縁樹脂層と、該絶縁樹脂層上に配された第一の磁性層と、該第一の磁性層上に配され、前記電極と電気的に接続されたインダクタと、該インダクタを覆うように配された第二の磁性層とを備え、前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されている半導体装置の製造方法であって、前記第一の磁性層上に、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されるように、該第一の磁性層と接触して第二の磁性層を形成することを特徴とする。
本発明の請求項5に係る半導体装置は、少なくとも一面に電極が設けられた基板と、該基板の一面を被覆する磁性層と、 該磁性層上に配され、前記電極と電気的に接続されたインダクタとを備えた半導体装置であって、前記磁性層は、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上であることを特徴とする。
本発明の請求項6に係る半導体装置は、請求項5において、前記インダクタを覆うように配された第二の磁性層を備え、前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されていること特徴とする。
本発明の請求項7に記載の半導体装置は、請求項5または6において、前記インダクタは、メアンダ形状またはスパイラル形状であることを特徴とする。
本発明の請求項8に記載の半導体装置の製造方法は、少なくとも一面に電極が設けられた基板と、該基板の一面を被覆する磁性層と、前記磁性層上に配され、前記電極と電気的に接続されたインダクタとを備え、前記磁性層は、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上である半導体装置の製造方法であって、前記基板の一面に、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上の磁性層を形成する工程と、前記磁性層上に、インダクタを直接形成する工程とを順に備えることを特徴とする。
According to a first aspect of the present invention, there is provided a semiconductor device comprising: a substrate provided with an electrode on at least one surface; an insulating resin layer covering one surface of the substrate; and a first magnetic layer disposed on the insulating resin layer. A semiconductor device comprising: an inductor disposed on the first magnetic layer and electrically connected to the electrode; and a second magnetic layer disposed to cover the inductor. One magnetic layer and the second magnetic layer are in contact with each other, and a closed magnetic circuit is formed in a plane perpendicular to the direction of current flowing in the inductor.
According to a second aspect of the present invention, in the semiconductor device according to the first aspect, the inductor has a meander shape or a spiral shape.
A semiconductor device according to a third aspect of the present invention is characterized in that, in the first or second aspect, a gap between wirings constituting the inductor is filled with an insulating resin.
According to a fourth aspect of the present invention, there is provided a method for manufacturing a semiconductor device, comprising: a substrate provided with an electrode on at least one surface; an insulating resin layer covering the one surface of the substrate; and a first disposed on the insulating resin layer. A magnetic layer; an inductor disposed on the first magnetic layer and electrically connected to the electrode; and a second magnetic layer disposed so as to cover the inductor; A method of manufacturing a semiconductor device in which a closed magnetic circuit is formed in a plane perpendicular to the direction of a current flowing in the inductor, wherein the first magnetic layer and the second magnetic layer are in contact with each other Forming a second magnetic layer on the layer in contact with the first magnetic layer so that a closed magnetic circuit is formed in a plane perpendicular to the direction of the current flowing in the inductor; To do.
According to a fifth aspect of the present invention, there is provided a semiconductor device having a substrate provided with an electrode on at least one surface, a magnetic layer covering one surface of the substrate, and disposed on the magnetic layer and electrically connected to the electrode. The magnetic layer has a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more.
A semiconductor device according to a sixth aspect of the present invention is the semiconductor device according to the fifth aspect, further comprising a second magnetic layer disposed so as to cover the inductor, wherein the first magnetic layer and the second magnetic layer are in contact with each other. The closed magnetic circuit is formed in a plane perpendicular to the direction of the current flowing in the inductor.
According to a seventh aspect of the present invention, in the semiconductor device according to the fifth or sixth aspect, the inductor has a meander shape or a spiral shape.
According to an eighth aspect of the present invention, there is provided a method for manufacturing a semiconductor device, comprising: a substrate provided with an electrode on at least one surface; a magnetic layer covering one surface of the substrate; and the magnetic layer disposed on the magnetic layer. And the magnetic layer has a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more, wherein the magnetic layer is formed on one surface of the substrate. And a step of forming a magnetic layer having a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more and a step of directly forming an inductor on the magnetic layer. .
本発明では、インダクタを磁性層で被覆することで、インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路を形成することができ、かつ、半導体基板と磁束とが垂直方向に発生しない構造とすることができる。これにより、インダクタンス値の増加、またはインダクタの小型化が図れる。
また、本発明では、磁性層に抵抗値の高い材料を用いることで、インダクタと磁性層との間に絶縁層を介さないで、インダクタと磁性層とを直接積層することが可能となるので、工程を簡略化することができる。
In the present invention, by covering the inductor with the magnetic layer, a closed magnetic circuit can be formed in a plane perpendicular to the direction of the current flowing in the inductor, and the semiconductor substrate and the magnetic flux are not generated in the vertical direction. It can be a structure. As a result, the inductance value can be increased or the inductor can be downsized.
Further, in the present invention, it is possible to directly laminate the inductor and the magnetic layer without using an insulating layer between the inductor and the magnetic layer by using a material having a high resistance value for the magnetic layer. The process can be simplified.
以下、本発明に係る半導体装置の一実施形態を図面に基づいて説明する。 Hereinafter, an embodiment of a semiconductor device according to the present invention will be described with reference to the drawings.
<第一の実施形態>
図1は、本発明の半導体装置の一例を示す断面図である。
この半導体装置10においては、集積回路(図示略)が形成された半導体基板1の表面に集積回路(IC、図示略)の電極2およびパッシベーション膜3が形成されている。
さらにこの半導体装置10は、半導体基板1のパッシベーション膜3上に設けられた絶縁樹脂層11と、この絶縁樹脂層11の上に設けられた第一の磁性層12と、第一の磁性層12上に設けられた配線層13と、配線層13を被覆して設けられた第二の磁性層14とを有する。配線層13は、誘導素子として図2に示すようなメアンダ形状のインダクタ13aを有する。
<First embodiment>
FIG. 1 is a cross-sectional view showing an example of a semiconductor device of the present invention.
In this
Further, the
半導体基板1は、少なくとも表層が絶縁部(図示略)をなす基材1aの一面上に、例えば電極2としてAlパッドを設け、さらにその上にSiNまたはSiO2 等のパッシベーション膜3(不動態化による絶縁層)を形成してなるものである。このパッシベーション膜3には、電極2と整合する位置に開口部5が設けられており、この開口部5を通して電極2が露出されている。パッシベーション膜3は、例えばLP−CVD法等により形成することができ、その膜厚は例えば0.1〜0.5[μm]である。
ここでは、メアンダ形状のインダクタ13aを有する配線層13を、集積回路と電気的に接続するための電極2が、半導体基板1の表面の2箇所(図では1箇所のみ表示)に設けられている。
The
Here, the
本発明では、メアンダ形状のインダクタ13aが第一の磁性層12と第二の磁性層14とで被覆されているので、インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路を形成することができ、かつ、半導体基板1と磁束が垂直方向に発生しない構造とすることができる。これにより、インダクタンス値の増加、もしくはインダクタの小型化が図れる。
一般に、磁性材料は非磁性材料に比べて透磁率が大きく、しかも磁性層に覆われたインダクタのインダクタンスはこの透磁率に比例する。このため、インダクタを磁性層で被覆することで、大きなインダクタンスを得ることができる。
インダクタが有するインダクタンスをこの磁性層の透磁率に比例して大きくすることが可能である。したがって、比透磁率が数百程度の磁性部材(例えば、フェライトの透磁率が数百程度)を用いることによりインダクタンスを増加させることができる。
さらにフェライト等電気抵抗率の高い磁性層材料を使用することによって、配線層と磁性層を直接接触することが可能となり、工程の削減が可能となる。また、磁性膜中の渦電流損失が低減する。
In the present invention, since the meander-shaped
In general, a magnetic material has a larger magnetic permeability than a nonmagnetic material, and the inductance of an inductor covered with a magnetic layer is proportional to the magnetic permeability. For this reason, a large inductance can be obtained by covering the inductor with a magnetic layer.
It is possible to increase the inductance of the inductor in proportion to the magnetic permeability of the magnetic layer. Therefore, the inductance can be increased by using a magnetic member having a relative permeability of several hundreds (for example, the permeability of ferrite is several hundreds).
Furthermore, by using a magnetic layer material having a high electrical resistivity such as ferrite, it is possible to directly contact the wiring layer and the magnetic layer, thereby reducing the number of processes. In addition, eddy current loss in the magnetic film is reduced.
半導体基板1は、シリコンウエハ等の半導体ウエハでもよく、半導体ウエハをチップ寸法に切断(ダイシング)した半導体チップであってもよい。半導体基板1が半導体チップである場合は、まず、半導体ウエハの上に、各種半導体素子やIC、誘導素子等を複数組、形成した後、チップ寸法に切断することで複数の半導体チップを得ることができる。
The
絶縁樹脂層11は、各電極2と整合する位置に形成された開口部15を有する。絶縁樹脂層11は、例えばポリイミド樹脂、エポキシ樹脂、シリコーン樹脂等からなり、その厚さは例えば1〜30μmである。
絶縁樹脂層11は、例えば回転塗布法、印刷法、ラミネート法などにより形成することができる。また開口部15は、例えばフォトリソグラフィ技術を利用したパターニングなどにより形成することができる。
The insulating
The insulating
第一の磁性層12は、各電極3と整合する位置に形成された開口部16を有する。また、第一の磁性層12は、閉磁路を形成するため、インダクタサイズから少なくとも50μm以上大きくするとよい。
磁性層材料としては、例えばNi,Fe,Znを主成分とするフェライトや、CoNbZr等のアモルファス金属、Ni−Fe等の強磁性体金属等の各種磁性部材を用いることができ、その厚さは、例えば1〜10[μm]である。第一の磁性層は、例えばめっき法やスパッタリング法やスピンコート法、スクリーン印刷法等により形成することができる。
磁性層材料は電気抵抗が高いほうが好ましいが、低抵抗の磁性層材料を使用するときは、第一の磁性層12と配線層13との間に絶縁層を配することにより、同様の効果を得ることが可能である。
The first
As the magnetic layer material, for example, various magnetic members such as ferrite mainly composed of Ni, Fe, Zn, amorphous metal such as CoNbZr, and ferromagnetic metal such as Ni-Fe can be used. For example, 1 to 10 [μm]. The first magnetic layer can be formed by, for example, a plating method, a sputtering method, a spin coating method, a screen printing method, or the like.
The magnetic layer material preferably has a high electrical resistance. However, when a low-resistance magnetic layer material is used, the same effect can be obtained by disposing an insulating layer between the first
配線層13は、誘導素子としてのメアンダインダクタ13aを有する。
配線層13の材料としては、例えばCu等が用いられ、その厚さは例えば1〜20μmである。これにより十分な導電性が得られる。配線層13は、例えば、電解銅めっき法等のめっき法、スパッタリング法、蒸着法、または2つ以上の方法の組み合わせにより形成することができる。
The
As a material of the
第二の磁性層14は、閉磁路を形成するため、第一の磁性層12と接触するようにパターンを形成する。
第二の磁性層14は、上述したような磁性層材料を例えばめっき法やスパッタリング法により形成することができる。その厚さは、例えば、1〜10[μm]である。
磁性層材料は電気抵抗が高いほうが好ましいが、低抵抗の磁性層材料を使用するときは、配線層13と第二の磁性層14との間に絶縁層を配することにより、同様の効果を得ることが可能である。
The second
The second
The magnetic layer material preferably has a high electrical resistance. However, when a low resistance magnetic layer material is used, the same effect can be obtained by arranging an insulating layer between the
図1では、半導体基板上の誘導素子1つに対応する部分のみを図示したが、本発明は、複数の誘導素子を備えた半導体装置に適用することもできる。また、図示しないが、本発明の半導体装置には、第二の磁性層上に、必要に応じて、封止樹脂層を形成したり、さらにバンプ等の外部への出力端子等の構造物を付加することができる。 In FIG. 1, only a portion corresponding to one inductive element on the semiconductor substrate is illustrated, but the present invention can also be applied to a semiconductor device including a plurality of inductive elements. Although not shown, in the semiconductor device of the present invention, a sealing resin layer is formed on the second magnetic layer as necessary, and structures such as output terminals to the outside such as bumps are further provided. Can be added.
次に、図1に示す半導体装置の製造方法について説明する。
まず、図3(a)に示すように、集積回路(図示略)、電極2およびパッシベーション膜3を有する半導体基板1を用意する。この半導体基板1は、上述したように、基材1aの一面上に電極2とパッシベーション膜3が形成されており、パッシベーション膜3には、電極2と整合する位置に開口部5が設けられた半導体ウエハである。パッシベーション膜3は例えばLP−CVD等により形成され、その膜厚は例えば0.1〜0.5[μm]である。
Next, a method for manufacturing the semiconductor device shown in FIG. 1 will be described.
First, as shown in FIG. 3A, a
次いで、図3(b)に示すように、半導体基板1のパッシベーション膜3の上に、開口部15を有する絶縁樹脂層11を形成する。
このような絶縁樹脂層11は、例えば上記樹脂からなる膜を例えば回転塗布法、印刷法、ラミネート法などによってパッシベーション膜3の全面に成膜した後、例えばフォトリソグラフィ技術を利用したパターニングなどにより、電極2と整合する位置に開口部15を形成することによって形成することができる。
Next, as shown in FIG. 3B, an insulating
Such an insulating
次に、図3(c)に示すように、半導体基板1上に第一の磁性層12を形成する。その厚さは、例えば、1〜10[μm]である。このとき、閉磁路を形成するため、第一の磁性層12は、インダクタサイズから少なくとも50[μm]以上大きくするとよい。
第一の磁性層12は、例えば上述したような磁性材料を、めっき法やスパッタリング法により成膜することによって形成することができる。このとき、Alパッドやチップのスクライブラインを露出させる。さらに、開口部15は、例えばイオンミリングやICP−RIEによるエッチング、またはフォトリソグラフィー法やリフトオフ法によるパターニングなどにより形成される。
Next, as shown in FIG. 3C, the first
The first
次に、図3(d)に示すように、第一の磁性層12の上に配線層13を形成する。その厚さは、例えば0.1〜30[μm]である。この配線層13を所定の領域に形成する方法は、特に限定されるものではない。
Next, as shown in FIG. 3D, the
ここで、配線層13を形成する好適な方法の一例について説明する。
まず、スパッタリング法等により、電解めっき用の薄いシード層(図示略)を第一の磁性層上の全面または必要な領域に形成する。シード層は、例えばスパッタリング法により形成されたCu層およびCr層からなる積層体、またはCu層およびTi層からなる積層体である。また、無電解Cuめっき層でもよいし、蒸着法、塗布法または化学気相成長法(CVD)等により形成された金属薄膜層であってもよいし、上記の金属層形成方法を組み合わせてもよい。
Here, an example of a suitable method for forming the
First, a thin seed layer (not shown) for electrolytic plating is formed on the entire surface of the first magnetic layer or a necessary region by sputtering or the like. The seed layer is, for example, a laminated body made of a Cu layer and a Cr layer formed by a sputtering method, or a laminated body made of a Cu layer and a Ti layer. Further, it may be an electroless Cu plating layer, a metal thin film layer formed by a vapor deposition method, a coating method, a chemical vapor deposition method (CVD), or the like, or a combination of the above metal layer forming methods. Good.
次に、シード層の上に、電解めっき用のレジスト膜(図示略)を形成する。このレジスト膜には配線層13の形成すべき領域に開口部を設け、該開口部において、前記シード層を露出させておく。レジスト膜は、例えば、フィルムレジストをラミネートする方法、液体レジストを回転塗布する方法等により成膜した後、フォトリソグラフィ技術によるパターニングにより形成することができる。
そして、前記レジスト膜をマスクとして露出したシード層上に、電解めっき法等により、Cu等から構成された配線層13を形成する。このように、所望の領域に配線層13が形成された後、不要なレジスト膜およびシード層はエッチングにより除去し、配線層13が形成された領域以外の部分では第一の磁性層12が露出されるようにする(図3(d)参照)。
Next, a resist film (not shown) for electrolytic plating is formed on the seed layer. The resist film is provided with an opening in a region where the
Then, a
なお、この際、第一の磁性層12に電気抵抗が低い磁性層材料を用いる場合は、第一の磁性層12と配線層13との間に絶縁層を設置する。絶縁層の形成は、例えばSiO2 、SiNを成膜したり、絶縁性の樹脂を塗布することにより可能である。
すなわち、フェライト等電気抵抗率の高い磁性層材料を使用することによって、第一の磁性層12と配線層13とを直接積層することが可能となり、工程の削減が可能となる。ただし、第一の磁性層12と配線層13との間に合金が生じる場合は、バリヤ層として上記の絶縁層が必要になる。
At this time, when a magnetic layer material having a low electric resistance is used for the first
That is, by using a magnetic layer material having high electrical resistivity such as ferrite, the first
次に、図3(e)に示すように、第二の磁性層14を形成する。その厚さは、例えば、1〜10[μm]である。このとき、閉磁路を形成するため、第一の磁性層12と接触するようにパターンを形成する。この工程により第一の磁性層12と第二の磁性層14を接続することで、インダクタ13aを覆うように接続された閉磁路が形成されるので、外部への磁場の漏洩を抑制できる。
第二の磁性層14は、上述したような磁性材料を例えばめっき法やスパッタリング法、スピンコート法、スクリーン印刷法等により成膜することによって形成することができる。さらに、例えば、フォトリソグラフィー法やリフトオフ法によるパターニングなどにより、所定の形状にパターニングする。
なお、この際、第二の磁性層14に電気抵抗が低い磁性層材料を用いる場合は、配線層13と第二の磁性層14との間に絶縁層を形成する。絶縁層の形成は、例えばSiO2、SiNを成膜したり、絶縁性の樹脂を塗布することにより可能である。
第二の磁性層14の形成後、前記誘導素子などの各種構造物が形成された半導体ウエハを所定の寸法にダイシングすることにより、前記誘導素子がパッケージ化された半導体チップを得ることができる。
Next, as shown in FIG. 3E, the second
The second
At this time, when a magnetic layer material having a low electric resistance is used for the second
After the second
半導体装置10では、インダクタ13aが第一の磁性層12と第二の磁性層14とで被覆されているので、インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路を形成することができ、かつ、基板と磁束が垂直方向に発生しない構造とすることができる。また、インダクタの近傍に磁性層が配置されることで効率的に磁束密度が増加するので、インダクタンス値の増加、もしくはインダクタの小型化が図れる。
さらに半導体装置10では、絶縁樹脂層11を介し配線層12を形成するので、基板との距離が離れ特性が向上する。また半導体基板への汚染を低減することができる。さらに、厚膜の絶縁樹脂層11で絶縁することにより、コンタミネーションの問題も回避することが可能である。
In the
Further, in the
なお、上記半導体装置10において、図4に示すように、インダクタ13aを構成する配線間の空隙に、絶縁性樹脂19を充填させてもよい。インダクタ13aを構成する配線間の空隙に、絶縁性樹脂19を充填することにより、第二の磁性層14が、インダクタ13aを構成する配線の側面に回り込まなくなる。これにより、さらにインダクタの高性能化を図ることが可能になる。
In the
<第二の実施形態>
図5は、本発明の半導体装置の一例を示す断面図である。
なお、図5において、図1と同じ構成要素については同じ符号を付し、共通部分の詳細な説明を省略する。
この半導体装置20は、半導体基板1のパッシベーション膜3上に設けられた第一の磁性層22と、この第一の磁性層22の上に設けられた配線層23と、配線層23を被覆して設けられた第二の磁性層24とを有する。配線層23は、誘導素子としてメアンダ形状のインダクタ22aを有する。
<Second Embodiment>
FIG. 5 is a cross-sectional view showing an example of the semiconductor device of the present invention.
In FIG. 5, the same components as those in FIG.
The
本発明では、磁性層材料として、十分に抵抗値の高い材料を用いている。ここで十分に抵抗値の高いとは、配線層と磁性層との間に絶縁層を挟まなくても、インダクタを形成する配線の絶縁を取ることが可能な程度に抵抗値が高いことをいう。
磁性層材料として、十分に抵抗値の高い材料を用いることで、絶縁層を間に挟まなくても、インダクタを形成する配線の絶縁を取ることが可能となる。これによりインダクタと磁性層との間に絶縁層を介さないで、インダクタと磁性層とを直接積層することが可能となるので、工程を簡略化することができる。また、工程を簡略化することにより作製コストの削減が可能となる。また、工程を簡略化することにより歩留まりを向上することができる。
In the present invention, a material having a sufficiently high resistance value is used as the magnetic layer material. Here, the resistance value is sufficiently high means that the resistance value is high enough to insulate the wiring forming the inductor without interposing an insulating layer between the wiring layer and the magnetic layer. .
By using a material having a sufficiently high resistance value as the magnetic layer material, it is possible to insulate the wiring forming the inductor without interposing an insulating layer therebetween. As a result, the inductor and the magnetic layer can be directly laminated without interposing an insulating layer between the inductor and the magnetic layer, so that the process can be simplified. In addition, the manufacturing cost can be reduced by simplifying the process. In addition, the yield can be improved by simplifying the process.
具体的には、磁性層材料は、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上であることが好ましい。これにより、絶縁層を配さなくても、インダクタを形成する配線の絶縁を十分に取ることが可能となる。
このような磁性層材料としては、例えばNi−Zn系フェライト等が挙げられる。これによりインダクタを形成する配線の絶縁を十分に取ることが可能となるとともに、効率的な磁気誘導を実現してインダクタの特性を向上することができる。
このような磁性層の厚みは、例えば0.5〜20[μm]であることが好ましい。これによりインダクタを形成する配線の絶縁を十分に取ることが可能となる。
Specifically, the magnetic layer material preferably has a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more. This makes it possible to sufficiently insulate the wiring forming the inductor without providing an insulating layer.
Examples of such a magnetic layer material include Ni—Zn ferrite. As a result, the wiring forming the inductor can be sufficiently insulated, and efficient magnetic induction can be realized to improve the characteristics of the inductor.
The thickness of such a magnetic layer is preferably 0.5 to 20 [μm], for example. Thereby, it is possible to sufficiently insulate the wiring forming the inductor.
次に、図5に示す半導体装置の製造方法について説明する。
まず、図6(a)に示すように、集積回路(図示略)、電極2およびパッシベーション膜3を有する半導体基板1を用意する。
次に図6(b)に示すように、パッシベーション膜3上に第一の磁性層22を形成する。その厚さは、例えば、1〜10[μm]である。このとき、閉磁路を形成するため、第一の磁性層21は、インダクタサイズから少なくとも50[μm]以上大きくするとよい。
Next, a method for manufacturing the semiconductor device shown in FIG. 5 will be described.
First, as shown in FIG. 6A, a
Next, as shown in FIG. 6B, a first
次に、図6(c)に示すように、第一の磁性層22の上に配線層23を直接形成する。その厚さは、例えば0.1〜30[μm]である。
次に、図6(d)に示すように、配線層23を覆うように第二の磁性層24を直接形成する。その厚さは、例えば、1〜10[μm]である。このとき、閉磁路を形成するため、第一の磁性層22と接触するようにパターンを形成する。この工程により第一の磁性層22と第二の磁性層24を接続することにより、インダクタ23を覆うように接続された閉磁路が形成されるので、外部への磁場の漏洩を抑制できる。
Next, as shown in FIG. 6C, the
Next, as shown in FIG. 6D, the second
半導体装置20では、磁性層材料として、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上と、絶縁をとるに十分に抵抗値の高い材料を用いることで、絶縁層を介すことなく磁性層と配線層とを直接積層することが可能となるので、工程を簡略化することができる。その結果、作製コストの削減、歩留まりの向上が図れる。
また、半導体装置20では、インダクタ23が第一の磁性層21と第二の磁性層24とで被覆されているので、インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路を形成することができ、かつ、基板と磁束が垂直方向に発生しない構造とすることができる。また、インダクタ23の近傍に磁性層が配置されることで効率的に磁束密度が増加するので、インダクタンス値の増加、もしくはインダクタの小型化が図れる。
インダクタを構成する配線の上に磁性層を成膜する場合、配線を個別に磁性層で覆うことが可能となるので、配線間の磁場の打ち消しあいによる損失を解消することが可能となる。
In the
Further, in the
When the magnetic layer is formed on the wiring constituting the inductor, the wiring can be individually covered with the magnetic layer, so that loss due to cancellation of the magnetic field between the wirings can be eliminated.
以上、本発明の半導体装置について説明してきたが、本発明はこれに限定されるものではなく、発明の趣旨を逸脱しない範囲で、適宜変更が可能である。
また、上述した実施形態では、インダクタとして、メアンダ形状のインダクタを例に挙げて説明したが、本発明はこれに限定されるものではなく、図9に示すような、スパイラル形状や、他の形状のインダクタにも本発明は適用可能である。
Although the semiconductor device of the present invention has been described above, the present invention is not limited to this, and can be appropriately changed without departing from the spirit of the invention.
In the above-described embodiment, the meander-shaped inductor has been described as an example of the inductor. However, the present invention is not limited to this, and a spiral shape or other shapes as shown in FIG. The present invention can also be applied to other inductors.
第二の磁性層上に封止樹脂層(図示略)を設けてもよい。封止樹脂層は、例えばポリイミド樹脂、エポキシ樹脂、シリコーン樹脂等からなり、その厚さは例えば1〜30[μm]である。封止樹脂層には、外部への端子を出力するための開口部が設けられる。
さらに、封止樹脂層の上に、必要に応じてバンプ等の外部への出力端子等の構造物を付加することができる。
また、本発明の半導体装置では、上記構造の上にさらに配線層や磁性層等を積層させてもよい。多層構造とすることで更にインダクタンス値を上昇させることができる。
また、本発明の効果は、集積回路の形成された半導体基板上にインダクタを形成する場合だけでなく、FPCやガラス基板、セラミック基板等上にインダクタを形成する場合にも同様の効果を発揮する。
A sealing resin layer (not shown) may be provided on the second magnetic layer. The sealing resin layer is made of, for example, polyimide resin, epoxy resin, silicone resin, or the like, and the thickness thereof is, for example, 1 to 30 [μm]. The sealing resin layer is provided with an opening for outputting a terminal to the outside.
Furthermore, structures such as output terminals to the outside such as bumps can be added on the sealing resin layer as necessary.
In the semiconductor device of the present invention, a wiring layer, a magnetic layer, or the like may be further stacked on the above structure. By using a multilayer structure, the inductance value can be further increased.
The effect of the present invention is not limited to the case where an inductor is formed on a semiconductor substrate on which an integrated circuit is formed, but also when the inductor is formed on an FPC, a glass substrate, a ceramic substrate, or the like. .
(実施例1)
図1に示すように、シリコン基板である半導体基板1と、絶縁樹脂層11と、第一の磁性層12と、誘導素子としてメアンダインダクタ13aを有する配線層13と、第二の磁性層14とを有する半導体装置10を作製した。
絶縁樹脂層は、ポリイミド系の絶縁樹脂をスピンコートにより10[μm]の厚さに成膜することにより形成した。
第一および第二の磁性層は、Ni−Zn系のフェライトをスパッタリング法により10μmの厚さに成膜することにより形成した。
配線層は、電解銅めっきにより10[μm]の厚さに成膜することにより形成した。
この半導体装置10におけるインダクタンス値を測定した。その結果(◇印)を図7に示す。
Example 1
As shown in FIG. 1, a
The insulating resin layer was formed by forming a polyimide insulating resin to a thickness of 10 [μm] by spin coating.
The first and second magnetic layers were formed by depositing Ni—Zn-based ferrite to a thickness of 10 μm by sputtering.
The wiring layer was formed by forming a film with a thickness of 10 [μm] by electrolytic copper plating.
The inductance value in the
(比較例1)
磁性層を配さなかったこと以外は実施例1と同様に半導体装置を作製し、そのインダクタンス値を測定した。その結果(□印)を図7に示す。
図7より、両者を比較すると、磁性層を配した実施例1のインダクタ(◇印)は、磁性層を配さなかった比較例1のインダクタ(□印)より、約9倍ほどインダクタンス値が上昇することが分かった。
(Comparative Example 1)
A semiconductor device was fabricated in the same manner as in Example 1 except that no magnetic layer was provided, and the inductance value was measured. The result (□ mark) is shown in FIG.
From FIG. 7, when comparing the two, the inductor of Example 1 with a magnetic layer (marked with ◇) has an inductance value about nine times that of the inductor of Comparative Example 1 with no magnetic layer (marked with □). It turns out to rise.
(実施例2)
図5に示すように、シリコン基板である半導体基板1と、第一の磁性層21と、誘導素子としてメアンダインダクタを有する配線層22と、第二の磁性層23とを有する半導体装置20を作製した。
第一および第二の磁性層は、Ni−Zn系のフェライトをスパッタリング法により1μmの厚さに成膜することにより形成した。この磁性層の透磁率はμ=300、電気伝導度は2.0×10−3[Ω−1m−1]であった。
配線層は、電解銅めっきにより10μmの厚さに成膜することにより形成した。オンチップ・インダクタのサイズは2×2[mm2 ]、L/S=150/30[μm]、ターン数は3とした。
この半導体装置20におけるインダクタンス値を測定した。その結果(◇印)を図8に示す。
(Example 2)
As shown in FIG. 5, a
The first and second magnetic layers were formed by depositing Ni—Zn ferrite to a thickness of 1 μm by sputtering. The magnetic layer had a magnetic permeability of μ = 300, and an electric conductivity of 2.0 × 10 −3 [Ω −1 m −1 ].
The wiring layer was formed by forming a film with a thickness of 10 μm by electrolytic copper plating. The size of the on-chip inductor was 2 × 2 [mm 2 ], L / S = 150/30 [μm], and the number of turns was 3.
The inductance value in the
(比較例2)
第一の磁性層と配線層との間に第一の絶縁層、配線層と第二の磁性層との間に第二の絶縁層をそれぞれ配したこと以外は実施例2と同様に半導体装置を作製した。
第一および第二の絶縁層は、ポリイミド系の絶縁樹脂をスピンコートにより成膜することにより形成した。第一の絶縁層の厚みは10[μm]とした。第二の絶縁層の厚みは、インダクタのスペース部の第一の絶縁層と第二の磁性層間において20[μm]、インダクタのライン部の配線と第二の磁性層間において10[μm]とした。
この半導体装置におけるインダクタンス値を測定した。その結果(□印)を図8に示す。
図8より、両者を比較すると、磁性層と配線層との間に絶縁層を形成しなかった実施例2のインダクタ(◇印)は、磁性層と配線層との間に絶縁層を形成した比較例2(□印)のインダクタよりよりも約6%ほどインダクタンス値が上昇することが分かった。
(Comparative Example 2)
Semiconductor device as in Example 2 except that the first insulating layer is disposed between the first magnetic layer and the wiring layer, and the second insulating layer is disposed between the wiring layer and the second magnetic layer. Was made.
The first and second insulating layers were formed by depositing a polyimide insulating resin by spin coating. The thickness of the first insulating layer was 10 [μm]. The thickness of the second insulating layer was 20 [μm] between the first insulating layer and the second magnetic layer in the space portion of the inductor, and 10 [μm] between the wiring in the inductor line portion and the second magnetic layer. .
The inductance value in this semiconductor device was measured. The result (□ mark) is shown in FIG.
FIG. 8 shows a comparison between the two inductors (marked with ◇) in which the insulating layer was not formed between the magnetic layer and the wiring layer. The insulating layer was formed between the magnetic layer and the wiring layer. It was found that the inductance value increased by about 6% as compared with the inductor of Comparative Example 2 (marked by □).
本発明は、例えば誘導素子がアンテナコイルとして機能する非接触ICタグ用半導体装置など、誘導素子を有する各種半導体装置に適用できる。 The present invention can be applied to various semiconductor devices having an inductive element such as a non-contact IC tag semiconductor device in which the inductive element functions as an antenna coil.
1 半導体基板、2 電極、3 パッシベーション膜、5 開口部、10 半導体装置、11 絶縁樹脂層、12 第一の磁性層、13 配線層、13a インダクタ(誘導素子)、14 第二の磁性層。
DESCRIPTION OF
Claims (8)
該基板の一面を被覆する絶縁樹脂層と、
該絶縁樹脂層上に配された第一の磁性層と、
該第一の磁性層上に配され、前記電極と電気的に接続されたインダクタと、
該インダクタを覆うように配された第二の磁性層とを備えた半導体装置であって、
前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されていることを特徴とする半導体装置。 A substrate provided with electrodes on at least one surface;
An insulating resin layer covering one surface of the substrate;
A first magnetic layer disposed on the insulating resin layer;
An inductor disposed on the first magnetic layer and electrically connected to the electrode;
A second magnetic layer disposed so as to cover the inductor,
The semiconductor device according to claim 1, wherein the first magnetic layer and the second magnetic layer are in contact with each other, and a closed magnetic circuit is formed in a plane perpendicular to a direction of current flowing in the inductor.
前記第一の磁性層上に、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されるように、該第一の磁性層と接触して第二の磁性層を形成することを特徴とする半導体装置の製造方法。 A substrate provided with an electrode on at least one surface, an insulating resin layer covering one surface of the substrate, a first magnetic layer disposed on the insulating resin layer, and disposed on the first magnetic layer; An inductor electrically connected to the electrode, and a second magnetic layer disposed so as to cover the inductor, wherein the first magnetic layer and the second magnetic layer are in contact with each other, A method of manufacturing a semiconductor device in which a closed magnetic circuit is formed in a plane perpendicular to the direction of current flowing in an inductor,
On the first magnetic layer, a second magnetic layer is formed in contact with the first magnetic layer so that a closed magnetic circuit is formed in a plane perpendicular to the direction of the current flowing in the inductor. A method of manufacturing a semiconductor device.
該基板の一面を被覆する磁性層と、
該磁性層上に配され、前記電極と電気的に接続されたインダクタとを備えた半導体装置であって、
前記磁性層は、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上であることを特徴とする半導体装置。 A substrate provided with electrodes on at least one surface;
A magnetic layer covering one surface of the substrate;
A semiconductor device comprising an inductor disposed on the magnetic layer and electrically connected to the electrode,
The magnetic layer has a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more.
前記第一の磁性層と第二の磁性層とは接触しており、前記インダクタ中を流れる電流の向きと垂直をなす面内において閉磁路が形成されていること特徴とする請求項5に記載の半導体装置。 A second magnetic layer disposed to cover the inductor;
The first magnetic layer and the second magnetic layer are in contact with each other, and a closed magnetic circuit is formed in a plane perpendicular to the direction of current flowing in the inductor. Semiconductor device.
前記基板の一面に、そのシート抵抗が1000[Ω/sq](厚さ1000[Å])以上の磁性層を形成する工程と、
前記磁性層上に、インダクタを直接形成する工程とを順に備えることを特徴とする半導体装置の製造方法。
A substrate provided with an electrode on at least one surface; a magnetic layer covering the one surface of the substrate; and an inductor disposed on the magnetic layer and electrically connected to the electrode, the magnetic layer comprising: A method of manufacturing a semiconductor device having a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more,
Forming a magnetic layer having a sheet resistance of 1000 [Ω / sq] (thickness 1000 [Å]) or more on one surface of the substrate;
And a step of directly forming an inductor on the magnetic layer.
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Family
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2005200629A Withdrawn JP2007019333A (en) | 2005-07-08 | 2005-07-08 | Semiconductor device and manufacturing method thereof |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2007019333A (en) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008210828A (en) * | 2007-02-23 | 2008-09-11 | Casio Comput Co Ltd | Semiconductor device and manufacturing method thereof |
| CN107275039A (en) * | 2016-04-05 | 2017-10-20 | 株式会社村田制作所 | The manufacture method of electronic unit and electronic unit |
| WO2019058967A1 (en) * | 2017-09-25 | 2019-03-28 | 日東電工株式会社 | Inductor and manufacturing method for same |
| JP2020013853A (en) * | 2018-07-17 | 2020-01-23 | 株式会社村田製作所 | Inductor component |
| US20230094425A1 (en) * | 2021-09-30 | 2023-03-30 | Lapis Semiconductor Co., Ltd. | Semiconductor device and semiconductor device fabrication method |
-
2005
- 2005-07-08 JP JP2005200629A patent/JP2007019333A/en not_active Withdrawn
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008210828A (en) * | 2007-02-23 | 2008-09-11 | Casio Comput Co Ltd | Semiconductor device and manufacturing method thereof |
| CN107275039A (en) * | 2016-04-05 | 2017-10-20 | 株式会社村田制作所 | The manufacture method of electronic unit and electronic unit |
| WO2019058967A1 (en) * | 2017-09-25 | 2019-03-28 | 日東電工株式会社 | Inductor and manufacturing method for same |
| JP2019062002A (en) * | 2017-09-25 | 2019-04-18 | 日東電工株式会社 | Inductor and manufacturing method thereof |
| JP7140481B2 (en) | 2017-09-25 | 2022-09-21 | 日東電工株式会社 | Inductor and manufacturing method thereof |
| US11735355B2 (en) | 2017-09-25 | 2023-08-22 | Nitto Denko Corporation | Inductor and producing method thereof |
| JP2020013853A (en) * | 2018-07-17 | 2020-01-23 | 株式会社村田製作所 | Inductor component |
| US20230094425A1 (en) * | 2021-09-30 | 2023-03-30 | Lapis Semiconductor Co., Ltd. | Semiconductor device and semiconductor device fabrication method |
| JP2023050936A (en) * | 2021-09-30 | 2023-04-11 | ラピスセミコンダクタ株式会社 | Semiconductor device and manufacturing method of semiconductor device |
| JP7701234B2 (en) | 2021-09-30 | 2025-07-01 | ラピスセミコンダクタ株式会社 | Semiconductor device and method for manufacturing the same |
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