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JP2006310398A - 薄膜素子の製造方法、及び電子機器 - Google Patents

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JP2006310398A
JP2006310398A JP2005128261A JP2005128261A JP2006310398A JP 2006310398 A JP2006310398 A JP 2006310398A JP 2005128261 A JP2005128261 A JP 2005128261A JP 2005128261 A JP2005128261 A JP 2005128261A JP 2006310398 A JP2006310398 A JP 2006310398A
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Japan
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thin film
film element
substrate
elements
thin
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JP2005128261A
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Yasuaki Kodaira
泰明 小平
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Publication date
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Abstract

【課題】 薄膜素子の切断端面に発生する微細なクラックにより、薄膜素子が破壊されることを防ぐ。
【解決手段】 複数の薄膜素子(15)を基板(20)上に接合して形成する工程と、1つ以上の薄膜素子(15)を含む部分に切り離す工程と、基板(20)と薄膜素子(15)の接合強度を熱処理によって強固にする工程と、薄膜素子(15)の周縁部を切断端面からのクラックをすべて除去できる位置で切断する工程を有し、切断面に生じるクラックを完全に除去する。
【選択図】 図4

Description

本発明は、薄膜素子の製造方法、及び電子機器に関する。
従来、電子デバイスの製造方法として、1枚の基板上に複数の薄膜素子を形成し、最後に個々の薄膜素子に切断するという方法がとられている。
例えば、特許文献1や特許文献2に記載された薄膜素子の転写技術を用いる場合にも、最終転写基板に複数の薄膜素子を転写した後、各々の薄膜素子に切断していた。さらにその後、熱工程を含むデバイス形成工程を行っていた。
特開平10−125929号公報 特開平10−125930号公報
しかしながら、個々の薄膜素子に切断する際、切断端面に微細なクラックが発生し、その後の工程等で、そのクラックが広がり、薄膜素子の内部へ侵入することにより素子が破壊される可能性があった。
よって、本発明は、切断端面に発生する微細なクラックにより薄膜素子が破壊されることを防ぐ、薄膜素子の製造方法、及び電子機器を提供することを目的とする。
上記目的を達成するため本発明の薄膜素子の製造方法は、複数の薄膜素子を基板上に接合して形成する工程と、1つ以上の上記薄膜素子を含む部分に切り離す工程と、上記基板と上記薄膜素子の接合強度を熱処理によって強固にする工程と、上記薄膜素子の周縁部を切断する工程を有する。
これにより、切断面のクラックが完全に除去され、後の熱工程等によって薄膜素子が破壊されることを防ぐことができる。
また、本発明の電子機器は、上述の薄膜素子の製造方法によって製造された薄膜素子を備える。
かかる構成とすることによって、電子機器の信頼性を向上させることができる。ここで電子機器は、携帯電話、電子ペーパー、PDA、電子手帳、電光掲示盤、宣伝公告用ディスプレイ、その他各種のものが含まれる。
以下、本発明の実施例について図面を参照して説明する。
図1(a)は、複数の薄膜素子15が形成された1枚の基板の平面図、同図(b)は(a)のA−A’線断面図である。図に示す複数の薄膜素子15を備えた基板は、転写元となる製造元基板上に薄膜素子15を形成した後、これを一旦、仮転写基板に転写し、さらに最終基板に転写することにより形成される。その後、個々の薄膜素子15毎に切断することにより、薄膜素子15を得る。
図2および図3を用いて、薄膜素子15の製造方法を説明する。
図2(a)は、製造元基板11上に、剥離層12を介して、複数の薄膜素子15を有する薄膜素子層13を形成した状態を示している。
製造元基板11は、信頼性の高い材料で構成されているのが好ましく、特に、耐熱性に優れた材料で構成されていることが好ましい。その理由は、剥離層12、及び薄膜素子層13を形成する際に、その種類や形成方法によってはプロセス温度が高くなる(例えば350〜1000℃程度)ことがあるからである。
具体的には、基板11の構成材料は、歪点が350℃以上のものが好ましく、500℃以上のものがより好ましい。このようなものとしては、例えば、石英ガラス、ソーダガラス、コーニング7059、日本電気ガラスOA−2等の耐熱性ガラスが挙げられる。
剥離層12は、照射される光を吸収し、その層内か界面の少なくとも一方において、剥離を生じるような性質を有するものである。
薄膜素子層13は、TFT等の薄膜素子を含む層である。薄膜素子としては、TFTの他に、例えば、薄膜ダイオードや、シリコンのPIN接合からなる光電変換素子(光センサ、太陽電池)やシリコン抵抗素子、その他の薄膜半導体デバイス、電極(例:ITO、メサ膜のような透明電極)、スイッチング素子、メモリー、圧電素子等のアクチュエータ、マイクロミラー(ピエゾ薄膜セラミックス)、磁気記録薄膜ヘッド、コイル、インダクター、薄膜高透磁材料およびそれらを組み合わせたマイクロ磁気デバイス、フィルター、反射膜、ダイクロイックミラー等がある。このような薄膜素子(薄膜デバイス)は、その形成方法との関係で、通常、比較的高いプロセス温度を経て形成される。
次に、図2(b)に示すように、薄膜素子層13の形成面に、仮接着材層16を形成し、仮接着材層16を介して剥離層17を有する仮転写基板18を接合する。剥離層17は、剥離層12と同様のものが用いられる。またはそれ以外の材料を使用してもよい。
仮接着材層16は後の工程で除去されるため、除去が容易な水溶性接着材等を用いて形成する。
次に、同図(c)に示すように、製造元基板11の裏面側から光を照射する。照射光は、製造元基板11を透過した後、剥離層12に照射される。これにより、剥離層12に剥離が生じ、結合力が減少または消滅する。よって、同図(d)に示すように、製造元基板11を離脱させることができる。
剥離層12に剥離が生じる原理は、剥離層12の構成材料にアブレーションが生じること、また、剥離層12に含まれているガスの放出、さらには照射直後に生じる溶融、蒸散等の相変化によるものであることが推定される。
ここで、アブレーションとは、照射光を吸収した固定材料(剥離層12の構成材料)が光化学的または熱的に励起され、その表面や内部の原子または分子の結合が切断されて放出することをいい、主に、剥離層12の構成材料の全部または一部が溶融、蒸散(気化)等の相変化を生じる現象として現れる。また、そのような相変化によって微小な発泡状態となり、結合力が低下することもある。
照射光としては、剥離層12に剥離を起こさせるものであればよく、例えば、X線、紫外線、可視光、赤外線(熱線)、レーザ光、ミリ波、マイクロ波、電子線、放射線(α線、β線、γ線)等が挙げられるが、そのなかでも、剥離層12のアブレーションを生じさせやすいという点でレーザ光が望ましい。
なお、薄膜素子層13に付着している剥離層12は、例えば洗浄、エッチング、アッシング、研磨等の方法またはこれらを組み合わせた方法により除去する。
次に、図3(a)に示すように、薄膜素子層13の裏面側に永久接着材層19を形成し、永久接着材層19を介して最終基板20を接合する。最終基板20としては、例えばプラスチック基板を用いる。
次に、同図(b)に示すように、仮転写基板18の上面側から光を照射する。照射光は、仮転写基板18を透過して剥離層17に照射され、剥離層17に剥離を生じさせる。その結果、仮転写基板18を分離することができる。残留した剥離層17は、必要に応じてエッチング等の方法によって除去する。また、仮接着材層16は、例えば水で洗浄することにより除去する。
以上の工程により、同図(c)に示す状態となる。
次に、同図(c)に示す切断箇所において、各々の薄膜素子15をダイシング等の方法で切り離し、同図(d)に示す状態にする。
次に、切り離された薄膜素子15に熱処理を施し、薄膜素子層13と最終基板20とを接着する永久接着材層19の接着力を高める。熱処理の後、図4の薄膜素子15の平面図に示すように、薄膜素子15の外周を再度切断する。
図4に示す切断箇所は、例えば切断端面からのクラックが発生している部分をすべて除去できる位置である。
熱処理により薄膜素子層13と最終基板20の接着力を強固にした上で、薄膜素子15の周縁部を切断してクラックを完全に除去すれば、後に行う熱工程等において薄膜素子15がクラックの侵入により破壊されることがない。
なお、ここでは1度目の切断において、図3(d)に示すように薄膜素子15毎に切り離したが、1度目の切断では2つ以上の薄膜素子15を含む部分に切り離し、熱処理により薄膜素子層13と最終基板20の接着力を強固にした後で、薄膜素子15毎に切断してもよい。
(電子機器)
図5は、本発明の電子機器の例として、携帯電話に適用した例を示す図である。
携帯電話230は、アンテナ部231、音声出力部232、音声入力部233、操作部234、表示部235を備えている。携帯電話230は、例えば表示部235に本発明の薄膜素子を利用可能である。
その他、例えば、電子ペーパー、PDA、電子手帳、電光掲示盤、宣伝公告用ディスプレイなどの電子機器にも適用することができる。
図1(a)は複数の薄膜素子が形成された1枚の基板の平面図、図1(b)は同図(a)のA−A’線断面図である。 図2(a)〜図2(d)は本発明の薄膜素子の製造方法を説明する図である。 図3(a)〜図3(d)は本発明の薄膜素子の製造方法を説明する図である。 図4は本発明の薄膜素子の平面図である。 図5は本発明の電子機器の例を説明する説明図である。
符号の説明
11 製造元基板、12,17 剥離層、13 薄膜素子層、15薄膜素子、16 仮接着材層、18 仮転写基板、19 永久接着材層、20 最終基板、25 保護膜

Claims (2)

  1. 複数の薄膜素子を基板上に接合して形成する工程と、
    1つ以上の前記薄膜素子を含む部分に切り離す工程と、
    前記基板と前記薄膜素子の接合強度を熱処理によって強固にする工程と、
    前記薄膜素子の周縁部を切断する工程を有する薄膜素子の製造方法。
  2. 請求項1に記載の薄膜素子の製造方法によって製造された薄膜素子を備えた電子機器。

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7786576B2 (en) 2007-02-06 2010-08-31 Seiko Epson Corporation Semiconductor device, method of manufacturing semiconductor device, and electronic apparatus
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