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JP2004087700A - 半導体装置およびその製造方法 - Google Patents

半導体装置およびその製造方法 Download PDF

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JP2004087700A
JP2004087700A JP2002245484A JP2002245484A JP2004087700A JP 2004087700 A JP2004087700 A JP 2004087700A JP 2002245484 A JP2002245484 A JP 2002245484A JP 2002245484 A JP2002245484 A JP 2002245484A JP 2004087700 A JP2004087700 A JP 2004087700A
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JP
Japan
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substrate
wiring
semiconductor chip
metal substrate
lands
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JP2002245484A
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English (en)
Inventor
Naoto Kimura
木村 直人
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NEC Semiconductors Kyushu Ltd
Original Assignee
NEC Semiconductors Kyushu Ltd
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Publication date
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    • H10W72/877
    • H10W90/724
    • H10W90/734

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Abstract

【課題】FCBGAの構造の半導体パッケージにおいて放熱性を確保しつつ、コストダウンを図る。
【解決手段】裏面に絶縁物を施し、その上に導電性金属を被着し、搭載する半導体チップのパッド位置に対応して配線およびランドを形成した金属基板と、この金属基板の前記配線の前記ランドとバンプで接合した前記半導体チップと、金属基板とバンプで接合すため、あらかじめ配線や貫通穴、ランドが形成され、また半導体チップ搭載部は凹形状を有し、且つ外部接続用ハンダボールを搭載した基板とで構成されている。
【選択図】   図1

Description

【0001】
【発明の属する技術分野】
本発明は半導体装置およびその製造方法に関し、特にパッケージの基板に熱導電率の良い金属を用いる半導体装置およびその製造方法に関する。
【0002】
【従来の技術】
公知例の特許第3005177号公報の断面図を図5に示す。これによると、チップ51はシリコン基板52に接合され、シリコン基板52からプリント配線基板54へ接合されている。
【0003】
また、現状のFCBGAは特開2001−15650は図6に示されるような構造を有している。すなわち、ICチップ63のベースと接合してそのICチップ63を固定する金属放熱板61と、外部にBGA実装パッドが形成され内部にICチップの実装用パッドとそのBGA実装パッドとを接続する配線導体が形成された絶縁層樹脂64と、BGA実装パッドに接合されたBGAはんだバンプ69とを備え、ICチップの実装用パッドははんだを介することなく直接配線導体に接合されている。
【0004】
【発明が解決しようとする課題】
上述した公知例の特許第3005177号公報の断面図を図5に示す。この構造であれば、チップの電気的動作に伴う発熱はシリコン基板を通して放熱されるが、シリコン基板の熱伝導率が低いので十分な放熱はできない。放熱が悪くチップの温度が上昇するとチップの電気的動作速度が遅くなったり故障したりする。
【0005】
また、特開2001−15650の構造を図6に示す、この構造では絶縁樹脂層または有機基板の製造コストが極めて高くなる。理由は配線とスキマのライン&スペースがせいぜい25μまでしか狭くすることが出来ないために、多数のボール(例:1500〜3000個)との配線が困難になり、積層有機基板を7層以上にする必要があるという欠点がる。
【0006】
本発明は、以上の欠点を回避するための方法である。金属基板に配線を形成すると有機基板の1/10の価格で製造できる。配線層はせいぜい2層で十分である。また、1500個以上のハンダバンプから金属基板を通して相当の熱が逃げ放熱効果も大きい。くわえて、基板を熱導電率の良い銅やアルミを用いるので十分な放熱ができる、また、銅やアルミは加工性が良いので、上表面に形成した溝により、表面積が約2倍に広がり、さらに放熱が良くなる。従って、チップの正常な動作を確保できる。特に、高速の電気的動作を行うチップでは効果が顕著である。
【0007】
【課題を解決するための手段】
本発明の半導体装置の製造方法は、金属基板の裏面に絶縁物を施し、その上に導電性金属を被着し、搭載する半導体チップのパッド位置に対応して配線およびランドを形成し、前記金属基板の前記配線の前記ランドと前記半導体チップのパッドをバンプで熱圧着や溶融法で接合して、この金属基板をあらかじめ配線や貫通穴、ランドが形成された配線基板やテープ基板にバンプにて接合する、また前記配線基板や前記テープ基板の半導体チップ搭載部は凹形状を有し、前記配線基板や前記テープ基板に外部接続用ハンダボールを搭載接合することを特徴とする半導体装置の製造方法。
【0008】
また、本発明の半導体装置は、裏面に絶縁物を施し、その上に導電性金属を被着し、搭載する半導体チップのパッド位置に対応して配線およびランドを形成した金属基板と、この金属基板の前記配線の前記ランドとバンプで接合した前記半導体チップと、前記金属基板とバンプで接合すため、あらかじめ配線や貫通穴、ランドが形成され、また半導体チップ搭載部は凹形状を有し、且つ外部接続用ハンダボールを搭載した基板と、を有することを特徴とする。また、前記金属基板の上面には放熱のための表面積を拡大するために厚み方向に複数の矩形もしくは三角形の溝が形成されていることを特徴とする。
【0009】
【発明の実施の形態】
次に図面を用いて本発明の実施形態を説明する。図1は本発明の断面図である。銅やアルミ、ステンレス等の金属基板1の上表面には板厚の約半分位の深さまで矩形もしくは三角形の断面形状を有する溝2が金属基板1全面に加工形成されている。金属基板1の厚みは100μm〜1000μm程度である。金属基板1の下表面に酸化物等の絶縁膜3を形成して、その上に蒸着法またはメッキ法により、銅やアルミを材料とする導電性の配線4やランド5を形成する。ランド5の位置はそれぞれ半導体チップ6のパッド7や配線基板であるガラスエポキシ基板8のランド10、バンプ11の位置に対応している。チップ6と金属基板1を金またはハンダで形成したバンプ11にて熱溶融および圧着にて接合する。金属基板1とガラスエポキシ基板8またはテープ基板はそれぞれ対応するランド10の部分をハンダで接合する。半導体チップ6裏面はガラスエポキシ基板8もしくはテープ基板(図示せず)にあらかじめ形成された凹部12で接着剤13にて接合する。金属基板1とガラスエポキシ基板8の隙間には絶縁性の接着剤樹脂14を注入する。これにより、チップと金属基板1、ガラスエポキシ基板8の接合性を十分確保する。ガラスエポキシ基板8またはテープ基板のランド15には外部接続用ハンダボール16を搭載接合する。
【0010】
次に本発明の製造方法を図2以降の図面で説明する。図2は金属基板1の断面図である。金属基板1上表面に機械的加工もしくはエッチング等の化学的加工により矩形もしくは三角形等の断面形状を有する溝2を板厚の半分程度まで板全面に形成する。金属基板1の下表面には酸化物等で絶縁膜3を形成し、蒸着法やメッキ法で配線4やランド5を形成する。
【0011】
図3は金属基板1の下側に半導体チップ6のパッドと金属基板1のランドをハンダや金等でバンプを形成し熱圧着で接合する。
【0012】
図4は上記半導体チップ6を搭載接合した金属基板1をガラスエポキシ基板8にハンダ等で接合する。半導体チップ裏面とガラスエポキシ基板は、ガラスエポキシ基板に形成された凹部を接着剤で接合する。金属基板1とガラスエポキシ基板8、半導体チップ6の隙間には絶縁性の接着樹脂14を注入する。前出の図1が完成した半導体装置の断面図である。
【0013】
【発明の効果】
以上説明したように、本発明は、金属基板1に拡散の手法で配線を形成すると有機基板の1/10の価格で製造できる。配線層は2層で十分である。また、1500個以上のハンダバンプから金属基板を通して相当の熱が逃げ放熱効果も大きいという効果がある。
【図面の簡単な説明】
【図1】本発明の第1の実施形態の構成を示す断面図である。
【図2】第1の実施形態における製造方法の金属基板の断面図である。
【図3】第1の実施形態におけるチップ搭載時の断面図である。
【図4】本発明のガラスエポキシ基板への接合時の断面図である。
【図5】第1の従来例の構成を示す断面図である。
【図6】第2の従来例の構成を示す断面図である。
【符号の説明】
1  金属基板
2  溝
3  絶縁膜
4  配線
5  ランド
6  半導体チップ
7  パッド
8  ガラスエポキシ基板
10  ランド
11  バンプ
12  凹部
14  絶縁性の接着剤樹脂
15  ランド
16  外部接続用ハンダボール

Claims (7)

  1. 金属基板の裏面に絶縁物を施し、その上に導電性金属を被着し、搭載する半導体チップのパッド位置に対応して配線およびランドを形成し、前記金属基板の前記配線の前記ランドと前記半導体チップのパッドをバンプで熱圧着や溶融法で接合して、この金属基板をあらかじめ配線や貫通穴、ランドが形成された配線基板やテープ基板にバンプにて接合する、また前記配線基板や前記テープ基板の半導体チップ搭載部は凹形状に形成し、前記配線基板や前記テープ基板に外部接続用ハンダボールを搭載接合することを特徴とする半導体装置の製造方法。
  2. 裏面に絶縁物を施し、その上に導電性金属を被着し、搭載する半導体チップのパッド位置に対応して配線およびランドを形成した金属基板と、この金属基板の前記配線の前記ランドとバンプで接合した前記半導体チップと、前記金属基板とバンプで接合すため、あらかじめ配線や貫通穴、ランドが形成され、また半導体チップ搭載部は凹形状を有し、且つ外部接続用ハンダボールを搭載した基板と、を有することを特徴とする半導体装置。
  3. 前記金属基板の上面には放熱のための表面積を拡大するために厚み方向に複数の矩形もしくは三角形の溝が形成されていることを特徴とする請求項2記載の半導体装置。
  4. 前記金属基板が銅で構成されることを特徴とする請求項2または3記載の半導体装置。
  5. 前記金属基板がアルミで構成されることを特徴とする請求項2または3記載の半導体装置。
  6. 前記基板がガラスエポキシ基板であることを特徴とする請求項2記載の半導体装置。
  7. 前記基板がテープ基板であることを特徴とする請求項2記載の半導体装置。
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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009021583A (ja) * 2007-06-19 2009-01-29 Honeywell Internatl Inc ダイ装着応力遮断構造
CN103165476A (zh) * 2011-12-15 2013-06-19 英飞凌科技股份有限公司 集成电路封装以及封装方法
US9105562B2 (en) 2011-05-09 2015-08-11 Infineon Technologies Ag Integrated circuit package and packaging methods
US9269685B2 (en) 2011-05-09 2016-02-23 Infineon Technologies Ag Integrated circuit package and packaging methods
US9425116B2 (en) 2011-05-09 2016-08-23 Infineon Technologies Ag Integrated circuit package and a method for manufacturing an integrated circuit package
JP2017510076A (ja) * 2014-03-31 2017-04-06 マイクロン テクノロジー, インク. 改良された熱性能を有する積層半導体ダイアセンブリならびに関連するシステムおよび方法

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009021583A (ja) * 2007-06-19 2009-01-29 Honeywell Internatl Inc ダイ装着応力遮断構造
US9105562B2 (en) 2011-05-09 2015-08-11 Infineon Technologies Ag Integrated circuit package and packaging methods
US9269685B2 (en) 2011-05-09 2016-02-23 Infineon Technologies Ag Integrated circuit package and packaging methods
US9425116B2 (en) 2011-05-09 2016-08-23 Infineon Technologies Ag Integrated circuit package and a method for manufacturing an integrated circuit package
CN103165476A (zh) * 2011-12-15 2013-06-19 英飞凌科技股份有限公司 集成电路封装以及封装方法
JP2017510076A (ja) * 2014-03-31 2017-04-06 マイクロン テクノロジー, インク. 改良された熱性能を有する積層半導体ダイアセンブリならびに関連するシステムおよび方法
US10461059B2 (en) 2014-03-31 2019-10-29 Micron Technology, Inc. Stacked semiconductor die assemblies with improved thermal performance and associated systems and methods

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