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JP2003271090A - プラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置 - Google Patents

プラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置

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Publication number
JP2003271090A
JP2003271090A JP2002072858A JP2002072858A JP2003271090A JP 2003271090 A JP2003271090 A JP 2003271090A JP 2002072858 A JP2002072858 A JP 2002072858A JP 2002072858 A JP2002072858 A JP 2002072858A JP 2003271090 A JP2003271090 A JP 2003271090A
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JP
Japan
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electrode
electrodes
voltage
pulse
address
Prior art date
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Pending
Application number
JP2002072858A
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English (en)
Inventor
Giichi Kanazawa
義一 金澤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Plasma Display Ltd
Original Assignee
Fujitsu Hitachi Plasma Display Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Hitachi Plasma Display Ltd filed Critical Fujitsu Hitachi Plasma Display Ltd
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Priority to EP02258500A priority patent/EP1345200A3/en
Priority to US10/315,070 priority patent/US6963320B2/en
Priority to TW091135864A priority patent/TW583620B/zh
Priority to CN02160417A priority patent/CN1445741A/zh
Priority to KR10-2003-0000419A priority patent/KR20030074120A/ko
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Abstract

(57)【要約】 【課題】 アドレスパルスの幅を狭くしても安定した動
作が行えるプラズマディスプレイパネルの駆動方法及び
プラズマディスプレイ装置の実現。 【解決手段】 隣接して交互に配置された複数の第１の
電極Ｘ及び第２の電極Ｙと、直交する方向に伸びる複数
の第３の電極Ａとを備え、第１の電極と第２の電極で表
示ラインが形成されるプラズマディスプレイパネル10
と、第３の電極に選択的に電圧を印加する第３駆動回路
11と、記第２の電極に選択的に走査パルスを印加する第
２駆動回路12と、各第２の電極への走査パルスの印加の
終了後に、対となって表示ラインを構成する第１の電極
に補助走査パルスを選択的に印加する第１駆動回路21と
を備える。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、３電極ＡＣ型プラ
ズマディスプレイパネルの駆動方法及びプラズマディス
プレイ装置に関する。
【０００２】
【従来の技術】平面ディスプレイとしてプラズマディス
プレイ装置（ＰＤＰ装置）が実用化されている、３電極
ＡＣ型プラズマディスプレイを例として説明を行う。
【０００３】図１は、一般的なプラズマディスプレイパ
ネルの構造を示す図である。図示のように、基板１の上
には一方向に伸びる複数のＸ（第１の）電極Ｘ１，Ｘ
２，…とＹ（第２）電極Ｙ１，Ｙ２，…が交互に隣接し
て配置され、更にＸ電極及びＹ電極と直交する方向に伸
びる複数のアドレス電極Ａが配置される。アドレス電極
の間にはアドレス電極に沿って伸びるストライプ状隔壁
２が形成される。通常、Ｘ電極及びＹ電極は一方の基板
に形成され、アドレス電極は対向する他方の基板に形成
され、２つの基板を対向して配置した上で、それらの間
の空間に放電用ガスが封止される。Ｘ電極とＹ電極の対
Ｘ１とＹ１，Ｘ２とＹ２，…とアドレス電極Ａの交差部
分に表示セルが形成される。従って、図示のように、Ｘ
電極とＹ電極の対Ｘ１とＹ１，Ｘ２とＹ２，…に対応し
て表示ラインＬ１，Ｌ２，…が形成される。
【０００４】図２は、図１のプラズマディスプレイパネ
ル１０を使用した従来のＰＤＰ装置の概略構成を示すブ
ロック図である。図示のように、ＰＤＰ装置は、アドレ
ス電極Ａに選択的に電圧を印加するアドレスドライバ
（第３駆動回路）１１と、Ｙ電極を駆動するＹ電極駆動
回路（第２駆動回路）１２と、Ｘ電極を駆動するＸ電極
駆動回路（第１駆動回路）１６と、制御回路１９とを有
する。Ｙ電極駆動回路１２は、アドレス期間にＹ電極に
順次印加する走査パルスを発生する走査ドライバ１３
と、維持放電期間にＹ電極に共通に印加する維持パルス
を発生する維持パルス回路１４と、リセット期間にＹ電
極に共通に印加する電圧及びアドレス期間に走査パルス
以外のＹ電極に共通に印加する電圧を発生するリセット
／アドレス電圧発生回路１５とを有する。また、Ｘ電極
駆動回路１６は、維持放電期間にＹ電極に共通に印加す
る維持パルスを発生する維持パルス回路１７と、リセッ
ト期間及びアドレス期間にＸ電極に共通に印加する電圧
を発生するリセット／アドレス電圧発生回路１８とを有
する。
【０００５】図３は図２のＰＤＰ装置の駆動波形を示す
図である。図示のように、１動作サイクルは、全表示セ
ルを均一な状態にするリセット期間と、点灯する表示セ
ルを選択するアドレス期間と、選択した表示セルのみ点
灯させる維持放電期間を有する。輝度は維持放電期間に
おける維持パルスの個数で決定される。維持パルスの周
波数が同じ時には、維持パルスの個数は維持放電期間長
さに比例する。ＰＤＰ装置は、各表示セルを点灯するか
点灯しないかの選択が行えるだけであるので、階調画像
を表示する場合には、図３のような動作サイクルを有
し、少なくとも一部は維持放電期間の長さが異なる複数
のサブフィールドで１表示フィールドを構成し、各表示
セル毎に点灯するサブフィールドを選択する。
【０００６】リセット期間においては、アドレスドライ
バ１１は全アドレス電極に０Ｖを印加し、Ｘ電極駆動回
路１６のリセット／アドレス電圧発生回路１８とＹ電極
駆動回路１２のリセット／アドレス電圧発生回路１５は
図３に示すような電圧を全Ｘ電極と全Ｙ電極に印加す
る。リセット期間は、Ｘ電極に負の電圧を印加すると共
にＹ電極に正の電圧を印加する書き込み部と、Ｘ電極に
正の電圧を印加すると共にＹ電極に負の電圧を印加する
消去部とから構成される。書き込み部では、Ｘ電極に印
加する負の電圧を緩やかに変化させた後、緩やかに変化
する正の電圧をＹ電極に印加し、微弱な放電によって全
表示セルで壁電荷を形成する。消去部では、Ｘ電極に印
加する電圧を正の電圧に切り換えると共に、緩やかに変
化する負の電圧をＹ電極に印加し、微弱な放電によって
全表示セルで壁電荷を消去又は一定量まで調整する。ア
ドレス期間には、全Ｘ電極に電圧Ｖｘを印加した状態
で、Ｙ電極に順次走査パルスを印加し、走査パルスに同
期して表示データに応じたアドレスパルスをアドレス電
極に選択的に印加する。走査パルスが印加されたＹ電極
とアドレスパルスが印加されたアドレス電極の交差部分
のセルでアドレス放電が発生し、アドレスパルスが印加
されないアドレス電極の交差部分のセルではアドレス放
電が発生しない。アドレス放電が発生したセルでは壁電
荷が形成され、各表示セルは表示データに応じた状態に
なる。維持放電期間には、アドレス電極に０Ｖを印加し
た状態で、０Ｖと電圧Ｖｓの間で変化する維持パルスを
交互にＹ電極とＸ電極に印加する。アドレス期間に壁電
荷が蓄積されたセルでは壁電荷による電圧が維持パルス
に重畳されて放電開始電圧以上になるので維持放電が発
生し、アドレス期間に壁電荷が蓄積されていないセルで
は維持放電が発生しない。維持放電により壁電荷はＹ電
極とＸ電極に交互に形成され、維持パルスが印加されて
いる間維持放電が続く。
【０００７】以上、ＰＤＰ装置の代表的な方式を例とし
て説明したが、各種の方式が実用化されており、多数の
変形例がある。
【０００８】
【発明が解決しようとする課題】近年、表示装置は益々
大容量高精細化が進み、プラズマディスプレイパネルも
ライン数が５００ライン程度から１０００ライン程度へ
と進化している。また、階調をより細かに表示したり、
サブフィールドで表示を行うデバイスに特有の課題であ
る動画像表示時の偽輪郭を回避するためにサブフィール
ド数を増加させることなどが要望されている。表示ライ
ン数が増加するとアドレスを行う回数が増加し、１回の
アドレス動作に割り当てられる時間、すなわち走査パル
スの幅が短くなる。また、サブフィールド数が増加すれ
ば、アドレス期間に割り当てられる時間が短くなり、や
はり走査パルスの幅を短くする必要がある。しかし、走
査パルスの幅を短くするとたとえアドレスパルスを印加
してもアドレス放電が発生せず、表示データを正しく書
き込めないという誤書き込みの問題が生じる。
【０００９】このような問題を解決する方法として、ア
ドレス電極を上下に分割し、画面の上半分と下半分で同
時にアドレス動作を行うことによりアドレス期間を半分
に短縮するいわゆるデュアルスキャンと呼ばれる方法が
ある。しかし、この方法は、アドレス電極を駆動するア
ドレスドライバが２個必要になり、コスト面で不利であ
るという問題があった。
【００１０】また、１表示ラインのアドレス時間を非常
に高速にする方法も提案されている。例えば、リセット
期間にリセット放電で十分な空間電荷を生成して残留さ
せ、アドレス放電を発生しやすくしてアドレス放電遅れ
時間を短くする方法である。しかし、十分な空間電荷を
生成するためにはリセット放電の強度を大きくする必要
があり、その場合リセット放電による全面発光強度が増
加してコントラストが低下するという表示品質面におけ
る問題が生じる。
【００１１】更に、アドレス放電時の印加電圧を高くし
て放電の成長を促し、短時間でアドレス放電を完結する
方法もあるが、隣接セルへのクロストークなど、放電制
御上の各種の問題がある。
【００１２】また、特開平９−３１１６６１号公報は、
Ｘ電極駆動回路にも走査ドライバを設け、アドレス期間
にＹ電極に走査パルスを印加するのに同期にしてＸ電極
に逆極性の走査パルスを印加することにより、Ｙ電極に
印加する走査パルスの電圧の絶対値を低減する方法を開
示している。この方法は、駆動回路の耐圧を低くできる
という利点があるが、走査パルス幅が短くなると上記と
同じ問題を生じる。
【００１３】アドレス放電は、アドレス電極にアドレス
パルスが印加され、Ｙ電極には走査パルスが印加される
ことで放電が開始されるが、アドレス電極とＹ電極間の
放電のみでは維持放電を行うのに十分な壁電荷が生成で
きない。そこで、Ｘ電極に高い電圧を印加して、アドレ
ス電極とＹ電極間の発生した放電がＸ電極とＹ電極間の
放電に移行し、Ｘ電極とＹ電極間の放電が成長して維持
放電に必要な壁電荷を生成して放電が収束するようにし
ている。これら一連の動作が行われる時間が短いとアド
レス電極とＹ電極間の放電が発生してもＸ電極とＹ電極
間の放電が成長せず、十分な壁電荷が形成されない状態
（アドレス放電不完全状態）となり、当然維持放電が行
えないことになると考えられる。なお、ここで言う放電
の成長とは、放電が停止しても十分な壁電荷を形成する
までにはある程度の時間が必要であり、それを含めて放
電の成長と表現している。
【００１４】以上説明したように、表示ライン数の増加
や階調表現の改善のためにはアドレスパルスの幅を狭く
する必要があるが、それは安定動作を阻害するという問
題があった。
【００１５】本発明は、このような問題を解決して、走
査パルスの幅を狭くしても安定した動作が行えるプラズ
マディスプレイパネルの駆動方法及びプラズマディスプ
レイ装置の実現を目的とする。
【００１６】
【課題を解決するための手段】上記目的を実現するた
め、本発明では、Ｙ電極（第２の電極）に印加した走査
パルスを取り去った後に、走査パルスが印加されたＹ電
極と対となって表示ラインを形成するＸ電極に補助走査
パルスを印加する。これにより、アドレス電極とＹ電極
間で発生した放電がＸ電極とＹ電極間にも拡大し、走査
パルスを取り去った後でもＸ電極とＹ電極間の放電が成
長し、十分な壁電荷が形成できる。
【００１７】本発明によれば、Ｙ電極に印加した走査パ
ルスを取り去った後に、走査パルスが印加されたＹ電極
と対となって表示ラインを形成するＸ電極に補助走査パ
ルスを印加するのでＸ電極とＹ電極間の電圧はある程度
高く維持される。補助走査パルスは、走査パルスを印加
した時と同様に、放電を成長させて十分な壁電荷が形成
できるように設定される。その結果、走査パルスの印加
期間が短く、その期間ではＸ電極とＹ電極間の放電が十
分に成長していない場合でも、引き続きＸ電極とＹ電極
間の放電は成長し、維持放電に必要な十分な壁電荷を形
成することができる。
【００１８】図４は、本発明の原理を示すリセット期間
とアドレス期間の波形図である。前述のように、リセッ
ト期間は、主に書き込み部と消去部により構成され、書
き込み部は微弱な放電によって壁電荷を形成し、消去部
は同様に微弱な放電によって壁電荷を消去あるいは一定
量まで調整する機能を備えている。アドレス放電はＹ電
極に走査パルスが印加され、同時に点灯するセルのアド
レス電極にアドレスパルスが印加され、アドレス放電が
開始される。この際、Ｘ電極とＹ電極間の電圧はＶ２で
あり、リセット期間の消去部の最終電圧であるＶ１より
多少高めに設定してある。次に、Ｙ電極の走査パルスが
除去されると同時に、Ｘ電極に補助走査パルスが印加さ
れる。その際のＸ電極とＹ電極間の電圧はＶ３である。
この補助走査パルスによって、走査パルスの印加中に十
分に成長できなかった放電が成長し、維持放電可能な壁
電荷が形成される。
【００１９】次に各電圧の関係について説明する。リセ
ット期間の消去部の電圧がＶ１であるのに対して、アド
レス期間や維持放電期間でＶ１以上の電圧がＸ電極とＹ
電極間に印加されると、アドレス放電を行っていないセ
ルであっても放電を開始してしまう。よって、基本的に
は、アドレス期間及び維持放電期間でのＸ電極とＹ電極
間の電圧はＶ１未満になるように設定する。しかしなが
ら、走査パルスのような非常に短時間のパルス幅（１μ
ｓ〜２μｓ程度）では、Ｖ１以上の電圧が印加されても
放電開始にいたらないので、Ｖ２はＶ１より１０Ｖ〜２
０Ｖ程度高めに設定している。また、そうすることでア
ドレス放電の開始速度や発生確率を高めることができ
る。Ｖ３に関しては、走査パルス印加期間内に発生した
アドレス放電を更に成長させるための電圧であるため、
Ｖ２ほど高くする必要はない。目安としてはＶ１と同じ
程度か多少低めに設定する。あるいは、電源及び駆動回
路を共通化するために維持放電パルスと同じ電圧として
もよい。更に、補助走査パルスの幅に関しては、走査パ
ルスを印加する順番などの工夫により、走査パルスの幅
より長く設定できるため、低い電圧でも十分な壁電荷の
形成が可能である。
【００２０】
【発明の実施の形態】図５は、本発明の第１実施例のＰ
ＤＰ装置で使用するプラズマディスプレイパネル１０の
構造を示す図である。図５のプラズマディスプレイパネ
ルは、隔壁が２次元格子状で、各表示セルがＸ電極とＹ
電極の対毎にも区切られている点が、図１のものと異な
る。従って、図５のプラズマディスプレイパネルでは、
１つの表示セルで発生した放電が隣接するセルに広がる
ことはない。
【００２１】図６は、第１実施例のＰＤＰ装置の概略構
成を示すブロック図である。図２と比較して明らかなよ
うに、従来のＰＤＰ装置とは、Ｘ電極駆動回路２１が補
助走査パルスを出力する補助走査ドライバ２２を備える
点が異なる。補助走査ドライバ２２は、例えば、走査ド
ライバ１３と同じ構成で実現できる。
【００２２】図７は、第１実施例の駆動波形を示す図で
ある。図３と比較して明らかなように、アドレス期間に
おいてＸ電極に補助走査パルスが印加される点が異な
る。以下、第１実施例における動作を詳しく説明する。
【００２３】リセット期間では、従来と同様に初期化動
作が行われ、全表示セルの状態が均一になる。アドレス
期間のＴ１で示す期間では、Ｙ１電極に電圧−Ｖｙ（−
１５０Ｖ）の走査パルスが印加され、同時にＸ１電極と
Ｙ１電極で形成される表示ラインＬ１の点灯するセルに
対応するアドレス電極に電圧Ｖａ（５０Ｖ）のアドレス
パルスが印加される。それにより、アドレス電極とＹ１
電極間でアドレス放電が開始される。この時、Ｘ電極に
は電圧Ｖｘ（５０Ｖ）が印加されているため、Ｘ１電極
とＹ１電極間に放電が広がる。しかし、Ｔ１の期間内で
は十分な壁電荷は形成されない。次のＴ２の期間では、
Ｙ１電極の走査パルスが取り去られ、Ｙ２電極に走査パ
ルスが印加される。同時に、Ｘ１電極に電圧Ｖｓｘ（１
８０Ｖ）からなる補助走査パルスが印加される。それに
より、Ｘ１電極とＹ１電極間の放電は成長を続け、維持
放電に十分な壁電荷が形成される。この時、Ｘ２電極と
Ｙ２電極間で形成される表示ラインＬ２の点灯するセル
に対応するアドレス電極にアドレスパルスが印加され、
アドレス放電が行われる。次のＴ３の期間には、Ｔ２の
期間と同様に、Ｙ３電極に走査パルスが印加され、Ｘ２
電極に補助走査パルスが印加される。これらの動作を順
次実施して全面に渡りアドレス放電を行う。維持放電期
間においては、従来と同様にＸ電極とＹ電極に維持パル
スを印加する。
【００２４】図７の駆動波形では、補助走査パルスは走
査パルスと同じパルス幅であったが、これに限定されず
任意に設定することが可能である。例えば、図８に示す
ように、補助走査パルスの幅を走査パルスの幅より長く
すれば、より多くの壁電荷を形成するのに有利である。
【００２５】また、第１実施例のＰＤＰ装置も、階調表
示を行うためには、１表示フィールドを複数のサブフィ
ールドで構成し、少なくとも一部のサブフィールドの維
持放電期間の長さを変えて輝度を異ならせ、点灯するサ
ブフィールドを組み合わせて表示を行う。各サブフィー
ルドのリセット期間とアドレス期間の長さは一定であ
る。
【００２６】次に、本発明の第２実施例のＰＤＰ装置を
説明する。第２実施例のＰＤＰ装置は、第１実施例のＰ
ＤＰ装置とほぼ同じ構成を有するが、消費電力などに応
じてサブフィールド内のアドレス期間の長さを制御する
点が第１実施例と異なる。なお、この制御は制御回路１
９により行われる。
【００２７】図９は、本発明の第２実施例におけるアド
レス期間の長さ制御を説明する図であり、（Ａ）は通常
時のサブフィールド構成を示し、（Ｂ）は低輝度・電力
抑制時に維持放電期間を短くした時のサブフィールド構
成を示し、（Ｃ）は第２実施例において低輝度・電力抑
制時にアドレス期間を拡張した時のサブフィールド構成
を示す。
【００２８】図９の（Ａ）に示すように、通常時は空き
時間が生じないように１表示フィールドの期間がすべて
サブフィールドＳＦ１−ＳＦｎに割り当てられている。
各サブフィールドのリセット期間とアドレス期間の長さ
は等しく、維持放電期間の長さは輝度に応じて設定され
ている。通常時の駆動波形は図７に示した第１実施例の
駆動波形と同じであり、図１０の（Ａ）に示すように、
アドレス期間には、Ｙ電極に順次走査パルスが印加さ
れ、走査パルスが取り去られた後Ｘ電極に補助走査パル
スが印加される。
【００２９】ＰＤＰ装置では、輝度を低く保つ場合や、
表示率が高くそのまま表示したのでは電力が許容限界を
越える場合には、各サブフィールドの維持放電期間の長
さをサブフィールドの輝度比を維持したまま短くして、
プラズマディスプレイパネル全体での維持放電パルス数
を抑える制御が行われる。第２実施例のＰＤＰ装置もこ
のような制御を行う。このような制御を行う場合、各サ
ブフィールドのリセット期間とアドレス期間の長さを一
定に保持したまま維持放電期間の長さのみを短くする
と、図９の（Ｂ）に示すように１表示フィールド内に空
き時間を生じることになる。この場合、アドレス期間に
おいては、図１０の（Ａ）のような走査パルスと補助走
査パルスが印加される。
【００３０】第２実施例では、図９の（Ｂ）に示す空き
時間が所定以上の長さになった時には、図１０の（Ｂ）
に示すように、走査パルスの幅を広げ、補助走査パルス
は印加しないようにする。この場合、１表示フィールド
は、図９の（Ｃ）に示すように空き時間がなくなり、各
サブフィールドのリセット期間の長さは同じに保持した
まま、アドレス期間の長さが広げられる。補助走査パル
スはなくなるが、走査パルスの幅が広くなるので走査パ
ルス期間内に十分な壁電荷が形成でき、誤書き込みは生
じない。これにより、補助走査パルスを印加する必要が
なくなるので、補助走査パルスを印加するために消費さ
れる電力を低減することができる。
【００３１】第１実施例の駆動方法では、図５に示すよ
うな２次元格子状の隔壁を有し、各表示セルが隔壁で分
離されたプラズマディスプレイパネルを使用したが、図
１に示すようなストライプ状隔壁を有するプラズマディ
スプレイパネルを使用することも可能である。しかし、
図７のＴ２の期間には、Ｘ１電極とＹ１電極間のアドレ
ス放電後の放電が行われており、更にＹ２電極とアドレ
ス電極間のアドレス放電も開始される。隣接する表示セ
ルで同時に放電が発生する場合には両者の干渉が起きや
すい。第１実施例で使用したパネルは図５のような２次
元格子状の隔壁を有するために各表示セルが隔壁で分離
されており、隣接する表示ライン間で干渉が起きること
はない。しかし、図１に示すようなストライプ状隔壁を
有するプラズマディスプレイパネルの場合には、Ｘ１電
極とＹ１電極で形成される表示ラインＬ１と、Ｘ２電極
とＹ２電極で形成される表示ラインＬ２の間で干渉が起
き、セルが表示データと異なる状態になる誤書き込みな
どの問題を発生する場合がある。もちろんＸ電極とＹ電
極の各組の間の距離を広くすることなどにより、干渉が
生じないようにでき、その場合には第１実施例の駆動方
法を適用できる。しかし、図１に示したプラズマディス
プレイパネルを使用する場合には、次に説明する第３実
施例の駆動波形を使用することが望ましい。
【００３２】図１１は、本発明の第３実施例のＰＤＰ装
置の駆動波形を示す図である。なお、ＰＤＰ装置の概略
構成は図６の第１実施例の構成と同じであり、走査パル
スと補助走査パルスを印加するシーケンスのみが異な
る。第３実施例では、Ｙ電極を奇数番目のＹ電極群と偶
数番目のＹ電極群の２つのグループに分け、前半アドレ
ス期間には奇数番目のＹ電極群に順次走査パルスを印加
し、後半アドレス期間には偶数番目のＹ電極群に順次走
査パルスを印加してアドレス放電を行う。これに合わせ
て、Ｘ電極も奇数番目のＸ電極群と偶数番目のＸ電極群
の２つのグループに分け、奇数番目と偶数番目のＸ電極
群に電圧Ｖｘを印加した状態で、前半アドレス期間には
奇数番目のＹ電極群に順次印加された走査パルスが取り
去られた後補助走査パルスを順次奇数番目のＸ電極群に
印加してＶｘに重畳し、前半アドレス期間には偶数番目
のＹ電極群に順次印加された走査パルスが取り去られた
後補助走査パルスを順次偶数番目のＸ電極群に印加して
Ｖｘに重畳する。これにより、隣接する表示ラインでア
ドレス放電とその成長が同時に行われることがなくな
り、干渉を防ぐことが可能である。
【００３３】図１２は、本発明の第４実施例のＰＤＰ装
置の駆動波形を示す図である。第４実施例の駆動方法も
図１に示したプラズマディスプレイパネルを駆動するの
に適した方法であり、第３実施例の駆動波形より一層干
渉が生じにくく、より高精細なプラズマディスプレイパ
ネルの駆動に適している。第４実施例の駆動波形は、前
半アドレス期間には偶数番目のＸ電極群に０Ｖを印加
し、後半アドレス期間には奇数番目のＸ電極群に０Ｖを
印加する点が異なる。具体的には、前半アドレス期間に
は偶数番目のＸ電極群に０Ｖを印加し、奇数番目のＸ電
極群にＶｘを印加した状態で、奇数番目のＹ電極群に順
次走査パルスを印加し、走査パルスが取り去られた後補
助走査パルスを奇数番目のＸ電極群に順次印加してＶｘ
に重畳する。後半アドレス期間には奇数番目のＸ電極群
に０Ｖを印加し、偶数番目のＸ電極群にＶｘを印加した
状態で、偶数番目のＹ電極群に順次走査パルスを印加
し、走査パルスが取り去られた後補助走査パルスを偶数
番目のＸ電極群に順次印加してＶｘに重畳する。
【００３４】第３実施例では、Ｙ１電極に走査パルスが
印加される時、Ｘ１電極とＸ２電極の両方にＶｘが印加
されているため、Ｙ１電極とＸ２電極間の電圧は大き
い。そのため、Ｙ１電極とＸ１電極間でアドレス放電が
発生すると、それをトリガとしてＹ１電極とＸ２電極間
でも放電を誘発する可能性がある。これに対して、第４
実施例の駆動波形では、Ｙ１電極に走査パルスが印加さ
れる時、Ｘ１電極にはＶｘが印加されているが、Ｘ２電
極には０Ｖが印加されているため、Ｙ１電極とＸ２電極
間の電圧は小さく、Ｙ１電極とＸ２電極間で放電が誘発
される可能性は低く、誤放電は発生しない。
【００３５】ＰＤＰ装置では一層の高精細化が求められ
ており、特許第２００１８９３号は、高精細の表示を低
コストで実現するＰＤＰ装置を開示している。このＰＤ
Ｐ装置は、従来のＰＤＰ装置が２本の表示電極の組で１
表示ラインが形成されるのに対して、隣接する表示電極
のすべての間で表示ラインを形成することにより、同数
の表示電極数であれば２倍の表示ラインが実現でき、同
数の表示ライン数を形成するのであれば半分の電極数で
実現できる。この方式はＡＬＩＳ(Alternate Lighting
of Surfaces)方式と呼ばれる。第５実施例は、本発明を
ＡＬＩＳ方式のＰＤＰ装置に適用した実施例である。
【００３６】図１３は、ＡＬＩＳ方式のプラズマディス
プレイパネルの構造を示す図である。図示のように、基
板１上に、同じ形状のＸ電極Ｘ１，Ｘ２，…とＹ電極Ｙ
１，Ｙ２，…が交互に隣接して配置され、それらに直交
する方向にアドレス電極Ａが配置され、アドレス電極の
間に隔壁２が設けられる。表示ラインＬ１，Ｌ２，…
は、Ｘ１とＹ１、Ｙ１とＸ２、Ｘ２とＹ２の間という具
合にＸ電極とＹ電極のすべての間に形成される。従っ
て、従来と同じ本数のＸ電極とＹ電極で、２倍の表示ラ
インが得られる。表示ラインＬ１，Ｌ２，…は、奇数番
目の表示ラインと偶数番目の表示ラインに分けられ、奇
数フィールドでは奇数番目の表示ラインが表示され、偶
数フィールドでは偶数番目の表示ラインが表示される。
【００３７】図１４は、本発明の第５実施例のＡＬＩＳ
方式のＰＤＰ装置の概略構成を示すブロック図である。
図示のように、このＰＤＰ装置は、図１３に示すような
パネル構造を有するプラズマディスプレイパネル１０
と、アドレスドライバ１１と、Ｙ電極駆動回路３１とＸ
電極駆動回路４１と、制御回路１９とを有する。ＡＬＩ
Ｓ方式のＰＤＰ装置では、Ｘ電極とＹ電極を奇数番目の
奇数電極群と偶数番目のグ数電極群に分けて駆動する必
要がある。そこで、Ｙ電極駆動回路３１は、走査ドライ
バ３２と、奇数Ｙ回路３３と、偶数Ｙ回路３４を有す
る。奇数Ｙ回路３３は、図６の維持パルス回路１４とリ
セット／アドレス電圧発生回路を合わせた構成を有し、
奇数Ｙ電極群に印加する走査パルスを除く信号を生成す
る。同様に、偶数Ｙ回路３４は偶数Ｙ電極群に印加する
走査パルスを除く信号を生成する。また、Ｘ電極駆動回
路４１は、補助走査ドライバ４２と、奇数Ｘ回路４３
と、偶数Ｘ回路４４を有し、奇数Ｘ回路４３は奇数Ｘ電
極群に印加する補助走査パルスを除く信号を生成し、偶
数Ｘ回路４４は偶数Ｘ電極群に印加する補助走査パルス
を除く信号を生成する。制御回路１９は各部の制御を行
う。第５実施例のＰＤＰ装置は、補助走査ドライバ４２
が設けられている点以外は従来のＡＬＩＳ方式のＰＤＰ
装置と同じ構成を有する。
【００３８】図１５と図１６は、第５実施例のＰＤＰ装
置の駆動波形を示し、図１５は奇数フィールドの波形
を、図１６は偶数フィールドの波形を示す。図１２と比
較して明らかなように、第５実施例の奇数フィールドの
リセット期間とアドレス期間の駆動波形は、第４実施例
の駆動波形と同じであるが、維持放電期間では偶数Ｙ電
極と偶数Ｘ電極に印加される維持パルスが逆相である点
が異なる。すなわち、第５実施例では、奇数フィールド
の前半アドレス期間においては、奇数Ｘ電極にＶｘを、
偶数Ｘ電極に０Ｖを印加した状態で、奇数Ｙ電極に順次
走査パルスが印加され、それに同期してアドレスパルス
が印加され、アドレス放電が行われる。走査パルスが取
り去られるのに同期して、奇数Ｘ電極に順次補助走査パ
ルスが印加される。後半アドレス期間には、奇数Ｘ電極
に０Ｖを、偶数Ｘ電極にＶｘを印加した状態で、偶数Ｙ
電極に順次走査パルスが印加され、それに同期してアド
レスパルスが印加され、アドレス放電が行われる。走査
パルスが取り去られるのに同期して、偶数Ｘ電極に順次
補助走査パルスが印加される。維持放電期間において、
奇数Ｙ電極と偶数Ｘ電極に同相の維持パルスが印加さ
れ、偶数Ｙ電極と奇数Ｘ電極に同相の維持パルスが印加
される。これにより、奇数番目の表示ラインＬ１，Ｌ
３，…が表示され、偶数番目の表示ラインＬ２，Ｌ４，
…に放電が誘発されるのが防止される。
【００３９】第５実施例の偶数フィールドの前半アドレ
ス期間においては、奇数Ｘ電極に０Ｖを、偶数Ｘ電極に
Ｖｘを印加した状態で、奇数Ｙ電極に順次走査パルスが
印加され、それに同期してアドレスパルスが印加され、
アドレス放電が行われる。走査パルスが取り去られるの
に同期して、偶数Ｘ電極に順次補助走査パルスが印加さ
れる。後半アドレス期間には、奇数Ｘ電極に０Ｖを、偶
数Ｘ電極にＶｘを印加した状態で、偶数Ｙ電極に順次走
査パルスが印加され、それに同期してアドレスパルスが
印加され、アドレス放電が行われる。走査パルスが取り
去られるのに同期して、奇数Ｘ電極に順次補助走査パル
スが印加される。維持放電期間には、奇数Ｘ電極と奇数
Ｙ電極に同相の維持パルスが、偶数Ｘ電極と偶数Ｙ電極
に同相の維持パルスが印加される。
【００４０】第５実施例の駆動波形は、従来のＡＬＩＳ
方式の駆動波形の一例に補助走査パルスを加えた点が異
なる。従来のＡＬＩＳ方式の他の駆動波形で本発明の補
助走査パルスを加えることも可能である。
【００４１】以上、本発明の実施例を説明したが、本発
明はこれに限定されるものでなく、各種のＰＤＰの駆動
方式に適用することが可能である。
【００４２】
【発明の効果】以上説明したように、本発明によれば、
誤書き込みを起こさずに１表示ライン当たりのアドレス
時間を短縮できるので、アドレス期間を短縮でき、その
分維持放電期間を拡大して高輝度化を図ったり、サブフ
ィールド数を増加して階調数を増加するなどの表示性能
の向上が可能となる。
【図面の簡単な説明】
【図１】一般的なプラズマディスプレイパネルの構造を
示す図である。
【図２】従来のプラズマディスプレイ（ＰＤＰ）装置の
概略構成を示すブロック図である。
【図３】従来のＰＤＰ装置の駆動波形を示す図である。
【図４】本発明の原理を示す波形図である。
【図５】本発明の第１実施例で使用するプラズマディス
プレイパネルの構造を示す図である。
【図６】第１実施例のＰＤＰ装置の概略構成を示すブロ
ック図である。
【図７】第１実施例のＰＤＰ装置の駆動波形を示す図で
ある。
【図８】駆動波形の変形例を示す図である。
【図９】本発明の第２実施例のＰＤＰ装置におけるアド
レス期間の長さ制御を説明する図である。
【図１０】第２実施例におけるアドレス期間の駆動波形
を示す図である。
【図１１】本発明の第３実施例のＰＤＰ装置の駆動波形
を示す図である。
【図１２】本発明の第４実施例のＰＤＰ装置の駆動波形
を示す図である。
【図１３】本発明の第５実施例で使用するプラズマディ
スプレイパネルの構造を示す図である。
【図１４】第５実施例のＰＤＰ装置の概略構成を示すブ
ロック図である。
【図１５】第５実施例のＰＤＰ装置の駆動波形（奇数フ
ィールド）を示す図である。
【図１６】第５実施例のＰＤＰ装置の駆動波形（偶数フ
ィールド）を示す図である。
【符号の説明】
１０…ドットマトリクス型プラズマディスプレイパネル １１…アドレスドライバ（第３電極駆動回路） １２，３１…Ｙ電極（第２電極）駆動回路 １３…走査ドライバ １４…維持パルス回路 １５…リセット／アドレス電圧発生回路 １７…維持パルス回路 １８…リセット／アドレス電圧発生回路 ２１，４１…Ｘ電極（第１電極）駆動回路 ２２…補助走査ドライバ
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/288 Ｇ０９Ｇ 3/28 Ｈ Ｈ０４Ｎ 5/66 １０１ Ｂ

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 同じ方向に伸び、隣接して交互に配置さ
    れた複数の第１及び第２の電極と、前記複数の第１及び
    第２の電極に直交する方向に伸びる複数の第３の電極と
    を備えるプラズマディスプレイパネルの駆動方法であっ
    て、 点灯セルを選択するアドレス放電を行うアドレス期間
    に、前記複数の第２の電極に順次走査パルスを印加し、
    前記走査パルスを取り去った後、前記走査パルスが印加
    された第２の電極と対となって表示ラインを構成する前
    記第１の電極に補助走査パルスを印加することを特徴と
    するプラズマディスプレイパネルの駆動方法。
  2. 【請求項２】 前記第２の電極を奇数第２電極群と偶数
    第２電極群とに分け、前記アドレス期間は、一方の電極
    群で順次前記走査パルス及び前記補助走査パルスを印加
    してアドレス放電を行う前半アドレス期間と、続いて他
    方の電極群に順次前記走査パルス及び前記補助走査パル
    スを印加してアドレス放電を行う後半アドレス期間とを
    備える請求項１に記載のプラズマディスプレイパネルの
    駆動方法。
  3. 【請求項３】 前記前半アドレス期間には、前記第２電
    極群の一方と対となって表示ラインを構成する前記第１
    の電極の一方の電極群に前記第２電極群の一方との電圧
    が大きくなる補助走査ベース電圧を印加した状態で、前
    記補助走査ベース電圧に前記補助走査パルスを重畳して
    印加し、前記後半アドレス期間には、前記第２電極群の
    他方と対となって表示ラインを構成する前記第１の電極
    の他方の電極群に前記第２電極群の他方との電圧が大き
    くなる補助走査ベース電圧を印加した状態で、前記補助
    走査ベース電圧に前記補助走査パルスを重畳して印加す
    る請求項２に記載のプラズマディスプレイパネルの駆動
    方法。
  4. 【請求項４】 前記補助走査パルスの幅は、前記走査パ
    ルスの幅より大きい請求項１に記載のプラズマディスプ
    レイパネルの駆動方法。
  5. 【請求項５】 前記補助走査パルスを印加した時の前記
    第１の電極と前記第２の電極間の電圧は、前記走査パル
    スを印加した時の前記第１の電極と前記第２の電極間の
    電圧以下である請求項１に記載のプラズマディスプレイ
    パネルの駆動方法。
  6. 【請求項６】 前記補助走査パルスを印加した時の前記
    第１の電極と前記第２の電極間の電圧は、維持放電時の
    前記第１の電極と前記第２の電極間の電圧とほぼ等しい
    請求項１に記載のプラズマディスプレイパネルの駆動方
    法。
  7. 【請求項７】 前記補助走査パルスを印加した時の前記
    第１の電極と前記第２の電極間の電圧は、リセット期間
    の最終工程で消去あるいは壁電荷調整のための放電を行
    う時の最終電圧以下である請求項１に記載のプラズマデ
    ィスプレイパネルの駆動方法。
  8. 【請求項８】 １表示フィールドの維持放電回数を随時
    調整し、 １表示フィールドの維持放電回数を少なくした時には、
    前記走査パルスの幅を長くして、前記補助走査パルスを
    印加せず、１表示フィールドの維持放電回数を大きく時
    には、前記走査パルスの幅を短くして、前記補助走査パ
    ルスを印加する請求項１に記載のプラズマディスプレイ
    パネルの駆動方法。
  9. 【請求項９】 １表示フィールドは、少なくとも一部は
    維持放電回数が異なる複数のサブフィールドで構成さ
    れ、 維持放電回数に応じて、前記補助走査パルスを印加する
    サブフィールドと、前記補助走査パルスを印加しないサ
    ブフィールドとを有する請求項１に記載のプラズマディ
    スプレイパネルの駆動方法。
  10. 【請求項１０】 同じ方向に伸び、隣接して交互に配置
    された複数の第１及び第２の電極と、前記複数の第１及
    び第２の電極に直交する方向に伸びる複数の第３の電極
    とを備え、前記第１の電極と前記第２の電極で表示ライ
    ンが形成されるプラズマディスプレイパネルと、 前記第３の電極に選択的に電圧を印加する第３駆動回路
    と、 前記第２の電極に選択的に走査パルスを印加する第２駆
    動回路と、 各第２の電極への前記走査パルスの印加の終了後に、前
    記走査パルスが印加された第２の電極と対となって表示
    ラインを構成する前記第１の電極に補助走査パルスを選
    択的に印加する第１駆動回路と、を備えることを特徴と
    するプラズマディスプレイ装置。
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