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JP2002299372A - Semiconductor device, method of manufacturing semiconductor device, and method of mounting semiconductor device - Google Patents

Semiconductor device, method of manufacturing semiconductor device, and method of mounting semiconductor device

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JP2002299372A
JP2002299372A JP2001096869A JP2001096869A JP2002299372A JP 2002299372 A JP2002299372 A JP 2002299372A JP 2001096869 A JP2001096869 A JP 2001096869A JP 2001096869 A JP2001096869 A JP 2001096869A JP 2002299372 A JP2002299372 A JP 2002299372A
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JP
Japan
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semiconductor device
substrate
electrode
mounting
side electrode
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JP2001096869A
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Satoshi Nakajima
敏 中島
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Seiko Epson Corp
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Seiko Epson Corp
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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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    • H10D62/117Shapes of semiconductor bodies
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    • H10W72/29
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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Wire Bonding (AREA)
  • Dicing (AREA)

Abstract

(57)【要約】 (修正有) 【課題】 モジュール形成時の厚みを低減し、平面方向
の材料伸縮によるせん断応力に耐える。 【解決手段】 半導体装置20は、半導体チップが形成
された面に設けられた表面電極3と、表面電極3と導通
され、当該半導体装置20の実装面にほぼ垂直な側面に
溝状に形成された側面電極10と、を備える。実装時の
ボンディング荷重を低減することができ、平面方向のせ
ん断応力を半導体チップに対して与えることがないの
で、半導体チップの特性の変化を抑制し、破損を防止す
ることができる。また、半導体装置の電極と基板電極と
の間の接続を確実に行え、接続信頼性を向上することが
できる。
(57) [abstract] (with correction) [PROBLEMS] To reduce the thickness at the time of forming a module and to withstand shear stress due to expansion and contraction of a material in a plane direction. A semiconductor device has a surface electrode provided on a surface on which a semiconductor chip is formed, and is electrically connected to the surface electrode, and is formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device. Side electrode 10. Since the bonding load at the time of mounting can be reduced and no shear stress in the planar direction is applied to the semiconductor chip, a change in the characteristics of the semiconductor chip can be suppressed and breakage can be prevented. Further, the connection between the electrode of the semiconductor device and the substrate electrode can be reliably performed, and the connection reliability can be improved.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、半導体装置、半導
体装置の製造方法および半導体装置の実装方法に係り、
特に実装時のボンディング荷重を低下させつつ、電機的
な接続を確実に行わせるための技術に関する。
The present invention relates to a semiconductor device, a method of manufacturing a semiconductor device, and a method of mounting a semiconductor device.
In particular, the present invention relates to a technique for reliably performing electrical connection while reducing a bonding load during mounting.

【0002】[0002]

【従来の技術】従来より基板上に半導体チップを実装す
るための技術が各種知られている。例えば、実装技術と
して、ワイヤーボンディング方式やフリップチップボン
ディング方式などが挙げられる。ワイヤーボンディング
方式によれば、図13に示すように、基板100上に半
導体チップ101を接着剤等で固定し、半導体チップ1
01の電極と基板100上の電極102とを導電ワイヤ
103などを用いて空中配線接続をしている。フリップ
チップボンディング方式によれば、図14に示すよう
に、半導体チップ201上に形成された導電性の電極
(あるいは突起電極)202と基板上の電極との位置あ
わせを行い、合金接合や導電性粒子、導電性接着剤20
3などを用いた機械的接触により接続している。
2. Description of the Related Art Conventionally, various techniques for mounting a semiconductor chip on a substrate have been known. For example, as a mounting technique, a wire bonding method, a flip chip bonding method, or the like can be given. According to the wire bonding method, as shown in FIG. 13, a semiconductor chip 101 is fixed on a substrate 100 with an adhesive or the like.
The electrode 01 and the electrode 102 on the substrate 100 are connected in the air using a conductive wire 103 or the like. According to the flip-chip bonding method, as shown in FIG. 14, a conductive electrode (or a protruding electrode) 202 formed on a semiconductor chip 201 and an electrode on a substrate are aligned to perform alloy bonding or conductive bonding. Particles, conductive adhesive 20
The connection is made by mechanical contact using 3 or the like.

【0003】[0003]

【発明が解決しようとする課題】ワイヤーボンディング
方式においては、図13に示すように、半導体チップ1
01を基板100上に搭載し、ワイヤーボンディング後
に、機械的強度を持たせるために導電ワイヤを含む半導
体チップ101をモールド剤104を塗布して埋設する
ように構成していた。この結果、モジュール105全体
としての厚みが増加してしまうという不具合があった。
また、半導体チップ101を高周波回路として用いる場
合には、ワイヤ長さが長くなりすぎ、高周波回路特性的
に好ましくないという問題点があった。フリップチップ
ボンディング方式によれば、半導体チップ201の電極
202および基板上の電極は、双方とも平面上に配置さ
れているため、図15に矢印で示すように、温度変化な
どに起因して生じる平面方向の材料伸縮を起こし、半導
体チップ材料と基板材料との線膨張係数の違いにより電
極接合部にせん断応力が働いて、電極接合部に亀裂が生
じ、導通不良を起こす可能性があった。
In the wire bonding method, as shown in FIG.
01 is mounted on a substrate 100, and after wire bonding, a semiconductor chip 101 including a conductive wire is applied and buried with a molding agent 104 in order to impart mechanical strength. As a result, there is a problem that the thickness of the module 105 as a whole increases.
Further, when the semiconductor chip 101 is used as a high-frequency circuit, there is a problem that the wire length is too long, which is not preferable in terms of high-frequency circuit characteristics. According to the flip-chip bonding method, since both the electrode 202 of the semiconductor chip 201 and the electrode on the substrate are arranged on a plane, as shown by arrows in FIG. There is a possibility that the material expands and contracts in the direction, a shear stress acts on the electrode joint due to a difference in linear expansion coefficient between the semiconductor chip material and the substrate material, a crack occurs in the electrode joint, and a conduction failure occurs.

【0004】また、多機能化を図るべく半導体チップサ
イズが大きくなり、さらに電極数が増加すると、半導体
チップを基板の電極に実装する際のボンディング加重が
大きくなり、半導体チップの能動面に応力が係り、半導
体チップの特性を変化させる原因ともなっていた。ま
た、半導体チップの実装時には、基板に応力がかかるた
め、先に実装された半導体チップの電極部に亀裂を与え
ることになっていた。また、ワイヤーボンディングと同
様に基板上に半導体チップを搭載するためモジュールと
しての厚みを増加させてしまうという問題点があった。
一方、半導体チップを大容量化、多機能化し、多くの入
出力端子を半導体チップから基板上に接続する半導体チ
ップの実装方法おいて、多くの入出力端子を突起電極と
して半導体チップ上に配置するには、電極の面積を縮小
し、配置ピッチを微細化する必要があるため、機械的強
度が十分に得られるほど突起電極の接続部の面積を確保
することはできず、平面電極を形成しなければならない
という問題点があった。
Further, when the size of a semiconductor chip is increased and the number of electrodes is increased in order to increase the number of functions, the bonding load when mounting the semiconductor chip on the electrodes of the substrate increases, and stress is applied to the active surface of the semiconductor chip. In this case, the characteristics of the semiconductor chip are changed. In addition, when a semiconductor chip is mounted, a stress is applied to the substrate, so that the electrode portion of the previously mounted semiconductor chip is cracked. In addition, there is a problem that the thickness of the module is increased because the semiconductor chip is mounted on the substrate similarly to the wire bonding.
On the other hand, in a semiconductor chip mounting method of increasing the capacity and increasing the functionality of a semiconductor chip and connecting many input / output terminals from the semiconductor chip to a substrate, many input / output terminals are arranged on the semiconductor chip as projection electrodes. In this case, it is necessary to reduce the area of the electrodes and make the arrangement pitch finer, so that it is not possible to secure the area of the connection portions of the protruding electrodes so that sufficient mechanical strength can be obtained. There was a problem that had to be.

【0005】また、微少な電極を形成するために高度な
技術レベルが要求されるという問題点があった。さらに
微細化、多ピン化されるとともに、サイズが大型化した
半導体チップの平面電極を基板上の電極に対し平面方向
同士で実装するには、非常に大きなボンディング加重が
必要となり、半導体チップあるいは基板に不要な応力を
印加することとなってしまうという問題点があった。そ
こで、本発明の目的は、モジュール形成時の厚みを低減
し、平面方向の材料伸縮によるせん断応力に耐える半導
体装置および半導体装置の製造方法を提供することにあ
る。また、半導体チップの実装時のボンディング荷重を
低減することができる実装方法を提供することにある。
Further, there is a problem that a high technical level is required to form minute electrodes. In order to mount the planar electrodes of a semiconductor chip, which has been miniaturized and multi-pinned and the size of which has been increased, in a plane direction with respect to the electrodes on the substrate, a very large bonding load is required. However, there is a problem that an unnecessary stress is applied to the substrate. SUMMARY OF THE INVENTION It is an object of the present invention to provide a semiconductor device and a method of manufacturing a semiconductor device which can reduce a thickness at the time of forming a module and withstand a shear stress caused by a material expansion and contraction in a planar direction. Another object of the present invention is to provide a mounting method capable of reducing a bonding load when mounting a semiconductor chip.

【0006】[0006]

【課題を解決するための手段】上記課題を解決するた
め、半導体装置は、半導体チップが形成された面に設け
られた表面電極と、前記表面電極と導通され、当該半導
体装置の実装面にほぼ垂直な側面に溝状に形成された側
面電極と、を備えたことを特徴としている。この場合に
おいて、前記側面電極は少なくとも前記実装面側が断面
テーパー状に形成されているように構成することができ
る。
In order to solve the above-mentioned problems, a semiconductor device has a surface electrode provided on a surface on which a semiconductor chip is formed, and is electrically connected to the surface electrode. And a side electrode formed in a groove shape on a vertical side surface. In this case, the side surface electrode can be configured such that at least the mounting surface side is formed in a tapered cross section.

【0007】また、半導体装置の製造方法は、ウェハ上
に表面電極とともに複数のLSIを形成するLSI形成
工程と、前記表面電極近傍に側面電極形成用孔を穿孔す
る穿孔工程と、前記側面電極形成用孔と前記表面電極と
を電気的に接続する接続工程と、ウェハ切断後の前記側
面電極形成用孔が所定の側面電極となるように前記ウェ
ハを前記側面電極形成用孔部分で切断して複数の半導体
チップに分離する切断工程と、を備えたことを特徴とし
ている。この場合において、前記穿孔工程は、前記ウェ
ハのLSI形成面側から他面に向かってレーザ光により
穿孔を行うようにしてもよい。
Further, the method of manufacturing a semiconductor device includes an LSI forming step of forming a plurality of LSIs together with a surface electrode on a wafer, a punching step of forming a side electrode forming hole near the surface electrode, A connection step of electrically connecting the hole and the surface electrode, and cutting the wafer at the side electrode forming hole portion so that the side electrode forming hole after wafer cutting becomes a predetermined side electrode. And a cutting step for separating into a plurality of semiconductor chips. In this case, in the punching step, the punching may be performed by laser light from the LSI forming surface side of the wafer to the other surface.

【0008】また、前記接続工程は、前記LSIの形成
面に絶縁コーティングを行うコーティング工程と、前記
絶縁コーティングの前記表面電極の所定対応部分を除去
する絶縁除去工程と、前記絶縁コーティングが除去され
た前記表面電極と前記側面電極形成用孔とをメッキによ
り導通させるメッキ工程と、を備えるようにしてもよ
い。
The connecting step includes a coating step of applying an insulating coating to a surface on which the LSI is formed, an insulating removing step of removing a predetermined portion of the surface electrode of the insulating coating, and a step of removing the insulating coating. A plating step of conducting the surface electrode and the side-surface electrode forming hole by plating.

【0009】さらに半導体装置の実装面にほぼ垂直な側
面に溝状に形成された側面電極を有する半導体装置を基
板上に実装する半導体装置の実装方法において、基板側
に前記半導体装置を収容する収容凹部と、前記収容凹部
の中央部分に向かって基板表面から片持ち梁状態に突設
され、かつ、前記側面電極に対応する位置に配置された
オーバーハング配線パターンとを設け、前記基板に垂直
に前記半導体装置を前記収容凹部内に所定の圧力で押し
込むことにより前記オーバーハングパターンと前記側面
電極を電気的に接続させる、ことを特徴としている。
Further, in a semiconductor device mounting method for mounting a semiconductor device having a side surface electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, a housing for housing the semiconductor device on the substrate side A concave portion, an overhang wiring pattern projecting from the substrate surface in a cantilever manner toward the center of the accommodation concave portion, and disposed at a position corresponding to the side surface electrode; The overhang pattern and the side electrode are electrically connected by pushing the semiconductor device into the housing recess at a predetermined pressure.

【0010】また、半導体装置の実装面にほぼ垂直な側
面に溝状に形成された側面電極を有する半導体装置を基
板上に実装する半導体装置の実装方法において、基板側
に前記半導体装置を収容する収容凹部と、前記収容凹部
を形成するに先立って前記側面電極に対応する位置に設
けた貫通スルーホールを垂直に切断あるいは切削するこ
とにより形成した基板側側面電極と、を設け、前記基板
に垂直に前記半導体装置を前記収容凹部内に収容し、前
記半導体装置の側面電極と前記基板側側面電極との間を
導電性接着剤により導通させる、ことを特徴としてい
る。
In a semiconductor device mounting method of mounting a semiconductor device having a side electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, the semiconductor device is housed on the substrate side. A housing recess, and a substrate side electrode formed by vertically cutting or cutting a through-hole provided at a position corresponding to the side electrode prior to forming the housing recess, and provided perpendicular to the substrate. The semiconductor device is housed in the housing recess, and conduction between the side electrode of the semiconductor device and the side electrode on the substrate side is conducted by a conductive adhesive.

【0011】また、半導体装置の実装面にほぼ垂直な側
面に溝状に形成された側面電極を有する半導体装置を基
板上に実装する半導体装置の実装方法において、基板側
に前記半導体装置を収容する収容凹部と、前記収容凹部
を形成するに先立って前記側面電極に対応する位置に設
けたスルーホールの全部あるいは一部を垂直に切断ある
いは切削することにより形成した基板側側面電極と、を
設け、前記基板に垂直に前記半導体装置を前記収容凹部
内に収容し、前記半導体装置の側面電極と前記基板側側
面電極との間を導電性接着剤により導通させる、ことを
特徴としている。
In a semiconductor device mounting method for mounting a semiconductor device having a side electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, the semiconductor device is housed on the substrate side. Housing recess, and a substrate side electrode formed by vertically cutting or cutting all or a part of a through hole provided at a position corresponding to the side electrode prior to forming the housing recess, The semiconductor device is housed in the housing recess perpendicularly to the substrate, and conduction is provided between a side electrode of the semiconductor device and the substrate side electrode by a conductive adhesive.

【0012】また、半導体装置の実装面にほぼ垂直な側
面に溝状に形成された側面電極を有する半導体装置を基
板上に実装する半導体装置の実装方法において、基板側
に前記半導体装置を収容する収容凹部を設け、前記収容
凹部内の内層配線パターンと基板表面の表層配線パター
ンとを前記側面電極に対応する位置に対応づけて導電性
ワイヤで接続し、前記基板に垂直に前記半導体装置を前
記収容凹部内に所定の圧力で押し込むことにより前記導
電性ワイヤと前記側面電極を電気的に接続させる、こと
を特徴としている。
In a semiconductor device mounting method for mounting a semiconductor device having side electrodes formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, the semiconductor device is housed on the substrate side. A receiving recess is provided, and an inner wiring pattern in the receiving recess and a surface wiring pattern on the surface of the substrate are connected by a conductive wire in association with a position corresponding to the side surface electrode, and the semiconductor device is vertically attached to the substrate. It is characterized in that the conductive wire and the side electrode are electrically connected by pushing the conductive wire into the housing recess with a predetermined pressure.

【0013】[0013]

【発明の実施の形態】次に本発明の好適な実施の形態に
ついて図面を参照して説明する。 [1]半導体チップの製造 まず、半導体チップの製造工程について説明する。 [1.1]LSI形成工程 まず、Si製のウェハに通常と同様の工程でLSIを形
成する。LSIの形成工程は、洗浄工程、拡散工程、薄
膜形成工程、パターニング工程を含む。まず、洗浄工程
は、ウェハを清浄な状態とすべく、洗浄を行う。拡散工
程は、pn接合工程や不純物プロファイル制御のために
行われる。薄膜形成工程は、シリコン窒化膜、多結晶シ
リコン、表面電極を含むアルミニウム電極等を形成す
る。パターニング工程は、露光工程およびエッチング工
程を含んでいる。露光工程は、シリコン基板上に塗布さ
れたレジストを露光、現像して所定のレジストパターン
を形成する。エッチング工程は、露光工程におけるレジ
ストパターンをマスクとして下地膜をエッチングし、パ
ターンを形成することとなる。以下、洗浄工程、拡散工
程、薄膜形成工程、パターニング工程繰り返して複数の
LSIをウェハ上に形成する。
Next, a preferred embodiment of the present invention will be described with reference to the drawings. [1] Manufacturing of Semiconductor Chip First, the manufacturing process of the semiconductor chip will be described. [1.1] LSI Forming Step First, an LSI is formed on a Si wafer by the same process as usual. The LSI forming process includes a cleaning process, a diffusion process, a thin film forming process, and a patterning process. First, in the cleaning step, cleaning is performed to keep the wafer in a clean state. The diffusion step is performed for a pn junction step and impurity profile control. In the thin film forming step, a silicon nitride film, polycrystalline silicon, an aluminum electrode including a surface electrode, and the like are formed. The patterning step includes an exposure step and an etching step. In the exposure step, the resist applied on the silicon substrate is exposed and developed to form a predetermined resist pattern. In the etching step, the underlying film is etched using the resist pattern in the exposure step as a mask to form a pattern. Hereinafter, a plurality of LSIs are formed on the wafer by repeating the cleaning step, the diffusion step, the thin film forming step, and the patterning step.

【0014】[1.2]穿孔工程 図1にLSIが形成されたウェハの外観斜視図を示す。
次に、複数のLSI1が形成されたウェハ2において、
図2に示すように、LSI1の周辺部分に形成された電
極(表面電極)3近傍の領域であって各電極に対応する
位置であって、仮想的に設けたダイシングラインDLに
沿って側面電極形成用孔4を穿孔して形成する。側面電
極形成用孔の穿孔後、図3(a)に示すように、LSI
および側面電極形成用孔の絶縁コーティング5を行う。
[1.2] Drilling Step FIG. 1 is an external perspective view of a wafer on which an LSI is formed.
Next, in the wafer 2 on which a plurality of LSIs 1 are formed,
As shown in FIG. 2, a side electrode is formed in a region near an electrode (surface electrode) 3 formed in a peripheral portion of the LSI 1, at a position corresponding to each electrode, and along a virtually provided dicing line DL. The forming hole 4 is formed by punching. After drilling the side electrode forming hole, as shown in FIG.
Then, the insulating coating 5 for the side electrode forming holes is performed.

【0015】[1.3]メッキ工程 次に図3(b)に示すように、表面電極の全部または一
部の絶縁コーティングをレーザ加工などにより除去す
る。そして、図3(c)に示すように、一般的な電極用
のメッキ材料6を用いて表面電極および側面電極形成用
孔内にメッキ処理を施し、両者を導通状態とする。次に
表面電極および側面電極形成用孔にポリイミドコーティ
ングなどの所定のコーティング処理を施す。
[1.3] Plating Step Next, as shown in FIG. 3B, the insulating coating on all or a part of the surface electrode is removed by laser processing or the like. Then, as shown in FIG. 3C, a plating process is performed on the surface electrode and the side surface electrode forming hole by using a general electrode plating material 6, and both are brought into a conductive state. Next, a predetermined coating process such as a polyimide coating is performed on the holes for forming the surface electrodes and the side electrodes.

【0016】[1.4]ダイシング工程 次にウェハ2を切り離して半導体チップにすべくダイシ
ングを行う。この場合において、側面電極形成用孔4の
中心点を通る直線(図2にダイシングラインDLとして
表示)に沿ってウェハ2のダイシングを行い、半導体チ
ップ20(図4参照)を得る。これにより、側面電極形
成用孔4は、2等分され、側面電極10となる。図4に
側面電極の外観斜視図を示す。図4に示すように、側面
電極10は、竹を半分に割ったような形状となってい
る。なお、得られる半導体チップ20の厚さを低減する
必要があれば、ダイシング前にウェハ2のLSI形成面
に対向する面(半導体チップの裏面;実装面)20Aに
機械的研磨あるいは化学的研磨を施すことにより厚さを
低減することが可能である。なお、ハーフダイシング状
態であれば、ダイシング後に面20Aに機械的研磨ある
いは化学的研磨を施すことにより厚さを低減することも
可能である。
[1.4] Dicing Step Next, dicing is performed to separate the wafer 2 into semiconductor chips. In this case, the wafer 2 is diced along a straight line (shown as a dicing line DL in FIG. 2) passing through the center point of the side electrode forming hole 4 to obtain a semiconductor chip 20 (see FIG. 4). As a result, the side-surface electrode forming hole 4 is divided into two equal parts, and the side-surface electrode 10 is formed. FIG. 4 shows an external perspective view of the side electrode. As shown in FIG. 4, the side surface electrode 10 has a shape obtained by splitting bamboo in half. If it is necessary to reduce the thickness of the obtained semiconductor chip 20, mechanical polishing or chemical polishing is performed on the surface (the back surface of the semiconductor chip; mounting surface) 20A of the wafer 2 facing the LSI forming surface before dicing. By performing the application, the thickness can be reduced. In the half dicing state, the thickness can be reduced by subjecting the surface 20A to mechanical polishing or chemical polishing after dicing.

【0017】[2]半導体チップの基板への実装 次に半導体チップの基板への実装について各基板毎に説
明する。 [2.1]フレキシブル基板の場合 まず、最初に実装対象の基板がフレキシブル基板の場合
について説明する。図5(a)、(b)に示すように、
半導体チップ20の実装先がフレキシブル基板30であ
る場合には、フレキシブル基板30の配線パターン31
を半導体チップ20の側面電極10に対応する位置に配
置したオーバーハングパターンとする。配線パターン3
1の材料としては、銅(Cu)、ニッケル(Ni)、金
(Au)などが用いられる。そして、半導体チップ20
を吸着などの方法により支持したツールTLにより半導
体チップ20の位置合わせを行いながら、フレキシブル
基板30に垂直な方向(図5(a)中、矢印で示す。)
から所定の圧力で加圧しながら実装する。
[2] Mounting of Semiconductor Chip on Substrate Next, mounting of the semiconductor chip on the substrate will be described for each substrate. [2.1] Case of Flexible Board First, the case where the board to be mounted is a flexible board will be described. As shown in FIGS. 5A and 5B,
When the mounting destination of the semiconductor chip 20 is the flexible substrate 30, the wiring pattern 31 of the flexible substrate 30 is used.
Is an overhang pattern arranged at a position corresponding to the side surface electrode 10 of the semiconductor chip 20. Wiring pattern 3
Copper (Cu), nickel (Ni), gold (Au), or the like is used as the material of (1). Then, the semiconductor chip 20
While aligning the semiconductor chip 20 with the tool TL supporting the method by suction or the like (indicated by an arrow in FIG. 5A).
And mounting while applying a predetermined pressure.

【0018】この場合に、半導体チップ20の側面電極
10と、フレキシブル基板30の配線パターン(オーバ
ーハングパターン)31とは図6に示すように接触状態
となり、導通することとなる。また、図7(a)に示す
ように、穿孔時に半導体チップの実装面側の側面電極の
形状がテーパー形状となるように側面電極形成用孔4を
形成すれば、図7(b)に示すように、側面電極10の
実装面側はテーパー形状となり、図8に示すように、よ
り確実に半導体チップ20の側面電極10と、フレキシ
ブル基板30の配線パターン31(オーバーハングパタ
ーン)と、が電気的に接続状態となる。このようなテー
パー形状の側面電極形成用孔4を形成するためには、L
SI形成面側から所定の出力のレーザ光で穿孔を行えば
よい。さらに配線パターン(オーバーハングパターン)
31を弾性の高い材料で形成し、半導体チップ20の実
装による配線パターン(オーバーハングパターン)31
の変形に伴う反発力により電気的接続の確実性を向上さ
せることも可能である。さらにまた、あらかじめ配線パ
ターン(オーバハングパターン)31に半田メッキを施
しておき、側面電極10と半田付けを行って電気的接続
を確保するように構成することも可能である。
In this case, the side electrode 10 of the semiconductor chip 20 and the wiring pattern (overhang pattern) 31 of the flexible substrate 30 are brought into contact as shown in FIG. Further, as shown in FIG. 7A, when the side electrode forming hole 4 is formed so that the shape of the side electrode on the mounting surface side of the semiconductor chip at the time of drilling is tapered, FIG. As described above, the mounting surface side of the side electrode 10 has a tapered shape, and as shown in FIG. 8, the side electrode 10 of the semiconductor chip 20 and the wiring pattern 31 (overhang pattern) of the flexible board 30 are more reliably electrically connected. Connection state. In order to form such a tapered side surface electrode forming hole 4, L
The perforation may be performed with a laser beam of a predetermined output from the SI forming surface side. Wiring pattern (overhang pattern)
31 is formed of a material having high elasticity, and a wiring pattern (overhang pattern) 31 by mounting the semiconductor chip 20 is formed.
It is also possible to improve the reliability of the electrical connection by the repulsive force accompanying the deformation of. Furthermore, it is also possible to apply a solder plating to the wiring pattern (overhang pattern) 31 in advance, and to perform soldering with the side surface electrode 10 to secure electrical connection.

【0019】[2.2]セラミック基板に貫通スルーホ
ールを形成する場合 次に実装対象の基板がセラミック基板であり、このセラ
ミック基板に貫通スルーホールを形成する場合について
図9を参照して説明する。図9に示すように、グリーン
状態(焼成前)の多層セラミック基板40の最表層とな
る表層基板41の形成時に、次層につながる貫通スルー
ホール42を形成し、この貫通スルーホール42の半導
体チップ20配置側の半分を抜き落とすことにより、基
板側側面電極43を形成する。その後、半導体チップ実
装用凹部44に相当する部分を打ち抜いた表層基板41
を含む他の層を構成する基板45と張り合わせ、焼成し
て多層セラミック基板40とする。そして、図9に示す
ように、半導体チップ20の側面電極10と基板側側面
電極43との間を導電粒子入りの異方性導電接着剤46
を介して電気的に接続する。この結果、半導体チップ2
0と表層基板41の次に積層されている基板45との間
には、異方性導電接着剤46を入れる必要がないので、
実装時のボンディング荷重を低減させることができ、半
導体チップ20に不要な応力を受けることがないので、
半導体チップ20の特性の変化を抑制し、実装時の破損
を避けることができる。すなわち、半導体実装時に導電
粒子入りの異方性導電接着剤46を側面方向に押し出し
ながら、異方性導電接着剤46と基板側配線または異方
性導電接着剤46と基板表面との間に形成された気泡を
押し出す必要がないので、半兆体チップ20に大荷重が
印加されることがないので、半導体チップ20の特性の
変化を抑制し、実装時の破損を避けることができるので
ある。
[2.2] Forming a Through-Through Hole in a Ceramic Substrate Next, a case where a substrate to be mounted is a ceramic substrate and a through-hole is formed in this ceramic substrate will be described with reference to FIG. . As shown in FIG. 9, when forming a surface layer substrate 41 which is the outermost layer of a multilayer ceramic substrate 40 in a green state (before firing), a through-hole 42 connected to the next layer is formed, and the semiconductor chip of the through-hole 42 is formed. The substrate-side side surface electrode 43 is formed by extracting half of the 20 side. Thereafter, the surface layer substrate 41 punched out at a portion corresponding to the semiconductor chip mounting concave portion 44.
Is bonded to a substrate 45 constituting another layer containing, and fired to form a multilayer ceramic substrate 40. Then, as shown in FIG. 9, an anisotropic conductive adhesive 46 containing conductive particles is provided between the side electrode 10 of the semiconductor chip 20 and the substrate side electrode 43.
To make electrical connection. As a result, the semiconductor chip 2
Since there is no need to put the anisotropic conductive adhesive 46 between the substrate 0 and the substrate 45 laminated next to the surface layer substrate 41,
Since the bonding load at the time of mounting can be reduced, and unnecessary stress is not applied to the semiconductor chip 20,
Changes in the characteristics of the semiconductor chip 20 can be suppressed, and breakage during mounting can be avoided. That is, anisotropic conductive adhesive 46 containing conductive particles is extruded in the lateral direction during semiconductor mounting, and is formed between anisotropic conductive adhesive 46 and substrate-side wiring or anisotropic conductive adhesive 46 and substrate surface. Since there is no need to push out the generated air bubbles, a large load is not applied to the semicircular chip 20, so that a change in the characteristics of the semiconductor chip 20 can be suppressed and breakage during mounting can be avoided.

【0020】[2.3]リジット基板に貫通スルーホー
ルを形成する場合 次に実装対象の基板がリジット基板であり、このリジッ
ト基板に貫通スルーホールを形成する場合について図1
0を参照して説明する。まず、図10に示すように、多
層リジット基板50の全層あるいは所定の層まで貫通す
る貫通スルーホール51を形成して、機械的切削加工に
より半導体チップ実装用凹部52を形成するに際し、貫
通スルーホール51を深さ方向の半分程度まで、かつ、
貫通スルーホール51の半導体チップ20配置側の半分
を削り落とす。これにより、貫通スルーホール51は、
基板側側面電極53を形成することとなる。そして、図
10に示すように、半導体チップ20の側面電極10と
基板側側面電極53との間を導電粒子入りの異方性導電
接着剤54を介して接続する。この結果、[2.2]項
において説明したセラミック基板の場合と同様に半導体
チップ20と半導体チップが対向する基板面50Aとの
間には、異方性導電接着剤54を入れる必要がない。従
って、実装時のボンディング荷重を低減させることがで
き、半導体チップ20に不要な応力をかけることがない
ので、半導体チップ20の特性の変化を抑制し、破損を
防止することができる。
[2.3] Case of Forming Through-Through Hole in Rigid Board Next, a case where a substrate to be mounted is a rigid board and a through-hole is formed in this rigid board is shown in FIG.
0 will be described. First, as shown in FIG. 10, a through-hole 51 is formed to penetrate all layers or a predetermined layer of the multilayer rigid substrate 50, and a through-hole 51 is formed by mechanical cutting to form a recess 52 for mounting a semiconductor chip. Hole 51 to about half of the depth direction, and
Half of the through-hole 51 on the side where the semiconductor chip 20 is arranged is cut off. Thereby, the through-hole 51 is
The substrate side electrode 53 is formed. Then, as shown in FIG. 10, the side electrode 10 of the semiconductor chip 20 and the substrate side electrode 53 are connected via an anisotropic conductive adhesive 54 containing conductive particles. As a result, it is not necessary to insert the anisotropic conductive adhesive 54 between the semiconductor chip 20 and the substrate surface 50A facing the semiconductor chip 20 as in the case of the ceramic substrate described in [2.2]. Therefore, the bonding load at the time of mounting can be reduced, and unnecessary stress is not applied to the semiconductor chip 20, so that a change in characteristics of the semiconductor chip 20 can be suppressed and breakage can be prevented.

【0021】[2.4]基板に内層スルーホール(非貫
通スルーホール)を形成する場合 続いて実装対象の基板がセラミック基板あるいはリジッ
ト基板であり、この基板に内層スルーホール形成する場
合について図11を参照して説明する。まず、多層セラ
ミック基板あるいは多層リジット基板である多層基板6
0の表層基板から所定の内層基板まで内層スルーホール
61を形成し、表層基板と内層基板との間を電気的に接
続する。そして、セラミック基板の場合は、半導体チッ
プ実装用凹部62に相当する部分を打ち抜いた基板を含
む各層を構成する基板を張り合わせ、焼成して多層セラ
ミック基板とする。また、リジット基板の場合は、機械
的切削加工により半導体チップ実装用凹部62を形成す
る。この場合に、内層スルーホール61の半導体チップ
20配置側の半分を削り落とすことにより基板側側面電
極63を形成する。そして、図11に示すように、半導
体チップ20の側面電極20と内層スルーホールを利用
して形成された基板側側面電極63との間を導電粒子入
りの異方性導電接着剤64を介して接続する。
[2.4] Case of Forming Inner-Layer Through Hole (Non-Through-Through Hole) on Substrate Subsequently, the substrate to be mounted is a ceramic substrate or a rigid substrate, and a case where an inner-layer through hole is formed on this substrate is shown in FIG. This will be described with reference to FIG. First, a multilayer substrate 6 which is a multilayer ceramic substrate or a multilayer rigid substrate.
An inner-layer through hole 61 is formed from the surface substrate No. 0 to a predetermined inner-layer substrate, and the surface substrate and the inner-layer substrate are electrically connected. Then, in the case of a ceramic substrate, substrates constituting each layer including a substrate obtained by punching out a portion corresponding to the concave portion 62 for mounting a semiconductor chip are laminated and fired to obtain a multilayer ceramic substrate. In the case of a rigid substrate, the concave portion 62 for mounting a semiconductor chip is formed by mechanical cutting. In this case, the substrate side surface electrode 63 is formed by shaving off a half of the inner layer through hole 61 on the semiconductor chip 20 side. Then, as shown in FIG. 11, between the side surface electrode 20 of the semiconductor chip 20 and the substrate side surface electrode 63 formed using the inner layer through hole via an anisotropic conductive adhesive 64 containing conductive particles. Connecting.

【0022】この結果、[2.2]項および[2.3]
項において説明したセラミック基板あるいはリジット基
板の場合と同様に半導体チップ20と半導体チップ20
が対向する基板面65との間には、異方性導電接着剤6
4を入れる必要がない。従って、実装時のボンディング
荷重を低減させることができ、半導体チップ20に不要
な応力がかかることがないので、半導体チップ20の特
性の変化を抑制し、破損を防止することができる。
As a result, [2.2] and [2.3]
Semiconductor chip 20 and the semiconductor chip 20 in the same manner as in the case of the ceramic substrate or the rigid substrate described in the section.
Between the substrate surface 65 and the anisotropic conductive adhesive 6
There is no need to enter 4. Accordingly, the bonding load at the time of mounting can be reduced, and unnecessary stress is not applied to the semiconductor chip 20, so that a change in the characteristics of the semiconductor chip 20 can be suppressed and breakage can be prevented.

【0023】また、導電粒子入りの異方性導電接着剤5
4を介して接続する方法以外の方法としては、図12に
示すように、表層配線パターン71と内層配線パターン
72とをワイヤボンディング装置によりワイヤ73で接
続し、半導体チップ20を実装する際にワイヤ73を半
導体チップ側の側面電極10と内層配線パターン72
(基板)との間に挟み込む。これにより、半導体チップ
20の側面電極10と、ワイヤ73とは図12に示すよ
うに接触状態となり、導通することとなる。図12にお
いては、ワイヤ73を表層配線パターン71側に最初に
接続し、その後、内層配線パターン72側に接続する場
合を図示しているが、ワイヤ73を内層配線パターン7
2側に最初に接続するように構成することも可能であ
る。さらに、上記各構成において、半導体チップ20と
半導体チップ20が対向する基板72との間には、必要
に応じて、エポキシ系接着剤などを入れるようにしても
かまわない。
The anisotropic conductive adhesive 5 containing conductive particles
As a method other than the method of connecting via the wiring 4, as shown in FIG. 12, the surface wiring pattern 71 and the inner wiring pattern 72 are connected by a wire 73 using a wire bonding apparatus, and when the semiconductor chip 20 is mounted, 73 is the side electrode 10 on the semiconductor chip side and the inner layer wiring pattern 72
(Substrate). As a result, the side electrode 10 of the semiconductor chip 20 and the wire 73 are brought into contact with each other as shown in FIG. FIG. 12 shows a case where the wire 73 is first connected to the surface wiring pattern 71 side and then connected to the inner wiring pattern 72 side.
It is also possible to configure to connect first to the two sides. Further, in each of the above configurations, an epoxy-based adhesive or the like may be inserted between the semiconductor chip 20 and the substrate 72 on which the semiconductor chip 20 faces, as necessary.

【0024】[3]実施形態の効果 以上の説明のように、本実施形態によれば、従来の実装
方法と比較して実装時のボンディング荷重を低減するこ
とができ、平面方向のせん断応力を半導体チップに対し
て与えることがないので、半導体チップの特性の変化を
抑制し、破損を防止することができる。また、半導体チ
ップ側の側面電極と基板側の側面電極とは、温度変化な
どに伴う半導体チップあるいは基板の変形(平面方向の
変形)の影響を受けにくく、接続部に亀裂等が発生しに
くく、接続信頼性を向上することができる。すなわち、
従来は、電極に対して直行する方向にせん断応力がかか
ることになっていたのに対し、本実施形態によれば、せ
ん断応力に平行する形で半導体チップの電極と基板電極
とが接続されており、弾性を有することとなって半導体
チップあるいは基板の変形の影響を受けにくくなってい
るのである。さらに半導体チップを含むモジュールの厚
みを低減することが可能となる。以上の説明において
は、基板の一方の面に半導体チップを実装する場合につ
いて述べたが、基板実装時のボンディング荷重が低いた
め、基板の両面に実装することも可能となっている。
[3] Effects of Embodiment As described above, according to this embodiment, the bonding load during mounting can be reduced as compared with the conventional mounting method, and the shear stress in the plane direction can be reduced. Since it is not applied to the semiconductor chip, a change in the characteristics of the semiconductor chip can be suppressed and breakage can be prevented. Further, the side electrode on the semiconductor chip side and the side electrode on the substrate side are hardly affected by deformation (deformation in a plane direction) of the semiconductor chip or the substrate due to a temperature change or the like, and a crack or the like is hardly generated in a connection portion. Connection reliability can be improved. That is,
Conventionally, a shear stress was applied in a direction perpendicular to the electrodes.On the other hand, according to the present embodiment, the electrodes of the semiconductor chip and the substrate electrodes were connected in a form parallel to the shear stress. Therefore, the semiconductor chip or the substrate is less susceptible to deformation due to the elasticity. Further, the thickness of the module including the semiconductor chip can be reduced. In the above description, the case where the semiconductor chip is mounted on one surface of the substrate has been described. However, since the bonding load at the time of mounting the substrate is low, it is possible to mount the semiconductor chip on both surfaces of the substrate.

【0025】[0025]

【発明の効果】本発明によれば、実装時のボンディング
荷重を低減することができ、平面方向のせん断応力を半
導体チップに対して与えることがないので、半導体チッ
プの特性の変化を抑制し、破損を防止することができ
る。また、半導体装置の電極と基板電極との間の接続を
確実に行え、接続信頼性を向上することができる。
According to the present invention, the bonding load at the time of mounting can be reduced, and a shear stress in the planar direction is not applied to the semiconductor chip. Damage can be prevented. Further, the connection between the electrode of the semiconductor device and the substrate electrode can be reliably performed, and the connection reliability can be improved.

【図面の簡単な説明】[Brief description of the drawings]

【図1】 LSIが形成されたウェハの外観斜視であ
る。
FIG. 1 is an external perspective view of a wafer on which an LSI is formed.

【図2】 側面電極形成用孔の穿孔についての説明図で
ある。
FIG. 2 is an explanatory diagram of perforation of a side electrode forming hole.

【図3】 側面電極の導通をとるための半導体装置の製
造方法の説明図である。
FIG. 3 is an explanatory diagram of a method of manufacturing a semiconductor device for establishing conduction of a side electrode.

【図4】 側面電極の外観斜視図である。FIG. 4 is an external perspective view of a side electrode.

【図5】 配線パターンをオーバーハングパターンとし
た場合の実装説明図である。
FIG. 5 is an explanatory view of mounting when a wiring pattern is an overhang pattern.

【図6】 側面電極と配線パターン(オーバーハングパ
ターン)との接続状態の説明図である。
FIG. 6 is an explanatory diagram of a connection state between a side electrode and a wiring pattern (overhang pattern).

【図7】 実装面側がテーパー形状となっている側面電
極の説明図である。
FIG. 7 is an explanatory diagram of a side surface electrode in which a mounting surface side has a tapered shape.

【図8】 側面電極の実装面側はテーパー形状とした場
合の実装説明図である。
FIG. 8 is an explanatory view of mounting when the mounting surface side of the side electrode is formed in a tapered shape.

【図9】セラミック基板に貫通スルーホールを形成する
場合の実装説明図である。
FIG. 9 is an explanatory view of mounting when a through-hole is formed in a ceramic substrate.

【図10】 リジット基板に貫通スルーホールを形成す
る場合の実装説明図である。
FIG. 10 is an explanatory view of mounting when a through-hole is formed in a rigid substrate.

【図11】 基板に内層スルーホール(非貫通スルーホ
ール)を形成する場合の実装説明図である。
FIG. 11 is an explanatory view of mounting when an inner layer through hole (non-through through hole) is formed in the substrate.

【図12】 導電性ワイヤを用いて実装を行う場合の実
装説明図である。
FIG. 12 is an explanatory diagram of mounting in a case where mounting is performed using a conductive wire.

【図13】 従来のワイヤボンディング方式を説明する
ための図である。
FIG. 13 is a view for explaining a conventional wire bonding method.

【図14】 従来のフリップチップボンディング方式を
説明するための図である。
FIG. 14 is a view for explaining a conventional flip chip bonding method.

【図15】 従来のフリップチップボンディング方式に
おける問題点を説明する図である。
FIG. 15 is a diagram illustrating a problem in a conventional flip chip bonding method.

【符号の説明】[Explanation of symbols]

1…LSI 2…ウェハ 3…表面電極 4…側面電極形成用孔 5…絶縁コーティング 6…メッキ 10…側面電極 20…半導体チップ(半導体装置) 30…フレキシブル基板 31…配線パターン(オーバーハングパターン) 40…多層セラミック基板 41…表層基板 42…貫通スルーホール 43…基板側側面電極 44…半導体チップ実装用凹部 45…基板 46…異方性導電接着剤 50…多層リジット基板 50A…基板面 51…貫通スルーホール 52…半導体チップ実装用凹部 53…基板側側面電極 54…異方性導電接着剤 60…多層基板 61…内層スルーホール 62…半導体チップ実装用凹部 63…基板側側面電極 64…異方性導電接着剤 71…表層配線パターン 72…内層配線パターン 73…ワイヤ DESCRIPTION OF SYMBOLS 1 ... LSI 2 ... Wafer 3 ... Surface electrode 4 ... Side electrode formation hole 5 ... Insulation coating 6 ... Plating 10 ... Side electrode 20 ... Semiconductor chip (semiconductor device) 30 ... Flexible substrate 31 ... Wiring pattern (overhang pattern) 40 ... Multilayer ceramic substrate 41 ... Surface layer substrate 42 ... Through through hole 43 ... Substrate side electrode 44 ... Recess for semiconductor chip mounting 45 ... Substrate 46 ... Anisotropic conductive adhesive 50 ... Multilayer rigid substrate 50A ... Substrate surface 51 ... Through through Hole 52: Semiconductor chip mounting recess 53: Substrate side electrode 54: Anisotropic conductive adhesive 60: Multilayer substrate 61: Inner layer through hole 62: Semiconductor chip mounting recess 63: Substrate side electrode 64: Anisotropic conduction Adhesive 71: Surface wiring pattern 72: Inner wiring pattern 73: Wire

───────────────────────────────────────────────────── フロントページの続き Fターム(参考) 5F033 MM30 PP27 PP28 VV07 5F044 AA02 AA05 EE01 EE02 EE21 KK03 KK04 KK07 KK11 KK25 LL07 MM03 MM13 MM25 NN02 NN03 QQ06  ──────────────────────────────────────────────────続 き Continued on the front page F term (reference) 5F033 MM30 PP27 PP28 VV07 5F044 AA02 AA05 EE01 EE02 EE21 KK03 KK04 KK07 KK11 KK25 LL07 MM03 MM13 MM25 NN02 NN03 QQ06

Claims (9)

【特許請求の範囲】[Claims] 【請求項1】 半導体チップが形成された面に設けられ
た表面電極と、 前記表面電極と導通され、当該半導体装置の実装面にほ
ぼ垂直な側面に溝状に形成された側面電極と、 を備えたことを特徴とする半導体装置。
1. A surface electrode provided on a surface on which a semiconductor chip is formed, and a side electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device, being electrically connected to the surface electrode. A semiconductor device, comprising:
【請求項2】 請求項1記載の半導体装置において、 前記側面電極は少なくとも前記実装面側が断面テーパー
状に形成されていることを特徴とする半導体装置。
2. The semiconductor device according to claim 1, wherein the side surface electrode has a tapered cross section at least on the mounting surface side.
【請求項3】 ウェハ上に表面電極とともに複数のLS
Iを形成するLSI形成工程と、 前記表面電極近傍に側面電極形成用孔を穿孔する穿孔工
程と、 前記側面電極形成用孔と前記表面電極とを電気的に接続
する接続工程と、 ウェハ切断後の前記側面電極形成用孔が所定の側面電極
となるように前記ウェハを前記側面電極形成用孔部分で
切断して複数の半導体チップに分離する切断工程と、 を備えたことを特徴とする半導体装置の製造方法。
3. A plurality of LSs together with a surface electrode on a wafer.
An LSI forming step of forming I; a perforating step of perforating a side electrode forming hole near the surface electrode; a connecting step of electrically connecting the side electrode forming hole and the surface electrode; and after cutting the wafer. A cutting step of cutting the wafer at the side electrode forming hole portion and separating the wafer into a plurality of semiconductor chips so that the side electrode forming hole becomes a predetermined side electrode. Device manufacturing method.
【請求項4】 請求項3記載の半導体装置の製造方法に
おいて、 前記穿孔工程は、前記ウェハのLSI形成面側から他面
に向かってレーザ光により穿孔を行うことを特徴とする
半導体装置の製造方法。
4. The method of manufacturing a semiconductor device according to claim 3, wherein in the punching step, the hole is formed by laser light from an LSI forming surface side of the wafer to another surface. Method.
【請求項5】 請求項3記載の半導体装置の製造方法に
おいて、 前記接続工程は、前記LSIの形成面に絶縁コーティン
グを行うコーティング工程と、 前記絶縁コーティングの前記表面電極の所定対応部分を
除去する絶縁除去工程と、 前記絶縁コーティングが除去された前記表面電極と前記
側面電極形成用孔とをメッキにより導通させるメッキ工
程と、 を備えたことを特徴とする半導体製造装置の製造方法。
5. The method of manufacturing a semiconductor device according to claim 3, wherein the connecting step includes a step of performing an insulating coating on a surface on which the LSI is formed, and removing a predetermined portion of the insulating coating corresponding to the surface electrode. A method for manufacturing a semiconductor manufacturing apparatus, comprising: an insulation removing step; and a plating step of conducting by plating between the surface electrode from which the insulating coating has been removed and the side surface electrode forming hole.
【請求項6】 半導体装置の実装面にほぼ垂直な側面に
溝状に形成された側面電極を有する半導体装置を基板上
に実装する半導体装置の実装方法において、 基板側に前記半導体装置を収容する収容凹部と、前記収
容凹部の中央部分に向かって基板表面から片持ち梁状態
に突設され、かつ、前記側面電極に対応する位置に配置
されたオーバーハング配線パターンとを設け、 前記基板に垂直に前記半導体装置を前記収容凹部内に所
定の圧力で押し込むことにより前記オーバーハングパタ
ーンと前記側面電極を電気的に接続させる、ことを特徴
とする半導体装置の実装方法。
6. A semiconductor device mounting method for mounting a semiconductor device having a groove-shaped side electrode on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, wherein the semiconductor device is housed on the substrate side. A receiving recess, and an overhang wiring pattern protruding from the substrate surface in a cantilever manner toward the center of the receiving recess, and disposed at a position corresponding to the side electrode; Wherein the semiconductor device is pressed into the housing recess with a predetermined pressure to electrically connect the overhang pattern to the side electrode.
【請求項7】 半導体装置の実装面にほぼ垂直な側面に
溝状に形成された側面電極を有する半導体装置を基板上
に実装する半導体装置の実装方法において、 基板側に前記半導体装置を収容する収容凹部と、前記収
容凹部を形成するに先立って前記側面電極に対応する位
置に設けた貫通スルーホールを垂直に切断あるいは切削
することにより形成した基板側側面電極と、を設け、 前記基板に垂直に前記半導体装置を前記収容凹部内に収
容し、前記半導体装置の側面電極と前記基板側側面電極
との間を導電性接着剤により導通させる、ことを特徴と
する半導体装置の実装方法。
7. A method for mounting a semiconductor device having a side electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, wherein the semiconductor device is housed on the substrate side. A housing recess, and a substrate side electrode formed by vertically cutting or cutting a through-hole provided at a position corresponding to the side electrode prior to forming the housing recess, and provided perpendicular to the substrate. Wherein the semiconductor device is housed in the housing recess, and conduction between the side electrode of the semiconductor device and the side electrode on the substrate side is conducted by a conductive adhesive.
【請求項8】 半導体装置の実装面にほぼ垂直な側面に
溝状に形成された側面電極を有する半導体装置を基板上
に実装する半導体装置の実装方法において、 基板側に前記半導体装置を収容する収容凹部と、前記収
容凹部を形成するに先立って前記側面電極に対応する位
置に設けたスルーホールの全部あるいは一部を垂直に切
断あるいは切削することにより形成した基板側側面電極
と、を設け、 前記基板に垂直に前記半導体装置を前記収容凹部内に収
容し、前記半導体装置の側面電極と前記基板側側面電極
との間を導電性接着剤により導通させる、ことを特徴と
する半導体装置の実装方法。
8. A method of mounting a semiconductor device having a side electrode formed in a groove shape on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, wherein the semiconductor device is accommodated on the substrate side. Housing recess, and a substrate side electrode formed by vertically cutting or cutting all or a part of a through hole provided at a position corresponding to the side electrode prior to forming the housing recess, Mounting the semiconductor device in the housing recess perpendicular to the substrate, and electrically connecting a side electrode of the semiconductor device and the side electrode on the substrate side with a conductive adhesive. Method.
【請求項9】 半導体装置の実装面にほぼ垂直な側面に
溝状に形成された側面電極を有する半導体装置を基板上
に実装する半導体装置の実装方法において、 基板側に前記半導体装置を収容する収容凹部を設け、 前記収容凹部内の内層配線パターンと基板表面の表層配
線パターンとを前記側面電極に対応する位置に対応づけ
て導電性ワイヤで接続し、 前記基板に垂直に前記半導体装置を前記収容凹部内に所
定の圧力で押し込むことにより前記導電性ワイヤと前記
側面電極を電気的に接続させる、ことを特徴とする半導
体装置の実装方法。
9. A method for mounting a semiconductor device having a groove-shaped side electrode on a side surface substantially perpendicular to a mounting surface of the semiconductor device on a substrate, wherein the semiconductor device is accommodated on the substrate side. An accommodation recess is provided, and an inner wiring pattern in the accommodation recess and a surface wiring pattern on the surface of the substrate are connected by a conductive wire in correspondence with a position corresponding to the side surface electrode, and the semiconductor device is vertically attached to the substrate. A method for mounting a semiconductor device, wherein the conductive wire and the side electrode are electrically connected by pushing the conductive wire into a housing recess with a predetermined pressure.
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