JP2001298240A - 光半導体装置およびその製造方法 - Google Patents
光半導体装置およびその製造方法Info
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Abstract
(57)【要約】
【課題】 半絶縁性半導体ブロック層とキャリアトラッ
プ層を有する埋め込みヘテロ構造型光半導体素子におい
て、素子容量低減の為に必要な狭メサ化プロセスに必要
とされるエッチング深さの制御性を緩和し、素子容量が
小さく高速光伝送に好適な光半導体素子を再現性良く作
製することを可能とする。 【解決手段】 埋め込みクラッド層及びコンタクト層を
選択成長により形成することにより、埋め込みクラッド
層をエッチングすることなくキャリアトラップ層および
半絶縁性ブロック層の一部がエッチングされた狭メサ構
造を形成する。
プ層を有する埋め込みヘテロ構造型光半導体素子におい
て、素子容量低減の為に必要な狭メサ化プロセスに必要
とされるエッチング深さの制御性を緩和し、素子容量が
小さく高速光伝送に好適な光半導体素子を再現性良く作
製することを可能とする。 【解決手段】 埋め込みクラッド層及びコンタクト層を
選択成長により形成することにより、埋め込みクラッド
層をエッチングすることなくキャリアトラップ層および
半絶縁性ブロック層の一部がエッチングされた狭メサ構
造を形成する。
Description
【0001】
【発明の属する技術分野】本発明は、主に光通信に用い
られる半導体光素子ならびに光通信装置に関し、特に半
絶縁性半導体ブロック層とキャリアトラップ層を有する
埋め込みヘテロ構造型光半導体素子ならびに光通信装置
に関するものである。
られる半導体光素子ならびに光通信装置に関し、特に半
絶縁性半導体ブロック層とキャリアトラップ層を有する
埋め込みヘテロ構造型光半導体素子ならびに光通信装置
に関するものである。
【0002】
【従来の技術】光ファイバ通信システム用の光源とし
て、種々の光半導体素子ならびに光モジュールが研究・
開発されている。特に数Gbit/Sec以上の高速変
調に用いる光半導体素子においては素子容量の低減が重
要であり、素子容量の大幅な低減と安定な横モード発振
特性を両立する有効な手段として半絶縁性半導体ブロッ
ク層を有する埋め込みヘテロ構造(Semi―Insu
lating BuriedHeterostRuct
ure: SI―BH構造)が実用に供されている。図エラー
! フ゛ックマークが定義されていません。は従来技術に係るS
I―BH構造を有する半導体レーザを示したものであ
る。一般に半絶縁性半導体ブロック層は電子およびホー
ルからなる電流キャリアの一方に対しては高抵抗層とし
て機能するが他方のキャリアに対しては高抵抗体として
機能しないため、該高抵抗層として機能しないキャリア
に対するキャリアトラップ層を形成することにより電流
狭窄性能を向上する手法が用いられる。
て、種々の光半導体素子ならびに光モジュールが研究・
開発されている。特に数Gbit/Sec以上の高速変
調に用いる光半導体素子においては素子容量の低減が重
要であり、素子容量の大幅な低減と安定な横モード発振
特性を両立する有効な手段として半絶縁性半導体ブロッ
ク層を有する埋め込みヘテロ構造(Semi―Insu
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ure: SI―BH構造)が実用に供されている。図エラー
! フ゛ックマークが定義されていません。は従来技術に係るS
I―BH構造を有する半導体レーザを示したものであ
る。一般に半絶縁性半導体ブロック層は電子およびホー
ルからなる電流キャリアの一方に対しては高抵抗層とし
て機能するが他方のキャリアに対しては高抵抗体として
機能しないため、該高抵抗層として機能しないキャリア
に対するキャリアトラップ層を形成することにより電流
狭窄性能を向上する手法が用いられる。
【0003】図24に示したSIーBH構造の場合、半
絶縁性半導体ブロック層として用いられているFeドー
プInPは電子電流に対しては高抵抗層として機能する
が、ホール電流に対しては高抵抗層として機能しないた
めFeドープInPブロック層2aのp電極側にホール
キャリアトラップ層としてSiドープInPホールトラ
ップ層3aが形成されている。該キャリアトラップ層に
は高濃度のドーピングを行わなくてはならならない為、
抵抗率が非常に低くなっており、キャリアトラップ層の
幅だけ等電位面が広がり素子容量を増加させてしまう。
従って、キャリアトラップ層を有するSIーBH構造に
おいてはキャリアトラップ層幅を小さくするためにエッ
チングによる狭メサ構造を形成しなければならない。図
24ならびに図25に示した従来技術に係る半導体レー
ザにおいてはエッチング溝9がn−InP基板エラー! フ゛ッ
クマークが定義されていません。aにまで達している為、エ
ッチング溝底10において電極8b―絶縁膜7n―In
P基板1aという構成になり、配線容量を規定するパラ
メータの1つである絶縁層厚が絶縁膜7のみの厚さとな
るために寄生容量が大きくなってしまうという欠点を有
する。これに対して図26に示すようにキャリアトラッ
プ層3全てをエッチングで除去し、かつ、半絶縁性半導
体ブロック層2a部分を残す構造とした場合には電極8
b−絶縁膜7−半絶縁性半導体ブロック層2a―n―I
nP基板1aという構成となり、該絶縁層厚が絶縁膜7
と半絶縁性半導体ブロック層2aの合計層厚となるた
め、配線容量が低減される。しかしながら、平坦な埋め
込みクラッド層4cを有する従来構成ではクラッド層を
含む1.5〜2μm以上をエッチングする必要があるた
め、十分な半絶縁性半導体ブロック層厚を残すには高精
度なエッチング深さ制御が必要である。特に、SSC
(Spot―Size Converter: スポット
サイズ変換器)導波路層等を具備する光半導体素子にお
いては、光電界がコンタクト層5、絶縁層7、電極8
b、あるいは素子外部にまで染み出すことを防ぐため
に、埋め込みクラッド層4cの厚さを3〜4μm以上に
する必要があり、十分な半絶縁性半導体ブロック層厚を
残すには極めて高精度なエッチング深さ制御性ならびに
エッチングおよび各半導体層厚の均一性が必要であると
いう問題がある。
絶縁性半導体ブロック層として用いられているFeドー
プInPは電子電流に対しては高抵抗層として機能する
が、ホール電流に対しては高抵抗層として機能しないた
めFeドープInPブロック層2aのp電極側にホール
キャリアトラップ層としてSiドープInPホールトラ
ップ層3aが形成されている。該キャリアトラップ層に
は高濃度のドーピングを行わなくてはならならない為、
抵抗率が非常に低くなっており、キャリアトラップ層の
幅だけ等電位面が広がり素子容量を増加させてしまう。
従って、キャリアトラップ層を有するSIーBH構造に
おいてはキャリアトラップ層幅を小さくするためにエッ
チングによる狭メサ構造を形成しなければならない。図
24ならびに図25に示した従来技術に係る半導体レー
ザにおいてはエッチング溝9がn−InP基板エラー! フ゛ッ
クマークが定義されていません。aにまで達している為、エ
ッチング溝底10において電極8b―絶縁膜7n―In
P基板1aという構成になり、配線容量を規定するパラ
メータの1つである絶縁層厚が絶縁膜7のみの厚さとな
るために寄生容量が大きくなってしまうという欠点を有
する。これに対して図26に示すようにキャリアトラッ
プ層3全てをエッチングで除去し、かつ、半絶縁性半導
体ブロック層2a部分を残す構造とした場合には電極8
b−絶縁膜7−半絶縁性半導体ブロック層2a―n―I
nP基板1aという構成となり、該絶縁層厚が絶縁膜7
と半絶縁性半導体ブロック層2aの合計層厚となるた
め、配線容量が低減される。しかしながら、平坦な埋め
込みクラッド層4cを有する従来構成ではクラッド層を
含む1.5〜2μm以上をエッチングする必要があるた
め、十分な半絶縁性半導体ブロック層厚を残すには高精
度なエッチング深さ制御が必要である。特に、SSC
(Spot―Size Converter: スポット
サイズ変換器)導波路層等を具備する光半導体素子にお
いては、光電界がコンタクト層5、絶縁層7、電極8
b、あるいは素子外部にまで染み出すことを防ぐため
に、埋め込みクラッド層4cの厚さを3〜4μm以上に
する必要があり、十分な半絶縁性半導体ブロック層厚を
残すには極めて高精度なエッチング深さ制御性ならびに
エッチングおよび各半導体層厚の均一性が必要であると
いう問題がある。
【0004】
【発明が解決しようとする課題】本発明は上記のような
問題点を排除するためになされたものであり、その目的
とするところは、素子容量が小さく高速光伝送に好適な
光半導体素子を再現性良く作製することを可能とし、同
素子を搭載することにより高速光伝送に好適な光通信用
モジュール、ならびに同素子あるいは同モジュールを用
いた高速光通信装置をより安価に提供することである。
問題点を排除するためになされたものであり、その目的
とするところは、素子容量が小さく高速光伝送に好適な
光半導体素子を再現性良く作製することを可能とし、同
素子を搭載することにより高速光伝送に好適な光通信用
モジュール、ならびに同素子あるいは同モジュールを用
いた高速光通信装置をより安価に提供することである。
【0005】
【課題を解決するための手段】前記課題を解決するため
の手段としての本発明は、半絶縁性半導体ブロック層と
キャリアトラップ層を有する埋め込みヘテロ構造型光半
導体素子において、選択成長によって形成されたクラッ
ド層及びコンタクト層を有し、かつ、キャリアトラップ
層および半絶縁性ブロック層がエッチングされたメサ構
造を有することを特徴とする。また、前記キャリアトラ
ップ層ならびに半絶縁性ブロック層のエッチング深さが
半絶縁性ブロック層にまで到達し、かつ、ブロック層下
の半導体基板にまでには到達しないことを特徴とする。
の手段としての本発明は、半絶縁性半導体ブロック層と
キャリアトラップ層を有する埋め込みヘテロ構造型光半
導体素子において、選択成長によって形成されたクラッ
ド層及びコンタクト層を有し、かつ、キャリアトラップ
層および半絶縁性ブロック層がエッチングされたメサ構
造を有することを特徴とする。また、前記キャリアトラ
ップ層ならびに半絶縁性ブロック層のエッチング深さが
半絶縁性ブロック層にまで到達し、かつ、ブロック層下
の半導体基板にまでには到達しないことを特徴とする。
【0006】(作用)本発明を用いることにより、埋め
込みクラッド層をエッチングする必要が無く、キャリア
トラップ層のみをエッチングすれば良いため、必要とさ
れるエッチングの深さ制御性が大幅に緩和される。ま
た、エッチング溝底部の半絶縁性半導体ブロック層を確
実に残すことが可能であり、電極配線に起因する寄生容
量を低減することが可能となる。これにより、素子容量
が小さく高速光伝送に好適な光半導体素子を再現性良く
作製することを可能とし、同素子を搭載した小型光通信
用モジュール、ならびに同素子あるいは同モジュールを
用いた高速光通信装置を安価に提供することを可能とす
る。
込みクラッド層をエッチングする必要が無く、キャリア
トラップ層のみをエッチングすれば良いため、必要とさ
れるエッチングの深さ制御性が大幅に緩和される。ま
た、エッチング溝底部の半絶縁性半導体ブロック層を確
実に残すことが可能であり、電極配線に起因する寄生容
量を低減することが可能となる。これにより、素子容量
が小さく高速光伝送に好適な光半導体素子を再現性良く
作製することを可能とし、同素子を搭載した小型光通信
用モジュール、ならびに同素子あるいは同モジュールを
用いた高速光通信装置を安価に提供することを可能とす
る。
【0007】
【発明の実施の形態】次に、本発明の実施の形態および
実施例について図面を参照して詳細に説明するが、本発
明は以下の実施の形態および実施例に限定されるもので
はない。
実施例について図面を参照して詳細に説明するが、本発
明は以下の実施の形態および実施例に限定されるもので
はない。
【0008】図1は本発明の第一の実施形態に係る光半
導体素子を示した斜視図である。図中埋め込みクラッド
層4c及びコンタクト層5は選択成長によって形成さ
れ、キャリアトラップ層3および半絶縁性ブロック層2
の一部のエッチングは該クラッド層4c及びコンタクト
層5の形成後に実施されたものである。
導体素子を示した斜視図である。図中埋め込みクラッド
層4c及びコンタクト層5は選択成長によって形成さ
れ、キャリアトラップ層3および半絶縁性ブロック層2
の一部のエッチングは該クラッド層4c及びコンタクト
層5の形成後に実施されたものである。
【0009】図2〜7は本実施形態の光半導体素子およ
びその製造方法を説明するための本発明第1の実施例と
して、発振波長1.3μm帯のFP-LD(Fabri-
Perot LaSer Diode)の作製工程を示し
た図である。n―InP基板1a上にMOVPE法によ
りn−InPクラッド層4a(厚さ0.2μm,ドーピ
ング濃度1ラ1018cm 3)、InGaAsPのSCHお
よび歪MQW項増を有する活性層6(量子井戸数8, 厚
さ0.2μm,PL(フォトルミネッセンス)波長1.
3μm)、p―InPクラッド層4b(厚さ0.1μ
m,ドーピング濃度7ラ1017cm 3)を順次成長する
(図2)。続いてp−InPクラッド層4b上にSiO
2ストライプマスク11(幅1.6μm)を形成し、該
マスクを用いた半導体エッチングにより活性層幅1.6
μmのメサストライプ12を形成する(図3)。さら
に、前記マスクを用いた選択成長により、FeドープI
nP半絶縁性ブロック層2a(厚さ2.5μm)および
SiドープInPホールトラップ層3a(厚さ0.5μ
m、ドーピング濃度3ラ1018cm 3)を形成する(図
4)。前記マスクを除去した後、1対のSiO2ストラ
イプマスク11(幅8μm、間隔5μm)を形成し、これ
をマスクとしてp−InPクラッド層4c(厚さ1.5
μm、ドーピング濃度1ラ1018cm 3)およびp―In
GaAsコンタクト層5a(厚さ0.3μm、ドーピン
グ濃度1ラ1019cm 3)の選択成長を行う(図5)。続
いて、前記選択成長マスクを除去した後、p−InPク
ラッド層およびp―InGaAsコンタクト層のメサス
トライプを覆う形で幅6μmのSiO2マスクストライ
プ11を形成し、これをマスクとしたドライエッチング
によりSiドープInPホールトラップ層3aおよびF
eドープInP半絶縁性ブロック層2aの一部を除去す
る(図6)。ここでホールトラップ層3aによる等電位
面の広がりを止めるためにホールトラップ層3aは完全
に除去する必要があり、かつ、電気配線による寄生容量
増加を抑制するために半絶縁性ブロック層2aを残す厚
さは大きい方が好ましいことから、エッチング深さは
0.7μmとした。さらにエッチングマスク11を除去
した後、SiO2絶縁膜7(厚さ0.4μm)を形成
し、電極コンタクト開口形成および電極形成プロセス、
劈開、端面コーティングプロセスを経て、図7に示す
1.3μm帯半導体レーザを得た。本実施例の1.3μ
m帯半導体レーザは共振器長250μmで素子容量0.
5pF,70mA駆動と気の3dB帯域12GHzと良
好な高速変調特性を示した。本実施例においてはクラッ
ド層及びコンタクト層の選択成長を行うためのSiO2
ストライプマスクの間隔は5μmとしたが、このマスク
間隔は選択成長によって形成されるメサ底部の幅とな
り、続くキャリアトラップ層および半絶縁性ブロック層
一部のエッチングによる狭メサ形成工程後のキャリアト
ラップ層幅の下限を規定する為、10μm以下にするこ
とが望ましい。一方、ストライプ間隔が小さすぎると台
形状に形成される選択成長メサ上部の幅が小さくなり電
極コンタクト抵抗が大きくなる為、3μm以上とするこ
とが望ましい。また、キャリアトラップ層および半絶縁
性ブロック層一部のエッチングにはドライエッチングを
用いたが、臭化水素や臭素-メタノール系、あるいは塩
酸系や硫酸系のエッチャントによるウェットエッチング
を用いても良い。
びその製造方法を説明するための本発明第1の実施例と
して、発振波長1.3μm帯のFP-LD(Fabri-
Perot LaSer Diode)の作製工程を示し
た図である。n―InP基板1a上にMOVPE法によ
りn−InPクラッド層4a(厚さ0.2μm,ドーピ
ング濃度1ラ1018cm 3)、InGaAsPのSCHお
よび歪MQW項増を有する活性層6(量子井戸数8, 厚
さ0.2μm,PL(フォトルミネッセンス)波長1.
3μm)、p―InPクラッド層4b(厚さ0.1μ
m,ドーピング濃度7ラ1017cm 3)を順次成長する
(図2)。続いてp−InPクラッド層4b上にSiO
2ストライプマスク11(幅1.6μm)を形成し、該
マスクを用いた半導体エッチングにより活性層幅1.6
μmのメサストライプ12を形成する(図3)。さら
に、前記マスクを用いた選択成長により、FeドープI
nP半絶縁性ブロック層2a(厚さ2.5μm)および
SiドープInPホールトラップ層3a(厚さ0.5μ
m、ドーピング濃度3ラ1018cm 3)を形成する(図
4)。前記マスクを除去した後、1対のSiO2ストラ
イプマスク11(幅8μm、間隔5μm)を形成し、これ
をマスクとしてp−InPクラッド層4c(厚さ1.5
μm、ドーピング濃度1ラ1018cm 3)およびp―In
GaAsコンタクト層5a(厚さ0.3μm、ドーピン
グ濃度1ラ1019cm 3)の選択成長を行う(図5)。続
いて、前記選択成長マスクを除去した後、p−InPク
ラッド層およびp―InGaAsコンタクト層のメサス
トライプを覆う形で幅6μmのSiO2マスクストライ
プ11を形成し、これをマスクとしたドライエッチング
によりSiドープInPホールトラップ層3aおよびF
eドープInP半絶縁性ブロック層2aの一部を除去す
る(図6)。ここでホールトラップ層3aによる等電位
面の広がりを止めるためにホールトラップ層3aは完全
に除去する必要があり、かつ、電気配線による寄生容量
増加を抑制するために半絶縁性ブロック層2aを残す厚
さは大きい方が好ましいことから、エッチング深さは
0.7μmとした。さらにエッチングマスク11を除去
した後、SiO2絶縁膜7(厚さ0.4μm)を形成
し、電極コンタクト開口形成および電極形成プロセス、
劈開、端面コーティングプロセスを経て、図7に示す
1.3μm帯半導体レーザを得た。本実施例の1.3μ
m帯半導体レーザは共振器長250μmで素子容量0.
5pF,70mA駆動と気の3dB帯域12GHzと良
好な高速変調特性を示した。本実施例においてはクラッ
ド層及びコンタクト層の選択成長を行うためのSiO2
ストライプマスクの間隔は5μmとしたが、このマスク
間隔は選択成長によって形成されるメサ底部の幅とな
り、続くキャリアトラップ層および半絶縁性ブロック層
一部のエッチングによる狭メサ形成工程後のキャリアト
ラップ層幅の下限を規定する為、10μm以下にするこ
とが望ましい。一方、ストライプ間隔が小さすぎると台
形状に形成される選択成長メサ上部の幅が小さくなり電
極コンタクト抵抗が大きくなる為、3μm以上とするこ
とが望ましい。また、キャリアトラップ層および半絶縁
性ブロック層一部のエッチングにはドライエッチングを
用いたが、臭化水素や臭素-メタノール系、あるいは塩
酸系や硫酸系のエッチャントによるウェットエッチング
を用いても良い。
【0010】図8は本発明の第二の実施形態に係る光半
導体素子を示した斜視図である。図中クラッド層4c及
びコンタクト層5は選択成長によって形成され、キャリ
アトラップ層3bおよび半絶縁性ブロック層2bの一部
のエッチングは該コンタクト5をエッチングマスクとし
て用いた選択性エッチングによって行われたものであ
る。
導体素子を示した斜視図である。図中クラッド層4c及
びコンタクト層5は選択成長によって形成され、キャリ
アトラップ層3bおよび半絶縁性ブロック層2bの一部
のエッチングは該コンタクト5をエッチングマスクとし
て用いた選択性エッチングによって行われたものであ
る。
【0011】図9〜14は本実施形態の光半導体素子お
よびその製造方法を説明するための本発明第2の実施例
として、発振波長1.55μm帯のSSC(Spot―
Size Converter: スポットサイズ変換
器)集積化DFB−LD(Distributed F
eedback LaSer Diode: 分布帰還型
レーザ)の作製工程を示した図である。まずn−InP
基板1a上にDFB−LD活性層を形成する領域にEB
(Electron Beam:電子ビーム)露光リソ
グラフィを用いて周期240nmの回折格子エラー! フ゛ックマ
ークが定義されていません。を形成し、続いて活性層およ
びSSC導波路成長用のSiO2マスクをCVD法によ
り堆積、フォトリソグラフィーによりパターニングする
(図9)。ここで活性層およびSSC導波路を成長する
ためのSiO2マスク11の開口幅は1.6μm、マスク
幅はDFB−LD部分14で30μmであり、SSC部
15先端に向かってマスク幅を5μmまで狭くすること
によって導波路コア層厚が徐々に小さくなるSSC導波
路が形成されるように設計している。またDFB−LD
部14の長さは300μm、SSC部15の長さは20
0μmとした。このように回折格子13およびSiO2
マスク11を形成した基板上に、活性層成長用開口スト
ライプ部における膜厚ならびに組成で、InAlGaA
sのSCHおよび歪MQW構造を有する活性層6(量子
井戸数6,厚さ0.2μm、PL波長1.56μm)、
p−InPクラッド層4b(厚さ0.1μm、ドーピン
グ濃度5ラ1017cm 3)を選択MOVPE成長により形
成する(図10)。次に、フォトリソグラフィーにより
活性層を含むメサ型光導波路の上部にのみSiO2マス
ク11を形成し、該マスクを用いた選択成長により、R
uドープInP半絶縁性ブロック層2b(厚さ1.3μ
m)およびSeドープInPホールトラップ層3b(厚
さ0.3μm,ドーピング濃度3ラ1018cm 3)を形成
する(図11)。前記マスク11を除去した後、1対の
SiO2ストライプマスク11(幅12μm、間隔8μ
m)を形成し、これをマスクとしてp−InPクラッド
層4c(厚さ4.0μm(ドーピング濃度1ラ1018c
m 3)およびp―InGaAsコンタクト層5a(厚さ
0.3μm、ドーピング濃度8ラ1018cm 3)の選択成
長を行う(図12)。続いて選択成長マスク11を除去
した後、前記選択成長によりメサ全体がp―InGaA
sコンタクト層5aに覆われていることを利用し、In
Pに対しては十分に大きなエッチング速度を有し、か
つ、InGaAsに対してはエッチング速度が小さい塩
酸と酢酸の混合液を用いてSeドープInPキャリアト
ラップ層3bおよびRuドープInP半絶縁性ブロック
層2bの一部のエッチングを行う(図13)。エッチン
グ深さは本発明第1の実施例と同じ理由から、キャリア
トラップ層3bを完全に除去し、かつ、半絶縁ブロック
層厚2bを十分に残す為に0.4μmとした。続いてS
iN絶縁膜7(厚さ0.3μm)を形成し、電極コンタク
ト開口および電極形成プロセス、劈開、端面コーティン
グプロセスを経て、図14に示す1.55μm帯SSC
集積化DFB−LDを得た。本実施例のSSC集積化D
FB−LDはDFB−LD部の実効屈折率と回折格子周
期によって決定される波長1.552μmで発振し、素
子容量0.8pF、70mA駆動時の3dB帯域11G
Hzと良好な高速変調特性を示した。本実施例において
は塩酸と酢酸の混合液を選択エッチャントとして用いた
が、塩酸単体あるいは塩酸とリン酸の混合液なども選択
エッチャントとして用いることができ、また、使用する
エッチャントは本実施例に限定されるものではない。
よびその製造方法を説明するための本発明第2の実施例
として、発振波長1.55μm帯のSSC(Spot―
Size Converter: スポットサイズ変換
器)集積化DFB−LD(Distributed F
eedback LaSer Diode: 分布帰還型
レーザ)の作製工程を示した図である。まずn−InP
基板1a上にDFB−LD活性層を形成する領域にEB
(Electron Beam:電子ビーム)露光リソ
グラフィを用いて周期240nmの回折格子エラー! フ゛ックマ
ークが定義されていません。を形成し、続いて活性層およ
びSSC導波路成長用のSiO2マスクをCVD法によ
り堆積、フォトリソグラフィーによりパターニングする
(図9)。ここで活性層およびSSC導波路を成長する
ためのSiO2マスク11の開口幅は1.6μm、マスク
幅はDFB−LD部分14で30μmであり、SSC部
15先端に向かってマスク幅を5μmまで狭くすること
によって導波路コア層厚が徐々に小さくなるSSC導波
路が形成されるように設計している。またDFB−LD
部14の長さは300μm、SSC部15の長さは20
0μmとした。このように回折格子13およびSiO2
マスク11を形成した基板上に、活性層成長用開口スト
ライプ部における膜厚ならびに組成で、InAlGaA
sのSCHおよび歪MQW構造を有する活性層6(量子
井戸数6,厚さ0.2μm、PL波長1.56μm)、
p−InPクラッド層4b(厚さ0.1μm、ドーピン
グ濃度5ラ1017cm 3)を選択MOVPE成長により形
成する(図10)。次に、フォトリソグラフィーにより
活性層を含むメサ型光導波路の上部にのみSiO2マス
ク11を形成し、該マスクを用いた選択成長により、R
uドープInP半絶縁性ブロック層2b(厚さ1.3μ
m)およびSeドープInPホールトラップ層3b(厚
さ0.3μm,ドーピング濃度3ラ1018cm 3)を形成
する(図11)。前記マスク11を除去した後、1対の
SiO2ストライプマスク11(幅12μm、間隔8μ
m)を形成し、これをマスクとしてp−InPクラッド
層4c(厚さ4.0μm(ドーピング濃度1ラ1018c
m 3)およびp―InGaAsコンタクト層5a(厚さ
0.3μm、ドーピング濃度8ラ1018cm 3)の選択成
長を行う(図12)。続いて選択成長マスク11を除去
した後、前記選択成長によりメサ全体がp―InGaA
sコンタクト層5aに覆われていることを利用し、In
Pに対しては十分に大きなエッチング速度を有し、か
つ、InGaAsに対してはエッチング速度が小さい塩
酸と酢酸の混合液を用いてSeドープInPキャリアト
ラップ層3bおよびRuドープInP半絶縁性ブロック
層2bの一部のエッチングを行う(図13)。エッチン
グ深さは本発明第1の実施例と同じ理由から、キャリア
トラップ層3bを完全に除去し、かつ、半絶縁ブロック
層厚2bを十分に残す為に0.4μmとした。続いてS
iN絶縁膜7(厚さ0.3μm)を形成し、電極コンタク
ト開口および電極形成プロセス、劈開、端面コーティン
グプロセスを経て、図14に示す1.55μm帯SSC
集積化DFB−LDを得た。本実施例のSSC集積化D
FB−LDはDFB−LD部の実効屈折率と回折格子周
期によって決定される波長1.552μmで発振し、素
子容量0.8pF、70mA駆動時の3dB帯域11G
Hzと良好な高速変調特性を示した。本実施例において
は塩酸と酢酸の混合液を選択エッチャントとして用いた
が、塩酸単体あるいは塩酸とリン酸の混合液なども選択
エッチャントとして用いることができ、また、使用する
エッチャントは本実施例に限定されるものではない。
【0012】図15は本発明の第三の実施形態に係る光
半導体素子を示した斜視図である。図中クラッド層4c
及びコンタクト層5は選択成長によって形成され、キャ
リアトラップ層3および半絶縁性ブロック層2の一部の
エッチングは該クラッド層4c及びコンタクト層5の選
択成長前に実施されたものである。
半導体素子を示した斜視図である。図中クラッド層4c
及びコンタクト層5は選択成長によって形成され、キャ
リアトラップ層3および半絶縁性ブロック層2の一部の
エッチングは該クラッド層4c及びコンタクト層5の選
択成長前に実施されたものである。
【0013】図16〜21は本実施形態の光半導体素子
およびその製造方法を説明するための本発明第3の実施
例として、1.58μm帯のEA(Electroab
sorption:電界吸収型)変調器集積化DFB−
LDの作製工程を示した図である。まずn−InP基板
エラー! フ゛ックマークが定義されていません。a上のDFB−L
D活性層を形成する領域にEB露光リソグラフィを用い
て周期242nmの回折格子13を形成し、続いてDF
B−LD部の活性層およびEA変調器部の吸収層を選択
成長する為のSiO2マスクをCVD法により堆積、フ
ォトリソグラフィーによりパターニングする(図1
6)。ここでDFB−LD部の活性層およびEA変調器
部の吸収層を成長するためのSiO2マスク11の開口
幅は1.7μm、マスク幅はDFB−LD活性層部分で
20μm、EA変調器部吸収層で12μmとすることに
よりEA変調器部吸収層の電界非印加時量子準位波長が
DFB−LD部の発振波長よりも短くなるように設計し
ている。このように回折格子13およびSiO2マスク
11を形成した基板上に、DFB−LD活性層成長用開
口ストライプ部における膜厚ならびに組成で、InGa
AsPのSCHおよび歪MQW構造を有する活性層6
(量子井戸数8、 厚さ0.24μm、 PL波長1.59
μm)、p−InPクラッド層4b(厚さ0.1μm、
ドーピング濃度5ラ1017cm 3)を選択MOVPE成長
により形成する(図17)。次に、フォトリソグラフィ
ーにより活性層および吸収層を含むメサ型光導波路の上
部にのみSiO2マスク11を形成し、該マスクを用い
た選択成長により、FeドープInP半絶縁性ブロック
層2a(厚さ1.0μm)およびSiドープInPホー
ルトラップ層3a(厚さ0.2μm、ドーピング濃度7ラ
1018cm 3)を形成する(図18)。前記マスク11
を除去した後、p−InPクラッド層およびp―InG
aAsコンタクト層のメサストライプを覆う形で幅5μ
mのSiO2マスクストライプ11を形成し、これをマ
スクとしたドライエッチングによりSiドープInPホ
ールトラップ層3aおよびFeドープInP半絶縁性ブ
ロック層2aの一部を除去する(図19)。ここでもエ
ッチング深さは本発明第1の実施例ならびに第2の実施
例と同じ理由から、キャリアトラップ層3aを完全に除
去し、かつ、半絶縁ブロック層2a厚を十分に残す為に
0.3μmとした。該エッチングマスク11を除去した
後、1対のSiO2ストライプマスク11(幅8μm、
間隔4μm)を形成し、これをマスクとしてp−InP
クラッド層4c(厚さ1.5μm、ドーピング濃度7ラ1
017cm 3)およびp―InGaAsコンタクト層5a
(厚さ0.3μm、ドーピング濃度7ラ1018cm 3)の
選択成長を行う(図20)。続いてSiO2絶縁膜7
(厚さ0.6μm)を形成し、電極コンタクト開口およ
び電極形成プロセス、劈開、端面コーティングプロセス
を経て、図21に示す1.58μm帯のEA変調器集積
化DFB−LDを得た。本実施例のEA変調器集積化D
FB−LDはDFB−LD部の実効屈折率と回折格子周
期によって決定される波長1.581μmで発振し、長
さ200μmの変調器部の素子容量0.4pF、3dB
帯域16GHzと良好な高速変調特性を示した。
およびその製造方法を説明するための本発明第3の実施
例として、1.58μm帯のEA(Electroab
sorption:電界吸収型)変調器集積化DFB−
LDの作製工程を示した図である。まずn−InP基板
エラー! フ゛ックマークが定義されていません。a上のDFB−L
D活性層を形成する領域にEB露光リソグラフィを用い
て周期242nmの回折格子13を形成し、続いてDF
B−LD部の活性層およびEA変調器部の吸収層を選択
成長する為のSiO2マスクをCVD法により堆積、フ
ォトリソグラフィーによりパターニングする(図1
6)。ここでDFB−LD部の活性層およびEA変調器
部の吸収層を成長するためのSiO2マスク11の開口
幅は1.7μm、マスク幅はDFB−LD活性層部分で
20μm、EA変調器部吸収層で12μmとすることに
よりEA変調器部吸収層の電界非印加時量子準位波長が
DFB−LD部の発振波長よりも短くなるように設計し
ている。このように回折格子13およびSiO2マスク
11を形成した基板上に、DFB−LD活性層成長用開
口ストライプ部における膜厚ならびに組成で、InGa
AsPのSCHおよび歪MQW構造を有する活性層6
(量子井戸数8、 厚さ0.24μm、 PL波長1.59
μm)、p−InPクラッド層4b(厚さ0.1μm、
ドーピング濃度5ラ1017cm 3)を選択MOVPE成長
により形成する(図17)。次に、フォトリソグラフィ
ーにより活性層および吸収層を含むメサ型光導波路の上
部にのみSiO2マスク11を形成し、該マスクを用い
た選択成長により、FeドープInP半絶縁性ブロック
層2a(厚さ1.0μm)およびSiドープInPホー
ルトラップ層3a(厚さ0.2μm、ドーピング濃度7ラ
1018cm 3)を形成する(図18)。前記マスク11
を除去した後、p−InPクラッド層およびp―InG
aAsコンタクト層のメサストライプを覆う形で幅5μ
mのSiO2マスクストライプ11を形成し、これをマ
スクとしたドライエッチングによりSiドープInPホ
ールトラップ層3aおよびFeドープInP半絶縁性ブ
ロック層2aの一部を除去する(図19)。ここでもエ
ッチング深さは本発明第1の実施例ならびに第2の実施
例と同じ理由から、キャリアトラップ層3aを完全に除
去し、かつ、半絶縁ブロック層2a厚を十分に残す為に
0.3μmとした。該エッチングマスク11を除去した
後、1対のSiO2ストライプマスク11(幅8μm、
間隔4μm)を形成し、これをマスクとしてp−InP
クラッド層4c(厚さ1.5μm、ドーピング濃度7ラ1
017cm 3)およびp―InGaAsコンタクト層5a
(厚さ0.3μm、ドーピング濃度7ラ1018cm 3)の
選択成長を行う(図20)。続いてSiO2絶縁膜7
(厚さ0.6μm)を形成し、電極コンタクト開口およ
び電極形成プロセス、劈開、端面コーティングプロセス
を経て、図21に示す1.58μm帯のEA変調器集積
化DFB−LDを得た。本実施例のEA変調器集積化D
FB−LDはDFB−LD部の実効屈折率と回折格子周
期によって決定される波長1.581μmで発振し、長
さ200μmの変調器部の素子容量0.4pF、3dB
帯域16GHzと良好な高速変調特性を示した。
【0014】図22は本発明第4の実施例として、本発
明第3の実施例に係るEA光変調器集積DFB−LD1
7からの出力光が非球面レンズ18および光アイソレー
タ19を介して光ファイバ20に入力されるように固定
し、さらに該EA光変調器集積DFB−LDを駆動するた
めの電気インターフェース21を内蔵した光通信用送信
モジュール22を示したものである。本モジュールを用
いれば、高速光送信信号を容易に作り出すことができ
る。これは本発明に係る光半導体素子が高速変調特性に
優れていることに基づく。
明第3の実施例に係るEA光変調器集積DFB−LD1
7からの出力光が非球面レンズ18および光アイソレー
タ19を介して光ファイバ20に入力されるように固定
し、さらに該EA光変調器集積DFB−LDを駆動するた
めの電気インターフェース21を内蔵した光通信用送信
モジュール22を示したものである。本モジュールを用
いれば、高速光送信信号を容易に作り出すことができ
る。これは本発明に係る光半導体素子が高速変調特性に
優れていることに基づく。
【0015】図23は本発明5の実施例として、本発明
第4の実施例に係る光送信モジュール22を用いた光通
信システムを示したものである。光送信装置23は光送
信モジュール22と該光送信モジュールを駆動する為の
駆動系24を有する。光送信装置22から出力された信
号光は光ファイバ20を通じて伝送され、受信装置25
内の受光モジュール26で検出される。本実施例に係る
光通信システムを用いることにより、2.5Gb/Sあ
るいは10Gb/S以上の高速光伝送が容易に実現でき
る。これは、本発明に係る光送信モジュールが良好な高
速変調特性を有し、立ち上がり・立ち下がりが高速で良
好な光伝送波形が得られることに基づく。
第4の実施例に係る光送信モジュール22を用いた光通
信システムを示したものである。光送信装置23は光送
信モジュール22と該光送信モジュールを駆動する為の
駆動系24を有する。光送信装置22から出力された信
号光は光ファイバ20を通じて伝送され、受信装置25
内の受光モジュール26で検出される。本実施例に係る
光通信システムを用いることにより、2.5Gb/Sあ
るいは10Gb/S以上の高速光伝送が容易に実現でき
る。これは、本発明に係る光送信モジュールが良好な高
速変調特性を有し、立ち上がり・立ち下がりが高速で良
好な光伝送波形が得られることに基づく。
【0016】なお、本発明の第一の実施形態、即ち、選
択成長によって形成されたクラッド層及びコンタクトを
有し、キャリアトラップ層および半絶縁性ブロック層の
一部のエッチングが該クラッド層及びコンタクト層の形
成後に行われる形態の実施例としてFP―LDを、第二
の実施形態、即ち、キャリアトラップ層および半絶縁性
ブロック層の一部のエッチングを選択成長によって形成
したコンタクト層をエッチングマスクとして用いた選択
性エッチングによって行う形態の実施例としてSSC-
DFB−LDを、第三の実施形態、即ち、キャリアトラ
ップ層および半絶縁性ブロック層の一部のエッチングを
該クラッド層及びコンタクト層の選択成長前に形成する
形態の例としてEA変調器集積DFB−LDを用いたが、
それぞれの実施形態を適用する光半導体素子はこれらの
組み合わせに限定されるものでないことは言うまでもな
く、単体のDFB−LDやEA変調器、あるいは半導体光
増幅素子や光ゲートスイッチ素子等、あらゆる光半導体
素子ならびに光モジュール、光伝送装置において適用す
ることが可能である。
択成長によって形成されたクラッド層及びコンタクトを
有し、キャリアトラップ層および半絶縁性ブロック層の
一部のエッチングが該クラッド層及びコンタクト層の形
成後に行われる形態の実施例としてFP―LDを、第二
の実施形態、即ち、キャリアトラップ層および半絶縁性
ブロック層の一部のエッチングを選択成長によって形成
したコンタクト層をエッチングマスクとして用いた選択
性エッチングによって行う形態の実施例としてSSC-
DFB−LDを、第三の実施形態、即ち、キャリアトラ
ップ層および半絶縁性ブロック層の一部のエッチングを
該クラッド層及びコンタクト層の選択成長前に形成する
形態の例としてEA変調器集積DFB−LDを用いたが、
それぞれの実施形態を適用する光半導体素子はこれらの
組み合わせに限定されるものでないことは言うまでもな
く、単体のDFB−LDやEA変調器、あるいは半導体光
増幅素子や光ゲートスイッチ素子等、あらゆる光半導体
素子ならびに光モジュール、光伝送装置において適用す
ることが可能である。
【0017】また本発明の実施例にはInGaAsP/
InP系材料ならびにInAlGaASinP形を用
い、n−InP基板を用いた例を示したが、材料系なら
びに基板の導電型はこれらの実施例に限定されるもので
はなく、GaInNAs/GaAs系やAlGaAs/
GaAs系,AlGaInP/GaInP系など、材料
系を使用したものであっても良く、p型あるいは半絶縁
性の基板を用いても良い。結晶成長方法や選択成長に用
いるマスクや絶縁膜材料も実施例に限定されるものでは
なく、例えば結晶成長方法としてMBE法、選択成長マ
スクとしてSiNx等、あらゆる方法・材料を用いた場
合にも、キャリアトラップ層を有する半絶縁性埋め込み
構造を用いた光半導体素子ならびに該光半導体素子を具
備する光送信モジュールおよび光通信システムにおい
て、本発明は適用可能である。
InP系材料ならびにInAlGaASinP形を用
い、n−InP基板を用いた例を示したが、材料系なら
びに基板の導電型はこれらの実施例に限定されるもので
はなく、GaInNAs/GaAs系やAlGaAs/
GaAs系,AlGaInP/GaInP系など、材料
系を使用したものであっても良く、p型あるいは半絶縁
性の基板を用いても良い。結晶成長方法や選択成長に用
いるマスクや絶縁膜材料も実施例に限定されるものでは
なく、例えば結晶成長方法としてMBE法、選択成長マ
スクとしてSiNx等、あらゆる方法・材料を用いた場
合にも、キャリアトラップ層を有する半絶縁性埋め込み
構造を用いた光半導体素子ならびに該光半導体素子を具
備する光送信モジュールおよび光通信システムにおい
て、本発明は適用可能である。
【0018】
【発明の効果】本発明により、埋め込みクラッド層をエ
ッチングする必要が無く、キャリアトラップ層のみをエ
ッチングすれば良いため、必要とされるエッチングの深
さ制御性が緩和される。また、エッチング溝底の半絶縁
性半導体ブロック層を確実に残すことが可能であり、電
極配線に起因する寄生容量を低減することが可能とな
る。これにより、寄生容量が小さく高速光伝送に好適な
光半導体素子を再現性良く作製することを可能とし、同
素子を搭載した小型光通信用モジュール、ならびに同素
子あるいは同モジュールを用いた高速光通信装置を安価
に提供することが可能となる。
ッチングする必要が無く、キャリアトラップ層のみをエ
ッチングすれば良いため、必要とされるエッチングの深
さ制御性が緩和される。また、エッチング溝底の半絶縁
性半導体ブロック層を確実に残すことが可能であり、電
極配線に起因する寄生容量を低減することが可能とな
る。これにより、寄生容量が小さく高速光伝送に好適な
光半導体素子を再現性良く作製することを可能とし、同
素子を搭載した小型光通信用モジュール、ならびに同素
子あるいは同モジュールを用いた高速光通信装置を安価
に提供することが可能となる。
【図1】本発明第一の実施形態を説明する図。
【図2】本発明第1の実施例を説明する図。
【図3】本発明第1の実施例を説明する図。
【図4】本発明第1の実施例を説明する図。
【図5】本発明第1の実施例を説明する図。
【図6】本発明第1の実施例を説明する図。
【図7】本発明第1の実施例を説明する図。
【図8】本発明第二の実施形態を説明する図。
【図9】本発明第2の実施例を説明する図。
【図10】本発明第2の実施例を説明する図。
【図11】本発明第2の実施例を説明する図。
【図12】本発明第2の実施例を説明する図。
【図13】本発明第2の実施例を説明する図。
【図14】本発明第2の実施例を説明する図。
【図15】本発明第三の実施形態を説明する図。
【図16】本発明第3の実施例を説明する図。
【図17】本発明第3の実施例を説明する図。
【図18】本発明第3の実施例を説明する図。
【図19】本発明第3の実施例を説明する図。
【図20】本発明第3の実施例を説明する図。
【図21】本発明第3の実施例を説明する図。
【図22】本発明第4の実施例を説明する図。
【図23】本発明第5の実施例を説明する図。
【図24】従来例を説明する図。
【図25】従来例を説明する断面図。
【図26】従来例を説明する断面図。
1:半導体基板、1a:n−InP基板、2:半絶縁性
半導体ブロック層、2a:FeドープInPブロック
層、2b:RuドープInPブロック層、3:キャリア
トラップ層、3a:SiドープInPホールトラップ
層、3b:SeドープInPホールトラップ層、4:ク
ラッド層、4a:n−InPクラッド層、4b:p−I
nPクラッド層、4c:p−InP埋め込みクラッド
層、5:コンタクト層、5a:p―InGaAsコンタ
クト層、6:活性層 7:絶縁膜 8:電極、8a:n側電極、8b:p側電極、8c:E
A変調器部p電極、9:エッチング溝 10:エッチング溝底部 11:マスク 12:活性層メサストライプ 13:回折格子 14:DFB−LD部 15:スポットサイズ変換導波路部 16:電解吸収型変調器部 17:本発明第3の実施例に係るEA光変調器集積DFB
−LD、18:非球面レンズ、19:光アイソレータ、
20:光ファイバ、21:EA光変調器集積DFB−L
D駆動用電気インタフェース、22:本発明第4の実施
例に係る光送信モジュール 23:光送信装置、24:光送信モジュール駆動系、2
5:受信装置、26:受光モジュール、
半導体ブロック層、2a:FeドープInPブロック
層、2b:RuドープInPブロック層、3:キャリア
トラップ層、3a:SiドープInPホールトラップ
層、3b:SeドープInPホールトラップ層、4:ク
ラッド層、4a:n−InPクラッド層、4b:p−I
nPクラッド層、4c:p−InP埋め込みクラッド
層、5:コンタクト層、5a:p―InGaAsコンタ
クト層、6:活性層 7:絶縁膜 8:電極、8a:n側電極、8b:p側電極、8c:E
A変調器部p電極、9:エッチング溝 10:エッチング溝底部 11:マスク 12:活性層メサストライプ 13:回折格子 14:DFB−LD部 15:スポットサイズ変換導波路部 16:電解吸収型変調器部 17:本発明第3の実施例に係るEA光変調器集積DFB
−LD、18:非球面レンズ、19:光アイソレータ、
20:光ファイバ、21:EA光変調器集積DFB−L
D駆動用電気インタフェース、22:本発明第4の実施
例に係る光送信モジュール 23:光送信装置、24:光送信モジュール駆動系、2
5:受信装置、26:受光モジュール、
Claims (12)
- 【請求項1】 半絶縁性半導体ブロック層とキャリアト
ラップ層を有する埋め込みヘテロ構造型光半導体素子に
おいて、選択成長によって形成されたクラッド層及びコ
ンタクト層を有し、かつ、キャリアトラップ層および半
絶縁性ブロック層がエッチングされたメサ構造を有する
ことを特徴とする光半導体素子。 - 【請求項2】 前記キャリアトラップ層ならびに半絶縁
性ブロック層のエッチング深さが半絶縁性ブロック層に
まで到達し、かつ、該ブロック層が形成される基板にま
では到達しないことを特徴とする請求項1記載の光半導
体素子。 - 【請求項3】 前記半絶縁性ブロック層がFe(鉄)ドー
プInPであることを特徴とする請求項1乃至2記載の
光半導体素子。 - 【請求項4】 前記半絶縁性ブロック層がRu(ルテニ
ウム)ドープInPであることを特徴とする請求項1乃
至2記載の光半導体素子。 - 【請求項5】 前記キャリアトラップ層がSi(シリコ
ン)ドープInPであることを特徴とする請求項1乃至
2記載の光半導体素子。 - 【請求項6】 前記キャリアトラップ層がSe(セレン)
ドープInPであることを特徴とする請求項1乃至2記
載の光半導体素子。 - 【請求項7】 請求項1乃至6記載の光半導体素子と、
該光半導体素子からの出力光を外部に導波するための手
段と、この導波手段に前記光半導体素子からの出力光を
入力する機構と、上記光半導体素子を駆動するための電
気的インターフェースを具備する光通信用モジュール。 - 【請求項8】 請求項1乃至6記載の光半導体素子を有
する通信手段と、この通信手段からの出力光を受信する
ための受信手段とを有する光通信装置および光通信シス
テム。 - 【請求項9】 半絶縁性半導体ブロック層とキャリアト
ラップ層を有する埋め込みヘテロ構造型光半導体素子の
製造工程において、クラッド層及びコンタクト層の少な
くとも一部分を選択成長によって形成し、かつ、該クラ
ッド層及びコンタクト層の選択成長後にキャリアトラッ
プ層および半絶縁性ブロック層の一部をエッチングする
工程を有することを特徴とする光半導体素子の製造方
法。 - 【請求項10】 前記キャリアトラップ層および半絶縁
性ブロック層の一部のエッチング行程において、前記選
択成長によって形成されたコンタクト層材料に対するエ
ッチング速度が該キャリアトラップ層材料および半絶縁
性ブロック層材料に対するエッチング速度よりも遅い選
択性エッチングを用い、選択成長によって形成されたコ
ンタクト層部分をエッチングマスクとして用いることを
特徴とする請求項9記載の光半導体素子の製造方法。 - 【請求項11】 半絶縁性半導体ブロック層とキャリア
トラップ層を有する埋め込みヘテロ構造型光半導体素子
において、半絶縁性半導体ブロック層およびキャリアト
ラップ層の形成前に該キャリアトラップ層および半絶縁
性ブロック層の一部をエッチングし、該エッチング工程
後にクラッド層及びコンタクト層を選択成長によって形
成する工程を有することを特徴とする光半導体素子の製
造方法。 - 【請求項12】 請求項8乃至10記載の光半導体素子
の製造方法において、前記キャリアトラップ層ならびに
半絶縁性ブロック層のエッチング深さが半絶縁性ブロッ
ク層にまで到達し、かつ、該ブロック層が形成される基
板にまでは到達しないことを特徴とする光半導体素子の
製造方法。
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| JP2021163925A (ja) * | 2020-04-02 | 2021-10-11 | 浜松ホトニクス株式会社 | 量子カスケードレーザ素子及び量子カスケードレーザ装置 |
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| JP4072937B2 (ja) * | 2001-05-11 | 2008-04-09 | 日本電信電話株式会社 | 半導体光素子 |
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| TWI281257B (en) * | 2005-03-30 | 2007-05-11 | Taiwan Semiconductor Mfg | Quasi-planar and FinFET-like transistors on bulk silicon |
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| FR2949619B1 (fr) * | 2009-08-28 | 2011-08-05 | Thales Sa | Laser semi-conducteur a modulation electrique |
| KR20160006838A (ko) * | 2014-07-09 | 2016-01-20 | 한국전자통신연구원 | 분포 궤환형 레이저 다이오드 어레이 및 그것을 제조하는 방법 |
| DE102015116970A1 (de) | 2015-10-06 | 2017-04-06 | Osram Opto Semiconductors Gmbh | Halbleiterlaser und Verfahren zur Herstellung eines Halbleiterlasers |
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| JPH11354886A (ja) * | 1998-06-10 | 1999-12-24 | Nec Corp | 半導体レーザおよびその製造方法 |
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2000
- 2000-04-12 JP JP2000110614A patent/JP3484394B2/ja not_active Expired - Fee Related
-
2001
- 2001-04-12 US US09/832,842 patent/US6539039B2/en not_active Expired - Fee Related
- 2001-04-12 EP EP01303467A patent/EP1146616A3/en not_active Withdrawn
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