DE19841227C1 - Power end stage to switch inductive load without free running circuit - Google Patents
Power end stage to switch inductive load without free running circuitInfo
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Abstract
Description
Die Erfindung betrifft eine Leistungsendstufe zum Schalten einer induktiven Last, insbesondere der Erregerwicklung eines Kraftstoffeinspritzventils einer Brennkraftmaschine, nach dem Oberbegriff von Anspruch 1.The invention relates to a power amplifier for switching an inductive load, especially the excitation winding Fuel injection valve of an internal combustion engine, according to Preamble of claim 1.
Leistungsendstufen werden insbesondere im Motorsteuerungsbe reich von Kraftfahrzeugen in großer Zahl verwendet. Für be stimmte Anwendungszwecke (beispielsweise Kraftstoffeinsprit zung oder Zündung, insbesondere Mehrfacheinspritzung) müssen die einzelnen Lasten mit exakt einzuhaltenden Schaltzeiten angesteuert werden. Aus diesem Grund werden solche Lasten oh ne Freilaufkreis betrieben, um kurze Abschaltphasen zu errei chen. Zum Schutz vor zu hohen Abschaltspannungen am Kollektor bzw. Drain des mit der Last in Reihe liegenden Leistungs schalters ohne Freilaufkreis (bei fehlender Freilaufdiode) wird zwischen dessen Basis/Gate und Kollektor/Drain in be kannter Weise eine Zenerdiode geschaltet, welche bei zu hohen Abschaltspannungen durchbricht und den Leistungsschalter in den leitenden Zustand steuert, bis die Abschaltspannung auf ungefährliche Werte abgeklungen ist. Dieser Zustand wird mit 'Zenerphase' bezeichnet.Power output stages are particularly in the engine control area used extensively by motor vehicles. For be certain application purposes (for example fuel injection ignition or ignition, especially multiple injection) the individual loads with exact switching times to be observed can be controlled. For this reason, such loads oh ne freewheel circuit operated to achieve short switch-off phases chen. To protect against excessive shutdown voltages at the collector or drain of the power in series with the load switch without free-wheeling circuit (if there is no free-wheeling diode) is in between its base / gate and collector / drain known a Zener diode switched, which is too high Breakdown voltages breaks through and the circuit breaker in controls the conductive state until the cutoff voltage is on safe values have subsided. This condition comes with Inscribed 'Zenerphase'.
Bevor die induktive Last wieder eingeschaltet werden kann, muß nach dem Abschalten die Dauer der Zenerphase abgewartet werden, um die Restenergie der Last abbauen zu können. Dies wurde bisher durch eine vorgegebene Sperr- oder Wartezeit ge währleistet, die jedoch aufgrund von Bauteiletoleranzen ver hältnismäßig lang bemessen sein mußte. Before the inductive load can be switched on again, After switching off, the duration of the zener phase must be waited for to reduce the residual energy of the load. This was previously ge by a predetermined blocking or waiting time ensures, however, due to component tolerances had to be relatively long.
Im ersten Ausführungsbeispiel einer Leistungsendstufe LE nach Fig. 1 ist eine Reihenschaltung einer induktiven Last V und eines als N-MOSFET ausgebildeten Leistungsschalters T zwi schen Pluspol +Uv und Minuspol GND einer nicht dargestellten Spannungsquelle angeordnet. Die Last V ist einerseits mit dem Pluspol +Uv und andererseits mit dem Drain d des als Lowside schalters ausgebildeten Leistungsschalters T verbunden, die Source s des Leistungsschalters T ist mit dem Minuspol GND verbunden. Zwischen Gate g und Drain d des Leistungsschalters T ist in bekannter Weise eine Reihenschaltung einer zum Drain d hin stromleitenden Zenerdiode Z, einer zum Gate g hin stromleitenden, nicht näher bezeichneten Sperrdiode (um einen Stromfluß vom Gate g zum Drain d bei leitendem Leistungs schalter T zu verhindern) und eines Widerstandes angeordnet.In the first exemplary embodiment of a power output stage LE according to FIG. 1, a series connection of an inductive load V and a power switch T designed as an N-MOSFET is arranged between the positive pole + Uv and negative pole GND of a voltage source (not shown). The load V is connected on the one hand to the positive pole + Uv and on the other hand to the drain d of the power switch T designed as a low side switch, the source s of the power switch T is connected to the negative pole GND. Between the gate g and the drain d of the circuit breaker T is a series connection of a zener diode Z that conducts current to the drain d, a blocking diode that conducts current to the gate g (unspecified) (for a current flow from the gate g to the drain d with a conductive power switch T) to prevent) and a resistor.
Zwischen dem Steuereingang E und einem Gatetreiber Tr, der das Steuersignal st auf die zur Ansteuerung des Leistungs schalters T erforderliche Spannung bringt, ist eine als strichlierter Kasten angedeutete Logikschaltung LS angeord net, die in diesem Ausführungsbeispiel ein Und-Glied UND auf weist, an deren einen Eingang die dem Eingang E der Lei stungsendstufe LE zugeführten Steuersignale st zum Ein- und Ausschalten der Last V gelegt werden und dessen Ausgang über die Treiberschaltung Tr mit dem Gate g des Leistungsschalters T verbunden ist.Between the control input E and a gate driver Tr, the the control signal st to control the power switch T brings voltage required is as Dashed box indicated logic circuit LS arranged net, which is an AND gate AND in this embodiment points, at one input that the input E of the Lei Control stage LE supplied control signals st for input and Turn off the load V and its output over the driver circuit Tr with the gate g of the circuit breaker T is connected.
Außerdem ist ein Differenzverstärker DV vorgesehen, dessen Eingänge mit je einem Anschluß des Shuntwiderstandes R ver bunden sind, und in welchem eine bei einem durch ihn fließen den Strom entstehende Potentialdifferenz (Spannung am Shunt widerstand) feststellbar ist, indem am Ausgang des Differen tialverstärkers DV ein logisches H-Signal erscheint, wenn keine Potentialdifferenz meßbar ist, und ein logisches L-Si gnal erscheint, wenn eine solche meßbar ist, d. h., wenn die Zenerdiode Z in leitendem Zustand ist. Der Ausgang des Diffe rentialverstärkers DV ist mit dem zweiten Eingang des Und- Gliedes UND verbunden. Im folgenden bedeutet 'L' ein Low- Signal, 'H' ein High-Signal, beispielsweise L = 0 V, H = +5 V.In addition, a differential amplifier DV is provided, the Inputs with one connection each of the shunt resistor R ver are bound, and in which one flows through him at one the potential difference arising (current at the shunt resistance) can be determined by at the exit of the difference tial amplifier DV a logical H signal appears when no potential difference can be measured, and a logical L-Si Signal appears if one is measurable, i. that is, if the Zener diode Z is in the conductive state. The exit of the diffe rential amplifier DV is connected to the second input of the Link AND connected. In the following, 'L' means a low Signal, 'H' a high signal, for example L = 0 V, H = +5 V.
Bei ausgeschalteter Last V ist das Steuersignal st = L, der Ausgang des Und-Gliedes UND ist ebenfalls L und der Lei stungsschalter T nichtleitend. Am Shuntwiderstand R ist keine Spannung und infolgedessen auch keine Potentialdifferenz meß bar, was ein H-Signal am zweiten Eingang des Und-Gliedes UND bewirkt.When the load V is switched off, the control signal st = L, the The output of the AND element AND is also L and the Lei Control switch T non-conductive. There is no shunt resistor R Voltage and therefore no potential difference bar, which is an H signal at the second input of the AND gate AND causes.
Sobald am Eingang E der Leistungsendstufe LE ein Steuersignal st = H erscheint, wird dieses über das Und-Glied UND dem Gate g des Leistungsschalters T zugeführt, wodurch dieser in den leitenden Zustand übergeht. Die Drainspannung geht nahezu nach Null. Es fließt ein Strom vom Pluspol +Uv über die Last V und den Leistungsschalter T zum Minuspol GND, solange das Steuersignal st ansteht. As soon as a control signal at input E of power output stage LE st = H appears, this is over the AND gate AND the gate g of the circuit breaker T fed, whereby this in the conductive state passes. The drain voltage is almost towards zero. A current flows from the positive pole + Uv through the load V and the circuit breaker T to the negative pole GND, as long as that Control signal st is present.
Aus der gattungsgemäßen DE 40 00 820 A1 ist eine Schutzschaltung für einen elek trischen Verbraucher bekannt, welche den Verbraucher abschal tet, wenn der durch ihn fließende Strom einen vorgegebenen Grenzwert überschreitet.From the generic DE 40 00 820 A1 is a protective circuit for an elek trical consumers known, which scarf the consumer Tet when the current flowing through it a predetermined Limit exceeded.
Die DE 44 28 675 A1 offenbart eine Schaltungsanordnung zum Schutz eines abschaltbaren Leistungshalbleiter-Schalters vor energiereichen Überspannungen, mit einer Spannungsklemmbe schaltung zwischen Gate und Drain des Leistungshalbleiter- Schalters; abhängig von dem durch die Spannungsklemmbeschal tung fließenden Strom wird der Leistungshalbleiter-Schalter gesteuert, wodurch die Elemente der Spannungsklemmbeschaltung entlastet werden und eine Begrenzung der Spannung am Lei stungshalbleiter-Schalter mit hoher Wiederholrate ermöglicht wird.DE 44 28 675 A1 discloses a circuit arrangement for Protection of a switchable power semiconductor switch against high energy surges, with a voltage clamp circuit between gate and drain of the power semiconductor Switch; depending on that by the tension clamp current flowing becomes the power semiconductor switch controlled, creating the elements of the voltage clamp circuit be relieved and a limitation of the voltage on the Lei power semiconductor switch with high repetition rate enabled becomes.
Es ist Aufgabe der Erfindung, eine Leistungsendstufe ohne Freilaufkreis zum Schalten einer induktiven Last dahingehend auszubilden, daß ein erneutes Einschalten sofort nach Ende der Zenerphase erfolgen kann.It is an object of the invention to provide a power amplifier without Free-wheeling circuit for switching an inductive load in this regard train that restarting immediately after the end the zener phase can take place.
Diese Aufgabe wird erfindungsgemäß durch die Merkmale des An spruchs 1 gelöst.This object is achieved by the features of the An spell 1 solved.
Im folgenden werden unter Bezugnahme auf die schematische Zeichnung zwei Ausführungsbeispiele einer erfindungsgemäßen Leistungsendstufe beschrieben und deren Funktionsweise erläu tert. Es zeigen:The following are with reference to the schematic Drawing two embodiments of an inventive Power output stage described and how it works tert. Show it:
Fig. 1 ein erstes Ausführungsbeispiel einer Leistungsend stufe, und Fig. 1 shows a first embodiment of a power stage, and
Fig. 2 ein zweites Ausführungsbeispiel einer Leistungs endstufe. Fig. 2 shows a second embodiment of a power output stage.
Wenn das Steuersignal verschwindet, st = L, wird der Lei stungsschalter T nichtleitend. An seinem Drain d steigt die Spannung schnell an, bis sie die Durchbruchspannung der Zenerdiode Z erreicht, beispielsweise +40 V, auf welche sie begrenzt wird. Ohne Zenerdiode würde sie noch wesentlich hö her ansteigen.When the control signal disappears, st = L, the lei Control switch T non-conductive. The rises at its drain d Voltage quickly until it reaches the breakdown voltage of the Zener diode Z reaches, for example +40 V, to which it is limited. Without the Zener diode, it would be much higher rise here.
Bei leitender Zenerdiode Z fließt ein Strom von der Last über die Sperrdiode, die Zenerdiode Z und den Shuntwiderstand R zum Gate g des Leistungsschalters T, wodurch dieser wieder und solange leitend gesteuert wird, bis die in der induktiven Last gespeicherte Energie abgebaut ist (Zenerphase).When the Zener diode Z is conductive, a current flows from the load the blocking diode, the Zener diode Z and the shunt resistor R to the gate g of the circuit breaker T, whereby this again and is controlled until the inductive Last stored energy is reduced (zener phase).
Der durch den Shuntwiderstand R fließende Strom bewirkt eine an ihm abfallende Spannung und damit eine Potentialdifferenz am Differenzverstärker DV, woraufhin am Ausgang des Diffe renzverstärkers DV ein L-Signal erscheint, welches das Und- Glied UND so lange sperrt, bis die Zenerdiode Z wieder nicht leitend und der durch sie fließende Strom zu Null wird. Da durch wird eine erneute Ansteuerung des Leistungsschalters T während der Zenerphase verhindert. Nach Ablauf der Zenerphase wird das Und-Glied UND wieder für ein nächstes - kommendes oder bereits während der Zenerphase am Eingang E erscheinen des - Steuersignal st freigegeben. Dies ist der früheste Zeitpunkt für eine neue Ansteuerung der Last V.The current flowing through the shunt resistor R causes one voltage drop across it and thus a potential difference at the differential amplifier DV, whereupon at the output of the dif limit amplifier DV an L signal appears, which is the und- Link AND blocks until the Zener diode Z does not work again conductive and the current flowing through it becomes zero. There is a renewed activation of the circuit breaker T prevented during the zener phase. After the zener phase becomes the AND-link AND again for another - coming or appear at input E during the zener phase des - control signal st released. This is the earliest Time for a new control of the load V.
In Fig. 2 ist ein zweites Ausführungsbeispiel einer Lei stungsendstufe LE dargestellt. Zum Unterschied von dem Aus führungsbeispiel nach Fig. 1 liegt hier der Shuntwiderstand R nicht in Reihe mit der Zenerdiode Z, sondern zwischen Sour ce s des Leistungsschalters T und dem Minuspol GND.In Fig. 2, a second embodiment of a Lei output stage LE is shown. In distinction from the off operation example according to FIG. 1 of the shunt resistor R is here not in series with the Zener diode Z, but between sour ce s T of the circuit breaker and the negative pole GND.
Auch hier ist wieder eine Reihenschaltung einer induktiven Last V und eines als N-MOSFET ausgebildeten Leistungsschal ters T zwischen Pluspol +Uv und Minuspol GND einer nicht dar gestellten Spannungsquelle angeordnet.Again, there is an inductive series connection Load V and a power switch designed as an N-MOSFET ters T between positive pole + Uv and negative pole GND is not one provided voltage source arranged.
Zwischen Gate g und Drain d des Leistungsschalters T ist ebenfalls eine Reihenschaltung einer zum Drain d hin strom leitenden Zenerdiode Z und einer zum Gate g hin stromleiten den, nicht näher bezeichneten Sperrdiode angeordnet.Is between gate g and drain d of the circuit breaker T. also a series connection of a current towards the drain d conductive Zener diode Z and one current to gate g the blocking diode, not specified, arranged.
Die am Shuntwiderstand R abfallende Spannung wird in einem Komparator K mit einem Schwellwert S verglichen, der an sei nem Ausgang ein H-Signal abgibt, wenn diese Spannung den Schwellwert S übersteigt, andernfalls ein L-Signal.The voltage drop across the shunt resistor R is in one Comparator K compared with a threshold S, which is on emits an H signal at its output if this voltage Threshold S exceeds, otherwise an L signal.
Wie in Fig. 1 ist zwischen dem Steuereingang E und dem Ga tetreiber Tr eine in einem strichlierten Kasten befindliche Logikschaltung LS angeordnet.As in Fig. 1, a logic circuit LS located in a dashed box is arranged between the control input E and the gate driver Tr.
Da der Shuntwiderstand R sowohl während der Ansteuerung der Last als auch während der daran anschließenden Zenerphase von einem Strom durchflossen wird, ist in diesem Fall die Logik schaltung LS etwas aufwendiger, um die Zenerphase zu detek tieren. Sie weist ein erstes Und-Glied U1 mit einem invertie renden Eingang auf, dem die Steuersignale st zugeführt wer den. Der andere Eingang ist mit dem Ausgang des Komparators K verbunden. Der Ausgang des ersten Und-Gliedes U1 ist mit dem mit einem Pfeil gekennzeichneten Takteingang eines D-Flip- Flop's FF verbunden. Ein D-Flip-Flop gibt das an seinem Ein gang D anliegende Signal mit dem Erscheinen der ansteigenden Flanke eines Taktsignals t an seinen Ausgang Q weiter. Der D- Eingang des D-Flip-Flop's FF liegt in diesem Ausführungsbei spiel permanent auf H-Signal, während der andere Eingang und der Q-Ausgang nicht beschaltet sind.Since the shunt resistor R is activated both during the activation of the Last as well as during the subsequent zener phase of in this case, the logic is through which a current flows circuit LS somewhat more complex to detect the zener phase animals. It has a first AND gate U1 with an invertie the input to which the control signals st are supplied the. The other input is with the output of the comparator K connected. The output of the first AND gate U1 is with the clock input of a D-flip- Flop's FF connected. A D flip-flop gives this at its on Gang D applied signal with the appearance of the increasing Flank of a clock signal t to its Q output. The D- The input of the D flip-flop FF is in this embodiment play permanently on H signal while the other input and the Q output are not connected.
Der Ausgang Q des D-Flip-Flop's FF ist mit dem einen Eingang eines zweiten Und-Gliedes U2 verbunden, dessen anderer Ein gang mit dem Eingang E verbunden ist. Der Ausgang des Kompa rators K ist noch mit einem "Clear"-Eingang CL des D-Flip- Flop's FF verbunden. Ein L-Signal am Clear-Eingang setzt das D-Flip-Flop in seinen Ausgangszustand Q = L, Q = H.The output Q of the D flip-flop FF is with one input of a second AND gate U2, the other one connected is connected to the input E. The exit of the compa rators K is still with a "Clear" input CL of the D flip Flop's FF connected. An L signal at the clear input sets this D flip-flop in its initial state Q = L, Q = H.
Diese Schaltung arbeitet folgendermaßen:This circuit works as follows:
Beim Einschalten der Versorgungsspannung Uv ist der Lei stungsschalter T gesperrt, die Source s liegt auf GND-Po tential und es geht das Ausgangssignal des Komparators K nach L. Dadurch wird das D-Flip-Flop FF über den Eingang CL in seinen Ausgangszustand Q = H gesetzt, wodurch das zweite Und-Glied U2 für ein Steuersignal st freigegeben wird. Das erste Und-Glied U1 ist gesperrt, da am Ausgang des Kompara tors K ein L-Signal liegt.When the supply voltage Uv is switched on, the Lei circuit breaker T locked, the source s is at GND-Po tential and it follows the output signal of the comparator K L. This turns the D flip-flop FF into the input CL its initial state Q = H is set, causing the second And gate U2 is released for a control signal st. The first AND gate U1 is blocked because at the exit of the Kompara tors K is an L signal.
Erscheint ein Steuersignal st = H, so wird über den Gatetrei ber Tr das Gate g des Leistungsschalters T angesteuert, wor auf dieser leitend wird. Es fließt ein Strom vom Pluspol +Uv durch die Last V, den Leistungsschalter T und den Shuntwider stand R zum Minuspol GND.If a control signal st = H appears, then the gate is used Driven via gate G of circuit breaker T, wor on this becomes a leader. A current flows from the positive pole + Uv through the load V, the circuit breaker T and the shuntwider R stood at the negative pole GND.
Die daraufhin am Shuntwiderstand R abfallende Spannung über steigt schnell den Schwellwert S. woraufhin das Ausgangssi gnal des Komparators K von L nach H geht. Das Und-Glied U1 bleibt aber weiter gesperrt, weil jetzt an seinem invertie renden Eingang infolge des anstehenden Steuersignals st ein L-Signal anliegt.The voltage then dropped across the shunt resistor R. threshold S. quickly rises, whereupon the output S. signal of the comparator K goes from L to H. The AND gate U1 but remains locked because now on its invertie input due to the pending control signal st L signal is present.
Wenn beim Abschalten der Last V das Steuersignal st von H nach L geht, erscheint am Ausgang des ersten Und-Gliedes U1 ein H-Signal als Taktsignal t, mit dessen ansteigender Flanke das am D-Eingang des D-Flip-Flop's FF anstehende H-Signal auf dessen Q-Ausgang übernommen wird. Infolge dessen erscheint am Q-Ausgang ein L-Signal, durch welches das zweite Und-Glied gesperrt wird.If the control signal st of H goes to L, appears at the exit of the first AND gate U1 an H signal as a clock signal t, with its rising edge the H signal present at the D input of the D flip-flop FF whose Q output is adopted. As a result, appears on Q output an L signal, through which the second AND gate is blocked.
Gleichzeitig wird infolge der beginnenden Zenerphase der Lei stungsschalter T leitend gehalten, bis die Abschaltspannung an seinem Drain d auf ungefährliche Werte abgeklungen ist. Während der Zenerphase wird eine neuerliche Ansteuerung des Leistungsschalters T durch das gesperrte zweite Und-Glied U2 verhindert.At the same time, due to the beginning of the zener phase, the lei Control switch T kept conductive until the cut-off voltage has decayed to harmless values at its drain d. During the zener phase, a new control of the Circuit breaker T through the blocked second AND gate U2 prevented.
Wenn die Zenerphase beendet ist, wird der Leistungsschalter T gesperrt. Die Spannung am Shuntwiderstand R verschwindet, wo durch das Ausgangssignal des Komparators K von H nach L geht. Dieses Ausgangssignal des Komparators K erscheint auch am Clear-Eingang CL des D-Flip-Flop's FF und setzt dieses in seinen Ausgangszustand Q = L, wodurch der Anfangszustand der Leistungsendstufe wieder hergestellt ist.When the zener phase has ended, the circuit breaker T blocked. The voltage at the shunt resistor R disappears where goes from H to L by the output signal of the comparator K. This output signal from the comparator K also appears on Clear input CL of the D flip-flop FF and sets this in its initial state Q = L, which makes the initial state of Power stage is restored.
Ab diesem Moment kann durch ein danach erscheinendes oder am Eingang E bereits vorliegendes Steuersignal st die Last V zum frühest möglichen Zeitpunkt wieder angesteuert werden.From this moment onwards, a subsequent or Input E control signal already present is the load V to be controlled again at the earliest possible time.
Es liegt im Rahmen der Erfindung, daß die vorstehend in einer Ausführung mit einem N-MOSFET als Leistungsschalter T be schriebene Leistungsendstufe sowohl mit Bipolartransistoren (npn, pnp) als auch mit P-MOSFET's als Leistungsschalter T ausführbar ist, wobei diese Leistungsschalter, unter Berück sichtigung der jeweiligen Polungen, sowohl als Lowside-Schal ter, wie beschrieben, aber auch als Highside-Schalter ein setzbar sind.It is within the scope of the invention that the above in a Version with an N-MOSFET as a circuit breaker T be written power stage with both bipolar transistors (npn, pnp) as well as with P-MOSFETs as circuit breakers T is executable, these circuit breakers, under consideration inspection of the respective polarities, both as a low-side scarf ter, as described, but also as a highside switch are settable.
Infolge der großen Zahl benötigter Leistungsendstufen werden oft vielfach integrierte Mehrfach-Leistungsendstufen einge setzt, z. B. Vier- oder Achtfach-Leistungsendstufen, und in naher Zukunft IC's mit noch mehr Leistungsendstufen infolge höherer Integrationsdichte. Für jede dieser Leistungsendstu fen wird eine oben beschriebene Schaltung LE benötigt, wobei diese Schaltungen ebenfalls zu integrierten Mehrfach-Lei stungsendstufen zusammengefaßt werden können.Due to the large number of power amplifiers required often integrated multiple power amplifiers sets, e.g. B. four or eight-fold power amplifiers, and in near future ICs with even more power amplifiers as a result higher integration density. For each of these performance end stages fen a circuit LE described above is required, wherein these circuits also to integrated multiple lei power stages can be summarized.
Claims (3)
daß die Logikschaltung (LS) ein Und-Glied (UND) enthält, des sen einem Eingang (E) die Steuersignale (st) zugeführt wer den, dessen Ausgangssignal über die Treiberschaltung (Tr) auf den Steueranschluß (g) des Leistungsschalters (T) ein wirkt, und dessen anderer Eingang mit dem Ausgang eines Differenzverstärkers (DV) verbunden ist, und
daß ein mit der Zenerdiode (Z) in Reihe liegender Shuntwider stand (R) vorgesehen ist, dessen Anschlüsse mit den Eingän gen des Differenzverstärkers (DV) verbunden sind. 2. Power output stage according to claim 1, characterized in
that the logic circuit (LS) contains an AND gate (AND), the sen an input (E) the control signals (st) who the output signal via the driver circuit (Tr) to the control terminal (g) of the circuit breaker (T) one acts, and the other input is connected to the output of a differential amplifier (DV), and
that a with the Zener diode (Z) in series shunt resistor (R) is provided, the connections of which are connected to the inputs of the differential amplifier (DV).
daß in der Logikschaltung (LS)
ein erstes Und-Glied (U1) vorgesehen ist, mit einem inver tierenden Eingang, dem die Steuersignale (st) zugeführt werden,
ein D-Flip-Flop (FF) vorgesehen ist, dessen Takteingang mit dem Ausgang des ersten Und-Gliedes (U1) verbunden ist, und dessen D-Eingang konstant mit einem H-Signal beaufschlagt ist,
ein zweites Und-Glied (U2) vorgesehen ist, dessen einer Eingang mit dem Q-Ausgang des D-Flip-Flop's (FF) verbunden ist, dessen anderem Eingang die Steuersignale (st) zuge führt werden, und dessen Ausgang über die Treiberschaltung (Tr) auf den Steueranschluß (g) des Leistungsschalters (T) einwirkt,
daß ein zwischen dem der Last (V) abgewandten Anschluß (s) des Leistungsschalters (T) und dem nicht mit der Last (V) verbundenen Pol (GND) der Spannungsquelle liegender Shunt widerstand (R) vorgesehen ist, und
daß ein Komparator (K) vorgesehen ist, dessen einem Eingang die am Shuntwiderstand (R) abfallende Spannung (uSh) zuge führt wird, dessen anderem Eingang ein Schwellwert (S) zu geführt wird, und dessen Ausgang mit dem zweiten Eingang des ersten Und-Gliedes (U1) und mit einem Clear-Eingang (CL) des D-Flip-Flop's (FF) verbunden ist.3. Power output stage according to claim 1, characterized in
that in the logic circuit (LS)
a first AND gate (U1) is provided with an inverting input to which the control signals (st) are supplied,
a D flip-flop (FF) is provided, the clock input of which is connected to the output of the first AND element (U1), and the D input of which is constantly supplied with an H signal,
a second AND gate (U2) is provided, one input of which is connected to the Q output of the D flip-flop (FF), the other input of which supplies the control signals (st), and the output of which is via the driver circuit ( Tr) acts on the control connection (g) of the circuit breaker (T),
that a shunt (R) is provided between the connection (s) of the circuit breaker (T) facing away from the load (V) and the pole (GND) of the voltage source not connected to the load (V), and
that a comparator (K) is provided, one input of which is supplied with the voltage (uSh) dropping across the shunt resistor (R), the other input of which is supplied with a threshold value (S), and the output of which is connected to the second input of the first und- Link (U1) and with a clear input (CL) of the D flip-flop (FF) is connected.
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