DE10153200B4

DE10153200B4 - Process for BPSG glass filling of openings in gate electrode layers

Info

Publication number: DE10153200B4
Application number: DE10153200A
Authority: DE
Inventors: Jürgen AMON; Jürgen Faul; Thomas Schuster; Ralf Staub
Original assignee: Infineon Technologies AG
Current assignee: Infineon Technologies AG
Priority date: 2001-10-27
Filing date: 2001-10-27
Publication date: 2005-08-04
Anticipated expiration: 2021-10-28
Also published as: DE10153200A1

Abstract

Verfahren zum Verfüllen von Öffnungen (4) in einer Gate-Elektrodenschicht (3) auf einer Halbleiterscheibe (1) mit den Verfahrensschritten:
Aufwachsen einer Gate-Oxidschicht (2) auf der Halbleiterscheibe (1);
Erzeugen einer Gate-Elektrodenschicht (3) auf der Gate-Oxidschicht (2);
Definition von Öffnungsbereichen (4); Ätzung der Gate-Elektrodenschicht (3) bis zur Gate-Oxidschichtk (7) in den festgelegten Öffnungsbereichen; Umwandeln der Gate-Oxidschicht (2) durch Einbringen von Stickstoff in den freigelegten Öffnungsbereichen;
Aufbringen einer BPSG-Schicht (8); und
thermisches Verfließen der BPSG-Schicht (8) zur Auffüllung der freigelegten Öffnungsbereiche (4).Method for filling openings (4) in a gate electrode layer (3) on a semiconductor wafer (1) with the method steps:
Growing a gate oxide layer (2) on the semiconductor wafer (1);
Generating a gate electrode layer (3) on the gate oxide layer (2);
Definition of opening areas (4); Etching the gate electrode layer (3) to the gate oxide layer (7) in the predetermined opening areas; Converting the gate oxide layer (2) by introducing nitrogen into the exposed opening areas;
Applying a BPSG layer (8); and
thermal flow of the BPSG layer (8) to fill the exposed opening areas (4).

Description

Die Erfindung betrifft ein Verfahren zum Verfüllen von Öffnungen, insbesondere von self aligned Kontakten zwischen Gateelektroden auf einer Halbleiterscheibe.The The invention relates to a method for filling openings, in particular of self aligned contacts between gate electrodes on a semiconductor wafer.

Zum Verfüllen von engen Spalten zwischen Gate-Leitungen auf einem Halbleiterchip wird üblicherweise die sogenannte Reflow-Technik mit dotierten Gläsern eingesetzt. Hierbei werden insbesondere mit Bor und Phosphor dotierte Gläser, sogenannte BPSG-Gläser verwendet, die bereits bei Temperaturen unter 900ºC gut verfließen. Der Bor- und Phosphorgehalt in den BPSG-Gläsern liegt dabei im allgemeinen zwischen ein und mehreren Prozent, wobei höhere Dotierkonzentrationen zu einem Absinken des Fließpunktes des BPSG-Glases und damit zu einem verbesserten Fließverhalten führen. Bei höheren Beimischungen von Bor und Phosphor steigt jedoch die Gefahr einer Hygroskopie der Glasschichten, da Oxid in Verbindung mit Feuchtigkeit zur Bildung von Phosphorsäure neigt, was insbesondere zu Korrosion führen kann.To the filling of narrow gaps between gate lines on a semiconductor chip becomes common the so-called reflow technique with doped glasses used. Here are in particular glasses doped with boron and phosphorus, so-called BPSG glasses, which flow well even at temperatures below 900 ° C. Of the Boron and phosphorus content in the BPSG glasses is generally between one and several percent, with higher doping concentrations to a decrease of the pour point of the BPSG glass and thus to an improved flow behavior to lead. At higher However, admixtures of boron and phosphorus increase the risk of Hygroscopy of the glass layers, since oxide combined with moisture for the formation of phosphoric acid tends, which in particular can lead to corrosion.

Wenn das BPSG-Glas zum Verfüllen von Öffnungen in der Gate-Elektrodenschicht direkt auf der üblicherweise aus Silizium bestehenden Halbleiterscheibe abgeschieden wird, kann weiterhin beim nachfolgenden Hochtemperaturschritt, der zum Verfließen des BPSG-Glases notwendig ist, Phosphor und Bor aus dem BPSG-Glas in die darunter liegende Siliziumschicht eindiffundieren. Hierdurch werden dann die in dieser Siliziumschicht eingestellten Dotierprofile unkontrollierbar verändert, was dazu führen kann, dass die Funktion der auf der Silizium-Scheibe hergestellten Transistoren gefährdet und damit die Funktionalität des gesamten Halbleiterchips beeinträchtigt bzw. zerstört wird.If to fill the BPSG glass of openings in the gate electrode layer directly on the usual silicon wafer may be deposited continue at the subsequent high-temperature step, the flow of the BPSG glass is necessary, phosphorus and boron from the BPSG glass in diffuse the underlying silicon layer. hereby then become the doping profiles set in this silicon layer changed uncontrollably, what cause it can that function of being produced on the silicon disk Transistors endangered and hence the functionality the entire semiconductor chip is affected or destroyed.

Um das Problem eines unkontrollierbaren Ausdiffundierens von Bor und Phosphor in die Silizium-Scheibe zu verhindern, wird vor dem Abscheiden des BPSG-Glases üblicherweise eine als Diffusionssperre wirkende Linerschicht aufgebracht. Als Linerschicht wird dabei vor allem Silizium-Oxynitrid eingesetzt. Die in der Öffnung eingebrachte Linerschicht hat üblicherweise eine Dicke von 5 bis 25nm, was zu einer lateralen Einengung insbesondere bei self aligned Kontakten führt. Dies ist insbesondere dann nachteilhaft, wenn in die Öffnungsbereiche im weiteren Prozessverlauf Bitline-Kontakte zum Anschluss einer in der Silizium-Scheibe ausgebildeten Source- bzw. Drain-Elektrode strukturiert werden. Die laterale Einengung der Kontaktöffnung durch die als Diffusionsbarriere eingesetzte Linerschicht führt nämlich dazu, dass das Prozessfenster zum Entfernen der BPSG-Glasfüllung in der Kontaktöffnung, d.h. das Kontaktfenster für die sogenannte CB (Contact Bitline)-Ätzung als auch die Kontaktfläche für den dann in die Öffnung eingebrachten Metallplug kleiner werden. Durch diese verkleinerte Kontaktfläche steigt wiederum der Kontaktwiderstand des Bitleitungskontaktes an. Dies stellt insbesondere ein Problem für Transistoren der Sub-0,25μm-Technologie dar.Around the problem of uncontrollable outdiffusion of boron and Preventing phosphorus in the silicon disk, before depositing the BPSG glasses usually applied as a diffusion barrier liner layer. When Liner layer is used mainly silicon oxynitride. The one in the opening introduced liner layer usually has a thickness of 5 to 25nm, resulting in a lateral narrowing in particular leads with self aligned contacts. This is particularly disadvantageous when in the opening areas in the further course of the process bitline contacts for the connection of a be structured in the silicon disk formed source or drain electrode. The lateral constriction of the contact opening through the as a diffusion barrier used liner layer leads namely, that the process window for removing the BPSG glass fill in the contact opening, i.e. the contact window for the so-called CB (Contact Bitline) etch as well as the contact area for the then in the opening introduced metal plug become smaller. By this reduced contact area in turn, the contact resistance of the bit line contact increases. This is a particular problem for sub-0.25μm technology transistors represents.

Um die ungewünschte laterale Einengung der Öffnungen in der Gate-Elektrodenschicht durch die notwendige Linerschicht zu vermindern, wird mit zunehmend kleineren Schichtdicken gearbeitet, wobei jedoch bei einer Schichtdicke unter 5nm der Silizum-Oxynitrid-Liner seine Funktion als Diffusionssperre verliert. Alternativ wird deshalb statt Oxynitrid als Linerschicht auch Siliziumnitrid eingesetzt, bei dem bereits unter 5nm liegende Schichtdicken eine effektive Diffusionsbarriere darstellen. Jedoch ist auch bei Siliziumnitrid eine Schichtdicke im nm-Bereich erforderlich, so dass der Einsatz einer solchen Linerschicht eine nicht unerhebliche Verkleinerung der Öffnungen nach sich zieht.Around the unwanted lateral narrowing of the openings in the gate electrode layer through the necessary liner layer To reduce, is working with increasingly smaller layer thicknesses, however, with a layer thickness of less than 5 nm, the silicon oxynitride liner loses its function as a diffusion barrier. Alternatively, therefore instead of oxynitride as liner layer also silicon nitride used, at the already below 5nm layer thicknesses an effective Represent diffusion barrier. However, silicon nitride is also used a layer thickness in the nm range required, so the use Such a liner layer a not inconsiderable reduction the openings pulls.

Aus der DE 100 10 286 A1 ist ein Verfahren zum Verfüllen von Öffnungen in einer Gate-Elektrodenschicht auf einer Halbleiterscheibe mit BDSG bekannt, bei dem vor dem Abscheiden des BPSG-Glases eine als Diffusionsbarriere wirkende Linerschicht, vorzugsweise Siliziumnitrid oder Siliziumoxynitrid, aufgebracht wird. Die Linerschicht wird dabei mit Hilfe eines CVD-Verfahrens eingebracht, wobei die schichtbildenden Ionen beschleunigt werden, sodass sich eine nichtkonforme Abscheidung mit einer dicken Schicht am Grabenboden und einer dünnen Schicht an den Seitenwänden ergibt, wodurch die Kontaktlocheinengung reduziert wird.From the DE 100 10 286 A1 A method is known for filling openings in a gate electrode layer on a semiconductor wafer with BDSG, in which a diffusion barrier layer, preferably silicon nitride or silicon oxynitride, is applied before deposition of the BPSG glass. The liner layer is thereby introduced by means of a CVD method, wherein the layer-forming ions are accelerated, resulting in a non-conforming deposition with a thick layer at the bottom of the trench and a thin layer on the side walls, whereby the contact hole narrowing is reduced.

Aufgabe der Erfindung ist es ein Verfahren zum Verfüllen von Öffnungen, insbesondere von Öffnungen in einer Gate-Elektrodenschicht mit BPSG-Glas bereitzustellen; bei dem eine ungewünschte laterale Einengung der Öffnungen beim Verfüllprozess vermieden wird.task The invention relates to a method for filling openings, in particular openings in a gate electrode layer with BPSG glass; at the one unwanted lateral narrowing of the openings during the filling process is avoided.

Diese Aufgabe wird erfindungsgemäß mit den Merkmalen des Anspruchs 1 oder des Anspruchs 2 gelöst. Bevorzugte Weiterbildungen sind in den abhängigen Ansprüchen angegeben.These Task is according to the invention with the Characteristics of claim 1 or claim 2 solved. preferred Trainings are in the dependent claims specified.

Gemäß der Erfindung wird auf die Abscheidung einer Linerschicht als Diffusionsbarriere vor dem Aufbringen der BPSG-Glasschicht gänzlich verzichtet. Als Diffusionsbarriere wird statt dessen die bereits im Rahmen der Gate-Elektrodenherstellung ausgebildete Gate-Oxidschicht eingesetzt, die nitridiert wird und so eine effektive Diffusionsbarriere für Phosphor und Bor bildet. Dieses Gateoxid wird vor dem Erzeugen der Gate-Elektrodenschicht auf der Halbleiterscheibe aufgewachsen. Die hergestellte Gate-Elektrodenschicht wird dann in festgelegten Öffnungsbereichen bis zur Gate-Oxidschicht zurückgeätzt. Anschließend wird die BPSG-Glasschicht aufgebracht und dann durch thermisches Verfließen die freigelegten Öffnungsbereiche mit BPSG-Glas verfüllt. Da das als Diffu sionssperre für das BPSG-Glas eingesetzte Gateoxid nur im Bodenbereich der Öffnungen ausgebildet ist, wird eine laterale Einengung der Öffnungen und damit eine nachträgliche Beschränkung der Bodenfläche, die z.B. zu einem erhöhten Kontaktwiderstand bei Bitline-Kontakten zum Anschluss der Source- bzw. Drain-Elektrode führen könnten, vermieden.According to the invention, the deposition of a liner layer as a diffusion barrier prior to the application of the BPSG glass layer is completely dispensed with. The diffusion barrier used instead is the gate oxide layer which has already been formed in the context of the gate electrode fabrication, which is nitrided and thus forms an effective diffusion barrier for phosphorus and boron. This gate oxide is deposited on the substrate before generating the gate electrode layer Semiconductor wafer grown. The prepared gate electrode layer is then etched back to the gate oxide layer in fixed opening areas. Subsequently, the BPSG glass layer is applied and then filled by thermal flow, the exposed opening areas filled with BPSG glass. Since the gate oxide used as Diffu sionssperre for the BPSG glass is formed only in the bottom region of the openings, a lateral constriction of the openings and thus a subsequent restriction of the bottom surface, for example, to an increased contact resistance at Bitline contacts for connecting the source or Drain lead electrode could be avoided.

Durch die Nitridierung des Gateoxides wird die Eignung als Diffusionssperre für Bor und Phosphor gewährleistet. Gemäß der Erfindung kann die Nitridierung der Gate-Oxidschicht dabei entweder nach dem Freilegen der Öffnungsbereiche in der Gate-Elektrodenschicht erfolgen oder bereits nach dem Aufwachsen der Gate-Oxidschicht vor dem Erzeugen der Gate-Elektrodenschicht durchgeführt werden.By the nitriding of the gate oxide becomes suitable as a diffusion barrier for boron and phosphorus guaranteed. According to the invention The nitridation of the gate oxide layer can be done either after the Exposing the opening areas take place in the gate electrode layer or already after growth the gate oxide layer before generating the gate electrode layer be performed.

Durch die Erfindung wird ein effektives Verfüllen von Öffnungsbereichen in einer Gate-Elektrodenschicht mit BPSG-Glas gewährleistet, und zugleich durch die nitridierte Gate-Oxidschicht ein Ausdiffundieren von Bor und Phosphor aus dem BPSG-Glas in die darunter liegende Halbleiterschicht vermieden, wobei die Verwendung der Gate-Oxidschicht als Diffusionsbarriere zu keiner lateralen Einschränkung der Öffnungsbereiche führt.By the invention will effectively fill opening areas in a gate electrode layer guaranteed with BPSG glass, and at the same time out-diffusion through the nitrided gate oxide layer of boron and phosphorus from the BPSG glass in the underlying Semiconductor layer avoided, the use of the gate oxide layer as a diffusion barrier to no lateral restriction of the opening areas leads.

Gemäß einer bevorzugten Ausführungsform der Erfindung wird nach dem Freilegen der Öffnungsbereiche thermisch eine zusätzliche Oxidschicht, die sogenannte Seitenwand-Oxidschicht erzeugt, die dann in einem weiteren Prozessschritt, vorzugsweise zusammen mit der Gate-Oxidschicht, nitridiert wird. Durch diese Ausgestaltung lässt sich eine verbesserte Oxidschicht als Diffusionsbarriere für Bor bzw. Phosphor aus dem BPSG-Glas erzeugen.According to one preferred embodiment of Invention becomes thermally after exposing the opening portions additional Oxide layer, which produces so-called sidewall oxide layer, which then in a further process step, preferably together with the Gate oxide layer is nitrided. By this configuration can be an improved oxide layer as a diffusion barrier for boron or phosphorus from the BPSG glass.

Gemäß einer weiteren bevorzugten Ausführungsform wird dann, wenn die Öffnungsbereiche zum Anschluss von Source- und Drainbereichen eines in der Halbleiterscheibe ausgebildeten Transistors dienen, die Source- und Draindotierung über die freigelegte Oxidschicht in den Öffnungsbereichen ausgeführt. Die Oxidschicht weist dabei vorzugsweise eine Dicke 1nm bis 6nm auf. Bei dieser Schichtdicke lässt sich eine besonders effektive Dotierimplantation der Source- und Drainbereiche durchführen.According to one another preferred embodiment is then when the opening areas for Connection of source and drain regions of one in the semiconductor wafer trained transistor serve, the source and drain doping on the exposed Oxide layer executed in the opening areas. The Oxide layer preferably has a thickness of 1 nm to 6 nm. At this layer thickness leaves a particularly effective doping implantation of the source and Perform drainage areas.

Gemäß bevorzugten Ausführungsformen kann die Nitridierung der Oxidschicht auf verschiedene Arten durchgeführt werden. So besteht die Möglichkeit, die Nitridierung der Oxidschicht mittels einer flachen Ionenimplantation von Stickstoff in das Oxid auszuführen, wobei die Dosierung im Bereich von 1·10¹⁴cm^–2 bis 1·10¹⁵cm^–2 bei einer Ionenenergie von 1keV bis 40keV liegt. Das implantierte Stickstoff wird anschließend thermisch aktiviert, so dass sich eine als Diffusionsbarriere für Bor wirkende Siliziumnitrid-Schicht an der Grenzfläche zur darunter liegenden Halbleiterscheibe bildet. Alternativ besteht die Möglichkeit, die Oxidschicht mittels einer N₂O oder NH₃ Nachbehandlung in einem Temperaturbereich von 800 bis 1000ºC bei einer Zeitdauer von 1 bis 60 Min. zu nitridieren.According to preferred embodiments, the nitriding of the oxide layer can be carried out in various ways. Thus, it is possible to carry out the nitriding of the oxide layer by means of a flat ion implantation of nitrogen into the oxide, the dosage being in the range from 1 × 10 ¹⁴ cm ^-2 to 1 × 10 ¹⁵ cm ^-2 at an ion energy of 1 keV to 40 keV. The implanted nitrogen is then thermally activated so that a silicon nitride layer acting as a diffusion barrier for boron forms at the interface with the underlying semiconductor wafer. Alternatively, it is possible to nitride the oxide layer by means of an N ₂ O or NH ₃ aftertreatment in a temperature range of 800 to 1000 ° C for a period of 1 to 60 minutes.

Gemäß einer dritten Variante kann die Nitridierung der Oxidschicht mit Hilfe eines CVD-Verfahrens in einer stickstoffhaltigen Atmosphäre in einem Temperaturbereich von 300 bis 500ºC erfolgen. Eine vierte Variante stellt eine Nitridierung der Oxidschicht mit Hilfe eines stickstoffhaltigen Plasmas dar.According to one third variant, the nitriding of the oxide layer using a CVD process in a nitrogen-containing atmosphere in a temperature range from 300 to 500 ° C respectively. A fourth variant involves nitridation of the oxide layer Help a nitrogen-containing plasma.

Die Erfindung wird anhand der beigefügten Zeichnungen näher erläutert. Es zeigen:The Invention will become apparent from the accompanying drawings explained in more detail. It demonstrate:

1A bis 1I schematisch eine erste Ausführungsform einer erfindungsgemäßen Prozessfolge zur Verfüllung einer Bitline-Kontakt-Öffnung zwischen Gate-Elektroden auf einem Halbleiterchip; und 1A to 1I schematically a first embodiment of a process sequence according to the invention for filling a bit line contact opening between gate electrodes on a semiconductor chip; and

2A bis 2I schematisch eine zweite Ausführungsform einer erfindungsgemäßen Prozessfolge zur Verfüllung einer Bitline-Kontakt-Öffnung zwischen Gate-Elektroden auf einem Halbleiterchip. 2A to 2I schematically a second embodiment of a process sequence according to the invention for filling a bit line contact opening between gate electrodes on a semiconductor chip.

Die Erfindung wird detailliert für die Verfüllung einer selbstjustierenden Bitline-Kontakt-Öffnung mit BPSG-Glas im Rahmen der Herstellung eines MOS-Transistors auf einer Silizium-Scheibe dargestellt. Das erfindungsgemäße Verfahren kann jedoch grundsätzlich zur Verfüllung jeder Art von Öffnungen in einer Gate-Elektrodenschicht auf einer Halbleiterscheibe eingesetzt werden.The Invention will be detailed for the backfilling a self-aligning bitline contact opening with BPSG glass in the frame the production of a MOS transistor on a silicon wafer shown. The inventive method however, basically for backfilling every kind of openings in a gate electrode layer is used on a semiconductor wafer become.

1A bis 1I zeigt schematisch einen ersten möglichen Prozessablauf, wobei jeweils ein Querschnitt durch die Silizium-Scheibe nach dem zuletzt erläuterten Prozessschritt dargestellt ist. 1A zeigt dabei einen Ausschnitt eines Quer schnitts einer Siliziumscheibe 1 in dem Prozessstadium vor der Erzeugung der Gate-Elektroden im Rahmen der Ausbildung von MOS-Transistoren auf der Siliziumscheibe. Zur Erzeugung der Gate-Elektrodenschicht wird in einem ersten Schritt die üblicherweise vorhandene dünne SiO₂-Schicht entfernt. Dann wird die Siliziumoberfläche in einem zweiten Prozessschritt thermisch oxidiert, um, wie in 1B gezeigt ist, eine Gate-Oxidschicht 2 herzustellen. Bei der thermischen Oxidation strömt üblicherweise Sauerstoff als Reaktionsgas über die geheizte Siliziumoberfläche, wobei der Sauerstoff sich mit dem Silizium der Halbleiterscheibe zu SiO₂ verbindet. Zur Erzeugung einer Gate-Oxidschicht wird herkömmlicherweise die sogenannte Trockenoxidation eingesetzt, bei der die Siliziumscheibe auf eine Temperatur von ca. 800ºC in einer reinen Sauerstoffatmosphäre aufgeheizt wird. Durch die chemische Reaktion zwischen der Siliziumoberfläche und dem Sauerstoff bildet sich eine extrem dünne Oxidschicht mit einer hohen Durchbruchsspannung und einer hohen Dichte, so dass ein elektrisch stark belastbares Oxid entsteht. 1A to 1I schematically shows a first possible process flow, wherein in each case a cross section through the silicon wafer after the last explained process step is shown. 1A shows a section of a cross-section of a silicon wafer 1 in the process stage before the generation of the gate electrodes in the course of the formation of MOS transistors on the silicon wafer. In order to produce the gate electrode layer, the usually present thin SiO ₂ layer is removed in a first step. Then, the silicon surface is thermally oxidized in a second process step to, as in 1B is shown, a gate oxide layer 2 manufacture. At the thermi Typically, oxygen flows as a reaction gas over the heated silicon surface, whereby the oxygen combines with the silicon of the semiconductor wafer to form SiO ₂ . To produce a gate oxide layer, so-called dry oxidation is conventionally used, in which the silicon wafer is heated to a temperature of about 800 ° C. in a pure oxygen atmosphere. The chemical reaction between the silicon surface and the oxygen forms an extremely thin oxide layer with a high breakdown voltage and a high density, resulting in an electrically strong oxide.

Auf dieser dünnen Gate-Schicht 2 mit einer Dicke von vorzugsweise einigen nm erfolgt dann in einem dritten Prozessschritt eine Poly-Siliziumabscheidung zur Erzeugung der Gate-Elektrodenschicht. Diese Polysiliziumschicht ist vorzugsweise mit Phosphor dotiert. Auf der Polysiliziumschicht wird dann ein Metallsilizid abgeschieden, auf dem wiederum eine Isolatorschicht, vorzugsweise Si₃N₄, erzeugt wird. Der so hergestellte Gateelektroden-Stapel ist in 1C durch Bezugszeichen 3 gekennzeichnet.On this thin gate layer 2 with a thickness of preferably a few nm then takes place in a third process step, a poly-silicon deposition to produce the gate electrode layer. This polysilicon layer is preferably doped with phosphorus. On the polysilicon layer, a metal silicide is then deposited, on which in turn an insulator layer, preferably Si ₃ N ₄ , is produced. The gate electrode stack thus produced is in 1C by reference numerals 3 characterized.

Auf diesem Gateelektroden-Stapel 3 werden dann mit dem an sich bekannten photolithografischen Verfahren Leiterbahnen und die Source/Drain-Bereiche der MOS-Transistoren definiert. Die Strukturen werden dabei zunächst über eine Fotomaske in einem dünnen strahlungsempfindlichen Fotolack, der auf dem Gateelektroden-Stapel 3 aufgebracht wird, erzeugt und dann mit einem speziellen Ätzverfahren in die aus Si₃N₄-Silizit- Polysilizium bestehende Gate-Elektrodenschicht übertragen. Die Ätzung ist dabei so ausgelegt, dass die Gate-Oxidschicht 2 als Ätzstopp dient. Nach der Ätzung des Gateelektroden-Stapels wird der verbleibende als Ätzmaske dienende Fotolack wieder entfernt. 1D zeigt einen Querschnitt durch die Siliziumscheibe nach diesem Prozessschritt, wobei eine Öffnung 4 für einen Source/Drain-Bereich 4 ausgebildet ist.On this gate electrode stack 3 are then defined by the known photolithographic process tracks and the source / drain regions of the MOS transistors. The structures are thereby initially via a photomask in a thin radiation-sensitive photoresist, which on the gate electrode stack 3 is applied, generated and then transferred by a special etching process in the Si ₃ N ₄ -Silicitic polysilicon existing gate electrode layer. The etching is designed so that the gate oxide layer 2 serves as an etch stop. After the etching of the gate electrode stack, the remaining resist serving as the etching mask is removed again. 1D shows a cross section through the silicon wafer after this process step, wherein an opening 4 for a source / drain region 4 is trained.

In einem weiteren Prozessschritt, der in 1E gezeigt ist, wird dann zum Einschluss des Gateelektroden-Stapels 2 eine weitere dünne Oxidschicht erzeugt. Diese zusätzliche dünne Oxidschicht 5 wird wiederum vorzugsweise durch thermische Oxidation der Silizium enthaltenden Oberfläche hergestellt. Durch diese weitere Oxidschicht 5 wird auch die am Boden der Öffnung 4 ausgebildete Gateoxid-Schicht 2 verstärkt.In a further process step, the in 1E is then shown to include the gate electrode stack 2 produces a further thin oxide layer. This extra thin oxide layer 5 is again preferably prepared by thermal oxidation of the silicon-containing surface. Through this further oxide layer 5 will also be at the bottom of the opening 4 formed gate oxide layer 2 strengthened.

Um einen selbstjustierenden Source/Drain-Kontakt in der Öffnung 4 in der Silizium-Scheibe 1 auszubilden, wird in einem weiteren Prozessschritt ein vorzugsweise aus Siliziumnitrid bestehender Spacer hergestellt. Hierzu wird eine Siliziumnitrid-Schicht aufgebracht und dann anisotrop zurückgeätzt, wobei die Ätzung auf dem thermisch gewachsenen Oxid, das sich aus der Gate-Oxidschicht 2 und der zusätzlich abgeschiedenen Seitenwand-Oxidationsschicht 5 zusammensetzt, stoppt. Die Oxidschicht wird dabei im Bodenbereich der Öffnung 4 durch Überätzung auf eine Dicke von 1 bis 6nm abgedünnt. 1F zeigt einen Querschnitt durch die Siliziumscheibe nach diesem Prozessschritt mit einer abgedünnten Oxidschicht 2a und einem Siliziumnitrid-Spacer 6 in Öffnungsbereich 4.To a self-aligning source / drain contact in the opening 4 in the silicon disk 1 form, in a further process step, a preferably made of silicon nitride spacer is produced. For this purpose, a silicon nitride layer is applied and then anisotropically etched back, wherein the etching on the thermally grown oxide, which consists of the gate oxide layer 2 and the additionally deposited sidewall oxidation layer 5 composed, stops. The oxide layer is in the bottom region of the opening 4 thinned by overetching to a thickness of 1 to 6nm. 1F shows a cross section through the silicon wafer after this process step with a thinned oxide layer 2a and a silicon nitride spacer 6 in opening area 4 ,

Durch diese abgedünnte Oxidschicht 2a im Öffnungsbereich 4 wird dann die Source/Drain-Dotierung vorzugsweise mittels Ionenimplantation von Dotieratomen durchgeführt. 1G zeigt einen Querschnitt durch die Siliziumscheibe nach Ausbildung des hochdotierten Source/Drain-Bereiches 7. Als n-Dotierung wird vorzugsweise Phosphor oder Arsen eingesetzt. Eine p-Dotierung wird dagegen vornehmlich mit Bor ausgeführt.Through this thinned oxide layer 2a in the opening area 4 Then, the source / drain doping is preferably carried out by means of ion implantation of doping atoms. 1G shows a cross section through the silicon wafer after formation of the highly doped source / drain region 7 , The n-type doping used is preferably phosphorus or arsenic. In contrast, a p-doping is carried out primarily with boron.

In einem weiteren Prozessschritt, der in 1H gezeigt ist, wird dann eine Nitridierung der abgedünnten Oxidschicht 2a am Boden der selbstjustierten Bitline-Kontakt-Öffnung 4 ausgeführt. Diese Nitridierung dient dazu, die Oxidschicht 2a, die bereits eine Diffusionsbarriere für Phosphor darstellt, zusätzlich in eine effektive Diffusionssperre für Bor umzuwandeln. Die Nitridierung kann dabei mit Hilfe folgender Methoden erfolgen.In a further process step, the in 1H is shown, then a nitridation of the thinned oxide layer 2a at the bottom of the self-aligned bitline contact opening 4 executed. This nitriding serves to the oxide layer 2a , which already represents a diffusion barrier for phosphorus, in addition to convert it into an effective diffusion barrier for boron. The nitridation can be carried out using the following methods.

Gemäß einer ersten Variante kann eine flache Ionenimplantation von Stickstoff in die Oxidschicht 2a bzw. in die Silizium-Scheibe 1 knapp unter die Oxidoberfläche ausgeführt werden. Der Dosisbereich für den Stickstoff liegt dabei vorzugsweise zwischen 1·10¹⁴cm^–2 und 1·10¹⁵cm^–2, wobei N₊–Ionen eine Energie von 1keV bis 20keV und N₂₊–Ionen eine Energie von 1keV bis 40keV aufweisen. Zur eigentlichen Nitridierung der Oxidschicht 2a, bei der sich dann an der Grenzfläche eine Siliziumnitridschicht ausbildet, wird ein zusätzlicher Temperaturschritt, vorzugsweise bei einer Temperatur von 800ºC ausgeführt. Die Aktivierung des Nitrids kann jedoch auch statt im Rahmen eines eigenständigen Temperaturschritts zusammen mit dem Verfließen der später aufgetragenen BPSG-Glasschicht erfolgen. Gemäß einer zweiten Variante kann die Nitridierung der freiliegenden Oxidschicht 2a am Boden der Öffnung 4 mit Hilfe einer N₂O oder NH₃ Nachbehandlung in einem Temperaturbereich von 800 bis 1000ºC bei einer Zeitdauer von 1 bis 60 min ausgeführt werden. Als eine dritte Variante ist eine Nitridierung der Oxidschicht 2a mittels eines CVD-Verfahrens in einer stickstoffhaltigen Atmosphäre in einem Temperaturbereich von 300 bis 500ºC möglich. Eine vierte Variante stellt eine Nitridierung der Oxidschicht 2a mit Hilfe eines stickstoffhaltigen Plasmas dar.According to a first variant, a flat ion implantation of nitrogen into the oxide layer 2a or in the silicon disk 1 just below the oxide surface. The dose range for the nitrogen is preferably between 1 × 10 ¹⁴ cm ^-2 and 1 × 10 ¹⁵ cm ^-2 , wherein N ₊ ions have an energy of 1keV to 20keV and N ₂₊ ions have an energy of 1keV to 40keV. For the actual nitridation of the oxide layer 2a in which a silicon nitride layer is then formed at the interface, an additional temperature step is carried out, preferably at a temperature of 800 ° C. However, the activation of the nitride can also take place in the context of an independent temperature step along with the flow of the later applied BPSG glass layer. According to a second variant, the nitriding of the exposed oxide layer 2a at the bottom of the opening 4 by means of an N ₂ O or NH ₃ aftertreatment in a temperature range of 800 to 1000 ° C for a period of 1 to 60 minutes. As a third variant is a nitridation of the oxide layer 2a by a CVD method in a nitrogen-containing atmosphere in a temperature range of 300 to 500 ° C. A fourth variant represents a nitridation of the oxide layer 2a with the aid of a nitrogen-containing plasma.

Die gemäß einer der oben genannten vier Varianten nitridierte freiliegende Oxidschicht 2a im Öffnungsbereich 4 sorgt für eine effektive Diffusionssperre gegen Bor und Phosphor aus der nachfolgend aufgebrachten BPSG-Glasschicht zum Ausfüllen der Öffnung 4. Diese BPSG-Schicht, bei der der Bor- und Phosphorgehalt jeweils im Bereich von einigen Prozent liegt, wird zuerst auf der Oberfläche abgeschieden und anschließend dann auf eine Temperatur bis 900ºC aufgeheizt, so dass die BPSG-Glasschicht in den Öffnungsbereich 4 einfließt. Anschließend wird die BPSG-Glasschicht dann vorzugsweise mit Hilfe eines chemisch-mechanischen Polierverfahrens wieder bis auf das Niveau des Gate-Schichtstapels 3 abgetragen, so dass eine plane Oberfläche entsteht, wie sie in 1I gezeigt ist. Die BPSG-Glasschicht 8 füllt dann die Öffnung 4 vollständig auf.The according to one of the above four Variants nitrided exposed oxide layer 2a in the opening area 4 Provides an effective diffusion barrier against boron and phosphorus from the subsequently applied BPSG glass layer to fill the opening 4 , This BPSG layer, each having a boron and phosphorus content of a few percent, is first deposited on the surface and then heated to a temperature of up to 900 ° C, so that the BPSG glass layer is in the opening area 4 flows. Subsequently, the BPSG glass layer is then preferably back to the level of the gate layer stack by means of a chemical-mechanical polishing process 3 removed, so that a flat surface is created, as in 1I is shown. The BPSG glass layer 8th then fill the opening 4 completely on.

Diese BPSG-Füllung 8 kann dann im weiteren Prozessverlauf durch eine sogenannte Bitleitung-Kontaktätzung in einem dafür vorgesehenen Bereich wieder geöffnet werden, wobei anschließend die Oxidschicht 2a am Boden des Kontaktlochbereich entfernt wird. Das so geöffnete Kontaktloch kann dann mit einem Metall oder Poly-Silizium aufgefüllt werden, um den Source/Drain-Bereich 7 des MOS-Transistors anzuschließen.This BPSG filling 8th can then be opened in the further course of the process by a so-called bit line contact etching in a designated area again, in which case the oxide layer 2a is removed at the bottom of the contact hole area. The contact hole thus opened can then be filled with a metal or poly-silicon to the source / drain region 7 of the MOS transistor.

Durch das erfindungsgemäße Verfahren wird gewährleistet, dass durch die für das BPSG-Glas erforderliche Diffusionssperre keine laterale Einengung der Öffnungsbereiche entsteht, da das dafür verwendete nitridierte Gateoxid ausschließlich im Bodenbereich erzeugt wird.By the inventive method is guaranteed that by the for the BPSG glass required diffusion barrier no lateral narrowing of the opening areas arises, because that's it used nitrided gate oxide produced exclusively in the soil area becomes.

Anstelle der im dargestellten Prozessverlauf nach der Siliziumnitrid-Spacer Erzeugung erfolgten Nitridierung der Gate-Oxidschicht im Bodenbereich kann diese Nitridierung zu jedem beliebigen Zeitpunkt erfolgen, an dem diese Gate-Oxidschicht im Bodenbereich frei zugänglich ist.Instead of in the process shown after the silicon nitride spacer Generation of nitridation of the gate oxide layer in the bottom region can do this Nitriding done at any time, at which this Gate oxide layer is freely accessible in the ground area.

2 zeigt eine alternative Prozessfolge, bei der die Nitridierung bereits nach dem Aufbringen der Gate-Oxidschicht 2 vor dem Ausbilden des Gate-Stapels 3 erfolgt. Auch hierbei kann wiederum eine der vier oben dargestellten Varianten zur Nitridierung der Gate-Oxidschicht eingesetzt werden. Die üb rigen Prozessschritte bei dem in 2 gezeigten Prozessablauf entsprechen dem Prozessablauf, wie er anhand von 1 erläutert wurde. 2 shows an alternative process sequence, in which the nitriding already after the application of the gate oxide layer 2 before forming the gate stack 3 he follows. Here again, one of the four variants shown above for nitriding the gate oxide layer can be used. The other process steps in the in 2 process flow shown correspond to the process flow, as it is based on 1 was explained.

Die Nitridierung kann alternativ aber z.B. auch nach dem in 1E gezeigten Prozessstadium erfolgen. Vorteilhaft an einer erst nach der Erzeugung des Gateelektroden-Stapels durchgeführten Nitridierung ist dabei, dass die Nitridierung dann ausschließlich in elektrisch unkritischen Gebieten erfolgt, wodurch vermieden wird, dass die Nitridierung Auswirkung auf die Ladungsträgerbeweglichkeit im Kanal des MOS-Transistors hat.The nitridation can alternatively but also eg after the in 1E shown process stage. The advantage of a nitriding carried out only after the generation of the gate electrode stack is that the nitridation then takes place exclusively in electrically noncritical regions, thereby avoiding that the nitridation has an effect on the charge carrier mobility in the channel of the MOS transistor.

Neben den dargestellten Prozessabläufen kann die Erfindung in jeder bekannten Prozessfolge eingesetzt werden, bei der eine BPSG-Glasverfüllung von Öffnungen durchgeführt wird und verhindert werden soll, dass Bor und Phosphor aus dieser BPSG-Schicht in die darunter liegende Halbleiterschicht eindiffundiert. Durch die vor der BPSG-Schicht aufgebrachte nitridierte Oxidschicht wird eine zuverlässige Diffusionsbarriere hergestellt, wobei die Oxidschicht so ausgebildet werden kann, dass eine laterale Einschnürung der Öffnungen verhindert wird.Next the processes shown can the invention can be used in any known process sequence, in the case of a BPSG glass filling of openings carried out is to prevent and boron and phosphorus from this BPSG layer in the underneath underlying semiconductor layer diffused. By the front of the BPSG layer Applied nitrided oxide layer becomes a reliable diffusion barrier manufactured, wherein the oxide layer can be formed so that a lateral constriction the openings is prevented.

Die in der vorstehenden Beschreibung, den Zeichnungen und den Ansprüchen offenbarten Merkmale der Erfindung können sowohl einzeln als auch in beliebiger Kombination für die Verwirklichung der Erfindung in ihren verschiedenen Ausgestaltungen von Bedeutung sein.The in the foregoing description, drawings and claims Features of the invention can both individually and in any combination for the realization the invention in its various embodiments of importance be.

Claims

Method for filling openings ( 4 ) in a gate electrode layer ( 3 ) on a semiconductor wafer ( 1 ) with the method steps: growth of a gate oxide layer ( 2 ) on the semiconductor wafer ( 1 ); Generating a gate electrode layer ( 3 ) on the gate oxide layer ( 2 ); Definition of opening areas ( 4 ); Etching the gate electrode layer ( 3 ) to the gate oxide layer ( 7 ) in the specified opening areas; Converting the gate oxide layer ( 2 ) by introducing nitrogen into the exposed opening areas; Applying a BPSG layer ( 8th ); and thermal flow of the BPSG layer ( 8th ) for filling the exposed opening areas ( 4 ).

Method for filling openings ( 4 ) in a gate electrode layer ( 3 ) on a semiconductor wafer ( 1 ) with the method steps: growth of a gate oxide layer ( 2 ) on the semiconductor wafer ( 1 ); Converting the gate oxide layer ( 2 ) by introducing nitrogen; Generating a gate electrode layer ( 3 ) on the gate oxide layer ( 2 ); Definition of opening areas ( 4 ); Etching the gate electrode layer ( 3 ) to the gate oxide layer ( 2 ) in the defined opening areas ( 4 ); Applying a BPSG layer ( 8th ); and thermal flow of the BPSG layer ( 8th ) for filling the exposed opening areas ( 4 ).

Method according to claim 1 or 2, wherein after exposing the opening areas ( 4 ) thermally an additional oxide layer ( 5 ) is generated, which is nitrided in a further process step.

Method according to one of claims 1 to 3, wherein at least one opening area ( 4 ) is a source / drain region, in the exposed source / drain region sidewall spacers ( 6 ) and a source / drain doping ( 7 ) in the semiconductor wafer via the oxide layer ( 2 ) occurs in the exposed source / drain region.

The method of claim 4, wherein the generation of sidewall spacers ( 6 by deposition of an Si ₃ N ₄ layer and subsequent anisotropic etching back of the Si ₃ N ₄ layer with etch stop on the oxide layer ( 2 ) he follows.

A method according to claim 4 or 5, the exposed oxide layer ( 2 ) has a thickness of 1nm to 6nm in the opening area.

Method according to one of claims 1 to 6, wherein the BPSG filling ( 8th ) is reopened locally in a source / drain region formed in the semiconductor wafer to form a contact hole, the oxide layer is removed at the bottom of the contact hole, and the contact hole is filled with a metal or poly-silicon to form the source / drain Area to connect.

The method of any one of claims 1 to 7, wherein the converting the gate oxide layer ( 2 ) by introducing nitrogen by means of a flat ion implantation of nitrogen in a dose range between 1E14 cm ^-2 and 1E15cm ^-2 at an energy between 1keV and 40keV and a subsequent thermal activation.

The method of any one of claims 1 to 7, wherein the converting the gate oxide layer ( 2 ) by introducing nitrogen by means of a N ₂ O or NH ₃ after-treatment in a temperature range of 800 ° C to 1000 ° C with a duration of 1 to 60 min.

The method of any one of claims 1 to 7, wherein the converting the gate oxide layer ( 2 ) by introducing nitrogen with the aid of a CVD method in a nitrogen-containing atmosphere in a temperature range of 300 ° C to 500 ° C.

The method of any one of claims 1 to 7, wherein the converting the gate oxide layer ( 2 ) by introducing nitrogen by means of a nitrogen-containing plasma.