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CN110570801B - 显示装置 - Google Patents

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CN110570801B CN201910864932.3A CN201910864932A CN110570801B CN 110570801 B CN110570801 B CN 110570801B CN 201910864932 A CN201910864932 A CN 201910864932A CN 110570801 B CN110570801 B CN 110570801B
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Abstract

一种显示装置包括多个像素及栅极驱动电路。多个像素包括按序排列的N个像素，且N为大于或等于2的正整数。N个像素包括第p个像素及第q个像素，其中p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数。栅极驱动电路与第p个像素的一扫描线电性连接，其中于一图框区间的第一子图框区间内，栅极驱动电路接收第一启始信号，以产生第一栅极脉冲信号。栅极驱动电路与第q个像素的一扫描线电性连接，其中于第一子图框区间的后的同一图框区间的第二子图框区间，栅极驱动电路接收第二启始信号，以产生第二栅极脉冲信号。

Description

显示装置
技术领域
本发明涉及一种电子装置，且特别涉及一种显示装置。
背景技术
随着显示科技的进步，显示装置已广泛应用在日常生活中，举凡家用的视听娱乐、公共场合的信息显示看板、电竞用的显示器及便携式电子产品都可见其踪迹。
一般而言，显示装置包括像素阵列基板、对向基板以及设置于像素阵列基板与对向基板之间的显示介质。像素阵列基板具有多个像素。欲提升显示装置的分辨率时，需在单位面积中设置数量更多的像素。也就是说，像素的像素电极及数据线的距离会更短。像素电极及数据线的距离短时，像素电极及数据线的耦合电容大，进而造成垂直串音(verticalcross-talk)现象。
发明内容
本发明提供一种显示装置，性能佳。
本发明一实施例的显示装置包括基板、设置于基板上的多个像素及栅极驱动电路。每一像素包括扫描线、数据线、第一开关元件及第一像素电极。第一开关元件具有第一端、第二端及控制端。第一开关元件的第一端电性连接至数据线。第一开关元件的控制端电性连接至扫描线。第一像素电极电性连接至第一开关元件的第二端。多个像素包括按序排列的N个像素，N为大于或等于2的正整数，N个像素包括第p个像素及第q个像素，p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数。栅极驱动电路与第p个像素的一扫描线电性连接，其中于一图框区间的第一子图框区间内，栅极驱动电路接收第一启始信号，以产生第一栅极脉冲信号。栅极驱动电路与第q个像素的一扫描线电性连接，其中于第一子图框区间之后的同一图框区间的第二子图框区间，栅极驱动电路接收第二启始信号，以产生第二栅极脉冲信号。第一栅极脉冲信号具有第一致能时间宽度，第二栅极脉冲信号具有第二致能时间宽度，且第一致能时间宽度与第二致能时间宽度不同。
本发明一实施例的显示装置包括基板、设置于基板上的多个像素及栅极驱动电路。每一像素包括扫描线、数据线、第一开关元件、第一像素电极、第二开关元件、第二像素电极、第三开关元件、控制线及充电更新电容器。第一开关元件具有第一端、第二端及控制端，其中第一开关元件的第一端电性连接至数据线，且第一开关元件的控制端电性连接至扫描线。第一像素电极电性连接至第一开关元件的第二端。第二开关元件具有第一端、第二端及控制端。第二开关元件的第一端电性连接至数据线。第二开关元件的控制端电性连接至扫描线。第二开关元件的第二端电性连接至第二像素电极。第三开关元件具有第一端、第二端及控制端。第三开关元件的第一端电性连接至第二开关元件的第二端。第三开关元件的控制端电性连接至控制线。第三开关元件的第二端电性连接至充电更新电容器。多个像素包括按序排列的N个像素，N为大于或等于2的正整数，N个像素包括第p个像素及第q个像素，p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数。栅极驱动电路与第p个像素的一扫描线电性连接，其中于一图框区间的第一子图框区间内，栅极驱动电路接收第一启始信号，以产生第一栅极脉冲信号。栅极驱动电路与第q个像素的一扫描线电性连接，其中于第一子图框区间之后的同一图框区间的第二子图框区间，栅极驱动电路接收第二启始信号，以产生第二栅极脉冲信号。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合附图作详细说明如下。
附图说明
图1为本发明一实施例的显示装置的示意图。
图2示出本发明一实施例的第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7、第二栅极脉冲信号Vg2、Vg4、Vg6、极性信号Vpol、第一启始信号Vst1、第二启始信号Vst2、第一数据信号Vdl1、第二数据信号Vdl2及像素电极的信号Vpx。
图3为本发明一实施例的像素PX的布局(layout)示意图。
图4为本发明一实施例的显示装置的剖面示意图。
图5为本发明另一实施例的像素PXA的布局示意图。
图6A为本发明又一实施例的像素PXB的电路示意图。
图6B为本发明又一实施例的像素PXB的布局(layout)示意图。
图7为本发明再一实施例的像素PXC的布局示意图。
图8为本发明一实施例的像素PXD的电路示意图。
图9为本发明另一实施例的像素PXE的电路示意图。
符号说明
1：像素阵列基板
2：对向基板
3：显示介质
4：时序控制电路
5：栅极驱动电路
6：数据驱动电路
10、10A、10B、10C、10D、10E：显示装置
110、210：基板
120：遮光导电图案
120a、120b：遮光导电部
130、131、132：像素电极
130a、130b：主干部
130c：分支部
140、141、142：遮光电极
150：连接图案
220：彩色滤光层
230：挡光图案
232：开口
240：共用电极
A-A’、B-B’：剖线
CL：控制线
Cx：充电更新电容器
DL：数据线
d1：第一方向
d2：第二方向
GI：栅绝缘层
PX、PXA、PXB、PXC、PXD、PXE：像素
R1、R2：像素列
SL、SL1～SL7：扫描线
TL：共用线
T、T1、T2、T3：开关元件
Ta：第一端
Tb：第二端
Tc：控制端
Td：半导体图案
t：图框区间
t1、t2：子图框区间
Vdl1：第一数据信号
Vdl2：第二数据信号
Vg1、Vg3、Vg5、Vg7：第一栅极脉冲信号
Vg2、Vg4、Vg6：第二栅极脉冲信号
Vpol：极性信号
Vpx：像素电极的信号
Vst1：第一启始信号
Vst2：第二启始信号
△V1、△V2：电压差
W1、W2：致能时间宽度
具体实施方式
现将详细地参考本发明的示范性实施例，示范性实施例的实例说明于附图中。只要有可能，相同元件符号在附图和描述中用来表示相同或相似部分。
应当理解，当诸如层、膜、区域或基板的元件被称为在另一元件“上”或“连接到”另一元件时，其可以直接在另一元件上或与另一元件连接，或者中间元件可以也存在。相反，当元件被称为“直接在另一元件上”或“直接连接到”另一元件时，不存在中间元件。如本文所使用的，“连接”可以指物理及/或电性连接。再者，“电性连接”或“耦合”是可为两个元件间存在其它元件。
本文使用的“约”、“近似”、或“实质上”包括所述值和在本领域普通技术人员确定的特定值的可接受的偏差范围内的平均值，考虑到所讨论的测量和与测量相关的误差的特定数量(即，测量系统的限制)。例如，“约”可以表示在所述值的一个或多个标准偏差内，或±30％、±20％、±10％、±5％内。再者，本文使用的“约”、“近似”或“实质上”可依光学性质、蚀刻性质或其它性质，来选择较可接受的偏差范围或标准偏差，而可不用一个标准偏差适用全部性质。
除非另有定义，本文使用的所有术语(包括技术和科学术语)具有与本发明所属领域的普通技术人员通常理解的相同的含义。将进一步理解的是，诸如在通常使用的字典中定义的那些术语应当被解释为具有与它们在相关技术和本发明的上下文中的含义一致的含义，并且将不被解释为理想化的或过度正式的意义，除非本文中明确地这样定义。
图1为本发明一实施例的显示装置的示意图。
图2示出本发明一实施例的第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7、第二栅极脉冲信号Vg2、Vg4、Vg6、极性信号Vpol、第一启始信号Vst1、第二启始信号Vst2、第一数据信号Vdl1、第二数据信号Vdl2及像素电极的信号Vpx。
图3为本发明一实施例的像素PX的布局(layout)示意图。图1省略图3的基板110的示出。
图4为本发明一实施例的显示装置的剖面示意图。图4的像素阵列基板1的剖面对应图3的剖线A-A’及B-B’。
请参照图1、图3及图4，显示装置10包括像素阵列基板1、相对于像素阵列基板1的对向基板2以及设置于像素阵列基板1与对向基板2之间的显示介质3。
在本实施例中，对向基板2可选择性地包括基板210、挡光图案230及彩色滤光层220。挡光图案230即俗称黑矩阵(Black Matrix)。挡光图案230设置于基板210上，且具有多个开口232。彩色滤光层220设置于基板210上，且与挡光图案230的多个开口232重叠。然而，本发明不限于此，根据其它实施例，彩色滤光层220及/或挡光图案230也可设置于像素阵列基板1的基板110上，而形成彩色滤光器在阵列上(color filter on array；COA)及/或黑矩阵在阵列上(Black matrix on Array；BOA)的结构。
在本实施例中，显示介质3可以是非自发光材料，例如但不限于：液晶。然而，本发明不限于此，根据其它实施例，显示介质3也可以是自发光材料，例如但不限于：有机电致发光材料、微型发光二极管(μLED)等。
像素阵列基板1包括基板110及设置于基板110上的多个像素PX。每一像素PX包括扫描线SL、数据线DL、开关元件T及像素电极130。数据线DL在第一方向d1上延伸，扫描线SL在第二方向d2上延伸，其中第一方向d1与第二方向d2交错。开关元件T包括控制端Tc、栅绝缘层GI、半导体图案Td、第一端Ta及第二端Tb。栅绝缘层GI设置于控制端Tc与半导体图案Td之间。第一端Ta及第二端Tb分别电性连接至半导体图案Td的不同两区。开关元件T的第一端Ta电性连接至数据线DL。开关元件T的控制端Tc电性连接至扫描线SL。像素电极130电性连接至开关元件T的第二端Tb。
请参照图3，在本实施例中，至少一像素PX包括遮光导电图案120。遮光导电图案120设置于像素PX的数据线DL与像素PX的像素电极130之间。也就是说，遮光导电图案120于基板110上的垂直投影的至少一部分位于数据线DL于基板110上的垂直投影与像素电极130于基板110上的垂直投影之间。
举例而言，在本实施例中，遮光导电图案120可包括第一遮光导电部120a及第二遮光导电部120b，第一遮光导电部120a设置于同一像素PX1的数据线DL与像素电极130之间，第二遮光导电部120b设置于一像素PX1的像素电极130与另一像素PX2的数据线DL之间。在本实施例中，第一遮光导电部120a及第二遮光导电部120b在第一方向d1上延伸。也就是说，在本实施例中，第一遮光导电部120a、第二遮光导电部120b与数据线DL大致上可平行设置，但本发明不以为限。
在本实施例中，第一遮光导电部120a与像素电极130可部分地(partially)重叠，且第二遮光导电部120b与像素电极130可部分地(partially)重叠。然而，本发明不限于此，根据其它实施例，第一遮光导电部120a及/或第二遮光导电部120b与像素电极130也可不重叠。
请参照图3及图4，在本实施例中，遮光导电图案120与扫描线SL可一起制作。也就是说，遮光导电图案120与扫描线SL可形成于同一导电层，而遮光导电图案120的材质与扫描线SL的材质可相同。
基于导电性的考量，扫描线SL一般是使用金属材料。但本发明不限于此，根据其他实施例，扫描线SL也可以使用其他导电材料，例如：合金、金属材料的氮化物、金属材料的氧化物、金属材料的氮氧化物、或是金属材料与其它导电材料的堆叠层。
在本实施例中，遮光导电图案120具有一预定电位，包括固定电位(例如：0V、接地或浮置(floating)电位)或可调整的非零电位。
在本实施例中，像素PX还包括共用电极240(绘于图4)。共用电极240与像素电极130之间的电位差用以驱动显示介质3。
举例而言，在本实施例中，显示装置10可以是多域垂直配向(multi-domainvertical alignment；MVA)型的液晶显示器，像素电极130包括第一主干部130a(绘于图3)、与第一主干部130a交错的第二主干部130b(绘于图3)以及连接至第一主干部130a和第二主干部130b的多个分支部130c(绘于图3)，且像素电极130及共用电极240可分别设置于相对的两个基板110、210。然而，本发明不以此为限，根据其它实施例，像素电极130也可以是其它形状，及/或像素电极130与共用电极240也可设置于同一基板。
在本实施例中，像素PX可选择性地包括遮光电极140(绘于图3)。遮光电极140与像素电极130的第一主干部130a及第二主干部130b重叠。在本实施例中，遮光电极140与遮光导电图案120可形成于同一导电层，且遮光电极140可连接于第一遮光导电部120a与第二遮光导电部120b之间，但本发明不以此为限。
请参照图1，显示装置10还包括用以驱动多个像素PX的驱动系统。所述驱动系统可包括时序控制电路4、栅极驱动电路5及数据驱动电路6。时序控制电路4与栅极驱动电路5及数据驱动电路6电性连接。栅极驱动电路5与多个像素PX的扫描线SL电性连接。数据驱动电路6与多个像素PX的数据线DL电性连接。
多个像素PX排成一像素阵列。在图1的实施例中，栅极驱动电路5可选择性地设置于像素阵列的单侧。然而，本发明不限于此，根据其它实施例，栅极驱动电路5也可设置于像素阵列的相对两侧。
多个像素PX包括沿第一方向d1按序排列的N个像素PX。N为大于或等于2的正整数。N个像素PX包括第p个像素PX及第q个像素PX，p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数。简言之，沿第一方向d1按序排列的N个像素PX包括奇数像素PX与偶数像素PX。
举例而言，沿第一方向d1按序排列的多个像素PX包括第1、3、5、7…个像素PX及第2、4、6…个像素PX，其中第1、3、5、7…个像素PX分别包括扫描线SL1、SL3、SL5、SL7…，且第2、4、6个像素PX分别包括扫描线SL2、SL4、SL6…。
请参照图1及图2，于一图框区间t的第一子图框区间t1内，栅极驱动电路5接收来自于时序控制电路4的第一启始信号Vst1，以产生多个第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7…。于第一子图框区间t1内，多个第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7…依时序传递至奇数像素PX的多条扫描线SL1、SL3、SL5、SL7…。
于第一子图框区间t1后的同一图框区间t的第二子图框区间t2，栅极驱动电路5接收第二启始信号Vst2，以产生多个第二栅极脉冲信号Vg2、Vg4、Vg6…，其中多个第二栅极脉冲信号Vg2、Vg4、Vg6…依时序传递至偶数像素PX的多条扫描线SL2、SL4、SL6…。
于第一子图框区间t1及第二子图框区间t2，时序控制电路4输出一极性信号Vpol至数据驱动电路6。于奇数像素PX的多条扫描线SL1、SL3、SL5、SL7…接收第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7…之后及偶数像素PX的多条扫描线SL2、SL4、SL6…接收第二栅极脉冲信号Vg2、Vg4、Vg6…之前，极性信号Vpol由第一电压准位切换至第二电压准位。
数据驱动电路6接收极性信号Vpol，以于第一子图框区间t1及第二子图框区间t2分别输出第一数据信号Vdl1及第二数据信号Vdl2至同一条数据线DL，其中第一数据信号Vdl1的极性与第二数据信号Vdl2的极性相反。举例而言，在本实施例中，像素阵列包括在一第二方向d2上排列的多个像素列R1、R2，每一像素列R1、R2的多个像素PX在第一方向d1上按序排列；多个像素列R1、R2包括在第二方向d2上交替排列的多个奇数像素列R1及多个偶数像素列R2；于第一子图框区间t1，奇数像素列R1的奇数像素PX具有第一极性(例如：正极性)，偶数像素列R2的奇数像素PX具有第二极性(例如：负极性)；于第二子图框区间t2，奇数像素列R1的偶数像素PX具有第二极性(例如：负极性)，偶数像素列R2的偶数像素PX具有第一极性(例如：正极性)；但本发明不以此为限。
因此，像素电极130于第一子图框区间t1及第二子图框区间t2分别与极性相反的数据线DL耦合。因数据线DL与像素电极130的电容耦合而分别于第一子图框区间t1及第二子图框区间t2造成的像素电极130的信号Vpx的电压差△V1及电压差△V2可互相补偿，进而改善垂直串音(vertical cross-talk)现象。
值得注意的是，第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7…具有第一致能时间宽度W1，第一致能时间宽度W1是指第一栅极脉冲信号Vg1、Vg3、Vg5、Vg7…具有栅极开启电位的时间长度，第二栅极脉冲信号Vg2、Vg4、Vg6…具有第二致能时间宽度W2，第二致能时间宽度W2是指第二栅极脉冲信号Vg2、Vg4、Vg6…具有栅极开启电位的时间长度，且第一致能时间宽度W1与第二致能时间宽度W2不同。
也就是说，每一像素PX的像素电极130、共用电极240及显示介质3可形成显示电容，奇数像素PX的显示电容与偶数像素PX的显示电容分别于第一子图框区间t1及继续第一子图框区间t1的第二子图框区间t2被充电，而奇数像素PX的显示电容被充电的时间与偶数像素PX的显示电容被充电的时间不同。因此，能避免因开关元件T漏电所造成的显示不良。
举例而言，在本实施例中，0.05≤|W1-W2|/W1≤0.30。具体而言，第一致能时间宽度W1及/或第二致能时间宽度W2可介于12微秒(μs)～14微秒，但本发明不以此为限。
图5为本发明另一实施例的像素PXA的布局(layout)示意图。图5的像素PXA与图3的像素PX类似，两者的差异在于：图5的像素PXA不包括图3的像素PX的遮光导电图案120。也就是说，在图5的实施例中，数据线DL与像素电极130之间无设置在第一方向d1上延伸的任何遮光导电图案。
图5的像素PXA可用以取代图1的像素PX，而形成另一显示装置10A。包括多个像素PXA的显示装置10A也可用前述的驱动系统驱动。特别是，像素PXA不包括遮光导电图案120而显示装置10A具有高开口率，搭配前述的驱动系统显示装置10A能在具有高开口率的前提下，改善垂直串音(vertical cross-talk)现象。
图6A为本发明又一实施例的像素PXB的电路示意图。图6B为本发明又一实施例的像素PXB的布局(layout)示意图。图6A及图6B的像素PXB与图3的像素PX类似，说明两者的差异如下。
请参照图6A及图6B，在本实施例中，每一像素PXB包括扫描线SL、数据线DL、控制线CL、开关元件T及像素电极130。开关元件T包括第一开关元件T1、第二开关元件T2、第三开关元件T3，而像素电极130包括第一像素电极131及第二像素电极132。
第一开关元件T1包括控制端Tc、第一端Ta及第二端Tb。第一开关元件T1的第一端Ta电性连接至数据线DL。第一开关元件T1的控制端Tc电性连接至扫描线SL。第一像素电极131电性连接至第一开关元件T1的第二端Tb。
第二开关元件T2具有第一端Ta、第二端Tb及控制端Tc。第二开关元件T2的第一端Ta电性连接至数据线DL。第二开关元件T2的控制端Tc电性连接至扫描线SL。第二开关元件T2的第二端Tb电性连接至第二像素电极132。
第三开关元件T3具有第一端Ta、第二端Tb及控制端Tc。第三开关元件T3的第一端Ta电性连接至第二开关元件T2的第二端Tb。第三开关元件T3的控制端Tc电性连接至控制线CL。在本实施例中，控制线CL可在第二方向d2上延伸，控制线CL与扫描线SL大致上可平行设置，但本发明不以此为限。
在本实施例中，像素PXB还包括遮光电极140。遮光电极140包括第一遮光电极141及第二遮光电极142。第一遮光电极141与第一像素电极131的第一主干部130a及第二主干部130b重叠。第二遮光电极142与第二像素电极132的第一主干部130a及第二主干部130b重叠。
第二遮光电极142与第二像素电极132重叠，而形成一充电更新电容器Cx。第三开关元件T3的第二端Tb电性连接至所述充电更新电容器Cx的一电极(即第二遮光电极142)。
举例而言，在本实施例中，像素PXB还包括一连接图案150，其中连接图案150与像素电极130可形成于同一膜层，而第三开关元件T3的第二端Tb可通过连接图案150电性连接至第二遮光电极142，但本发明不以此为限。
在本实施例中，像素PXB包括遮光导电图案120。遮光导电图案120设置于像素PX的数据线DL与像素PX的第一像素电极131之间。也就是说，遮光导电图案120于基板110上的垂直投影的至少一部分位于数据线DL于基板110上的垂直投影与第一像素电极131于基板110上的垂直投影之间。
多个像素PXB包括在第二方向d2上排列且相邻的像素PX1及像素PX2。举例而言，在本实施例中，遮光导电图案120可包括第一遮光导电部120a及第二遮光导电部120b，第一遮光导电部120a设置于同一像素PX1的数据线DL与第一像素电极131之间，第二遮光导电部120b设置于一像素PX1的第一像素电极131与另一像素PX2的数据线DL之间。
像素PXB可用以取代图1的像素PX，而形成另一显示装置10B。包括多个像素PXB的显示装置10B也可用前述的驱动系统驱动。搭配前述的驱动系统，包括多个像素PXB的显示装置10B也能改善垂直串音现象。
图7为本发明再一实施例的像素PXC的布局(layout)示意图。图7的像素PXC与图6A及图6B的像素PXB类似，两者的差异在于：图7的像素PXC不包括图6A及图6B的像素PXB的遮光导电图案120。也就是说，在图7的实施例中，数据线DL与第一像素电极131之间无设置在第一方向d1上延伸的任何遮光导电图案。
图7的像素PXC可用以取代图1的像素PX，而形成另一显示装置10C。包括多个像素PXC的显示装置10C也可用前述的驱动系统驱动。特别是，像素PXC不包括遮光导电图案120而显示装置10C具有高开口率，搭配前述的驱动系统显示装置10C能在具有高开口率的前提下，改善垂直串音现象。
图8为本发明一实施例的像素PXD的电路示意图。图8的像素PXD与图3的像素PX类似，说明两者的差异如下。
请参照图8，在本实施例中，每一像素PXD包括扫描线SL、数据线DL、共用线TL、开关元件T及像素电极130。开关元件T包括第一开关元件T1、第二开关元件T2、第三开关元件T3，而像素电极130包括第一像素电极131及第二像素电极132。
第一开关元件T1包括控制端Tc、第一端Ta及第二端Tb。第一开关元件T1的第一端Ta电性连接至数据线DL。第一开关元件T1的控制端Tc电性连接至扫描线SL。第一像素电极131电性连接至第一开关元件T1的第二端Tb。
第二开关元件T2具有第一端Ta、第二端Tb及控制端Tc。第二开关元件T2的第一端Ta电性连接至数据线DL。第二开关元件T2的控制端Tc电性连接至扫描线SL。第二开关元件T2的第二端Tb电性连接至第二像素电极132。
第三开关元件T3具有第一端Ta、第二端Tb及控制端Tc。第三开关元件T3的第一端Ta电性连接至第二开关元件T2的第二端Tb。第三开关元件T3的控制端Tc电性连接至扫描线SL。第三开关元件T3的第二端Tb电性连接至共用线TL。
在本实施例中，于实际的布局(layout)上，像素PXD包括遮光导电图案(未示出)。遮光导电图案设置于像素PXD的数据线DL与像素PXD的第一像素电极131之间。也就是说，遮光导电图案于基板(未示出)上的垂直投影的至少一部分位于数据线DL于基板上的垂直投影与第一像素电极131于基板上的垂直投影之间。
多个像素PXD包括在第二方向d2上排列且相邻的像素PX1及像素PX2。举例而言，在本实施例中，于实际的布局上，遮光导电图案(未示出)可包括第一遮光导电部(未示出)及第二遮光导电部(未示出)，第一遮光导电部设置于同一像素PX1的数据线DL与第一像素电极131之间，第二遮光导电部设置于一像素PX1的第一像素电极131与另一像素PX2的数据线DL之间。
图8的像素PXD可用以取代图1的像素PX，而形成另一显示装置10D。包括多个像素PXD的显示装置10D也可用前述的驱动系统驱动。搭配前述的驱动系统，包括多个像素PXD的显示装置10D也能改善垂直串音现象。
图9为本发明另一实施例的像素PXE的电路示意图。图9的像素PXE与图8的像素PXD类似，两者的差异在于：图9的像素PXE不包括图8的像素PXD的遮光导电图案。也就是说，在图9的实施例中，数据线DL与第一像素电极131之间无设置在第一方向d1上延伸的任何遮光导电图案。
虽然本发明已以实施例公开如上，然其并非用以限定本发明，任何所属技术领域中技术人员，在不脱离本发明的精神和范围内，当可作些许的变动与润饰，故本发明的保护范围当视权利要求所界定者为准。

Claims (17)

1.一种显示装置，包括：
一基板；
多个像素，设置于该基板，其中所述多个像素的每一个包括：
一扫描线；
一数据线；
一第一开关元件，具有一第一端、一第二端及一控制端，其中该第一开关元件的该第一端电性连接至该数据线，且该第一开关元件的该控制端电性连接至该扫描线；及
一第一像素电极，电性连接至该第一开关元件的该第二端；以及
一栅极驱动电路，其中所述多个像素包括沿第一方向按序排列的N个像素，N为大于或等于2的正整数，该N个像素包括一第p个像素及一第q个像素，p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数；
该栅极驱动电路与该第p个像素的一扫描线电性连接，其中于一图框区间的一第一子图框区间内，该栅极驱动电路接收一第一启始信号，以产生一第一栅极脉冲信号；
该栅极驱动电路与该第q个像素的一扫描线电性连接，其中于该第一子图框区间之后的该图框区间的一第二子图框区间，该栅极驱动电路接收一第二启始信号，以产生一第二栅极脉冲信号；
该第一栅极脉冲信号具有一第一致能时间宽度，该第二栅极脉冲信号具有一第二致能时间宽度，且该第一致能时间宽度与该第二致能时间宽度不同。
2.如权利要求1所述的显示装置，还包括：
一数据驱动电路，与该第p个像素的一数据线及该第q个像素的一数据线电性连接，其中该数据驱动电路分别于该第一子图框区间及该第二子图框区间输出一第一数据信号及一第二数据信号，且该第一数据信号的极性与该第二数据信号的极性相反。
3.如权利要求1所述的显示装置，其中该第一致能时间宽度为W1，该第二致能时间宽度为W2，且0.05≤|W1-W2|/W1≤0.30。
4.如权利要求1所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间存在一遮光导电图案。
5.如权利要求1所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间不存在任何的遮光导电图案。
6.如权利要求1所述的显示装置，其中所述多个像素的每一者还包括：
一第二开关元件，具有一第一端、一第二端及一控制端；
一第二像素电极，其中该第二开关元件的该第一端电性连接至该数据线，该第二开关元件的该控制端电性连接至该扫描线，该第二开关元件的该第二端电性连接至该第二像素电极；
一第三开关元件，具有一第一端、一第二端及一控制端，其中该第三开关元件的该第一端电性连接至该第二开关元件的该第二端；
一控制线，其中该第三开关元件的该控制端电性连接至该控制线；以及
一充电更新电容器，其中该第三开关元件的该第二端电性连接至该充电更新电容器。
7.如权利要求6所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间存在一遮光导电图案。
8.如权利要求6所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间不存在任何的遮光导电图案。
9.如权利要求1所述的显示装置，其中所述多个像素的每一者还包括：
一第二开关元件，具有一第一端、一第二端及一控制端；
一第二像素电极，其中该第二开关元件的该第一端电性连接至该数据线，该第二开关元件的该控制端电性连接至该扫描线，该第二开关元件的该第二端电性连接至该第二像素电极；
一第三开关元件，具有一第一端、一第二端及一控制端，其中该第三开关元件的该第一端电性连接至该第二开关元件的该第二端，且该第三开关元件的该控制端电性连接至该扫描线；以及
一共用线，其中该第三开关元件的该第二端电性连接至该共用线。
10.如权利要求9所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间存在一遮光导电图案。
11.如权利要求9所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间不存在任何的遮光导电图案。
12.一种显示装置，包括：
多个像素，其中所述多个像素的每一个包括：
一扫描线；
一数据线；
一第一开关元件，具有一第一端、一第二端及一控制端，其中该第一开关元件的该第一端电性连接至该数据线，且该第一开关元件的该控制端电性连接至该扫描线；
一第一像素电极，电性连接至该第一开关元件的该第二端；
一第二开关元件，具有一第一端、一第二端及一控制端；
一第二像素电极，其中该第二开关元件的该第一端电性连接至该数据线，该第二开关元件的该控制端电性连接至该扫描线，该第二开关元件的该第二端电性连接至该第二像素电极；
一第三开关元件，具有一第一端、一第二端及一控制端，其中该第三开关元件的该第一端电性连接至该第二开关元件的该第二端；
一控制线，其中该第三开关元件的该控制端电性连接至该控制线；及
一充电更新电容器，其中该第三开关元件的该第二端电性连接至该充电更新电容器；以及
一栅极驱动电路，其中所述多个像素包括沿第一方向按序排列的N个像素，N为大于或等于2的正整数，该N个像素包括一第p个像素及一第q个像素，p为小于或等于N的奇数且为正整数，q为小于或等于N的偶数且为正整数；
该栅极驱动电路与该第p个像素的一扫描线电性连接，其中于一图框区间的一第一子图框区间内，该栅极驱动电路接收一第一启始信号，以产生一第一栅极脉冲信号；
该栅极驱动电路与该第q个像素的一扫描线电性连接，其中于该第一子图框区间之后的该图框区间的一第二子图框区间，该栅极驱动电路接收一第二启始信号，以产生一第二栅极脉冲信号。
13.如权利要求12所述的显示装置，还包括：
一数据驱动电路，与该第p个像素的一数据线及该第q个像素的一数据线电性连接，其中该数据驱动电路分别于该第一子图框区间及该第二子图框区间输出一第一数据信号及一第二数据信号，且该第一数据信号的极性与该第二数据信号的极性相反。
14.如权利要求12所述的显示装置，其中，该第一栅极脉冲信号具有一第一致能时间宽度，该第二栅极脉冲信号具有一第二致能时间宽度，且该第一致能时间宽度与该第二致能时间宽度不同。
15.如权利要求14所述的显示装置，其中该第一致能时间宽度为W1，该第二致能时间宽度为W2，且0.05≤|W1-W2|/W1≤0.30。
16.如权利要求12所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间存在一遮光导电图案。
17.如权利要求12所述的显示装置，其中所述多个像素的至少一者的该数据线与所述多个像素的该至少一者的该第一像素电极之间不存在任何的遮光导电图案。
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