CN117497600A - 超结碳化硅晶体管的结构、制造方法及电子设备 - Google Patents
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- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 title claims abstract description 80
- 229910010271 silicon carbide Inorganic materials 0.000 title claims abstract description 80
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 17
- 239000004065 semiconductor Substances 0.000 claims abstract description 32
- 239000000758 substrate Substances 0.000 claims abstract description 27
- 238000000034 method Methods 0.000 claims abstract description 16
- 230000000694 effects Effects 0.000 claims abstract description 15
- 229910052751 metal Inorganic materials 0.000 claims description 35
- 239000002184 metal Substances 0.000 claims description 35
- 239000000463 material Substances 0.000 claims description 12
- 238000003860 storage Methods 0.000 claims description 12
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 7
- 229920005591 polysilicon Polymers 0.000 claims description 7
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 6
- 235000012239 silicon dioxide Nutrition 0.000 claims description 3
- 239000000377 silicon dioxide Substances 0.000 claims description 3
- 230000002146 bilateral effect Effects 0.000 claims 2
- 238000005516 engineering process Methods 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 14
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 6
- 230000004888 barrier function Effects 0.000 description 6
- 229910052710 silicon Inorganic materials 0.000 description 6
- 239000010703 silicon Substances 0.000 description 6
- 238000005468 ion implantation Methods 0.000 description 5
- 238000005036 potential barrier Methods 0.000 description 5
- 238000007740 vapor deposition Methods 0.000 description 3
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 2
- 230000009286 beneficial effect Effects 0.000 description 2
- 230000005669 field effect Effects 0.000 description 2
- 230000010354 integration Effects 0.000 description 2
- 238000009740 moulding (composite fabrication) Methods 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 229910002601 GaN Inorganic materials 0.000 description 1
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical group [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 229910052763 palladium Inorganic materials 0.000 description 1
- 230000003071 parasitic effect Effects 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
- 230000005641 tunneling Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/60—Insulated-gate field-effect transistors [IGFET]
- H10D30/63—Vertical IGFETs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D12/00—Bipolar devices controlled by the field effect, e.g. insulated-gate bipolar transistors [IGBT]
- H10D12/01—Manufacture or treatment
- H10D12/031—Manufacture or treatment of IGBTs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/10—Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
- H10D62/102—Constructional design considerations for preventing surface leakage or controlling electric field concentration
- H10D62/103—Constructional design considerations for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse-biased devices
- H10D62/105—Constructional design considerations for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse-biased devices by having particular doping profiles, shapes or arrangements of PN junctions; by having supplementary regions, e.g. junction termination extension [JTE]
- H10D62/109—Reduced surface field [RESURF] PN junction structures
- H10D62/111—Multiple RESURF structures, e.g. double RESURF or 3D-RESURF structures
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/10—Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
- H10D62/124—Shapes, relative sizes or dispositions of the regions of semiconductor bodies or of junctions between the regions
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/80—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials
- H10D62/83—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials being Group IV materials, e.g. B-doped Si or undoped Ge
- H10D62/832—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials being Group IV materials, e.g. B-doped Si or undoped Ge being Group IV materials comprising two or more elements, e.g. SiGe
- H10D62/8325—Silicon carbide
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Abstract
一种超结碳化硅晶体管的结构、制造方法及电子设备,属于半导体技术领域,包括左右对称的两个子场效应管结构和多个第二有源层,左右对称的切面为矢状面,所述子场效应管结构包括衬底、漂移层、第一阱、半导体柱、第一有源层以及栅极结构;漂移层设置于衬底的上表面;第一阱设置于漂移层的上表面;其中,第一阱与矢状面之间设置预设距离;半导体柱设置于第一阱下表面;第一有源层设置于第一阱中且位于第一阱上表面;栅极结构覆盖第一阱顶部;多个第二有源层设置于两个栅极结构之间;半导体柱、第二有源层和第一阱的掺杂类型为第一类型;衬底、漂移层和第一有源层的为第二类型;减小了导通损耗和芯片面积,增大了可靠性和电流密度,简化了工艺。
Description
技术领域
本申请属于半导体技术领域,尤其涉及一种超结碳化硅晶体管的结构、制造方法及电子设备。
背景技术
碳化硅(SiC)功率金属-氧化-半导体场效应晶体管(metal-oxide-semiconductorfield-effect transistor,MOSFET)由于其更快的开关速度、更低的开关损耗和更高的工作温度范围,已成为电动汽车和光伏逆变器等高功率应用中硅绝缘栅双极晶体管(IGBT)的有力竞争对手。在实际应用中,MOSFET 需要反并联二极管来处理反向电流,硅基MOSFET常采用体二极管来降低寄生电感,起到续流作用,但是对于SiC MOSFET,其材料带隙较宽,体二极管开启电压(约2.7V)远高于硅基MOSFET(约1.5V),导通损耗较大。
相关的碳化硅晶体管将SiC MOSFET与SBD或JFET反并联集成可以起到反向续流作用,但通常并联在平面,其会使芯片面积有所增大;也有相关的碳化硅晶体管通过分裂栅在反向时控制续流通道开启的结构,但其存在栅极可靠性、工艺复杂以及电流密度低的问题。
故相关的碳化硅晶体管存在导通损耗大、芯片面积大、可靠性差、工艺复杂以及电流密度低的缺陷。
发明内容
本申请的目的在于提供一种超结碳化硅晶体管的结构、制造方法及电子设备,旨在解决相关的氮化镓功率器件导通损耗大、芯片面积大、可靠性差、工艺复杂以及电流密度低的问题。
本申请实施例提供了一种超结碳化硅晶体管的结构,包括左右对称的两个子场效应管结构,左右对称的切面为矢状面,所述子场效应管结构包括:
衬底;
设置于所述衬底的上表面的漂移层;
设置于所述漂移层的上表面的第一阱;其中,所述第一阱与所述矢状面之间设置预设距离;
设置于所述第一阱中且位于所述第一阱上表面的第一有源层;
覆盖所述第一阱顶部的栅极结构;
设置于所述第一阱下表面的半导体柱;
所述超结碳化硅晶体管的结构还包括:
设置于两个所述栅极结构之间的多个第二有源层;
其中,所述半导体柱、所述第二有源层和所述第一阱的掺杂类型为第一类型;所述衬底、所述漂移层和所述第一有源层的为第二类型。
在其中一个实施例中,所述超结碳化硅晶体管的结构还包括:
设置于所述漂移层的上表面且位于侧面和所述第一阱之间的第一有源区。
在其中一个实施例中,所述超结碳化硅晶体管的结构包括:
设置于两个所述第一阱之间的电荷存储区。
在其中一个实施例中,所述第一类型为P型,所述第二类型为N型;或者
所述第一类型为N型,所述第二类型为P型。
在其中一个实施例中,还包括:
覆盖所述第一有源层和所述第二有源层的第一金属层;
位于所述衬底的下表面的第二金属层;
与所述栅极结构连接的第三金属层;
所述第一金属层为所述超结碳化硅晶体管的源极电极,所述第二金属层为所述超结碳化硅晶体管的漏极电极,所述第三金属层为所述超结碳化硅晶体管的栅极电极。
在其中一个实施例中,所述栅极结构的材料包括二氧化硅和多晶硅;所述个第二有源层的材料包括多晶硅;所述漂移层、所述第一有源层和所述第一阱的材料包括碳化硅。
本申请实施例还提供一种超结碳化硅晶体管的制造方法,超结碳化硅晶体管左右对称,且左右对称的切面为矢状面,所述制造方法包括:
在衬底的上表面形成漂移层,并在所述漂移层两侧形成半导体柱;
在所述半导体柱和所述漂移层的上表面形成左右对称的两个第一阱;其中,所述第一阱与所述矢状面之间设置预设距离;
分别在两个所述第一阱中且位于所述第一阱上表面形成两个第一有源层;
分别在两个所述第一阱的顶部形成两个栅极结构;
在两个所述栅极结构之间形成多个第二有源层。
在其中一个实施例中,所述在所述漂移层的上表面形成左右对称的两个第一阱之后还包括:
在所述半导体柱的上表面且位于侧面和所述第一阱之间分别形成两个第一有源区。
在其中一个实施例中,所述在两个所述栅极结构之间形成多个第二有源层之后还包括:
在第一有源层的上表面和第二有源层的上表面形成第一金属层;
在所述衬底的下表面形成第二金属层;
形成与所述栅极结构连接的第三金属层。
本申请实施例还提供一种电子设备,所述电子设备包括上述的超结碳化硅晶体管的结构。
本发明实施例与现有技术相比存在的有益效果是:由于漂移层和衬底作为漏极,第一阱作为栅极,第一有源层作为源极。第二有源层与漂移层构成异质结。当超结碳化硅晶体管加正向电压时,漏极和源极导通,异质结反偏,异质结的耗尽层扩展夹断续流通道;当超结碳化硅晶体管加反向电压时,漏极和源极关断,异质结正偏,异质结的耗尽层扩展夹断续流导通,从而无需将SiC MOSFET与肖特基势垒二极管(schottky barrier diode, SBD)或结型场效应管(junction field-effect transistor,JFET)反并联集成即可以起到反向续流作用,减小了导通损耗和芯片面积,增大了可靠性和电流密度,简化了工艺;同时,半导体柱和漂移层形成超结结构,提高了耐压能力;且对于超结结构,由于漂移区存在大面积半导体柱,所以存在一定的少子存储效应,开关特性较差,而异质结没有空穴势垒,空穴可以自由通过,从而起到快速抽取空穴的作用,提升了开关频率。
附图说明
为了更清楚地说明本发明实施例中的技术发明,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本申请一实施例提供的超结碳化硅晶体管的结构的一种结构示意图;
图2为本申请一实施例提供的超结碳化硅晶体管的结构中续流通道的一种结构示意图;
图3为本申请一实施例提供的超结碳化硅晶体管的结构的一种能带图;
图4为本申请一实施例提供的超结碳化硅晶体管的结构的另一种结构示意图;
图5为本申请一实施例提供的超结碳化硅晶体管的结构的另一种结构示意图;
图6为本申请一实施例提供的超结碳化硅晶体管的结构的另一种能带图;
图7为本申请一实施例提供的超结碳化硅晶体管的结构的另一种结构示意图;
图8为本申请实施例提供的超结碳化硅晶体管的制造方法中形成漂移层的一种示意图;
图9为本申请实施例提供的超结碳化硅晶体管的制造方法中形成第一阱的一种示意图;
图10为本申请实施例提供的超结碳化硅晶体管的制造方法中形成第一有源层的一种示意图;
图11为本申请实施例提供的超结碳化硅晶体管的制造方法中形成栅极结构的一种示意图;
图12为本申请实施例提供的超结碳化硅晶体管的制造方法中形成第二有源层的一种示意图;
图13为本申请实施例提供的超结碳化硅晶体管的制造方法中形成第一有源区的一种示意图。
具体实施方式
为了使本申请所要解决的技术问题、技术方案及有益效果更加清楚明白,以下结合附图及实施例,对本申请进行进一步详细说明。应当理解,此处所描述的具体实施例仅仅用以解释本申请,并不用于限定本申请。
需要说明的是,当元件被称为“固定于”或“设置于”另一个元件,它可以直接在另一个元件上或者间接在该另一个元件上。当一个元件被称为是“连接于”另一个元件,它可以是直接连接到另一个元件或间接连接至该另一个元件上。
需要理解的是,术语“长度”、“宽度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本申请的限制。
此外,术语“第一”、“第二”仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本申请的描述中,“多个”的含义是两个或两个以上,除非另有明确具体的限定。
图1示出了本发明实施例提供的超结碳化硅晶体管的结构,为了便于说明,仅示出了与本发明实施例相关的部分,详述如下:
超结碳化硅晶体管的结构,包括左右对称的两个子场效应管结构,左右对称的切面为矢状面100,子场效应管结构包括衬底10、漂移层20、第一阱30、半导体柱90、第一有源层40以及栅极结构50。
漂移层20设置于衬底10的上表面。
第一阱30设置于漂移层20的上表面;其中,第一阱30与矢状面100之间设置预设距离。
第一有源层40设置于第一阱30中且位于第一阱30上表面。
栅极结构50覆盖第一阱30顶部。
半导体柱90设置于所述第一阱下表面。
超结碳化硅晶体管的结构还包括多个第二有源层60。
多个第二有源层60设置于两个栅极结构50之间。
其中,第二有源层60和第一阱30的掺杂类型为第一类型;衬底10、漂移层20和第一有源层40的为第二类型。第一类型和第二类型不同。
需要说明的是,第二有源层60为高掺杂,掺杂浓度在1e19以上,宽度约为0.1至0.2μm,续流沟道宽度在0.1至0.2μm,该结构可以在对元胞面积很小增加的情况下增加续流通道。
第二有源层60的数量为两个以上,本申请的说明书附图以2个第二有源层60形成续流通道进行说明,简单增加第二有源层60与续流通道的数目的实施例也在本申请保护范围内。
具体实施中,漂移层20和衬底10作为漏极,第一阱30作为栅极,第一有源层40作为源极。第二有源层60与漂移层20构成异质结。以第一类型为P型且第二类型为N型为例,当超结碳化硅晶体管加正向电压时,源极接低电位,漏极和源极导通,异质结反偏,异质结的耗尽层扩展夹断续流通道,如图2的左半部分所示。当超结碳化硅晶体管加反向电压时,源极接高电位,漏极和源极关断,异质结正偏,异质结的耗尽层扩展夹断续流导通,如图2的右半部分所示,从而无需将SiC MOSFET与SBD或结型场效应管JFET反并联集成即可以起到反向续流作用,减小了导通损耗和芯片面积,增大了可靠性和电流密度,简化了工艺。半导体柱和漂移层形成超结结构,提高了耐压能力;且对于超结结构,由于漂移区存在大面积半导体柱,所以存在一定的少子存储效应,开关特性较差,而异质结没有空穴势垒,空穴可以自由通过,从而起到快速抽取空穴的作用,提升了开关频率。
异质结能带图如图3所示,由于禁带宽度差异,硅与碳化硅接触会形成导带的势垒差,为了防止正向漏电过大而对耐压产生影响,正向电子势垒∆E-forward应该足够大,此处正向电子势垒∆Ep-forward约0.7eV;为增加正向电子势垒高度,可考虑在第二有源层60上形成肖特基接触。硅与碳化硅接触没有形成价带的势垒差,故空穴可以自由通过。
如图4所示,超结碳化硅晶体管的结构还包括第一有源区70。
第一有源区70设置于漂移层20的上表面且位于侧面和第一阱30之间。
需要说明的是,第一有源区70的掺杂类型为第一类型。第一有源区70为重掺杂。第一有源区70的材料可以为碳化硅。
通过设置第一有源区70,相邻的超结碳化硅晶体管之间形成隔离,实现了多个超结碳化硅晶体管的元胞的集成。
如图5所示,超结碳化硅晶体管的结构还包括电荷存储区80(charge storagelayer,CSL)。
电荷存储区80设置于两个第一阱30之间。
需要说明的是,电荷存储区80的掺杂类型为第二类型。电荷存储区80的掺杂浓度大于漂移层20的掺杂浓度且小于第一有源层40的掺杂浓度。电荷存储区80的材料为碳化硅。
需要注意的是,CSL浓度不宜超过1E17,如图6所示,高浓度SiC会使异质结势垒变薄,更容易发生自第二有源区到漂移层20的电子隧穿,使正向漏电流增加,耐压性能劣化。
通过设置电荷存储区80,减小了第一阱30之间的JFET效应,增大了超结碳化硅晶体管正向导通电流。
作为示例而非限定,第一类型为P型,第二类型为N型;或者
第一类型为N型,第二类型为P型。
如图7所示,超结碳化硅晶体管的结构还包括第一金属层01、第二金属层02和第三金属层。
第一金属层01覆盖第一有源层40和第二有源层60;
第二金属层02位于衬底10的下表面。
第三金属层与栅极结构50连接。
需要说明的是,第一金属层01为超结碳化硅晶体管的源极电极,第二金属层02为超结碳化硅晶体管的漏极电极,第三金属层为超结碳化硅晶体管的栅极电极。
作为示例而非限定,第二有源层60和第一金属层01直接为肖特基接触,从而提高了势垒,在超结碳化硅晶体管加正向电压时,减少了漏电流。
具体实施中,栅极结构50的材料包括二氧化硅和多晶硅;个第二有源层60的材料包括多晶硅;漂移层20、第一有源层40和第一阱30的材料包括碳化硅。
与一种超结碳化硅晶体管实施例相对应,本发明还提供了一种超结碳化硅晶体管的制造方法的一种实施例。
一种超结碳化硅晶体管的制造方法,超结碳化硅晶体管左右对称,且左右对称的切面为矢状面100,方法包括步骤401至步骤406。
在步骤401中,如图8所示,在衬底10的上表面形成漂移层20,并在漂移层20两侧形成半导体柱90;
具体实施中,步骤401有两种情况。
第一种情况下,步骤401具体为:通过溅射或气相沉积形成子漂移层,并通过离子注入在子漂移层两侧形成子半导体柱,且重复执行该步骤多次,以在衬底10的上表面形成漂移层20,并在漂移层20两侧形成半导体柱90。
第二种情况下,步骤401具体为:通过溅射或气相沉积形成漂移层20,通过刻蚀在漂移层20两侧形成凹槽,并在凹槽中填充半导体柱90。
在步骤402中,如图9所示,在半导体柱90和漂移层20的上表面形成左右对称的两个第一阱30;其中,第一阱30与矢状面100之间设置预设距离。
通过离子注入在漂移层20的上表面形成左右对称的两个第一阱30。
在步骤403中,如图10所示,分别在两个第一阱30中且位于第一阱30上表面形成两个第一有源层40。
通过离子注入分别在两个第一阱30中且位于第一阱30上表面形成两个第一有源层40。
在步骤404中,如图11所示,分别在两个第一阱30的顶部形成两个栅极结构50。
通过热氧氧化和多晶硅沉积分别在两个第一阱30的顶部形成两个栅极结构50。
在步骤405中,如图12所示,在两个栅极结构50之间形成多个第二有源层60。
通过气相沉积和离子注入在两个栅极结构50之间形成多个第二有源层60。
具体实施中,步骤402之后还包括步骤402-2。
在步骤402-2中,如图13所示,在半导体柱90的上表面且位于侧面和第一阱30之间分别形成两个第一有源区70。
通过离子注入在漂移层20的上表面且位于侧面和第一阱30之间分别形成两个第一有源区70。
具体实施中,步骤405之后还包括步骤406至步骤408。
在步骤405中,在第一有源层的上表面和第二有源层的上表面形成第一金属层。
在步骤405中,在衬底的下表面形成第二金属层。
在步骤405中,形成与栅极结构连接的第三金属层。
值得强调的是,第一金属层为超结碳化硅晶体管的源极电极,第二金属层为超结碳化硅晶体管的漏极电极,第三金属层为超结碳化硅晶体管的栅极电极。
值得注意的是,金属层可以为金或钯。
本发明实施例包括左右对称的两个子场效应管结构和多个第二有源层,左右对称的切面为矢状面,所述子场效应管结构包括衬底、漂移层、第一阱、半导体柱、第一有源层以及栅极结构;漂移层设置于衬底的上表面;第一阱设置于漂移层的上表面;其中,第一阱与矢状面之间设置预设距离;第一有源层设置于第一阱中且位于第一阱上表面;栅极结构覆盖第一阱顶部;半导体柱设置于第一阱的下表面;多个第二有源层设置于两个栅极结构之间;其中,第二有源层和第一阱的掺杂类型为第一类型;衬底、漂移层和第一有源层的为第二类型;减小了导通损耗和芯片面积,增大了可靠性和电流密度,简化了工艺。同时,半导体柱和漂移层形成超结结构,提高了耐压能力;且对于超结结构,由于漂移区存在大面积半导体柱,所以存在一定的少子存储效应,开关特性较差,而异质结没有空穴势垒,空穴可以自由通过,从而起到快速抽取空穴的作用,提升了开关频率。
应理解,上述实施例中各步骤的序号的大小并不意味着执行顺序的先后,各过程的执行顺序应以其功能和内在逻辑确定,而不应对本申请实施例的实施过程构成任何限定。
以上所述实施例仅用以说明本申请的技术方案,而非对其限制;尽管参照前述实施例对本申请进行了详细的说明,本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分技术特征进行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本申请各实施例技术方案的精神和范围,均应包含在本申请的保护范围之内。
Claims (10)
1.一种超结碳化硅晶体管的结构,其特征在于,包括左右对称的两个子场效应管结构,左右对称的切面为矢状面,所述子场效应管结构包括:
衬底;
设置于所述衬底的上表面的漂移层;
设置于所述漂移层的上表面的第一阱;其中,所述第一阱与所述矢状面之间设置预设距离;
设置于所述第一阱中且位于所述第一阱上表面的第一有源层;
覆盖所述第一阱顶部的栅极结构;
设置于所述第一阱下表面的半导体柱;
所述超结碳化硅晶体管的结构还包括:
设置于两个所述栅极结构之间的多个第二有源层;其中,所述半导体柱、所述第二有源层和所述第一阱的掺杂类型为第一类型;所述衬底、所述漂移层和所述第一有源层的为第二类型。
2.如权利要求1所述的超结碳化硅晶体管的结构,其特征在于,所述超结碳化硅晶体管的结构还包括:
设置于所述漂移层的上表面且位于侧面和所述第一阱之间的第一有源区。
3.如权利要求1所述的超结碳化硅晶体管的结构,其特征在于,所述超结碳化硅晶体管的结构包括:
设置于两个所述第一阱之间的电荷存储区。
4.如权利要求1所述的超结碳化硅晶体管的结构,其特征在于,所述第一类型为P型,所述第二类型为N型;或者
所述第一类型为N型,所述第二类型为P型。
5.如权利要求1所述的超结碳化硅晶体管的结构,其特征在于,还包括:
覆盖所述第一有源层和所述第二有源层的第一金属层;
位于所述衬底的下表面的第二金属层;
与所述栅极结构连接的第三金属层;
所述第一金属层为所述超结碳化硅晶体管的源极电极,所述第二金属层为所述超结碳化硅晶体管的漏极电极,所述第三金属层为所述超结碳化硅晶体管的栅极电极。
6.如权利要求1至5任意一项所述的超结碳化硅晶体管的结构,其特征在于,所述栅极结构的材料包括二氧化硅和多晶硅;所述个第二有源层的材料包括多晶硅;所述漂移层、所述第一有源层和所述第一阱的材料包括碳化硅。
7.一种超结碳化硅晶体管的制造方法,其特征在于,超结碳化硅晶体管左右对称,且左右对称的切面为矢状面,所述制造方法包括:
在衬底的上表面形成漂移层,并在所述漂移层两侧形成半导体柱;
在所述半导体柱和所述漂移层的上表面形成左右对称的两个第一阱;其中,所述第一阱与所述矢状面之间设置预设距离;
分别在两个所述第一阱中且位于所述第一阱上表面形成两个第一有源层;
分别在两个所述第一阱的顶部形成两个栅极结构;
在两个所述栅极结构之间形成多个第二有源层。
8.根据权利要求7所述的超结碳化硅晶体管的制造方法,其特征在于,所述在所述漂移层的上表面形成左右对称的两个第一阱之后还包括:
在所述半导体柱的上表面且位于侧面和所述第一阱之间分别形成两个第一有源区。
9.根据权利要求7所述的超结碳化硅晶体管的制造方法,其特征在于,所述在两个所述栅极结构之间形成多个第二有源层之后还包括:
在第一有源层的上表面和第二有源层的上表面形成第一金属层;
在所述衬底的下表面形成第二金属层;
形成与所述栅极结构连接的第三金属层。
10.一种电子设备,其特征在于,所述电子设备包括如权利要求1至6任意一项所述的超结碳化硅晶体管的结构。
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| Application Number | Priority Date | Filing Date | Title |
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| Country | Link |
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