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CN103562898A - 用于便携式电子设备的接口扩展器 - Google Patents

用于便携式电子设备的接口扩展器 Download PDF

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CN103562898A
CN103562898A CN201280026839.1A CN201280026839A CN103562898A CN 103562898 A CN103562898 A CN 103562898A CN 201280026839 A CN201280026839 A CN 201280026839A CN 103562898 A CN103562898 A CN 103562898A
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CN
China
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interface
hub
communication
speed link
group interface
Prior art date
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Pending
Application number
CN201280026839.1A
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English (en)
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A·J·克鲁姆林
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Apple Inc
Original Assignee
Apple Inc
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Abstract

所公开的实施例提供一种促进便携式电子设备中的组件之间的通信的系统。该系统包括将第一组接口耦合到高速链路的第一集线器以及将第二组接口耦合到该高速链路的第二集线器。第一集线器可以通过第一组接口中的第一接口接收来自第一组件的通信，并且通过高速链路来传输通信。第二集线器可以从高速链路接收通信，并且通过第二组接口中的第二接口将通信传输到第二组件。因此，第一和第二集线器可以减少在第一和第二组接口之间传输通信所需的线路的数量。

Description

用于便携式电子设备的接口扩展器
技术领域
实施例涉及便携式电子设备中的接口。更特别地，实施例涉及促进有效率地使用便携式电子设备内的空间的接口扩展器。
背景技术
近来，计算能力和无线联网技术的改善已经显著增强了诸如膝上型计算机、平板计算机、便携式媒体播放器以及移动电话之类的便携式电子设备的能力。这样增强的能力通常由不同印刷电路板（PCB）上的多个组件提供。例如，平板计算机可以包含用于处理器、端口、按钮、无线电和/或无线收发器、电池和/或平板计算机中的其他组件的单独PCB。
然后，组件和/或PCB可以电连接以允许组件实现便携式电子设备的功能。例如，集成电路互连（I2C）总线和/或一组通用输入/输出（GPIO）接口可以通过一组线路将一组外围组件连接到处理器。然后，处理器可以通过经由线路将信号传输到外围组件并经由线路从外围组件接收响应来与外围组件进行通信。
然而，随着便携式电子设备中的功能和/或组件数量增大，便携式电子设备中的线路数量也会增大。例如，在平板计算机内，可以使用多个I2C总线来将作为总线主装置操作的处理器和/或微控制器连接到作为总线从装置操作的各种外围组件。线路又可能占据便携式电子设备内的更大空间量，因此，减小了便携式电子设备中的组件可用空间和/或要求便携式电子设备的尺寸的相应增大。
因此，便携式电子设备的使用可以通过改善用于在便携式电子设备中的组件之间实现通信的接口的空间效率来得到促进。
发明内容
所公开的实施例提供一种促进便携式电子设备中的组件之间的通信的系统。该系统包括将第一组接口耦合到高速链路的第一集线器以及将第二组接口耦合到高速链路的第二集线器。第一集线器可以通过第一组接口中的第一接口接收来自第一组件的通信，并且通过高速链路来传输通信。第二集线器可以从高速链路接收通信，并且通过第二组接口中的第二接口将通信传输到第二组件。因此，第一和第二集线器可以减少在第一和第二组接口之间传输通信所需的线路的数量。
在某些实施例中，通过高速链路传输通信涉及对通信进行编码，接收来自高速链路的通信涉及对通信进行解码。通信可以通过标识第一接口和与通信相关联的转变（transition）并将该转变和该第一接口编码为数据包来被编码。然后，该通信可以通过从该数据包获得该转变和该第一接口，并在第二接口处产生该转变来被解码。
在某些实施例中，第一集线器对应于主集线器，第二集线器对应于从集线器。
在某些实施例中，从集线器连接到一个或多个总线主组件（busmaster component），主集线器连接到一个或多个总线从组件（busslave component）。
在某些实施例中，从集线器配置为从便携式电子设备中的处理器接收配置信息，并将配置信息传播到主集线器。
在某些实施例中，每个集线器都包括配置为将来自于第一组接口的一组接口电压转换为与第一集线器相关联的核心电压的第一电平移位器、以及配置为将核心电压转换为与高速链路相关联的链路电压的第二电平移位器。
在某些实施例中，高速链路包括时钟线路、与从第一组接口到第二组接口的通信相关联的第一数据线路、以及与从第二组接口到第一组接口的通信相关联的第二数据线路。
在某些实施例中，第一和/或第二组接口包括集成电路互连（I2C）接口、串行外围接口（SPI）、安全数字输入输出（SDIO）接口以及通用输入/输出（GPIO）接口。
附图说明
图1示出根据一实施例的系统的示意图。
图2示出根据一实施例从集线器和主集线器到一组组件的连接。
图3示出根据一实施例与从集线器和主集线器相关联的一组线路和一组接口。
图4示出根据一实施例从集线器和主集线器中的一组电压的使用。
图5示出根据一实施例促进便携式电子设备中的组件之间的通信的过程的流程图。
图6示出根据一实施例的便携式电子设备。
在图中，相似的参考编号表示相同的图形元素。
具体实施方式
给出下面的描述以使任何本领域技术人员都能够实现和使用各实施例，并且是在特定应用及其要求的背景下提供的。对所公开的实施例的各种修改对本领域技术人员是显而易见的，在不偏离本公开的精神和范围的情况下，此处所定义的一般原理可以应用于其他实施例和应用。因此，本发明不限于所示实施例，而是具有与此处所公开的原理和特征一致的最宽范围。
本详细说明中描述的数据结构和代码通常存储在计算机可读存储介质中，其可以是能存储供计算机系统使用的代码和/或数据的任何设备或介质。计算机可读存储介质包括但不限于易失性存储器、非易失性存储器、磁和光存储设备（诸如盘驱动器、磁带、CD（紧凑盘）、DVD（数字万用盘或数字视频盘））、或现在已知的或以后开发的能够存储代码和/或数据的其他介质。
在详细描述部分说明的方法和过程可以实现为可以存储在上述计算机可读存储介质中的代码和/或数据。当计算机系统读取和执行存储在计算机可读存储介质中的代码和/或数据时，计算机系统执行体现为数据结构和代码并存储在计算机可读存储介质内的方法和过程。
此外，此处所描述的方法和过程可以包括在硬件模块或设备中。这些模块或设备可以包括但不限于专用集成电路（ASIC）芯片、现场可编程门阵列（FPGA）、在特定时间执行特定软件模块或代码段的专用或共享处理器和/或现在已知的或以后开发的其他可编程逻辑器件。当激活硬件模块或装置时，它们执行包括在其内的方法和过程。
所公开的实施例提供用于促进一组组件之间的通信的方法和系统。组件可用于实现诸如膝上型计算机、平板计算机、移动电话、个人数字助理（PDA）、便携式媒体播放器和/或数码相机之类的便携式电子设备的功能。如图1所示，组件可以包括便携式电子设备中的主逻辑板100（例如，主板）上的处理器110。组件还可包括一组外围组件132-140，诸如端口、按钮、无线收发器、扬声器和/或麦克风，它们使用一组接口152-154与处理器进行通信。例如，处理器110和/或组件132-140可以使用集成电路互连（I2C）接口和/或一组通用输入/输出（GPIO）接口来在彼此之间传输信号。其他实现可以包括串行外围接口（SPI）或安全数字输入输出（SDIO）接口，作为I2C接口的补充（或替代）。
本领域技术人员将理解，处理器110和组件132-140能以最大化便携式电子设备内的空间利用的方式来定位和/或安置。处理器110与组件132-140之间的这种物理分离可能另外要求使用线路来实现处理器110与组件132-140之间的通信。例如，跨越平板计算机的长度的一组线路可以将平板计算机的一端的处理器110连接到平板计算机的另一端的输入/输出（I/O）设备，由此允许处理器110通过I2C接口与I/O设备进行通信。
然而，这样的线路必须容纳在便携式电子设备的外壳内。例如，可以在便携式电子设备内产生组件（例如，处理器110、组件132-140）之间的间隙，以便连接组件的线路可以置于间隙内。沿着相同的线条，可以增大便携式电子设备的一个或多个尺寸，以在便携式电子设备内产生用于线路的空间。
此外，便携式电子设备中增强的功能还可以通过向便携式电子设备添加新组件（例如，组件132-140）并使用更多线路来在组件之间传输信号来提供。结果，随着便携式电子设备的更新和/或改善，线路在便携式电子设备内占据的空间量可能会增大。
在一个或多个实施例中，图1的系统通过减少在组件（例如，处理器110、组件132-140）之间传输通信所需的线路数量而促进了便携式电子设备内的空间的高效率使用。第一集线器120可以将第一组接口152连接到高速链路130，第二集线器122可以将第二组接口154连接到高速链路130。如下面更详细地讨论的那样，集线器120-122和高速链路130可以提供接口扩展器，其使用比接口152-154更少数量的线路和更高操作频率来实现便携式电子设备中的组件（例如，处理器110、组件132-140）之间的通信。注意，如果有多个不同速度的接口（例如，I2C、SPI、SDIO和GPIO）连接到集线器120-122，则集线器120-122可以动态地改变高速链路130的速度和内部定时以减少功耗。如此，取决于高速链路130正在从接口（I2C、SPI、SDIO或GPIO）接收的业务类型，高速链路130可以改变其速度。例如，如果高速链路130从一个以上接口接收混合业务，则它可以选择集线器之间的数据速率以用于较高速度的业务。
为了促进便携式电子设备中的组件之间的通信，集线器120可以通过接口152从处理器110接收通信，并通过高速链路130将通信传输到集线器122。一旦集线器122接收到通信，集线器122就可以通过接口154将通信传输到通信所指向的一个或多个组件132-140。相反，集线器122可以通过接口154从组件132-140接收通信，并通过高速链路130将通信传输到集线器120。在接收到通信之后，集线器120可以通过接口152将通信传输到处理器110。
在一个或多个实施例中，集线器120-122和高速链路130减小了便携式电子设备内由线路占据的空间量，而与便携式电子设备中的接口152-154、处理器110和/或组件132-140的使用无关。特别地，高速链路130可以包括将时钟信号从处理器110传输到组件132-140的时钟线路、与从处理器110到组件132-140的通信相关联的第一数据线路以及与从组件132-140到处理器110的通信相关联的第二数据线路。高速链路130的操作频率可以显著高于接口152-154的操作频率，因此允许与多个接口152-154相关联的单向通信在一个数据线路上传输。例如，高速链路130可以以MHz频率操作，该频率比耦合到集线器120-122的一个或多个I2C接口的400KHz操作频率快一个数量级以上。
为了通过高速链路130传输通信，集线器120-122可以编码从处理器110和/或组件132-140接收到的通信。同样，集线器120-122可以在通过高速链路130接收到通信之后解码通信。例如，集线器120可以通过标识与通信相关联的接口以及转变（例如，低到高、高到低），将转变和所标识的接口编码为六比特数据包，并通过高速链路130中的单向数据线路将数据包传输到集线器122，来处理来自处理器110的通信。集线器122可以接收数据包，解码数据包以获得转变和接口，并在所标识的接口处生成转变。下面将参考图3更详细地论述数据在高速链路130上的传输。
因此，高速链路130可以将用于在处理器110和组件132-140之间传输信号的线路数量从便携式电子设备中的接口152-154的数量的倍数减少到三个。此外，因为组件（例如，处理器110、组件132-140）直接连接到的接口152-154未被集线器120-122和/或高速链路130修改，因此集线器120-122和高速链路130还可提供用于促进组件之间的通信的软件不可知的机构。
在一个或多个实施例中，集线器120-122配置为促进连接到接口152-154的总线主组件和总线从组件之间的数据传输。例如，处理器110可以对应于发出时钟信号并使用组件132-140的地址将数据传输到I2C从组件132-140的I2C主装置。为了促进处理器110作为I2C主装置的操作，集线器120可以充当从集线器，其通过接口152从处理器110接收时钟信号和数据，并通过高速链路130将时钟信号和数据传输到集线器122。集线器120还可从处理器110接收与集线器120-122相关联的配置信息，并将配置信息传播到集线器122。另一方面，集线器122可以充当主集线器，其接收来自高速链路130的时钟信号和数据，并通过接口154向组件132-140发出时钟信号和数据。下面将参考图2更详细地论述主集线器和从集线器的操作。
为了用不同的操作电压（例如，1.8V、3.3V、5.0V）处理来自接口152-154的通信，每个集线器120-122可包括第一电平移位器，其将来自于连接到集线器的接口152-154的一组接口电压转换为与集线器相关联的核心电压。集线器还可包括第二电平移位器，其将核心电压转换为与高速链路130相关联的链路电压。换言之，集线器120-122可以将与接口152-154相关联的不同接口电压转换为核心电压，集线器120-122以核心电压操作以缓冲和/或编码从连接到集线器的接口152-154接收到的通信。在通信被编码之后，核心电压被转换为高速链路130的链路电压，以实现编码了的通信在高速链路130上的传输。下面将参考图4更详细地论述通过集线器120-122对电压的管理。
图2示出根据一实施例从集线器202和主集线器204到一组组件206-228的连接。如图2所示，从集线器202可以连接到一个或多个总线主组件226-228和一组总线从组件206-212，而主集线器204可以仅连接到总线从组件214-224。例如，从集线器202和主集线器204可以为两个或更多I2C接口（例如，“SDAi”、“SDAk”）提供接口扩展器。从集线器202可以连接到作为I2C接口的I2C主装置操作的一个或多个处理器、微控制器和/或系统级芯片（SoC），而主集线器204可以连接到作为I2C接口的I2C从装置操作的一组外围组件。
另外，从集线器202和主集线器204可以配置为促进总线主组件226-228和总线从组件214-224之间的通信。特别地，从集线器202和主集线器204可以充当从集线器202和主集线器204分别连接到的组件206-228的从和主装置。例如，从集线器202可以通过从总线主组件226-228接收时钟信号和/或通信来充当总线主组件226-228的从设备。类似地，主集线器204可以通过将从从集线器202接收到的时钟信号和/或通信传输到从组件214-224来充当总线从组件214-224的主设备。
从集线器202和主集线器204还可实现总线从组件（例如，组件206-224）和总线主组件（例如，组件226-228）之间的时钟拉伸。例如，主集线器204可以在总线主组件228和总线从组件220之间的通信期间检测到总线从组件220将时钟线保持为低。主集线器204可以通过总线从组件220将表示时钟拉伸的编码传输到从集线器202，然后从集线器202将来自总线主组件228的时钟信号保持为低，以防止总线主组件228传输更多数据。相反，从集线器202可以检测来自总线从组件206检测时钟拉伸，并将表示拉伸了的时钟的编码传输到主集线器204，然后主集线器204可以将拉伸了的时钟传播到总线从组件214-224，以跨连接到从集线器202和/或主集线器204的所有组件206-228维护定时的一致性。
此外，从集线器202可包括从一个或多个总线主组件226-228接收配置信息并将配置信息传播到主集线器204的功能。例如，从集线器202和主集线器204可以对应于包含相同电路的两个集线器（例如，图1的集线器120-122）。为将集线器配置为从集线器202和主集线器204，一个或多个总线主组件226-228可以将低有效（active-low）信号传输到对应于从集线器202的集线器上的启动管脚（boot pin）。总线主组件226-228还可将与从集线器202和主集线器204的供电、对GPIO接口的控制和/或其他配置特定的寄存器相关的配置信息传输到从集线器202。然后，从集线器202可以基于配置信息设置一个或多个配置寄存器，并通过高速链路230将配置信息传播到主集线器204，在那里也设置对应的配置寄存器。
本领域技术人员将理解，组件（例如，组件206-228）、从集线器（例如，从集线器202）以及主集线器（例如，主集线器204）的其他布局也是可行的。例如，从集线器202和主集线器204可以包括利用连接到从集线器202和主集线器204二者的总线主组件（例如，组件226-228）在组件206-228之间传输通信的功能。从集线器202还可连接到多个主集线器以增大连接到接口扩展器的总线从组件的数量和/或减少用于在总线从组件和总线主组件之间传输通信的线路的数量。
图3示出根据一实施例与从集线器302和主集线器304相关联的一组线路308-312和一组接口314-320。如前所述，线路308-312可以形成高速链路306，其减少了在连接到接口314-320的组件之间传输通信所需的线路数量。
特别地，高速链路306可以包括时钟线路308和两个数据线路310-312。可以使用时钟线路308来将来自于连接到从集线器302的总线主组件传输到连接到主集线器304的总线从组件。数据线路310-312可以对应于在连接到从集线器302的组件和连接到主集线器304的组件之间传输通信的单向数据线路。例如，来自于连接到从集线器302的组件的通信可以被缓冲，编码并且通过数据线310高速传输到主集线器304，以减少将通信从第一组接口314和318传输到第二组接口316和320所需的线路数量。
接口314-320可以对应于通过从集线器302、主集线器304以及高速链路306扩展的不同接口。例如，接口314-316可以对应于连接到多组电压轨322-326和328-330的I2C接口。轨道322可以与用于以第一操作电压（例如，“VSLEEP”）将配置信息从总线主组件传输到从集线器302的I2C接口（例如，“I2C0”）相关联。可以使用配置信息来设置从集线器302中的配置寄存器，和/或将配置信息传播到主集线器304以便设置主集线器304中的配置寄存器。轨道324和328每个可以与第二操作电压（例如，“VDD1”）的三个I2C接口（例如，“I2C1～3”）相关联，轨道326和330每个可以与第三操作电压（例如，“VDD2”）的两个I2C接口（例如，“I2C4～5”）相关联。于是，轨道322-330可以允许以不同电压操作的I2C节点通过从集线器302、主集线器304以及高速链路306被连接。
沿相同线条，接口318-320可以对应于也连接到多组电压轨332-342的GPIO接口。轨道332和338每个可与第一操作电压（例如，“VSLEEP”）的四个GPIO接口相关联，轨道334和340每个可与第二操作电压（例如，“VDD2”）的四个GPIO节点相关联，轨道336和342每个可与第三操作电压（例如，“VDD1”）的八个GPIO节点相关联。如下面参考图4更详细论述的那样，与轨道322-342相关联的各种操作电压都可以转换为与从集线器302和/或主集线器304相关联的核心电压，以允许对来自接口314-320的具有不同的接口（例如，操作）电压的通信的处理。然后，可以将核心电压转换为与高速链路306相关联的链路电压，以实现通信跨高速链路306的传输。
图4示出根据一实施例的从集线器402和主集线器404中的一组电压的使用。可以使用第一接口（例如，操作）电压（例如，“VDDSLEEP”）来给从集线器402和主集线器404供电和/或将配置信息传输到从集线器402和/或主集线器404。一组电压调节器424-426（例如，低压差调节器（low-dropout regulator））可以将第一接口电压转换为从集线器402和主集线器404以其操作的核心电压（例如，“VDDCORE”）。
如上文所描述的那样，可以使用额外的接口电压（例如，“VDD1”、“VDD2”）来将通信从一组或多组接口420-422（例如，I2C接口、GPIO接口）传输到集线器（例如，从集线器402、主集线器404）。为了通过从集线器402和主集线器404对通信进行缓冲和/或处理，第一组电平移位器408-410可以将来自接口420-422的接口电压转换为从集线器402和主集线器404的核心电压。
在接口电压转换为核心电压之后，集线器上的接口处理机构412-414可以将通信编码为数据包以用于在连接从集线器402和主集线器404的高速链路406上传输。接下来，第二组电平移位器416-418可以将核心电压转换为与高速链路406相关联的链路电压（例如，“VDDSLEEP”）。然后，可以通过高速链路406以链路电压来传输编码了的通信。如图4所示，链路电压可以对应于用于对集线器进行供电的第一接口电压。替代地，链路电压可以对应于与第一接口电压不同的操作电压。
一旦通过高速链路406接收到编码了的通信，接收集线器（例如，从集线器402、主集线器404）上的互补电平移位器416-418可以将通过其接收编码了的通信的链路电压转换为接收集线器的核心电压，以通过对应的接口处理机构412-414来实现编码了的通信的解码。在通信被解码之后，核心电压被下一电平移位器408-410转换为一组接口电压，以实现解码了的通信以接口420-422的接口电压传输到接口420-422。
图5示出根据一实施例的促进便携式电子设备中的组件之间的通信的过程的流程图。在一个或多个实施例中，一个或多个步骤可以被省略、重复和/或以不同的顺序执行。相应地，图5所示出的步骤的具体布置不应解释为对实施例的范围的限制。
首先，通过便携式电子设备中的第一组接口中的第一接口从第一组件接收通信（操作502）。例如，可以通过I2C接口和/或GPIO接口从处理器和/或外围组件接收通信。
接下来，通过高速链路来传输通信（操作504）。为了实现通信在高速链路上的传输，通信可以被编码。例如，可以标识与通信相关联的转变和第一接口，并将其编码为数据包，然后数据包在高速链路中的单向数据线路上传输。伴随转变的时钟信号还可通过高速链路中的时钟线路来传输。
在通过高速链路接收到通信时，通信通过便携式电子设备中的第二组接口中的第二接口传输到第二组件（操作506）。例如，可以通过高速链路接收到数据包，并将其解码以标识转变和第二接口。然后可以在第二接口处生成转变以将通信传输到第二组件。
上面描述的可再充电电池单元一般可以用于任何类型的电子设备中。例如，图6示出了包括处理器602、存储器604和显示器608的便携式电子设备600。便携式电子设备600可以对应于膝上型计算机、平板计算机、移动电话、PDA、便携式媒体播放器、数码相机和/或其他类型的电池供电的电子设备。另外，便携式电子设备600中的处理器602、存储器604、显示器608和/或其他组件之间的通信可以通过一组集线器606来促进。
特别地，集线器606可以包括将第一组接口耦合到高速链路的第一集线器以及将第二组接口耦合到高速链路的第二集线器。第一和第二组接口可以包括I2C接口和/或GPIO接口。第一集线器可以通过第一组接口中的第一接口接收来自第一组件的通信，并且通过高速链路来传输通信。第二集线器可以从高速链路接收通信，并且通过第二组接口中的第二接口将通信传输到第二组件。因此，第一和第二集线器可以减少在第一和第二组接口之间传输通信所需的线路数量。
前面对实施例的描述仅用于示范和说明。它们无意是详尽无遗的或将本发明限制到所公开的形式。因此，许多修改和变型将对本领域技术人员变得显然。此外，以上公开无意限制本发明。

Claims (25)

1.一种促进便携式电子设备中的组件之间的通信的系统，包括：
将第一组接口耦合到高速链路的第一集线器，其中所述第一集线器配置为：
通过所述第一组接口中的第一接口接收来自第一组件的通信；以及
通过所述高速链路来传输所述通信；以及
将第二组接口耦合到所述高速链路的第二集线器，其中所述第二集线器配置为：
接收来自所述高速链路的所述通信；以及
通过所述第二组接口中的第二接口将所述通信传输到第二组件，
其中，通过所述高速链路在所述第一组接口和所述第二组接口之间传输通信减少了传输所述通信所需的线路的数量。
2.如权利要求1所述的系统，
其中，通过所述高速链路传输所述通信包括对所述通信进行编码，以及
其中，接收来自所述高速链路的所述通信包括对所述通信进行解码。
3.如权利要求2所述的系统，其中，对所述通信进行编码包括：
标识与所述通信相关联的转变和所述第一接口；以及
将所述转变和所述第一接口编码为数据包。
4.如权利要求1所述的系统，
其中，所述第一集线器对应于主集线器，且
其中，所述第二集线器对应于从集线器。
5.如权利要求4所述的系统，
其中，所述从集线器连接到一个或多个总线主组件，且
其中，所述主集线器连接到一个或多个总线从组件。
6.如权利要求4所述的系统，其中，所述从集线器配置为：
从所述便携式电子设备中的处理器接收配置信息；以及
将所述配置信息传播到所述主集线器。
7.如权利要求1所述的系统，其中，所述第一集线器包括：
配置为将来自所述第一组接口的一组接口电压转换为与所述第一集线器相关联的核心电压的第一电平移位器；以及
配置为将所述核心电压转换为与所述高速链路相关联的链路电压的第二电平移位器。
8.如权利要求1所述的系统，其中，所述高速链路包括：
时钟线路；
与从所述第一组接口到所述第二组接口的通信相关联的第一数据线路；以及
与从所述第二组接口到所述第一组接口的通信相关联的第二数据线路。
9.如权利要求1所述的系统，其中，所述第一组接口包括下列中的至少一个：
集成电路互连（I2C）接口；
串行外围接口（SPI）；
安全数字输入输出（SDIO）接口；以及
通用输入/输出（GPIO）接口。
10.如权利要求1所述的系统，其中，所述高速链路配置为基于所述高速链路正在接收的业务的混合来改变速度。
11.一种便携式电子设备，包括：
第一组接口；
第二组接口；
将所述第一组接口耦合到高速链路的第一集线器，其中所述第一集线器配置为：
通过所述第一组接口中的第一接口接收来自第一组件的通信；以及
通过所述高速链路来传输所述通信；以及
将所述第二组接口耦合到所述高速链路的第二集线器，其中所述第二集线器配置为：
接收来自所述高速链路的所述通信；以及
通过所述第二组接口中的第二接口将所述通信传输到第二组件，
其中，通过所述高速链路在所述第一组接口和所述第二组接口之间传输通信减少了传输所述通信所需的线路的数量。
12.如权利要求11所述的便携式电子设备，
其中，通过所述高速链路传输所述通信包括对所述通信进行编码，且
其中，接收来自所述高速链路的所述通信包括对所述通信进行解码。
13.如权利要求12所述的便携式电子设备，其中，编码所述通信包括：
标识与所述通信相关联的转变和所述第一接口；以及
将所述转变和所述第一接口编码为数据包。
14.如权利要求11所述的便携式电子设备，
其中，所述第一集线器对应于主集线器，且
其中，所述第二集线器对应于从集线器。
15.如权利要求14所述的便携式电子设备，
其中，所述从集线器连接到一个或多个总线主设备，且
其中，所述主集线器连接到一个或多个总线从设备。
16.如权利要求14所述的便携式电子设备，其中，所述从集线器配置为：
从所述便携式电子设备中的处理器接收配置信息；以及
将所述配置信息传播到所述主集线器。
17.如权利要求11所述的便携式电子设备，其中，所述第一和第二集线器包括：
配置为将来自所述第一组接口的一组接口电压转换为与所述第一集线器相关联的核心电压的第一电平移位器；以及
配置为将所述核心电压转换为与所述高速链路相关联的链路电压的第二电平移位器。
18.如权利要求11所述的便携式电子设备，其中，所述高速链路包括：
时钟线路；
与从所述第一组接口到所述第二组接口的通信相关联的第一数据线路；以及
与从所述第二组接口到所述第一组接口的通信相关联的第二数据线路。
19.如权利要求11所述的便携式电子设备，其中，所述高速链路配置为基于所述高速链路正在接收的业务的混合来改变速度。
20.一种促进便携式电子设备中的组件之间的通信的方法，包括：
通过所述便携式电子设备中的第一组接口中的第一接口接收来自第一组件的通信；
通过高速链路来传输所述通信；以及
在通过所述高速链路接收到通信时，通过所述便携式电子设备中的第二组接口中的第二接口将所述通信传输到第二组件，
其中，通过所述高速链路在所述第一组接口和所述第二组接口之间传输通信减少了传输所述通信所需的线路的数量。
21.如权利要求20所述的方法，
其中，通过所述高速链路传输所述通信包括对所述通信进行编码，且
其中，接收来自所述高速链路的所述通信包括对所述通信进行解码。
22.如权利要求21所述的方法，其中，编码所述通信包括：
标识与所述通信相关联的转变和所述第一接口；以及
将所述转变和所述第一接口编码为数据包。
23.如权利要求20所述的方法，其中，所述高速链路包括：
时钟线路；
与从所述第一组接口到所述第二组接口的通信相关联的第一数据线路；以及
与从所述第二组接口到所述第一组接口的通信相关联的第二数据线路。
24.如权利要求20所述的方法，其中，所述第一组接口包括下列中的至少一个：
集成电路互连（I2C）接口；
串行外围接口（SPI）；
安全数字输入输出（SDIO）接口；以及
通用输入/输出（GPIO）接口。
25.如权利要求20所述的方法，其中，所述便携式电子设备是移动电话、平板计算机以及便携式媒体播放器中的至少一种。
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