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CN108806596A - 像素驱动电路及方法、显示装置 - Google Patents

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CN108806596A
CN108806596A CN201810705976.7A CN201810705976A CN108806596A CN 108806596 A CN108806596 A CN 108806596A CN 201810705976 A CN201810705976 A CN 201810705976A CN 108806596 A CN108806596 A CN 108806596A
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陈小海
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Chengdu BOE Optoelectronics Technology Co Ltd
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BOE Technology Group Co Ltd
Chengdu BOE Optoelectronics Technology Co Ltd
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Abstract

本公开涉及显示技术领域，尤其涉及一种像素驱动电路及像素驱动方法、显示装置。该像素驱动电路可以包括第一开关单元、第二开关单元、第一初始化单元、驱动单元、第二初始化单元、补偿单元、隔离单元、储能单元。该像素驱动电路在工作过程中可以消除驱动晶体管的阈值电压以及第一电源信号的压降对驱动电流的影响，确保各像素驱动电路输出的驱动电流一致，从而保证各像素显示亮度的均一性。

Description

像素驱动电路及方法、显示装置
技术领域
本公开涉及显示技术领域，尤其涉及一种像素驱动电路及像素驱动方法、显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点越来越多地被应用于高性能显示领域当中。
但是驱动晶体管在制作过程中，由于工艺偏差会导致不同位置的驱动晶体管的阈值电压存在差异。并且随着工作时间延长及使用环境改变，驱动晶体管的阈值电压会发生漂移。同时，显示器各像素所处的位置不同会导致电源的压降(IR Drop)不同，从而对OLED的驱动电流产生影响。如果不能对阈值电压和电源IR Drop进行补偿，则会导致OLED显示器的发光不均匀，使显示画面的观感变差。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
本公开的目的在于提供一种像素驱动电路及像素驱动方法、显示装置，进而至少在一定程度上克服由于阈值电压漂移导致的显示亮度不均匀的问题。
根据本公开的一个方面，提供一种像素驱动电路，用于驱动电致发光元件，所述像素驱动电路包括：第一开关单元，与第一节点连接，用于响应扫描信号而导通，以将数据信号传输至所述第一节点；第二开关单元，与所述第一节点连接，用于响应控制信号而导通，以将参考信号传输至所述第一节点；第一初始化单元，与所述第一节点连接，用于响应复位信号而导通，以将初始化信号传输至所述第一节点；驱动单元，与第二节点以及第三节点连接，用于响应所述第二节点的信号而导通，并在第一电源信号的作用下输出驱动电流至所述第三节点；第二初始化单元，与所述第二节点连接，用于响应所述复位信号而导通，以将所述初始化信号传输至所述第二节点；补偿单元，与所述第二节点以及所述第三节点连接，用于响应所述扫描信号而导通，以联通所述第二节点和所述第三节点；隔离单元，与所述第三节点连接，用于响应所述控制信号而导通，以将所述驱动电流传输至所述电致发光元件；储能单元，连接于所述第一节点和所述第二节点之间。
在本公开的一种示例性实施例中，所述第一开关单元包括第一晶体管，其中：所述第一晶体管的第一端用于接收所述数据信号，第二端连接所述第一节点，控制端用于接收所述扫描信号。
在本公开的一种示例性实施例中，所述第二开关单元包括第二晶体管，其中：所述第二晶体管的第一端用于接收所述参考信号，第二端连接所述第一节点，控制端用于接收所述控制信号。
在本公开的一种示例性实施例中，所述第一初始化单元包括第三晶体管，其中：所述第三晶体管的第一端用于接收所述初始化信号，第二端连接所述第一节点，控制端用于接收所述复位信号。
在本公开的一种示例性实施例中，所述第二初始化单元包括第四晶体管，其中：所述第四晶体管的第一端用于接收所述初始化信号，第二端连接所述第二节点，控制端用于接收所述复位信号。
在本公开的一种示例性实施例中，所述驱动单元包括驱动晶体管，其中：所述驱动晶体管的第一端用于接收所述第一电源信号，第二端连接所述第三节点，控制端连接所述第二节点。
在本公开的一种示例性实施例中，所述补偿单元包括第五晶体管，其中：所述第五晶体管的第一端连接所述第二节点，第二端连接所述第三节点，控制端用于接收所述扫描信号。
在本公开的一种示例性实施例中，所述隔离单元包括第六晶体管，其中：所述第六晶体管的第一端连接所述第三节点，第二端连接所述电致发光元件，控制端用于接收所述控制信号。
根据本公开的一个方面，提供一种像素驱动电路，用于驱动电致发光元件，包括：第一晶体管，第一端用于接收数据信号，第二端连接第一节点，控制端用于接收扫描信号；第二晶体管，第一端用于接收参考信号，第二端连接所述第一节点，控制端用于接收控制信号；第三晶体管，第一端用于接收初始化信号，第二端连接所述第一节点，控制端用于接收复位信号；驱动晶体管，第一端用于接收第一电源信号，第二端连接第三节点，控制端连接第二节点；第四晶体管，第一端用于接收所述初始化信号，第二端连接所述第二节点，控制端用于接收所述复位信号；第五晶体管，第一端连接所述第二节点，第二端连接所述第三节点，控制端用于接收所述扫描信号；第六晶体管，第一端连接所述第三节点，第二端连接所述电致发光元件，控制端用于接收所述控制信号；存储电容，第一端连接所述第一节点，第二端连接所述第二节点。
根据本公开的一个方面，提供一种像素驱动方法，用于驱动上述任意一项所述的像素驱动电路，所述像素驱动方法包括：在复位阶段，利用所述复位信号导通所述第一初始化单元以及第二初始化单元，以使所述初始化信号写入所述第一节点和所述第二节点；在充电阶段，利用所述扫描信号导通所述第一开关单元以及补偿单元，以使所述数据信号以及所述驱动单元的阈值电压写入所述储能单元；在发光阶段，利用所述控制信号导通所述第二开关单元以及隔离单元，以使所述驱动单元在所述第二节点的信号的作用下导通，并在所述第一电源信号的作用下通过所述隔离单元向所述电致发光元件输出驱动电流。
在本公开的一种示例性实施例中，所述初始化信号的电压为0。
在本公开的一种示例性实施例中，所述复位信号和所述扫描信号的导通时段之间具有一缓冲时段。
根据本公开的一个方面，提供一种显示装置，包括上述任意一项所述的像素驱动电路。
本公开一种示例性实施例提供的一种像素驱动电路及像素驱动方法、显示装置，该像素驱动电路包括第一开关单元、第二开关单元、第一初始化单元、驱动单元、第二初始化单元、补偿单元、隔离单元、储能单元。在该像素驱动电路的工作过程中，一方面，通过第一开关单元、补偿单元、第一初始化单元、第二开关单元、第二初始化单元的配合，以及通过补偿单元，将第二节点和第三节点联通，从而将驱动单元的控制端和第二端联通，以将驱动单元中晶体管的阈值电压和第一电源信号写入第二节点，即对驱动单元的阈值电压进行补偿，消除驱动单元的阈值电压对驱动电流的影响，确保各像素驱动电路输出的驱动电流一致，进而保证各像素显示亮度的均一性；另一方面，通过该补偿单元还可消除第一电源信号对驱动单元的控制端和第一端之间的电压的影响，从而消除第一电源信号IR压降对各像素显示亮度的影响，确保各像素驱动电路输出的驱动电流一致，保证各像素显示亮度的均一性。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
附图说明
通过参照附图来详细描述其示例性实施例，本公开的上述和其它特征及优点将变得更加明显。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。在附图中：
图1为本公开一种像素驱动电路的示意图；
图2为本公开一种像素驱动电路的具体结构示意图；
图3为本公开一示例性实施例中提供的像素驱动电路的工作时序图；
图4为本公开提供的像素驱动电路的仿真结果示意图。
附图标记：
M1-M6 第一至第六晶体管
M7 驱动晶体管
C 存储电容
N1-N3 第一至第三节点
VDD 第一电源信号
Vint 初始化信号
VData 数据信号
Gate 扫描信号
Reset 复位信号
Vref 参考信号
L 电致发光元件
VSS 第二电源信号
具体实施方式
现在将参考附图更全面地描述示例实施例。然而，示例实施例能够以多种形式实施，且不应被理解为限于在此阐述的实施例；相反，提供这些实施例使得本公开将全面和完整，并将示例实施例的构思全面地传达给本领域的技术人员。所描述的特征、结构或特性可以以任何合适的方式结合在一个或更多实施例中。在下面的描述中，提供许多具体细节从而给出对本公开的实施例的充分理解。然而，本领域技术人员将意识到，可以实践本公开的技术方案而没有所述特定细节中的一个或更多，或者可以采用其它的方法、组元、材料、装置、步骤等。在其它情况下，不详细示出或描述公知技术方案以避免模糊本公开的各方面。
此外，附图仅为本公开的示意性图解，并非一定是按照比例绘制。图中相同的附图标记标识相同或相似的部分，因而将省略对它们的重复描述。
本示例实施方式中提供了一种像素驱动电路，用于驱动电致发光元件，参照图1所示，该像素驱动电路可以包括：
第一开关单元100，与第一节点N1连接，用于响应扫描信号Gate而导通，以将数据信号VData传输至所述第一节点N1；
第二开关单元200，与所述第一节点N1连接，用于响应控制信号EM而导通，以将参考信号Vref传输至所述第一节点N1；
第一初始化单元300，与所述第一节点N1连接，用于响应复位信号Reset而导通，以将初始化信号Vint传输至所述第一节点N1；
第二初始化单元400，与所述第二节点N2连接，用于响应所述复位信号Reset而导通，以将所述初始化信号Vint传输至所述第二节点N2；
补偿单元500，与所述第二节点N2以及第三节点N3连接，用于响应所述扫描信号Gate而导通，以联通所述第二节点N2和第三节点N3；
驱动单元700，与第二节点N2以及第三节点N3连接，用于响应所述第二节点的信号而导通，并在第一电源信号VDD的作用下输出驱动电流至所述第三节点N3；
隔离单元600，与所述第三节点N3连接，用于响应所述控制信号EM而导通，以将所述驱动电流传输至所述电致发光元件；
储能单元800，连接于所述第一节点N1和所述第二节点N2之间。
通过如上所述补偿单元，一方面，将第二节点N2和第三节点N3联通，从而将驱动单元的控制端和第二端联通，以将驱动单元中晶体管的阈值电压和第一电源信号写入第二节点，即对驱动单元的阈值电压进行补偿，消除驱动单元的阈值电压对驱动电流的影响，确保各像素驱动电路驱动电流一致，进而保证各像素显示亮度的均一性；另一方面，通过该补偿单元还可消除第一电源信号对驱动单元的控制端和第一端之间的电压的影响，从而消除电源IR压降对各像素显示亮度的影响，确保各像素驱动电路输出的驱动电流一致，保证各像素显示亮度的均一性。
下面结合附图对本示例实施方式中的像素驱动电路各个单元进行详细的说明。参考图2所示，第一开关单元包括第一晶体管M1，所述第二开关单元包括第二晶体管M2，所述第一初始化单元包括第三晶体管M3，所述第二初始化单元包括第四晶体管M4，所述驱动单元包括驱动晶体管M7，所述补偿单元包括第五晶体管M5，所述隔离单元包括第六晶体管M6，所述储能单元包括存储电容C。
如图2中所示，第一晶体管至第六晶体管以及驱动晶体管均具有控制端、第一端和第二端。在此基础上，上述像素驱动电路中的第一晶体管至第六晶体管(M1～M6)和驱动晶体管M7的连接关系如下：
所述第一晶体管M1的第一端用于接收所述数据信号VData，第二端连接所述第一节点N1，控制端用于接收所述扫描信号Gate；所述第二晶体管M2的第一端用于接收所述参考信号Vref，第二端连接所述第一节点N1，控制端用于接收所述控制信号EM；所述第三晶体管M3的第一端用于接收所述初始化信号Vint，第二端连接所述第一节点N1，控制端用于接收所述复位信号Reset；所述驱动晶体管M7的第一端用于接收所述第一电源信号VDD，第二端连接所述第三节点N3，控制端连接所述第二节点N2；所述第四晶体管M4的第一端用于接收所述初始化信号Vint，第二端连接所述第二节点N2，控制端用于接收所述复位信号Reset；所述第五晶体管M5的第一端连接所述第二节点N2，第二端连接所述第三节点N3，控制端用于接收所述扫描信号Gate；所述第六晶体管M6的第一端连接所述第三节点N3，第二端连接所述电致发光元件L，控制端用于接收所述控制信号EM；所述存储电容C的第一端连接所述第一节点N1，第二端连接所述第二节点N2。
需要说明的是，各晶体管的控制端可以为栅极、第一端可以为源极、第二端可以为漏极；或者，晶体管的第一端和第二端可以互换。在本示例实施方式中，所有晶体管均可以均采用N型薄膜晶体管或者P型薄膜晶体管。需要说明的是：针对不同的晶体管类型，各个信号端的电平信号需要相应的调整变化。所述薄膜晶体管可以为非晶硅薄膜晶体管、多晶硅薄膜晶体管以及非晶-氧化铟镓锌薄膜晶体管中的一种或多种。
例如，第一晶体管至第六晶体管均为P型薄膜晶体管时，所述晶体管的第一端均可以为源极，所述晶体管的第二端均可以为漏极。再例如，在所述第一晶体管至第六晶体管均为N型薄膜晶体管时，所述晶体管的第一端均可以为漏极，所述晶体管的第二端可以均为源极。需要说明的是，上述晶体管还可以为其他类型的晶体管，本示例性实施例对此不作特殊限定。
此外，各晶体管可以为增强型晶体管或者耗尽型晶体管，本示例性实施例对此不作特殊限定。需要说明的是，由于晶体管的源极和漏极对称，因此，晶体管的源极、漏极可以互换。
所述驱动晶体管M7具有控制端、第一端以及第二端。例如，驱动晶体管M7的控制端可以为栅极，第一端可以为源极、第二端可以为漏极。再例如，驱动晶体管M7的控制端可以为栅极，第一端可以为漏极，第二端可以为源极。此外，驱动晶体管M7可以为增强型驱动晶体管或耗尽型驱动晶体管，本示例性实施例对此不作特殊限定。
所述存储电容C的类型可以根据具体的电路进行选择。例如，可以为MOS电容、金属电容或双多晶电容等，本示例性实施例对此不作特殊限定。
所述电致发光元件L为电流驱动型电致发光元件，由流经驱动晶体管M7的电流控制其进行发光，例如，电致发光元件可为OLED，但本示例性实施例中的电致发光元件L不限于此。此外，电致发光元件L具有第一极和第二极。例如，电致发光元件L的第一极可以为阳极，第二极可以为阴极。除此之外，电致发光元件L的第一极和第二极也可互换。电致发光元件L的第一极与第六晶体管的第一端连接，第二极连接第二电源信号VSS。
在阵列排布的多个像素驱动电路中，为了简化阵列排布的多个像素驱动电路的电路结构，可复用各像素驱动电路中的扫描信号Gate实现逐行扫描，所述像素驱动电路与第N-1行以及第N行扫描信号线连接；其中，第N行扫描信号线用于输出所述扫描信号Gate，第N-1行扫描信号线用于输出所述复位信号Reset；且其中的N为正整数。
在本公开的示例性实施例中，还提供了一种像素驱动方法，用于驱动如图1和图2所示的像素驱动电路。下面，以所述晶体管均为P型薄膜晶体管、驱动晶体管为P型驱动晶体管为例，结合图3所示的像素驱动电路的工作时序图对图1和图2中的像素驱动电路的工作过程加以详细的说明。由于晶体管均为P型薄膜晶体管，因此，晶体管的第一端均为源极，晶体管的第二端均为漏极，且晶体管的导通信号均为低电平信号，晶体管的关断信号为高电平信号。该驱动时序图示出了控制信号EM、扫描信号Gate、初始化信号Vint、数据信号VData、参考信号Vref、复位信号Reset、第一电源信号VDD，其中，第一电源信号VDD保持高电平信号不变，参考信号Vref保持小于数据信号VData，初始化信号Vint的电压例如可为0。需要注意的是，将初始化信号Vint保持低电平信号不变能够减小或消除初始化信号对于驱动电流的影响。
基于此，所述像素驱动电路的工作过程具体可以包括以下阶段：
在T1阶段即复位阶段，可利用所述复位信号Reset导通所述第一初始化单元以及第二初始化单元，以使所述初始化信号写入所述第一节点和所述第二节点。具体而言，在T1阶段，在控制信号EM的高电平信号作用下，第二晶体管M2和第六晶体管M6关闭；在扫描信号Gate的高电平信号作用下，第一晶体管M1和第五晶体管M5关闭；在复位信号Reset的低电平信号作用下，第三晶体管M3和第四晶体管M4导通。如此一来，可将初始化信号Vint通过第三晶体管M3传输至第一节点N1，并将初始化信号Vint通过第四晶体管M4传输至第二节点N2，由于T1阶段初始化信号Vint为低电平信号，因此第一节点和第二节点均为低电平信号，进而在第二节点N2的低电平信号作用下，驱动晶体管M7导通，以将第一电源信号VDD经过驱动晶体管M7传输至第三节点N3。
在T2阶段即充电阶段，可利用所述扫描信号Gate导通所述第一开关单元100以及补偿单元500，以使所述数据信号以及所述驱动单元700的阈值电压写入所述储能单元800。具体而言，在T2阶段，在扫描信号Gate的低电平信号作用下，第一晶体管M1和第五晶体管M5导通；在复位信号Reset的高电平信号作用下，第三晶体管M3和第四晶体管M4关闭；在控制信号EM的高电平信号作用下，第二晶体管M2和第六晶体管M6关闭。如此一来，可将数据信号VData通过第一晶体管M1传输至第一节点N1，此时第一节点的电压为VData；由于第五晶体管M5导通，可将驱动晶体管M7的控制端和第二端联通，从而将第一电源信号VDD和驱动晶体管M7的阈值电压Vth写入第二节点N2，因此第二节点N2的电压为VDD+Vth，以通过第一节点和第二节点对存储电容进行充电，实现将数据信号VData以及所述驱动单元的阈值电压Vth写入所述储能单元的功能，同时由于驱动晶体管M7导通，可将第一电源信号VDD和驱动晶体管M7的阈值电压Vth写入第三节点N3。在该阶段中，可直接通过第一电源信号VDD对存储电容C进行充电，因此能够大幅度提高电容充电速度。在T2阶段和T3阶段之间，由于存在信号突变，扫描信号Gate会通过寄生电容耦合作用拉高第一节点N1和第二节点N2的电压。
需要说明的是，参考图3所示，在T1阶段和T2阶段之间，复位信号Reset和扫描信号Gate的导通时段之间具有一缓冲时段。通过设置缓冲时段，可减少复位信号和扫描信号之间的串扰。
在T3阶段即发光阶段，可利用控制信号EM导通第二开关单元200以及隔离单元600，以使驱动单元700在所述第二节点N2的电压信号的作用下导通，并在所述第一电源信号VDD的作用下通过所述隔离单元600向所述电致发光元件L输出驱动电流。具体而言，在T3阶段，在扫描信号Gate的高电平信号作用下，第一晶体管M1和第五晶体管M5关闭；在复位信号Reset的高电平信号作用下，第三晶体管M3和第四晶体管M4关闭；在控制信号EM的低电平信号作用下，第二晶体管M2和第六晶体管M6导通。如此一来，可将参考信号Vref经过第二晶体管M2传输至第一节点N1，此时第一节点N1的电压为Vref，且第一节点相对于上一阶段的电压变化量为Vref-VData，同时由于存储电容C的自举作用，第二节点N2的电压在T2阶段的基础上发生同样的变化量，即第二节点N2的电压由T2阶段的VDD+Vth变化为T3阶段的VDD+Vth+Vref-VData。由图4中的仿真结果可得，N1节点T3阶段电压相对于T2阶段电压的变化量Vref-VData为负值。
第二节点N2的电压VDD+Vth+Vref-VData中，Vref-VData为负值，因此VDD+Vth+Vref-VData与第一电源信号VDD之差小于驱动晶体管M7的阈值电压Vth，则驱动晶体管M7能够在第二节点N2的电压信号的作用下导通，并在第一电源信号VDD的作用下输出驱动电流，驱动电流通过第六晶体管M6传输至电致发光元件L以驱动电致发光元件发光。结合仿真图进行说明，当阈值电压为-2.3V左右，第一电源信号VDD为5V时，第二节点N2的电压VDD+Vth+Vref-VData为1.7V，与第一电源信号VDD之差小于驱动晶体管M7的阈值电压Vth。需要说明的是，可设置参考信号Vref小于数据信号VData，以使驱动晶体管M7导通。例如，可将参考信号Vref设置为-1V或0V或1V等，可将数据信号VData设置在2V到5V之间。只要参考信号Vref小于数据信号VData的最小值，即可导通驱动晶体管M7。
第二节点N2的电压VDD+Vth+Vref-VData中，阈值电压Vth在此处表现为负值，如果VDD+Vth+Vref-VData与第一电源信号VDD之差小于驱动晶体管M7的阈值电压Vth，则驱动晶体管M7能够在第二节点N2的电压信号的作用下导通，并在第一电源信号VDD的作用下输出驱动电流，驱动电流通过第六晶体管M6传输至电致发光元件L以驱动电致发光元件发光。此时，假设电致发光元件L的第一极的电压变为电致发光元件L的导通电压VL，第一节点N1的电压为参考电压Vref，第二节点N2的电压变为VX。
在此基础上，驱动晶体管M7的驱动电流的计算公式可表示为：Ion＝K×(Vgs-Vth)2＝K×(VX-VDD-Vth)2。
下面，根据电荷守恒原理，即T2阶段中像素驱动电路中的电荷与T3阶段像素驱动电路中的电荷相同可得：
(VDD+Vth-VData)C＝(VX-Vref)C
求解上述公式可得：VX＝VDD+Vth-VData+Vref
将VX代入驱动晶体管M7的驱动电流的计算公式可得：
Ion＝K×(VDD+Vth-VData+Vref-VDD-Vth)2＝K×(Vref-VData)2
由此可知，驱动电流与驱动晶体管M7的阈值电压Vth和第一电源信号VDD的电压均无关。
结合图4中的第一节点和第二节点的电压仿真结果而言，通过在T2阶段导通第五晶体管，将驱动晶体管M7的控制端和第二端联通，将驱动晶体管M7的阈值电压Vth和第一电源信号VDD写入第二节点N2，即对驱动晶体管M7的阈值电压Vth进行补偿，消除驱动晶体管M7的阈值电压Vth对驱动电流的影响，确保各像素驱动电路输出的驱动电流一致，进而保证各像素显示亮度的均一性；同时消除第一电源信号VDD对驱动晶体管M7的控制端和第一端之间的电压的影响，从而消除电源IR的压降损耗对各像素显示亮度的影响，以在发光阶段确保各像素驱动电路输出的驱动电流一致，保证各像素显示亮度的均一性。除此之外，本示例中的像素驱动电路还可减少第一电源信号VDD的抖动，还可通过较低的参考电压达到降低功耗的目的。
本示例性实施例中，采用全P型薄膜晶体管具有以下优点：对噪声抑制力强；由于是低电平导通，而充电管理中低电平容易实现；P型薄膜晶体管制程简单，相对价格较低；P型薄膜晶体管的稳定性更好。
需要说明的是：在上述具体的实施例中，所有晶体管均为P型薄膜晶体管；但本领域技术人员容易根据本公开所提供的像素驱动电路得到所有晶体管均为N型薄膜晶体管的像素驱动电路。在本公开的一种示例性实施方式中，所有晶体管可以均为N型薄膜晶体管，由于晶体管均为N型薄膜晶体管，因此，晶体管的导通信号均为高电平，晶体管的第一端均为漏极，晶体管的第二端均为源极。当然，本公开所提供的像素驱动电路也可以改为CMOS(Complementary Metal Oxide Semiconductor，互补金属氧化物半导体)电路等，并不局限于本实施例中所提供的像素驱动电路，这里不再赘述。
本示例实施方式还提供一种显示装置，包括上述的像素驱动电路。该显示装置还可包括：多条扫描线，用于提供扫描信号；多条数据线，用于提供数据信号；多个像素驱动电路，电连接于上述的扫描线和数据线；其中，所述显示装置例如可以包括手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。通过如上所述的像素驱动电路中的第五晶体管，将驱动晶体管的控制端和第二端联通，以将驱动晶体管的阈值电压和第一电源信号写入第二节点，即对驱动晶体管的阈值电压进行补偿，消除驱动晶体管的阈值电压对驱动电流的影响，确保各像素驱动电路输出的驱动电流一致，进而保证各像素显示亮度的均一性；另外，还可消除第一电源信号对驱动晶体管的控制端和第一端之间的电压的影响，从而消除电源IR压降对各像素显示亮度的影响，确保各像素驱动电路输出的驱动电流一致，保证各像素显示亮度的均一性。
需要说明的是：所述显示装置中各模块单元的具体细节已经在对应的像素驱动电路中进行了详细的描述，因此这里不再赘述。
应当注意，尽管在上文详细描述中提及了用于动作执行的设备的若干模块或者单元，但是这种划分并非强制性的。实际上，根据本公开的实施方式，上文描述的两个或更多模块或者单元的特征和功能可以在一个模块或者单元中具体化。反之，上文描述的一个模块或者单元的特征和功能可以进一步划分为由多个模块或者单元来具体化。
此外，尽管在附图中以特定顺序描述了本公开中方法的各个步骤，但是，这并非要求或者暗示必须按照该特定顺序来执行这些步骤，或是必须执行全部所示的步骤才能实现期望的结果。附加的或备选的，可以省略某些步骤，将多个步骤合并为一个步骤执行，以及/或者将一个步骤分解为多个步骤执行等。
本领域技术人员在考虑说明书及实践这里公开的发明后，将容易想到本公开的其它实施方案。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由所附的权利要求指出。

Claims (13)

1.一种像素驱动电路，用于驱动电致发光元件，其特征在于，所述像素驱动电路包括：
第一开关单元，与第一节点连接，用于响应扫描信号而导通，以将数据信号传输至所述第一节点；
第二开关单元，与所述第一节点连接，用于响应控制信号而导通，以将参考信号传输至所述第一节点；
第一初始化单元，与所述第一节点连接，用于响应复位信号而导通，以将初始化信号传输至所述第一节点；
驱动单元，与第二节点以及第三节点连接，用于响应所述第二节点的信号而导通，并在第一电源信号的作用下输出驱动电流至所述第三节点；
第二初始化单元，与所述第二节点连接，用于响应所述复位信号而导通，以将所述初始化信号传输至所述第二节点；
补偿单元，与所述第二节点以及所述第三节点连接，用于响应所述扫描信号而导通，以联通所述第二节点和所述第三节点；
隔离单元，与所述第三节点连接，用于响应所述控制信号而导通，以将所述驱动电流传输至所述电致发光元件；
储能单元，连接于所述第一节点和所述第二节点之间。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一开关单元包括第一晶体管，其中：
所述第一晶体管的第一端用于接收所述数据信号，第二端连接所述第一节点，控制端用于接收所述扫描信号。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第二开关单元包括第二晶体管，其中：
所述第二晶体管的第一端用于接收所述参考信号，第二端连接所述第一节点，控制端用于接收所述控制信号。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第一初始化单元包括第三晶体管，其中：
所述第三晶体管的第一端用于接收所述初始化信号，第二端连接所述第一节点，控制端用于接收所述复位信号。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述第二初始化单元包括第四晶体管，其中：
所述第四晶体管的第一端用于接收所述初始化信号，第二端连接所述第二节点，控制端用于接收所述复位信号。
6.根据权利要求1所述的像素驱动电路，其特征在于，所述驱动单元包括驱动晶体管，其中：
所述驱动晶体管的第一端用于接收所述第一电源信号，第二端连接所述第三节点，控制端连接所述第二节点。
7.根据权利要求1所述的像素驱动电路，其特征在于，所述补偿单元包括第五晶体管，其中：
所述第五晶体管的第一端连接所述第二节点，第二端连接所述第三节点，控制端用于接收所述扫描信号。
8.根据权利要求1所述的像素驱动电路，其特征在于，所述隔离单元包括第六晶体管，其中：
所述第六晶体管的第一端连接所述第三节点，第二端连接所述电致发光元件，控制端用于接收所述控制信号。
9.一种像素驱动电路，用于驱动电致发光元件，其特征在于，包括：
第一晶体管，第一端用于接收数据信号，第二端连接第一节点，控制端用于接收扫描信号；
第二晶体管，第一端用于接收参考信号，第二端连接所述第一节点，控制端用于接收控制信号；
第三晶体管，第一端用于接收初始化信号，第二端连接所述第一节点，控制端用于接收复位信号；
驱动晶体管，第一端用于接收第一电源信号，第二端连接第三节点，控制端连接第二节点；
第四晶体管，第一端用于接收所述初始化信号，第二端连接所述第二节点，控制端用于接收所述复位信号；
第五晶体管，第一端连接所述第二节点，第二端连接所述第三节点，控制端用于接收所述扫描信号；
第六晶体管，第一端连接所述第三节点，第二端连接所述电致发光元件，控制端用于接收所述控制信号；
存储电容，第一端连接所述第一节点，第二端连接所述第二节点。
10.一种像素驱动方法，用于驱动权利要求1所述的像素驱动电路，其特征在于，所述像素驱动方法包括：
在复位阶段，利用所述复位信号导通所述第一初始化单元以及第二初始化单元，以使所述初始化信号写入所述第一节点和所述第二节点；
在充电阶段，利用所述扫描信号导通所述第一开关单元以及补偿单元，以使所述数据信号以及所述驱动单元的阈值电压写入所述储能单元；
在发光阶段，利用所述控制信号导通所述第二开关单元以及隔离单元，以使所述驱动单元在所述第二节点的信号的作用下导通，并在所述第一电源信号的作用下通过所述隔离单元向所述电致发光元件输出驱动电流。
11.根据权利要求10所述的像素驱动方法，其特征在于，所述初始化信号的电压为0。
12.根据权利要求10所述的像素驱动方法，其特征在于，所述复位信号和所述扫描信号的导通时段之间具有一缓冲时段。
13.一种显示装置，其特征在于，包括权利要求1～9中任意一项所述的像素驱动电路。
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