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CN104575438B - 一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置 - Google Patents

一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置 Download PDF

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CN104575438B
CN104575438B CN201510082323.4A CN201510082323A CN104575438B CN 104575438 B CN104575438 B CN 104575438B CN 201510082323 A CN201510082323 A CN 201510082323A CN 104575438 B CN104575438 B CN 104575438B
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Abstract

本发明公开了一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置，涉及显示技术领域，为解决信号输出端输出的信号存在噪声及易失真的问题。所述移位寄存器单元包括：第一输入子模块将信号输入端输入的信号传输至第一节点；第二输入子模块根据信号输入端输入的信号将低电平信号输入端输入的信号传输至第二节点；输出控制模块根据第一节点的信号将时钟信号输入端输入的信号传输至第二节点；输出模块根据第二节点的信号将高电平信号输入端输入的信号传输至信号输出端。本发明提供的移位寄存器单元及其驱动方法、栅极驱动电路、显示装置，用于避免信号输出时存在噪声及失真的情况。

Description

一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置。
背景技术
薄膜晶体管液晶显示屏(Thin Film Transistor Liquid Crystal Display，简称TFT-LCD)的驱动电路由栅极驱动电路和数据驱动电路组成。一般地，首先栅极驱动电路打开一行，数据驱动电路对此行像素进行充电，然后栅极驱动电路关闭此行并打开下一行，数据驱动电路再对打开的这一行像素进行充电，依次对每行像素充电以实现整面TFT-LCD的显示。
目前，一种现有的移位寄存器，电路结构如图1所示，该移位寄存器工作的第一阶段t1：输入信号端INPUT输入的信号为高电平，M1开启，节点PU处于高电平，对电容C进行充电，并且M3开启，时钟信号输入端CLK输入的信号为低电平，信号输出端处于低电平；第二阶段t2：输入信号端INPUT输入的信号为低电平，M1关闭，电容C对节点PU放电，节点PU保持高电平，M3保持开启，时钟信号输入端CLK输入的信号为高电平，信号输出端处于高电平；第三阶段t3：复位信号输入端RESET输入的信号为高电平，M2开启，节点PU处于低电平，M3、M6和M8关闭，M5和M7保持开启，节点PD为高电平，M4和M9开启，信号输出端处于低电平。
然而，如图2所示，信号输入端INPUT输入高电平信号时，电容C一端的PU点升高，导致电容C的另一端耦合噪声，从而导致信号输出端OUTPUT输出的信号存在噪声；并且，信号输出端OUTPUT通过M3与时钟信号输入端CLK连接，由于时钟信号输入端CLK的驱动能力较差，导致当负载较大时，信号输出端OUTPUT容易失真。
发明内容
本发明的目的在于提供一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置，用于解决信号输出端输出的信号存在噪声及易失真的问题。
为了实现上述目的，本发明提供如下技术方案：
第一方面，本发明提供一种移位寄存器单元，：输入模块、输出控制模块和输出模块；
所述输入模块包括第一输入子模块和第二输入子模块；其中，所述第一输入子模块连接信号输入端和第一节点，用于将所述信号输入端输入的信号传输至所述第一节点；所述第二输入子模块连接所述信号输入端、低电平信号输入端和第二节点，用于根据所述信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第二节点；
所述输出控制模块连接所述第一节点、时钟信号输入端和所述第二节点，用于根据所述第一节点的信号将所述时钟信号输入端输入的信号传输至所述第二节点；
所述输出模块连接所述第二节点、高电平信号输入端和信号输出端，用于根据所述第二节点的信号将所述高电平信号输入端输入的信号传输至所述信号输出端。
结合第一方面，在第一方面的第一种实现方式中，还包括：复位控制模块、复位模块；
所述复位控制模块连接复位信号输入端、所述低电平信号输入端、所述第一节点、第三节点、所述高电平信号输入端和所述第二节点，用于根据所述复位信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第一节点，并且将所述高电平信号输入端输入的信号传输至所述第三节点，并且根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述第一节点和所述第二节点；
所述复位模块连接所述第三节点、所述低电平信号输入端和所述信号输出端，用于根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述信号输出端。
结合第一方面，在第一方面的第二种实现方式中，所述第一输入子模块包括：第一晶体管，其栅极和第一级连接所述信号输入端，第二级连接所述第一节点。
所述第二输入子模块包括：第二晶体管，其栅极连接所述信号输入端，第一级连接所述第二节点，第二级连接所述低电平信号输入端。
结合第一方面，在第一方面的第三种实现方式中，所述输出控制模块包括：第三晶体管和电容；
所述第三晶体管，其栅极连接所述第一节点，第一级连接所述时钟信号输入端，第二级连接所述第二节点；
所述电容，其一端连接所述第一节点，另一端连接所述第二节点。
结合第一方面，在第一方面的第四种实现方式中，所述输出模块包括：第四晶体管；
所述第四晶体管，其栅极连接所述第二节点，第一级连接所述高电平信号输入端，第二级连接所述信号输出端。
结合第一方面的第一种实现方式，在第一方面的第五种实现方式中，所述复位控制模块包括：第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管、第十晶体管和第十一晶体管；
所述第五晶体管，其栅极连接所述复位信号输入端，第一级连接所述第一节点，第二级连接所述低电平信号输入端；
所述第六晶体管，其栅极连接所述第一节点，第一级连接所述第八晶体管的第二级，第二级连接所述低电平信号输入端；
所述第七晶体管，其栅极连接所述第一节点，第一级连接所述第三节点，第二级连接所述低电平信号输入端；
所述第八晶体管，其栅极和第一级连接所述高电平信号输入端，第二级连接所述第六晶体管的第一级；
所述第九晶体管，其栅极连接所述第八晶体管的第二级，第一级连接所述高电平信号输入端，第二级连接所述第三节点；
所述第十晶体管，其栅极连接所述第三节点，第一级连接所述第一节点，第二级连接所述低电平信号输入端；
所述第十一晶体管，其栅极连接所述第三节点，第一级连接所述第二节点，第二级连接所述低电平信号输入端。
结合第一方面的第一种实现方式，在第一方面的第六种实现方式中，所述复位模块包括：第十二晶体管；
所述第十二晶体管，其栅极连接所述第三节点，第一级连接所述信号输出端，第二级连接所述低电平信号输入端。
第二方面，本发明提供一种栅极驱动电路，包括至少两级如第一方面所述的移位寄存器单元；
除第一级移位寄存器单元外，其余每个移位寄存器单元的信号输入端与其相邻的上一级移位寄存器单元的本级信号输出端相连接；
除最后一级移位寄存器单元外，其余每个移位寄存器单元的复位信号输入端与其相邻的下一级移位寄存器单元的本级信号输出端相连接。
第三方面，本发明提供一种显示装置，包括如第二方面所述的栅极驱动电路。
第四方面，本发明提供一种用于驱动如第一方面所述的移位寄存器单元的驱动方法，包括：
第一阶段
信号输入端输入的信号为高电平信号，所述高电平信号控制第一晶体管开启，所述高电平信号传输至第一节点，所述第一节点对电容充电，并且控制第三晶体管开启，时钟信号输入端输入的低电平信号传输至第二节点；
所述高电平信号同时控制第二晶体管开启，低电平信号输入端输入的信号传输至第二节点，所述第二节点对电容进行放电，以使得所述第二节点保持低电平；
第二阶段
信号输入端输入的信号为低电平信号，所述第一晶体管和所述第二晶体管关闭，所述电容放电，所述第一节点保持高电平，所述时钟信号输入端输入的高电平信号传输至第二节点，所述第二节点控制第四晶体管开启，高电平信号输入端输入的高电平信号传输至信号输出端；
第三阶段
复位信号输入端输入的信号为高电平信号，所述高电平信号控制第五晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述第一节点，第六晶体管和第七晶体管关闭；
高电平信号输入端输入的高电平信号控制第八晶体管和第九晶体管开启，所述高电平信号传输至第三节点；所述第三节点控制第十一晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述第二节点，所述第二节点对电容进行放电；所述第三节点同时控制第十二晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述信号输出端。
本发明提供的移位寄存器单元及其驱动方法、栅极驱动电路、显示装置，第二输入子模块根据信号输入端输入的信号将低电平信号输入端输入的信号传输至第二节点，由于电容一端的第一节点的电平升高导致电容另一端的第二节点耦合的噪声，通过与低电平信号输入端进行信号传输，实现对第二节点进行放噪，从而可以避免信号输出端输出的信号存在噪声；并且，输出模块根据第二节点的信号将高电平信号输入端输入的信号传输至信号输出端，由于高电平信号输入端的驱动能力较强，从而可以避免信号输出端失真的情况。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为现有技术中移位寄存器单元的电路示意图；
图2为图1的驱动过程的时序图；
图3为本发明实施例中移位寄存器单元的模块示意图；
图4为本发明实施例中另一种移位寄存器单元的模块示意图；
图5为本发明实施例中移位寄存器单元的电路示意图；
图6为本发明实施例中栅极驱动电路的模块示意图；
图7为图5的驱动过程的时序图。
附图标记：
1-输入模块，2-输出控制模块，
3-输出模块，11-第一输入子模块，
12-第二输入子模块，4-复位控制模块，
5-复位模块。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
实施例一
本发明实施例提供了一种移位寄存器单元，如图3所示，该移位寄存器单元包括：输入模块1、输出控制模块2和输出模块3。
输入模块1包括第一输入子模块11和第二输入子模块12。
其中，第一输入子模块11连接信号输入端INPUT和第一节点PU，用于将信号输入端INPUT输入的信号传输至第一节点PU。第二输入子模块12连接信号输入端INPUT、低电平信号输入端VGL和第二节点PO，用于根据信号输入端INPUT输入的信号将低电平信号输入端VGL输入的信号传输至第二节点PO。
输出控制模块2连接第一节点PU、时钟信号输入端CLK和第二节点PO，用于根据第一节点PU的信号将时钟信号输入端CLK输入的信号传输至第二节点PO。
输出模块3连接第二节点PO、高电平信号输入端VGH和信号输出端OUTPUT，用于根据第二节点PO的信号将高电平信号输入端VGH输入的信号传输至信号输出端OUTPUT。
可选地，如图4所示，该移位寄存器单元还包括：复位控制模块4、复位模块5。
复位控制模块4连接复位信号输入端RESET、低电平信号输入端VGL、第一节点PU、第三节点PD、高电平信号输入端VGH和第二节点PO，用于根据复位信号输入端RESET输入的信号将低电平信号输入端VGL输入的信号传输至第一节点PU，并且将高电平信号输入端VGH输入的信号传输至第三节点PD，并且根据第三节点PD的信号将低电平信号输入端VGL输入的信号传输至第一节点PU和第二节点PO。
复位模块5连接第三节点PD、低电平信号输入端VGL和信号输出端OUTPUT，用于根据第三节点PD的信号将低电平信号输入端VGL输入的信号传输至信号输出端OUTPUT。
为了便于本领域技术人员理解，如图5所示，本发明实施例提供了以上所述的各个模块的具体结构：
可选地，第一输入子模块11包括：第一晶体管M1，其栅极和第一级连接信号输入端INPUT，第二级连接第一节点PU。
第二输入子模块12包括：第二晶体管M2，其栅极连接信号输入端INPUT，第一级连接第二节点PO，第二级连接低电平信号输入端VGL。
可选地，输出控制模块2包括：第三晶体管M3和电容C。
第三晶体管M3，其栅极连接第一节点PU，第一级连接时钟信号输入端CLK，第二级连接第二节点PO。
电容C，其一端连接第一节点PU，另一端连接第二节点PO。
可选地，输出模块3包括：第四晶体管M4。
第四晶体管M4，其栅极连接第二节点PO，第一级连接高电平信号输入端VGH，第二级连接信号输出端OUTPUT。
可选地，复位控制模块4包括：第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9、第十晶体管M10和第十一晶体管M11。
第五晶体管M5，其栅极连接复位信号输入端RESET，第一级连接第一节点PU，第二级连接低电平信号输入端VGL。
第六晶体管M6，其栅极连接第一节点PU，第一级连接第八晶体管M8的第二级，第二级连接低电平信号输入端VGL。
第七晶体管M7，其栅极连接第一节点PU，第一级连接第三节点PD，第二级连接低电平信号输入端VGL。
第八晶体管M8，其栅极和第一级连接高电平信号输入端VGH，第二级连接第六晶体管M6的第一级。
第九晶体管M9，其栅极连接第八晶体管M8的第二级，第一级连接高电平信号输入端VGH，第二级连接第三节点PD。
第十晶体管M10，其栅极连接第三节点PD，第一级连接第一节点PU，第二级连接低电平信号输入端VGL。
第十一晶体管M11，其栅极连接第三节点PD，第一级连接第二节点PO，第二级连接低电平信号输入端VGL。
可选地，复位模块5包括：第十二晶体管M12。
第十二晶体管M12，其栅极连接第三节点PD，第一级连接信号输出端OUTPUT，第二级连接低电平信号输入端VGL。
需要说明的是，以上所述的第一至第十二薄膜晶体管均可以为PMOSFET，也可以为NMOSFET，本发明实施例对此不进行限定。示例性地，本发明实施例中选择第一至第十四薄膜晶体管均为PMOSFET。
本发明实施例提供的移位寄存器单元，第二输入子模块根据信号输入端输入的信号将低电平信号输入端输入的信号传输至第二节点，由于电容一端的第一节点的电平升高导致电容另一端的第二节点耦合的噪声，通过与低电平信号输入端进行信号传输，实现对第二节点进行放噪，从而可以避免信号输出端输出的信号存在噪声；并且，输出模块根据第二节点的信号将高电平信号输入端输入的信号传输至信号输出端，由于高电平信号输入端的驱动能力较强，从而可以避免信号输出端失真的情况。
此外，本发明实施例还提供了一种栅极驱动电路，如图6所示，该栅极驱动电路包括至少两级上述的移位寄存器单元。其中，除第一级移位寄存器单元外，其余每个移位寄存器单元的信号输入端INPUT与其相邻的上一级移位寄存器单元的本级信号输出端OUTPUT相连接；除最后一级移位寄存器单元外，其余每个移位寄存器单元的复位信号输入端RESET与其相邻的下一级移位寄存器单元的本级信号输出端OUTPUT相连接。
本发明实施例还提供了一种显示装置，该显示装置包括以上所述的栅极驱动电路。该显示装置可以为：液晶面板、平板电脑、电视机、显示器、笔记本电脑、电子纸、手机、数码相框、导航仪等任何具有显示功能的产品或部件。
本发明实施例提供的栅极驱动电路和显示装置可以实现上述提供的移位寄存器单元的功能，具体结构实现请参见上述实施例对移位寄存器单元的说明，在此不再赘述。
实施例二
本发明实施例提供了一种用于实施例一中所述的移位寄存器单元的驱动方法，如图5所示的移位寄存器单元的驱动方法分为3个阶段，驱动过程的时序图如图7所示。需要说明的是，以下仅以第一至第十二薄膜晶体管均为PMOSFET为例对三个阶段进行详细描述，此时，第一至第十二薄膜晶体管均为栅极上施加的信号为高电平信号时开启，低电平信号时关闭。
第一阶段t1：
信号输入端INPUT输入的信号为高电平信号，高电平信号控制第一晶体管M1开启，高电平信号传输至第一节点PU，第一节点PU对电容C充电，并且控制第三晶体管M3开启，时钟信号输入端CLK输入的低电平信号传输至第二节点PO。
高电平信号同时控制第二晶体管M2开启，低电平信号输入端VGL输入的信号传输至第二节点PO，第二节点PO对电容C进行放电，以使得第二节点PO保持低电平。
第二阶段
信号输入端INPUT输入的信号为低电平信号，第一晶体管M1和第二晶体管M2关闭，电容C放电，第一节点PU保持高电平，时钟信号输入端CLK输入的高电平信号传输至第二节点PO，第二节点PO控制第四晶体管M4开启，高电平信号输入端VGH输入的高电平信号传输至信号输出端OUTPUT。
第三阶段
复位信号输入端RESET输入的信号为高电平信号，高电平信号控制第五晶体管M5开启，低电平信号输入端VGL输入的低电平信号传输至第一节点PU，第六晶体管M6和第七晶体管M7关闭。
高电平信号输入端VGH输入的高电平信号控制第八晶体管M8和第九晶体管M9开启，高电平信号传输至第三节点PD。第三节点PD控制第十一晶体管M11开启，低电平信号输入端VGL输入的低电平信号传输至第二节点PO，第二节点PO对电容C进行放电。第三节点PD同时控制第十二晶体管M12开启，低电平信号输入端VGL输入的低电平信号传输至信号输出端OUTPUT。
本发明实施例提供的移位寄存器单元的驱动方法，第二输入子模块根据信号输入端输入的信号将低电平信号输入端输入的信号传输至第二节点，由于电容一端的第一节点的电平升高导致电容另一端的第二节点耦合的噪声，通过与低电平信号输入端进行信号传输，实现对第二节点进行放噪，从而可以避免信号输出端输出的信号存在噪声；并且，输出模块根据第二节点的信号将高电平信号输入端输入的信号传输至信号输出端，由于高电平信号输入端的驱动能力较强，从而可以避免信号输出端失真的情况。
通过以上的实施方式的描述，所属领域的技术人员可以清楚地了解到本发明可借助软件加必需的通用硬件的方式来实现，当然也可以通过硬件，但很多情况下前者是更佳的实施方式。基于这样的理解，本发明的技术方案本质上或者说对现有技术做出贡献的部分可以以软件产品的形式体现出来，该计算机软件产品存储在可读取的存储介质中，如计算机的软盘，硬盘或光盘等，包括若干指令用以使得一台计算机设备(可以是个人计算机，服务器，或者网络设备等)执行本发明各个实施例所述的方法。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种移位寄存器单元，包括：输入模块、输出控制模块和输出模块，其特征在于，
所述输入模块包括第一输入子模块和第二输入子模块；其中，所述第一输入子模块连接信号输入端和第一节点，用于将所述信号输入端输入的信号传输至所述第一节点；所述第二输入子模块连接所述信号输入端、低电平信号输入端和第二节点，用于根据所述信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第二节点；
所述输出控制模块连接所述第一节点、时钟信号输入端和所述第二节点，用于根据所述第一节点的信号将所述时钟信号输入端输入的信号传输至所述第二节点；
所述输出模块连接所述第二节点、高电平信号输入端和信号输出端，用于根据所述第二节点的信号将所述高电平信号输入端输入的信号传输至所述信号输出端。
2.根据权利要求1所述的移位寄存器单元，其特征在于，还包括：复位控制模块、复位模块；
所述复位控制模块连接复位信号输入端、所述低电平信号输入端、所述第一节点、第三节点、所述高电平信号输入端和所述第二节点，用于根据所述复位信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第一节点，并且将所述高电平信号输入端输入的信号传输至所述第三节点，并且根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述第一节点和所述第二节点；
所述复位模块连接所述第三节点、所述低电平信号输入端和所述信号输出端，用于根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述信号输出端。
3.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一输入子模块包括：第一晶体管，其栅极和第一级连接所述信号输入端，第二级连接所述第一节点；
所述第二输入子模块包括：第二晶体管，其栅极连接所述信号输入端，第一级连接所述第二节点，第二级连接所述低电平信号输入端。
4.根据权利要求1所述的移位寄存器单元，其特征在于，所述输出控制模块包括：第三晶体管和电容；
所述第三晶体管，其栅极连接所述第一节点，第一级连接所述时钟信号输入端，第二级连接所述第二节点；
所述电容，其一端连接所述第一节点，另一端连接所述第二节点。
5.根据权利要求1所述的移位寄存器单元，其特征在于，所述输出模块包括：第四晶体管；
所述第四晶体管，其栅极连接所述第二节点，第一级连接所述高电平信号输入端，第二级连接所述信号输出端。
6.根据权利要求2所述的移位寄存器单元，其特征在于，所述复位控制模块包括：第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管、第十晶体管和第十一晶体管；
所述第五晶体管，其栅极连接所述复位信号输入端，第一级连接所述第一节点，第二级连接所述低电平信号输入端；
所述第六晶体管，其栅极连接所述第一节点，第一级连接所述第八晶体管的第二级，第二级连接所述低电平信号输入端；
所述第七晶体管，其栅极连接所述第一节点，第一级连接所述第三节点，第二级连接所述低电平信号输入端；
所述第八晶体管，其栅极和第一级连接所述高电平信号输入端，第二级连接所述第六晶体管的第一级；
所述第九晶体管，其栅极连接所述第八晶体管的第二级，第一级连接所述高电平信号输入端，第二级连接所述第三节点；
所述第十晶体管，其栅极连接所述第三节点，第一级连接所述第一节点，第二级连接所述低电平信号输入端；
所述第十一晶体管，其栅极连接所述第三节点，第一级连接所述第二节点，第二级连接所述低电平信号输入端。
7.根据权利要求2所述的移位寄存器单元，其特征在于，所述复位模块包括：第十二晶体管；
所述第十二晶体管，其栅极连接所述第三节点，第一级连接所述信号输出端，第二级连接所述低电平信号输入端。
8.一种栅极驱动电路，其特征在于，包括至少两级如权利要求1-7任一项所述的移位寄存器单元；
除第一级移位寄存器单元外，其余每个移位寄存器单元的信号输入端与其相邻的上一级移位寄存器单元的本级信号输出端相连接；
除最后一级移位寄存器单元外，其余每个移位寄存器单元的复位信号输入端与其相邻的下一级移位寄存器单元的本级信号输出端相连接。
9.一种显示装置，其特征在于，包括如权利要求8所述的栅极驱动电路。
10.一种用于驱动如权利要求1-7任一项所述的移位寄存器单元的驱动方法，其特征在于，包括：
第一阶段
信号输入端输入的信号为高电平信号，所述高电平信号控制第一晶体管开启，所述高电平信号传输至第一节点，所述第一节点对电容充电，并且控制第三晶体管开启，时钟信号输入端输入的低电平信号传输至第二节点；
所述高电平信号同时控制第二晶体管开启，低电平信号输入端输入的信号传输至第二节点，所述第二节点对电容进行放电，以使得所述第二节点保持低电平；
第二阶段
信号输入端输入的信号为低电平信号，所述第一晶体管和所述第二晶体管关闭，所述电容放电，所述第一节点保持高电平，所述时钟信号输入端输入的高电平信号传输至第二节点，所述第二节点控制第四晶体管开启，高电平信号输入端输入的高电平信号传输至信号输出端；
第三阶段
复位信号输入端输入的信号为高电平信号，所述高电平信号控制第五晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述第一节点，第六晶体管和第七晶体管关闭；
高电平信号输入端输入的高电平信号控制第八晶体管和第九晶体管开启，所述高电平信号传输至第三节点；所述第三节点控制第十一晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述第二节点，所述第二节点对电容进行放电；所述第三节点同时控制第十二晶体管开启，所述低电平信号输入端输入的低电平信号传输至所述信号输出端。
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